"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 361-380 / 2,110건

기초전자회로실험1 5주차 결렙 드모르간정리와 편리한입출력

+ C’ 제한 조건을 만족하는 회로 구성 - 입력 3 개 , NOT GATE 3 개 이하 , AND GATE 2 개 이하 , OR GATE 2 개 이하 AB + A’B + C ... De Morgan 의 정리와 편리한 입출력 실험 목표 관련 이론 De Morgan 정리를 활용하여 논리식을 간략화하고 소자를 이용한 실험을 통해 이를 증명할 수 있다 . 스위치 ... 스위치 연결에서의 플로팅 상태 를 방지하기 위해 사용되는 저항 ※ 플로팅 (floating) : 회로에서 핀에 5V(1) 또는 0V(0) 의 입력 값이 없을 때 핀이 자신이 어떠

리포트 | 3페이지 | 1,000원 | 등록일 2020.10.07 | 수정일 2020.10.12

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[A+] 중앙대학교 전자회로 설계실습 시험 대비 자료 / 족보 , 01,02,03,04,05,06,07,08,09,10

실험 내용 정리 [1]Inverting, Non-inverting, summing Amplifier를 설계출력신호가 주파수 2 KHz의 정현파인 어떤 센서의 출력전압 ... 오실로스코프로 측정하였더니 peak to peak 전압이 100 mV이었다.(A) 센서의 Thevenin 등가회로를 구하는 과정을 기술하고 센서의 Thevenin 등가회로 ... 를 PSPICE로 그려서 제출한다.연립해서 저항 전압 구하기.(B) 센서의 Thevenin 등가회로를 Function generator와 저항으로 구현 하려할 때 Function

시험자료 | 20페이지 | 2,000원 | 등록일 2024.03.13 | 수정일 2024.03.20

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[논리회로실험] 실험3. 가산기&감산기 결과보고서

* 실험 1 : 반가산기1) 실험 과정- 주어진 회로를 설계한다.- 출력 결과를 확인하고 진리표를 작성한다.2) 실험 결과ABSC*************101Boolean ... 는 예비보고서의 예상 결과 값과 동일하게 나왔다.* 실험 2 : 전가산기1) 실험 과정- 주어진 회로를 설계한다.- 출력 결과를 확인하고 진리표를 작성한다.2) 실험 결과 ... 는 실험1과 마찬가지로 예비보고서의 결과 값과 동일하게 나왔다.* 실험 3 : 반감산기1) 실험 과정- 주어진 회로를 설계한다.- 출력 결과를 확인하고 진리표를 작성한다.2) 실험 결과

리포트 | 5페이지 | 1,000원 | 등록일 2023.03.28

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JK flip flops 실험보고서

실험 4 : JK flip-flops1. JK FF1.1. NOR gate(7402)로 RS latch를 그림 1과 같이 회로를 완성한다. 이 JK FF은 CLK ... 의 진리표 (1)2. single chip JK FF2.1. IC 7476에는 2 개의 JK FF이 들어 있다. 그림 3과 같이 JK FF 하나만을 써서 회로를 구성한다. 5번 pin ... FF의 진리표 (2)multisim_JK flip-flops_IC 7476 gate2.2. C와 S를 “1”로 하고 J와 K를 표 3과 같이 변화시켜 가며 CLK 수의 변화에 따른

리포트 | 5페이지 | 1,000원 | 등록일 2021.04.06

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논리회로실험 예비보고서4

회로와 같이 구성한다.④ 선택입력 값에 따라 멀티플렉싱 기능이 이루어지는지 확인하고 ②의 결과와 같은지 확인한다.·예상결과 : 실험1은 not 게이트와 nand 게이트를 이용 ... 하여 Enable 입력을 갖는 4x1 멀티플렉서 회로를 구성해보고 Dual 4-Input Multiplexer IC인 74HC153의 결과와 비교해보는 실험이다. 우선 회로식을 통해 ... 74HC139의 결과와 비교해보는 실험이다. 우선 회로식을 통해 분석해보면, 74HC11과 74HC04를 이용한 회로의 식은Y _{0}={bar{S _{1}}}{bar{S _{0

리포트 | 9페이지 | 1,500원 | 등록일 2020.09.18

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광운대학교 전기공학실험 실험7. 디코더와 인코더 결과레포트 [참고용]

를 응용 및 설계 하여 실용적 목적 회로 구성에 대한 연습을 진행한다.3. 실험 결과(1) 예비보고서 (1)항에 해당하는 회로를 7400 NAND gate IC만을 사용하여 구현 ... 됐으며, actvie LOW이므로 001이 정상 출력됨을 볼 수 있다. 오른쪽사진은 무관항 검증을 한 모습이며, 자세한 내용은 고찰에서 다루겠다.4. 고찰본 실험을 통해 디지털논리회로 ... 설계의 과정 중 NAND, NOR게이트로의 변환을 통해 공학적으로 더 나은 회로를 구성하도록하는 방법을 알 수 있다. 실험 순서1에서 기존의 AND, NOT게이트를 NAND 게이트

리포트 | 6페이지 | 1,500원 | 등록일 2024.01.02

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서강대학교 디지털논리회로실험 레포트 3주차

디지털 논리회로 실험 결과 보고서3주차 Decoders and Encoders5조1.실험제목: Decoders and Encoders2.실험목적:-일반적인 binary ... 94. 실험과정STEP 1,2) 그림 10과 같이 회로를 구성한 후 PSW0와 PSW1의 변화에 의한 LED0~LED3의 변화를 표 1에 기록한다.그림 SEQ 그림 ... =(PSW0+PSW1) = (PSW0’*PSW1)’회로에서 도출한 식과 표에서 도출한 식이 같다는 것을 보았을 때 실험이 성공적이었다는 것을 알 수 있다. 또한 모든 출력 값에서 하나

리포트 | 12페이지 | 1,000원 | 등록일 2020.08.12 | 수정일 2020.08.26

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서강대학교 21년도 디지털논리회로실험 8주차 결과레포트 (A+자료) - Shift Register, Multiplier, 4-digit 7-segment display

디지털논리회로실험 8주차 실험 보고서목적-Shift registers의 구조와 동작원리를 이해한다.-Multiplier 설계를 통해 shift register의 활용방법을 익힌다 ... .-4-digit 4-segment display의 구동원리를 이해하고 활용을 위한 회로를 설계한다.이론2-1. Shift registersshift register는 flip ... 으로 입low로, 한 후, 해당 digit의 A~DP 신호를 선택하여 입력시켜주면 된다. clock의 주기가 매우 짧다면 시각의 잔상효과에 의해 계속 켜진 것처럼 보이게 될 것이다.실험

리포트 | 33페이지 | 2,000원 | 등록일 2022.09.18

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전자회로실험_A+레포트_증가형 MOSFET의 바이어스 회로

전자 회로 실험 1. 증가형 N-채널 MOSFET의 바이어스 회로 동작을 예측한다.2. 전압분배 바이어스 회로에서 드레인 저항 RD가 동작점에 미치는 영향을 확인한다.3. 자기 ... , 브레드보드, 저항, 트랜지스터(N-채널 MOSFET 2N7000)실험방법I. N-채널 MOSFET 전압분배 바이어스 회로의 동작점 전류, 전압 측정하기① N-채널 MOSFET ... 서 동작점, 전류, 전압을 측정한다.C. 실험결과1) N-채널 MOSFET 전압분배 바이어스 회로의 동작점 전류, 전압 측정하기RD [kΩ]VGSQIDQVDSQ0.511.585 V1

리포트 | 6페이지 | 2,000원 | 등록일 2024.04.04

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아주대학교 논리회로실험 예비보고서2

this code of ethics.[실험1-Basic Gates]1. 실험 목적CMOS 회로의 전기적인 특성(logic levels & DC noise margins, dc 특성 ... gate)pin maptruth table logic symbol4. 실험절차 및 예상결과-실험1) Inverter의 입출력 특성 확인① 위의 그림과 같은 회로를 구성한 후 VCC ... , ac 특성)을 실험을 통해 알아본다.2. 실험에 대한 이론·logic levels & DC noise margins논리회로는 전기 신호를 처리하여 입력값을 얻는다. 전형적인

리포트 | 10페이지 | 1,500원 | 등록일 2020.09.18

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아날로그 및 디지털회로설계실습 2주차 Switching Mode Power Supply(SMPS)예비 리포트

을 설계해보는 실험을 했다. 이론부에 따라 적혀 있는 식으로 계산해 소자들의 값을 구해 Buck converter 회로, Boost converter 회로를 구성했다.서론: SMPS ... 하는 실험을 했다.실험결과PWM칩(UC3845)을 이용하여 아래 성능의 PWM 제어 회로를 설계하시오.- 출력전압: 0 V ~ 10 V (peak to peak)- 스위칭 주파수 f ... PWM제어회로에 대해 알아볼 수 있었으며 PWM제어 회로를 통해 SMPS을 설계해보는 실험을 했다.이론부에 따라 적혀 있는 식을 계산해 소자들의 값을 구해 Buck c

리포트 | 4페이지 | 1,000원 | 등록일 2021.09.02

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[논리회로실험] Latch & Flip-Flop - 결과보고서

) 실험 4 : J-K Latch with Enable ( Gate 이용 ) (생략)- 74HC10 1개와 74HC00 1개를 이용하여 J-K Latch 회로를 구현한다. ... 한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험교수명:학 번:성 명:실험 6. Latch & Flip ... -Flop1. 실험 과정 및 결과1) 실험 1 : R-S Latch with Enable (생략)- 74HC00 1개로 R-S Latch 회로를 구현한다.- Enable(C)에 1

리포트 | 6페이지 | 1,000원 | 등록일 2021.05.04

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전자회로설계실습 8번 예비보고서

전자회로설계실습(예비보고서 - 8)소 속담당 교수수업 시간편 성학 번성 명설계실습 8. MOSFET Current Mirror 설계1. 목적N-Type MOSFET을 이용 ... 숫자 세 자리까지만 사용한다.그림 1의 회로와 같이 Current Source에서 , 로는 2N7000(Fairchild)을 이용하며 =10V인 경우, =10mA인 전류원을 설계 ... 한다.(A) 2N7000의 Data sheet로부터 을 구한다. 사용한 수식 및 수치를 자세히 적어서 제출한다. (Gate Threshold Voltage와 On-Stage

리포트 | 6페이지 | 1,000원 | 등록일 2024.08.16

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A+ 중앙대 아날로그및디지털회로설계실습(결과)2. Swithcing Mode Power Supply(SMPS)

실험은 가변저항 r값을 변동시켜 톱니파의 모양을 바꿔가며 듀티 레이시오를 변화시켜 측정하고 그 때의 출력전압을 측정하는 실험으로 변경하였다.buck converter 회로를 구성 ... 고 있다.2. 실험 결과2-4. 설계실습 방법2-4-1 PWM 제어회로① PWM 제어회로를 구성한다.② 톱니 파형과 출력 파형을 확인한다.7번 포트에 10v인가하였고, Vref에는 5 ... 아날실습2 결과요약 :SMPS (Switching Mode Power Supply)의 동작 원리와 회로 모듈을 이해하여 SMPS를 설계하였다.pwm 제어회로를 구성하였을 때 4번

리포트 | 6페이지 | 1,000원 | 등록일 2022.09.10

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[A+결과레포트 전자회로설계실습]10. CMOS Inverter, Tri-state 설계

Inverter의 구현 및 동작3.2 Tri-state의 구현 및 동작4. 결론5. 참고문헌1. 요약이번 실험에서는 집적회로에 많이 사용되는 CMOS Inverter의 구현 및 동작 ... 을 알아보는 실험을 하였다. 그 결과, 가 증가하면 의 크기가 증가하고 의 크기가 증가한다는 것을 수치 상으로 얻을 수 있었다. 그 다음, CMOS inverter 회로를 구성 ... 를 성공적으로 설계하고 구현하였고 그 결과, 특징을 잘 알 수 있었던 성공적인 실험이었다.2. 서론CMOS는 PMOS와 NMOS의 대칭 쌍을 이용한 집적회로를 구성하는 기술이다. 그리고

리포트 | 12페이지 | 2,000원 | 등록일 2020.11.26

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중앙대 전자전기공학부 전자회로설계실습 예비보고서(실험4)

전자회로 설계 실습예비보고서설계실습 4. MOSFET 소자 특성 측정실험일시 :작성자 :담당교수 :이름학번분반실험날짜설계실습 4. MOSFET 소자 특성 측정실험 목적MOS ... 보다 훨씬 낮은 경우, 즉 Drain과 Source가 거의 short된 경우에는 iD-vDS특성이 거의 직선이 되며 다음 식으로 근사할 수 있다.3.2 MOSFET 회로도 구성 및 ... 시뮬레이션 (OrCAD PSPICE)(A) OrCAD를 이용하여 그림 1의 회로도를 설계하여라. (2N7000/FAI 이용, VG와 MOSFET 게이트 연결 시 점퍼 와이어 대신 1K

리포트 | 7페이지 | 1,500원 | 등록일 2021.08.18

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시립대 전전설2 Velilog 결과리포트 6주차

로) 를 설계해보는 실험이다. 순차 조합 회로 중에서도 LATCH, D FlipFlop, J-K FlipFlop, S-R FlipFlop 등의 지식을 이용해서 데이터 전송회로, 직렬입력 ... Gate를 이용한 LATCH회로 구성에서 NOR게이트를 사용했다는 차이만 있을 뿐 나오는 값은 NAND게이트를 이용한 LATCH와 동일하다.? 회로 구성? 진리표 ... Logic Design (순차 조합회로) 를 설계해보는 실험이다. 순차 조합 회로 중에서도 LATCH, D FlipFlop, J-K FlipFlop, S-R FlipFlop 등

리포트 | 14페이지 | 2,000원 | 등록일 2021.12.11

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아주대 논리회로실험 실험10 DAC & ADC converter 예비보고서

를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2020.11.15과목명: 논리회로실험교수명:분 반:학 번:성 명:실험10 예비보고서- DAC & ADC converter -1 ... . 실험 목적- DAC와 ADC 변환기 회로를 구성하고 동작원리를 이해한다.2. 실험 소자1) 74HC○○칩- 74HC시리즈의 74는 TTL IC를 의미하고, HC는 High ... 은 전압이 인가되고, 단자가 활성화 되었을 때 MSB부 터 하위비트의 전류는 앞의 전류의 1/2배가 되는 특성을 가진다.4. 회로 결선도- 실험1(DAC), 실험2(ADC)5

리포트 | 6페이지 | 1,000원 | 등록일 2021.05.07 | 수정일 2021.07.23

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실습 6. 위상 제어 루프(PLL) 예비보고서

신호(기준전압) Vref 와 출력의 피드백 신호의 주파수를 비교하여 그 위상 차이를 검출 - 실험에서는 XOR gate이 역할위상 차이로 겹치지 않은 전압만 출력한다 즉 간략 ... 실습 6. 위상 제어 루프(PLL)6-1. 실습목적위상 제어 루프 회로의 이론을 학습하고 간단한 위상 제어 루프 회로를 구성하여 주파수 동기화 (Phase Locking) 원리 ... Op amp UA741 : 3개Inverter 74HC04 : 1개XOR gate 74HC86 : 1개BJT 2N3904 : 1개사용장비오실로스코프(Oscilloscope) : 1대

리포트 | 14페이지 | 2,000원 | 등록일 2022.09.19

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광운대학교 전기공학실험 실험6. 논리조합회로의 설계 결과레포트 [참고용]

동작을 이해함으로써 논리회로 조작능력을 함양한다.3. 실험결과(1) 예비보고서 1항의 회로를 결선하고 원래의 진리표와 일치하는지 확인하라.ABCX이론값측정값오차00 ... 검증 실험 시 이론값과 일치한다.(4) 예비보고서 4항의 회로를 결선하고 그 결과가 설계요구조건에 부합하는지 확인하라.설계한 논리 다이어그램만능기판구성 (아무도 안 누를 때)한 명 ... 입력에 대한 역할을 부여하였으며 제대로 동작한다. 무작위로 2개 이상의 버튼을 누르면 LED가 점등된다. 이 2가지 결과를 통해 해당회로가 올바르게 설계되었음을 실험적으로 검증

리포트 | 9페이지 | 1,500원 | 등록일 2024.01.02

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