"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,721-1,740 / 2,110건

디지털회로 [ 반가산기, 전가산기, 반감산기, 전감산기 _ 사전 ]

3. 반가산기, 전가산기,반감산기, 전감산기제출일실험조이름-사전 보고서-? 실험목적연산 회로의 기본인 가산기, 감산기의 구조를 이해하고, 기본 게이트들을 사용해 가산기와 감산기 ... 기의 회로도를 기본 TTL 소자를 이용해 BreadBoard에 구성한 뒤 그 동작을 확인하고 값을 측정하여 적는다.? 실험 Simulation1. 반감산기 동작 확인?시뮬레이션 ... 출력은 입력 신호 A와 B에 대한 출력 상태 S와 C를 관찰하는 것으로 Exclusive OR의 합 회로와 AND gate의 자리올림 회로의 결과를 확인 할 수 있다. 1개

리포트 | 6페이지 | 1,000원 | 등록일 2008.04.08

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NAND게이트

제목논리 게이트 회로의 응용목적MAX+PLUS II 와 실습키트의 기본 사용법을 익힌다.Logic gate 회로와 회로의 응용 법을 안다.관련학습★ NAND 게이트-2 개 이상 ... 및 이론 공부를 많이 해야겠습니다.결론 및 고찰이번 실험은 게이트 회로를 응용 하는 것이며 NAND 게이트 의 사용 그리고 게이트의 변환 ,상태 버퍼에 대해서입니다.NAND ... -AND 의 의미로 NAND 게이트로 부른다.1. NAND 게이트의 진리표ABY*************. NAND 논리 기호3. NAND 게이트의 대표적인 회로-IC : 74004

리포트 | 8페이지 | 1,000원 | 등록일 2009.12.15

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개방 컬렉터 출력의 풀업저항 결정

Collector 와 일반 TTL 회로 비교 -Open collector 형에서 출력 을 결선하는 것만으로 AND gate 와 동일한 특성을 수행SIMULATION - Rp 값의 범위 ... 개방 컬렉터 출력의 풀업저항 결정목 차 실험목적 이론 실험순서 실험결과 1 2 3 4실험 목적 TTL 개방 컬렉터 (Open-Collector) 출력형태의 용도에 대해 고찰 ... 한다 . 풀업 저항치를 결정하는 방법을 배운다 . 수동 풀업의 한계를 고찰한다 .Open Collector 논리게이트와 일반적인 회로 차이 - R 3 가 포함된 회로 일반 TTL 회로

리포트 | 12페이지 | 2,000원 | 등록일 2008.10.25

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트랜지스터 증폭기 실험에 관한 레포트

1. 실험제목Transistor의 응용 회로 실험22. 실험목적MOSFET Transistor의 기본적인 특성을 이용하여 증폭기 회로에 대하여 실험하고 증폭의 원리를 이해 ... 회로 분석 및 시뮬레이션1-1) 위의 회로에서 v_sig를 인가하지 않은 경우에 대해서 Vout이 4~5V 가량이 되도록 R_D값을 결정하시오. 실험을 통해 Vout 값을 측정하시오 ... 한다. BJT의 다단 Amp를 구성하고 그 특성을 이해하여 본다.3. 실험내용1) Transistor의 Biasing 방식에 대한 증폭4. 실험준비물1) MOSFET 트랜지스터5. 실험

리포트 | 22페이지 | 3,000원 | 등록일 2010.06.11

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fet 특성 및 증폭기 예비보고서 피스파이스 넷리스트 시뮬레이션 파형 결과 포함

전자 회로 실험( 실험2. 예비 보고서 )실험 2. FET특성 및 증폭기1. 관련 이론FET는 전자 전류와 정공 전류를 이용하는 바이폴라 트랜지스터와는 달리 하나의 전하 반송자만 ... 가 계속 증가하더라도 드레인 전류는 거의 일정하다. 이 드레인 전류값을 Idss라 표기하며 JFET규격표에 항상 명시한다. Idss는 외부 회로와 관계없고, Vgs=0V에서 JFET ... aturation region)에서 동작된다.그림 2 FET 등가회로FET증폭기는 보통의 트랜지스터와 마찬가지로 소스공통(common source), 게이트공통(common gate

리포트 | 13페이지 | 1,500원 | 등록일 2008.09.24

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[LCD실험]분해한 panel을 다양한 장비를 사용하여 특성 실험

분해한 panel을 다양한 장비를 사용하여 특성 실험(α-step, UV-vis spectrometer, 4-point probe)1. 실험목표: 분해한 Panel ... 의 Transmittance 측정을 통해 각 필름의 역할을 알고 단차 측정을 통해 TFT 증착 과정 예상, metal line의 면 저항을 측정2. 실험장비(LGD, AUO, SMD)TFT ... Labpro S/W)4-point probe3. 실험방법A. Sheet Resistance 측정1) 4-Point probe를 Setting하고, SMD에서는 TFT backplane

리포트 | 9페이지 | 6,000원 | 등록일 2012.07.11

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실험13 JFET와 증폭기

이 없어지고 드레인 전류는 차단된다. 두 세번째 실험을 통해서 JFET의 바이어스는 첫번쨰로 자기 바이어스는 아래 회로를 통해서 N채널 JFET의 자기 바이어스 구조를 구현 ... 적으로 경향성을 확인할 수 있었다. JFET의 특성에 대해서 다시금 확인할 수 있었다.6. 참고문헌전자회로 실험, 이승훈실험 13. JFET와 증폭기실험 14. MOSFET 특성 실험화요일 실험 1주차1조20060977유민우 ... 20060977 유민우실험13. JFET와 증폭기도입JFET와 증폭기의 특성을 살펴본다.*실험 목적(1) JFET의 드레인 전류 ID 에 대한 드레인-소스 전압 VDS, 게이트

리포트 | 7페이지 | 1,000원 | 등록일 2009.10.31

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FET를 이용한 2단 증폭기 설계

FET를 이용한 2단 증폭기 설계1. 실험 목표- FET의 특성을 이용 2단 증폭기를 설계 하고 전압이득과 컷 오프 를 알아보자.2. 관련이론◎ J-FET1.1 개념및 특징J ... (Junction)FET는 Gate-Channel 간의 PN접합으로 이루어져 있는데 보통 Transistor가 다수 캐리어와 반대극성의 소수 캐리어를 갖고 있으므로 바이폴러라 하는데 ... 이 존재한다. FET의 드라이브에서는 입력용량 Ciss와 드라이브 회로의 임피던스와의 균형이 중요하다. 이 입력용량을 충전하기 위해 게이트-소스간에는게이트 전류가 D 순간적으로 흐른다

리포트 | 9페이지 | 5,000원 | 등록일 2010.05.06

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[공학기술]디지털 논리회로 1,2,3장 예비보고서

Gate 회로를 구성하고 입력 A의 변화에 따른 출력 Y의 상태를 [표 1-7]에 기록하라.제2장UNIVERSAL 게이트 (NAND, NOR)1. 실험 목적논리 회로에서 가장 많이 사용 ... )? 7411 (3조 3입력 AND Gate)? 7404 (6조 Inverter)2. 실험 과정, 회로도 및 타이밍 다이어그램(1) NAND Gate① 2입력 NAND Gate7408 ... 와 1개의 출력단자를 가지며 적어도 1개의 입력단자에 입력 1이 가해졌을 때만 출력단자에 1이 나타나도록 구성된 회로이다.-NOT GateNOT Gate는 1개 입력과 1개의 출력

리포트 | 36페이지 | 1,000원 | 등록일 2007.05.08

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디지털 집적 회로 AND 예비레포트

디지털 집적 회로 AND, OR 게이트1. 실험목적1) AND, OR게이트의 특징과 기호를 이해한다.2) 구성된 AND 게이트와 OR 게이트를 실험을 통해 진리표를 작성한다.3 ... ) 혼합된 AND/OR 게이트의 실험을 통한 진리표 작성2. 기초 이론1) 논리회로전자계산기의 연산장치 등의 중요한 부분에 사용된다. 가장 기본적인 논리소자는 논리곱(AND) ·논리 ... 이 필요하다.예) 기본적 논리회로(디지털 논리회로 시간때 배웠었던 내용이다.)2) 게이트게이트(gate)란, 한 개 이상의 입력 신호를 받아 한 개의 출력 신호를 내는 전자회로이

리포트 | 4페이지 | 4,000원 | 등록일 2009.03.11

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논리회로실험 counter resister

) 가 입력되어야 하고, C의 NAND gate에는 1,2,3,4에 해당하는 신호들의 보수들의 입력이 필요하다. 그래서 실험의 회로가 구성되었으며, 회로로부터 역으로 생각해보면 위의 표 ... gate를 거치게 해, 최종적으로 AND gate의 결과물을 얻도록 하였다.)실험 2. 3진 카운터※ 결과 분석각 J-K 플립플롭에서 J값에 변화를 주는 파형을 입력해 일정주기 ... 실험 1. 2단 2진 카운터※ 결과 분석(J=K=1일때, CL=0이면 Q는 그대로 CL=1이면 Q는 반전)J-K플립플롭의 동작에 의해 A와 A', B와 B'의 파형을 출력할 수

리포트 | 3페이지 | 1,500원 | 등록일 2008.01.17

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제 5장 Battery Tester and Charging 회로 실험 [예비 보고서]

제 5장 Battery Tester and Charging 회로 실험[실험예비]▶▶ Economical Battery Tester 회로① Economical Battery ... 시간이 소요된다.② Economical Battery Tester 사용부품을 조사하고, 제시된 내용을 참고하여 회로 시스템을 분석하라.1) Capacitor의 용량에 따른 회로시스템 ... 의 변화에 에 맞춘 변화작용을 충분히 할 수 있기 때문에 어느 정도 회로의 영향을 미친다고 할 수 있겠다.2) Transistor의 특성을 적용하여 회로시스템의 동작을 설명하라

리포트 | 4페이지 | 1,000원 | 등록일 2008.03.28

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아주대_논리회로실험_예비5_래치와 플립플롭

라고 말하기도 한다.3. 예비보고서(1) NAND gate를 이용하여 클럭화되지 않은 R-S F/F의 조합 회로를 구성하고 그 동작을 설명하시오. ◆Truth tableSRQ00Q ... 실험 5. 래치와 플립플롭(Latch & Flip-Flop)1. 목적여러 종류의 flip-flop을 구성하여 그 동작 특성을 알아본다.2. 이론◆ Flip-Flop플립플롭은 그림 ... 7-6에 나타낸 것과 같이 제어신호와 클럭 신호를 입력으로 갖는 기억소자로, 다양한 종류(SR, JK, D, T 플립플롭 등)가 있다. 각 플립플롭에 대한 회로 및 동작 특성

리포트 | 6페이지 | 1,000원 | 등록일 2010.04.04

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오실로스코프(1)

다.▶ 오실로 스코프 실험방법 및 결과< DC 전압측정 >① 그림과 같이 회로를 구성한다.② 결합(coupling)스위치를 GND로 한 후 수직위치 조절기 (Y)를 스크린 중앙의 수평 ... -p이므로 옴의 법칙으로 구한 결과와 실제로 측정한 결과가 다릅니다. 이는 측정할 때 실수가 있었거나 회로 구성할 때 미세한 실수가 있는 것 같습니다.▶ 실험 고찰◎오실로스코프 실험 ... ▶ 실험 목적① 오실로스코프(Oscilloscope)의 동작원리에 대하여 이해한다.② 오실로스코프의 사용법을 익힌다.③ 함수발생기(Function Generator)의 사용법

리포트 | 9페이지 | 1,000원 | 등록일 2011.03.05

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다중화기

도Select 0 or 1123*************81174LS04 NOT Gate3. 실험 순서1) ① 예비 보고를 바탕으로 74153 칩 하나로 반가산기를 구성한다.② 출력 ... 한다.② 앞 1번 실험을 반복한다.3) ① 앞 1과 2의 실험 회로를 연결하여 2 bit 덧셈기를 구성한다.② 이것이 제대로 동작하는지를 LED를 사용하여 조교에게 확인 받는다.3 ... 실험을 반복하라.◆ 전가산기를 구현하는 pin 연결도S CoutSelect 0 or 1123567414131210981174LS04 NOT Gate전 가산기의 진리표ABCSCout

리포트 | 9페이지 | 1,000원 | 등록일 2008.09.26

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Ch5. Exclusive OR 게이트와 응용

게이트 구현 (c) NOR 게이트 구현3. 사용기기 및 부품? 디지털 실험장치? 직류전원 공급장치? 회로시험기? 오실로스코프? TTL 7400 (quad 2-input NAND ... 전류는 30mA이다.4. 실험과정 및 결과예측(1) 그림5-3과 같은 회로를 결선하고 입력 A.B에 따른 출력 X를 측정하라.그림5-3 XOR 게이트 회로표(2) 그림5-4와 같 ... PageCh5. Exclusive OR 게이트와 응용사 전 보 고 서제출일학과조학번조원이름이름1. 실험목적(1) XOR 게이트의 동작 특성을 이해한다.(2) XOR 게이트의 구성

리포트 | 5페이지 | 2,000원 | 등록일 2008.01.08

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연세대 전기전자 기초실험 7. 기본 논리 게이트 설계 실험 (예비보고서)

실험 예비 보고서실험 제목 : 7. 기본 논리 게이트 설계 실험학과학년학번분반실험조성명1. 목적논리 회로를 구성하는 기본 논리 게이트의 동작을 이해하고, 논리 회로를 간소 ... 와 Collector에 신호가 들어가야 Emitter로 출력이 나오므로 이는 AND의 원리와 같고 트랜지스터로 구현한 대략적인 회로와 NMOS로 구현한 그림은 다음과 같다.2) OR Gate두 ... 개의 입력단자에서 결합되는 네 가지 조합에 대하여 논리합과 동일한 결과를 출력하는 회로이다. 그림은 다음과 같다.3) NOT Gate입력되는 것과 반대의 결과가 출력되는 것

리포트 | 6페이지 | 1,000원 | 등록일 2007.12.30

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(실험 보고서)JFET 공통 소스 증폭기 실험 및 시뮬레이션

JFET 공통 소스 증폭기1. 목적JFET 공통 소스 증폭기를 구성하여 증폭기의 특성 및 동작 원리를 실험을 통하여 이해한다.2. 이론JFET Common Source ... . 그러므로 JFET은 입력신호원의 출력 임피단스가 높은 경우에 높은 전류이득을 얻기 위한 회로에 이용된다.?공통 소스 증폭기는 FET 동작의 선형영역 내의 입력을 바이어스? 저항 RG ... : 아래 그림은 N채널 FET구조를 나타낸 그림으로서. Source, Drain, Gate로 구성된다.여기서 Vds 는 drain-source 간의 걸어준 전압, Vgs는 gate-s

리포트 | 4페이지 | 1,500원 | 등록일 2008.12.11

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연세대 전기전자 기초실험 5. Battery tester and chargning (예비보고서)

실험 예비 보고서실험 제목 : 5. Battery Tester and Charging 회로 실험학과학년학번분반실험조성명1. 목적본 교재로 학습한 전기회로의 기본적 이론과 실험적인 ... tester 회로건전지의 전압이 전자장비 동작을 위한 충분한 전압을 만족시키는지 알아보는 실험이다. 먼저 V1 단자에 Voltage Source가 될 테스트해 볼 배터리를 연결 ... 회로가 동작하는데 걸리는 소요시간은 증가하고 큰 Capacitor의 용량을 채워야 하기 때문에 배터리의 소모 전력이 많을 것이다. 따라서 실험에 따른 적절한 Capacitance

리포트 | 6페이지 | 1,000원 | 등록일 2007.12.30

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(실험보고서) MOSFET 전압 전류 특성 실험 및 시뮬레이션

: MOSFET)의 드레인 전류에 대한 드레인-소스전압의 효과와 게이트-소스 효과, 드레인 전류와 게이트 소스 전압 사이의 관계를 알아본다. 시뮬레이션과 실험을 통하여 MOSFET와 JFET ... 의 source와 drain은 실리콘 표면에 생성되며 gate의 양쪽에 배치 되게 된다. 반도체 영역은 대부분 트랜지스터 역할을 하기 위해 표면이 단결정 실리콘으로 도핑 되어 있 ... 다.산화막은 실리콘 산화막 형태로 구성 되는데 금속막과 절연을 하는 기능을 한다. 금속막은 MOS 트랜지스터에 전압을 인가하기 위한 지점으로 사용된다.MOS 트랜지스터는 gate,s

리포트 | 5페이지 | 1,500원 | 등록일 2008.12.11

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