"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,801-1,820 / 2,110건

플립플롭 예비

1.실험 제목-플립 플롭2.실험 목적순서논리회로의 기반이 되는 플립플롭의 동작원리를 살펴보고 전반적인 이해를 도모한다.3.이론플립플롭은 1개의 bit 정보를 기억할 수 있는 기억 ... (flip-flop)은 정보의 저장 또는 기억회로, 계수 회로 및 데이터 전송회로 등에 많이 사용된다. 물론 이 Flip-Flop은 기본적인 논리 Gate를 조합함으로써 만들어진다.플립 ... device에서 신호가 올라가는데 걸리는 시간을 설정시간이라 한다.5.실험 절차(1)디지털 실험기판 위에 7400 NAND 게이트를 이용하여 RS플립플롭 회로 (a)를 구성하고 데이터 스위치로 S, R의 논리상태를 표1 과 같이 변화시키면서 오실로스코프로 Q와

리포트 | 8페이지 | 1,000원 | 등록일 2009.04.08

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연세대 전기전자 기초실험 9. 연산 회로 설계 실험 (결과보고서)

실험 결과 보고서실험 제목 : 9. 연산 회로 설계 실험학과학년학번분반실험조성명표 9-4. 4비트 덧셈기/뺄셈기의 진리표입 력출 력Add/SubtractS3S2S1S0오버플로우 ... 째 구성한 그림은 다음과 같다.4-bit CLA 4개에 Carry Lookahead logic을 첨가한 것이다. 위의 회로보다 빠르지만 총 310 gates 가 소요된다. 첫 번째 그림 ... ※ 실험에 사용된 segment 코드module four_bit_ALU(alu_out, data_a, data_b, scode, mcode);input [3:0] scode

리포트 | 9페이지 | 1,000원 | 등록일 2007.12.30

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디지털논리회로실습 - 제 7장 디코더 인코더

디지털회로실험예비 보고서(제 7장 디코더와 인코더)학과학번성명1조컴퓨터공학과20040244김선습안현태안정민김성훈제 7장 디코더(Decoder)와 인코더(Encoder)1. 실험 ... , 회로도 및 타이밍 다이어그램그리고 예비실험 및 조사2.1 디코더(Decoder) ( n X 2ⁿ)디코더는 2진 코드(n Bit) 형태의 입력을 받아들여 우리가 일상적으로 사용 ... 하는 10진수등의 형태로 변환하여 출력해주는 장치※ 인코더 - 우리가 일상적으로 사용하는 10진수 등을 입력으로 받아들여 2진 코드의 형태로 변환하여 출력해주는 장치2. 실험 과정

리포트 | 23페이지 | 2,000원 | 등록일 2008.12.08

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VHDL BCD to Excess-3 Code Converter(prelab) xilinx spartan3e board실험

이들간의 연결이 상당히 복잡하다. 이는 회로를 Computer가 생성하다 보니 어쩔 수 없이 생기는 문제이다. 이 회로는 나중에 Layout 과정에서 Routing(배선-Gate ... 전자전기컴퓨터설계실험IIIPRELAB REPORT[BCD to Excess-3 Code Converter]학 과담당교수조학 번이 름제 출 일목 차 HYPERLINK \l "실험 ... HYPERLINK \l "실험방법" 2. 실 험 방 법 (Materials & Methods) HYPERLINK \l "실험도구" 1) Materials HYPERLINK \l

리포트 | 28페이지 | 2,000원 | 등록일 2008.09.28

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Exclusive OR 게이트와 그 응용

supply)- 회로실험기(Tester) - 오실로스코프(가급적 2 현상)- TTL 7400(quad 2-input NAND Gate) - TTL 7402(quad 2-input ... ) - TTL 7486(quad 2-input XOR Gate)4. 실험과정 및 결과 예측- 그림 5-3과 같은 회로를 결선하고 입력 A, B에 따른 출력 X를 측정하여 아래의 표 ... 사전보고서제출일학과전자공학과조학번조원이름성명Ch. 5 Exclusive OR 게이트와 그 응용- -1. 실험목적- XOR 게이트의 동작 특성을 이해한다.- XOR 게이트의 구성

리포트 | 5페이지 | 1,000원 | 등록일 2007.01.11

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시뮬레이션을 이용한 도메인에 따른 LCD의 시야각 특성 분석

등가회로를 나타내면 다음 그림과 같다.Gate 배선은 순차적으로 시분할 방식으로 선택되어지며 선택된 gate 신호배선에서는 gate 구동 driver IC로부터 약 20V의 TFT ... LCD의 구동원리를 알아보고, LCD가 바라보는 각도에 따른 시야각의 특성이 어떠한 이유 때문에 발생하는지를 알아보기 위해 시뮬레이션 실험을 통하여 결과를 도출해보았다. 우리는 이 ... 실험에서 각 픽셀의 도메인을 나누어 도메인 수의 변화에 따른 시야각의 변화와 픽셀모양에 따른 시야각의 변화와 특성을 관찰하여 어떠한 도메인과 픽셀이 가장 시야각이 좋고 나쁜지

리포트 | 20페이지 | 2,500원 | 등록일 2008.12.08

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Boolean Algebra/Fundamental Operations & Boolean Algebra/Theorems

gate, OR gate로 이루어진 다소 복잡한 logic circuit를 설계하여 보고, 같은 결과를 나타내는 두 회로를 비교하는 실험도 하였다.또한, 디지털시스템설계 실험의 첫 ... 를 AND/OR gate를 통해 확인할 수 있었다. 또한 이들과 De Morgan's law 등을 바탕으로 몇 가지 theorems를 정립할 수 있었다.실험 과정에 관해 조금 언급 ... problem 2 of the Self-test?Agree.2. Write the Boolean expression for the middle AND gate in Fig. 5-4a and

리포트 | 7페이지 | 1,000원 | 등록일 2008.01.07

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Basic Current Source 와 Cascode Current Source

2] 저항이 첨가된 전류미러 회로일반적으로 실험 시 Current Source를 Power Supply와 Resistor로 대신하므로 그림 2는 IREF로 MOSFET에 Bias ... Basic Current Source 와 Cascode Current Source실험 목적 : N-Channel Current Source 와 N-Channel Cascode ... Current Source를비교/분석실험 관련 이론Current MirrorTransistor를 Bias시키기 위해 보편적으로 Constant-Current Source를 사용

리포트 | 5페이지 | 1,000원 | 등록일 2008.03.23

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HEMT이용한 주파수 2체배기 설계 및 제작 (diode 체배기 설계및 제작)

. HEMT의 gate 단자에서 입력신호를 제외한 모든 고조파 성분에 대해 단락회로로 보이도록 저역통과여파기를 설계하고, 최대 전력이 전달되도록 정합을 시켜준다.Ⅲ. 설 계본 과제 ... 주파 신호원인 수정 발전기로부터 고주파를 발생시켜 얻게 되며, 고조파를 발생시키기 위해 비선형 회로를 사용하게 되고 이때 사용하는 비선형 소자중에는 dc 전류와 전압 사이의 비선형 ... 이 된다는 것이 알려져 있으며 버렉터나 SRD를 이용한 회로는 다이오드의 비선형 캐패시턴스 특성을 이용한 리엑티브 체배기이다. 버렉터는 초고주파 신호의 비교적 낮은 고조파를 발생

리포트 | 7페이지 | 2,000원 | 등록일 2009.06.02

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Ch10. 플립 플롭

의 입력으로 인가되어 최종 출력 Q에 나타나게 된다.3. 사용기기 및 부품? 디지털 실험장치? 직류전원 공급장치? 싱글 펄스 발생기? 회로시험기? 오실로스코프?TTL 7400 ... . 실험과정 및 결과예측(1) 그림 10-9와 같은 RST-F/F 회로를 결선하고 입력 R, S의 변화가 clock pulse()에 따라 어떻게 변화하는지 표 10-5에 써넣어라(단 S ... PageCh10. 플립 플롭사 전 보 고 서제출일학과조학번조원이름이름1. 실험목적(1) RS 플립 플롭의 기본 개념을 파악 하고 RS-Latch와의 차이점을 발견한다.(2) D

리포트 | 8페이지 | 2,000원 | 등록일 2008.01.08

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[공학]실험 6. 4비트 산술논리회로와 시뮬레이션

실험 6. 4비트 산술논리회로와 시뮬레이션예비 보고서에서 실험 방법 1의 내용 중, 1adder 생성시에 XOR2 gate를 XNOR2 gate로 잘못 사용해서 구현 하 ... . MyCAD를 이용하여 의 (a)와 같은 1비트 전가산기를 그리고 시뮬레이션을 한 다음 (b)와 같이 심볼화 하라.(a)회로도(b)심볼결과 보고서 ;1. 실험 5 ... 였다. 그래서 다음과 같이 수정하고 그 시뮬레이션 값을 적는다. 하지만 재미있는 점을 발견 하였다. XNOR2 gate를 사용하여도 결과값에 영향을 주지 않는다는 것이다. 그 이유는 부울

리포트 | 9페이지 | 1,000원 | 등록일 2006.12.20

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디코더 인코더 예비보고서

되며, AND Gate로 구성할 수 있다. 만약 n Bit의 정보 중에서 사용되지 않는 정보가 있거나 Don't care 정보가 있으면 디코더의 출력은 2ⁿ개보다 적어진다.-회로 ... 1. 실험 제목 : 디코더와 인코더2. 실험 목표복호기 및 부호기의 기능을 익히고 구성 방법을 배운다.3. 사용부품 및 계기 :직류전원장치(DC Power Supply), 함수 ... 화된 데이터를 해독하여 그에 대응되는 아날로그 신호로 바꿔주는 컴퓨터 회로로 인코더의 반대개념으로 디코더라고도 하고, 데이터를 본래 형태로 바꿔준다는 의미에서 복호기라고도 한다.-디코더

리포트 | 4페이지 | 1,000원 | 등록일 2009.01.05

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Closing The Circle - Speed, Timing, and Effectiveness

COMMERCIALIZATION○ 스마트카드IC(integrated circuit : 집적회로) 기억소자를 장착하여대용량의 정보를 담을 수 있는 전자식 신용카드로ISO의 규격은 IC가 1개 이상 ... 내장되어 있는 모든 카드○ 1974년에 Roland Moreno에 의해서 발명- 아이디어 초기 당시, 카드사이즈 크기와 직접회로(integrated circuit) 사용 등 설계 ... 치면서 끝냅니다. 기업은 그들의 선택에 더 신중해야(consequential)하고, 정말 중요한 프로젝트를 장려해야 합니다.”- Stage-gate 프로세스는 기업이 적고 더 나

리포트 | 19페이지 | 3,000원 | 등록일 2010.05.10

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pspice가산기시뮬레이션

기 실험으로 7486 EX-OR gate의 합인 S 회로와 7408 AND gate의 자리올림수인 C 회로를 구성하여 반가산기의 동작을 보기 위한 회로이다.나. 부울 식으로 표현 ... . 실험회로 2 - 두 개의 반가산기와 한 개의 OR게이트로 구성된 전가산기가. 두 개의 반가산기와 한 개의 OR gate 로 구성된 전가산기의 회로를 구성하여 전가산기의 동작을 보 ... 의 OR gate로 전가산기 회로를 구성한다.다. 회로구성라. A와 B의 Cin의 입력 펄스마. 시뮬레이션 결과바. 시뮬레이션 결과 확대 및 고찰이 실험의 시뮬레이션은 입력신호 A

리포트 | 10페이지 | 1,000원 | 등록일 2006.12.04

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BJT 와 MOSFET의 장단점

BJT vs MOSFET 전자회로실험 II목차 동작원리 I-V 특성 온도에 대한 특성 Switching 증폭기 SummaryBJT 와 MOSFET 의 동작원리 전자와 Hole ... 모두 전류를 발생시키는데 이용 . (Bipolar Junction Transistor)BJT 와 MOSFET 의 동작원리 V GS ※ Gate 에는 전류가 흐르지 않는다 . 도선 ... DSLSwitching ※ Depletion load device 와 NMOS 를 이용한 인버터 회로 . switching 속도가 더 빠르다 Noise 에 덜 민감하다 .BJT

리포트 | 15페이지 | 1,000원 | 등록일 2008.09.14

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물리전자공학 프로젝트 Design and analysis of long-channel nMOSFETs

개형을 갖게 된다. Talyor 공식을 이용해서식을 보상하여 주면=의 식으로 도출되어지고, 기울기를 통해 linear하게 증가하는 것을 실험 결과값을 통해 증명해낼 수 있다.이상 ... 한 값으로 잡히지 않는다. 이는 회로 스펙 결정에서 불안정성을 가져오기 때문에 좋지않다. 그래서 linear한 gm을 가지게하기 위해 Vds값이 작은 0.1V로 설정하여주 ... positive voltafe substrate current가 흘러 전압 강하가 일어날 수 있고, 충돌한 전자는 강한 에너지에 의해 절연체를 뛰어넘어 Gate로 갈 수도 있지만 절연막을 뚫고 였다.

리포트 | 8페이지 | 2,000원 | 등록일 2013.02.25

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Ch15. 동기식 카운터(Synchronous Counters)

-7의 동기식 Count-Up 카운터 실험 회로를 결선하고 다음 순서에 따라 실험하여라.① 로직 펄서(싱글 펄스) 1을 순간적으로 눌렀 다 놓는다.(접지시켰다 +5[V]로 여결 또는 ... 하여라.③ 그림 15-7의 실험회로에서 로직 펄서 대신 CK 단자(핀 번호 1번)에 구형파 발진기 3을 접 속하고 발진기의 출력을 5 rm[Vp-p]가 되게 한 후 1[kHz]와 100 ... [kHz]에 대하여 2현상 오실로 그림 15-7 비동기식 Count-Up 카운터 실험회로 스코프로 각 부분(Cp, A, B, C, D)의 파형을 비교 관측하여라.(2) 그림 15

리포트 | 5페이지 | 2,000원 | 등록일 2008.01.08

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박막의 표면처리 및 식각 실험 예비보고사

/1./실험제목/박막 재료의 표면 처리 및 PR 제거/2./실험목적/여러 가지 전기 및 전자기기에 사용되는 반도체 소자의 제조공정은 박막재료의 세 가지 공정으로 나눠 지는데 첫째 ... 이다. 본 실험에서는 마스크에 의하여 형성된 패턴을 증착된 박막위로 전달하는 식각공정에 대하여 이해하고 그에 따른 박막의 표면과 두께의 변화 등에 대하여 고찰하고자 한다./3 ... ./실험내용/가장 널리 사용되는 실리콘 산화막 (silicon oxide; SiO2) 박막을 적절한 식각가스를 선택하여 반응성 이온식각장치(reactive ion etcher; RIE

리포트 | 13페이지 | 1,000원 | 등록일 2007.06.04

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N체분계수기와 10진계수기

page(4) 실습내용4)실험 방법1. Mod-3 카운터실험할 회로는 그림 9.4와 같이 구성한다.SWG의 주파수 또는 CRO의 수평소인속도는 그림 9.5에 clock 으로 명시 ... 실 험 예 비 보 고 서실험 단원 및 제목N체분계수기와 10진계수기검사란1) 실험 목적① T Flop-Flop을 P단 직렬접속한 계수기로서 2p보다 적은 다른 인수로 입력 주파수 ... sheet)를 참고하면 된다.④ MOD-3 카운터왼쪽 그림은 MOD-3 카운터의 회로도이다.카운터의 동작은 입력단자 A,B,C,D = LOW, DN = HIGH, CLR

리포트 | 8페이지 | 2,500원 | 등록일 2009.07.11

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가산기와 감산기

upply)- 회로실험기(Tester) - 오실로스코프(가급적 2 현상)- TTL 7400(quad 2-input NAND Gate)- TTL 7404(Hex Inberter) ... . 실험과정 및 결과 예측- 그림 6-11과 같은 회로를 결선하고 입력 A, B에 따른 출력 S와 C를 측정하여 표 6-5를 완성하여라.그림 6-11 반 가산기 회로출력 결과AB ... 사전보고서제출일학과전자공학과조학번조원이름성명Ch. 6 가산기와 감산기(Adders and Subtractors)- -1. 실험목적- 반 가산기와 전 가산기의 원리를 이해한다.

리포트 | 5페이지 | 1,000원 | 등록일 2007.01.11

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