"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,741-1,760 / 2,110건

비동기 및 동기 카운터

1. 실험 목적☞ 비동기 및 동기 카운터의 구성 및 동작원리 이해☞비동기 및 동기 타운터 TTL IC 에 대한 사용법 터득2. 관련 이론 (basic logic gate)☞ JK ... 000001000120010300114010050101601107011181000910013. 가상실험 및 실험결과①4진 비동기식 카운터의 회로도☞ 회로구성도☞ 가상실험결과☞ 실험결과V1V2②4진 하향 비 ... 동기식 카운터 회로도☞ 회로구성도☞ 가상실험결과☞ 실험결과V1V2③8진 비동기식 카운터의 회로도☞ 회로구성도☞ 가상실험결과☞ 실험결과V1V2V3④8진 동기식 카운터의 회로도☞ 회로

리포트 | 17페이지 | 2,000원 | 등록일 2008.03.13

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논리회로 실험 (가산기와 감산기) 결과 (사진첨부, PSPICE첨부, Truth TAble , 카노맵 첨부)

(borrow)를 구하는 회로이다. 한 자리의 2진수를 뺄셈하는 형태를 네 가지 조합이 발생한다.《반감산기 실험 사진》①회로구성inverter하나를 추가하여 XOR GATE, AND ... 을 서약합니다.학 부: 전자공학부제출일: 07.9.22과목명: 논리회로 실험교수명: 박성진 교수님조: 10조학 번: 200320474 200320463성 명: 이준범 이영길실험 3 ... 대등하게 동작한다. 하지만 회로상 에서 3개 입력이 대칭되어 있다고 할 수 없다.①회로구성XOR GATE , AND GATE, OR GATE를 이용하여 전가산기를 구성

리포트 | 9페이지 | 3,000원 | 등록일 2007.09.22

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8장결과Common Source Amplifier 설계

의 원인으로는 우리가 시뮬레이션을 돌릴 때와 실험 즉 이상적일 때와 일반적일 때의 차이 때문이다. MOSFET의 gate에는 임피던스가 무한대로 전류가 흐르면 안 되지만 실험 ... 8. Common Source Amplifier 설계4. 설계실습 내용 및 분석(주의) 다음의 실험에서 얻어지는 결과들을 설계실습계획서에서 예측한 결과들과 비교하고 다를 경우 오 ... 하여 표에 포함하라. 오차와 그 원인을 분석하라.(a)함수발생기에 40mV는 입력이 되지 않아서 입력 값을 50mV로 실험을 했다. 그래서 예비레포트의 시뮬레이션 값을 50mV

리포트 | 6페이지 | 1,500원 | 등록일 2009.10.04

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[예비]위상 제어 루프 PLL

설계실습 7. 위상 제어 루프1.목적:위상 제어 루프 회로의 이론을 학습하고 간단한 위상 제어 루프 회로를 구성하 여 주파수 동기화(Phase Locking) 원리를 이해한다.2 ... .실험준비물DMM, Power SupplyOscilloscopeFunction generator탄소저항:100Ω, 5%, 1/2W 3개1kΩ 5% 1/2W 2개5kΩ 5% 1/2W ... OP amp 3개74HC04 inverter 1개74HC86 XOR gate 1개3.설계실습 계획서(1)uA741 Op Amp 전기적 특성74HC04 inverter 의 전기

리포트 | 9페이지 | 1,500원 | 등록일 2008.11.03

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연세대 전기전자 기초실험 5. Battery tester and chargning (예비보고서)

실험 예비 보고서실험 제목 : 5. Battery Tester and Charging 회로 실험학과학년학번분반실험조성명1. 목적본 교재로 학습한 전기회로의 기본적 이론과 실험적인 ... tester 회로건전지의 전압이 전자장비 동작을 위한 충분한 전압을 만족시키는지 알아보는 실험이다. 먼저 V1 단자에 Voltage Source가 될 테스트해 볼 배터리를 연결 ... 회로가 동작하는데 걸리는 소요시간은 증가하고 큰 Capacitor의 용량을 채워야 하기 때문에 배터리의 소모 전력이 많을 것이다. 따라서 실험에 따른 적절한 Capacitance

리포트 | 6페이지 | 1,000원 | 등록일 2007.12.30

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ADDER COMPARATOR

Gate Array)란?프로그램이 가능한 Logic Device, 회로 설계자가 직접회로를 구현할 수 있는 새로운 형태의 주문형 반도체이다. 장점으로는 전력 손실이 적고 설계변경 ... .HTM" FPGA 에디션 2.0'NVIDIA8800GT와 연동되어사용되고 있는 Xilinx-ML555실험목적8비트 가산기와 비교기를 4비트 adder, comparator를 사용 ... 로 변환되어야 한다.▶ UCF(User Constraints File) 작성설계자가 회로의 물리적 제약 조건들을 UFC를 통해서 입력할 수 있다.▶ Implementation(적용

리포트 | 21페이지 | 1,000원 | 등록일 2010.03.26

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FF, SP CONVERSION

다.Spartan-3Spartan-3 모형도Spartan-3▶ FPGA(Field Programmabe Gate Array)란?프로그램이 가능한 Logic Device, 회로 설계자가 직접회로 ... /FPGA.HTM" FPGA 에디션 2.0'NVIDIA8800GT와 연동되어사용되고 있는 Xilinx-ML555실험목적RS Flip-Flop과 Master-Slave RS Fliip ... 가 회로의 물리적 제약 조건들을 UFC를 통해서 입력할 수 있다.▶ Implementation(적용)합성 과정의 출력으로 얻어진 게이트 수준의 Netlist회로를 실제 타겟 FPGA

리포트 | 14페이지 | 1,000원 | 등록일 2010.03.26

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기초 회로 실험에 필요한 장비들, AND 게이트의 실험 과정 및 결과

-오실로스코프 -함수 발생기 -DC 전원공급기 -AND Gate 실험*-실험 1 세미나-08. 03. 21. 15조. 박혜리, 박혜영장비 소개 오실로스코프 DC Power ... Supply Bread board 함수 발생기 AND Gate 실험 과정 예상 결과*오실로스코프- 시간에 따른 전압의 변화를 화면에 출력하는 장치 DC Power Supply – 직류 ... 10 0 0 1*▶ 펄스입력에 대한 AND 동작 ◀오실로스코프와 DC Supply를 이용하여 AND gate논리값을 측정하기 위한 실험 필요 장비: 오실로스코프 2대, DC

리포트 | 51페이지 | 1,000원 | 등록일 2008.05.01

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디코더를 이용한 조합논리

출력 조합논리 회로를 구현한다. ● 실험기기 1 7408 AND 게이트 1 7474 플립플롭 1 74LS138 디코더 1 DIP 스위치 2 LED 빨간색, 노란색, 초록색 1 ... 12. 디코더를 이용한 조합논리학과 : 전자공학과 학번 :20413525, 20413549 이름 : 김지용, 임현욱1. 실험목적 및 실험기기● 실험목적 - 디코더를 이용한 다중 ... 등의 형태로 변환하여 출력해주는 장치를 말하며 '복호기'또는 '해독기'라고도 한다. 디코더는 n개의 입력선과 2ⁿ개의 출력선으로 구성되며, AND Gate로 구성할 수 이

리포트 | 17페이지 | 2,000원 | 등록일 2008.12.15

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[컴퓨터 공학 실험] 논리 및 연산회로{가산기(Adder),감산기(Subtractor),부호 변환기(Code converter)}

: 가능하면 NAND or NOR gate 만으로 구성한다 . 5. 회로 검증 : 실험값이 진리표의 이론값와 일치하는지 확인한다 .다 -2) 8421(BCD)-2421 부호 변환기 ... 논리 및 연산회로 Xxx( 이름 ) xxx목 차 가산기 (Adder) 반가산기 (Half Adder) 전가산기 (Full Adder) 병렬 가산기 (Parallel Adder ... ) 정의 두 개 이상의 수를 입력하여 이들의 합을 출력으로 나타내는 회로 . Adder Sum가 -1) 반가산기 (Half Adder) 정의 입력 변수인 두 개의 이진수를 더하여 합

리포트 | 24페이지 | 1,000원 | 등록일 2009.03.25

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주파수응답 및 필터의 이해

필터실험① 저항과 캐패시터를 이용하여 고역통과 필터를 구성하고, 주파수 응답을 측정한다. 필터는 입력 신호의 주파수에 따라 그 응답이 달라지므로 여러 주파수를 회로에 인가하여 크기 ... 주파수응답 및 필터의 이해1. 실험 목적1) 주파수 응답 및 필터에 대한 이론을 학습한다.2) PSIM(소프트웨어)의 사용법을 익힌다.3) 고주파 통과 필터(HPF : High ... . 실험 도구저항; 전기저항(電?抵抗, electric resistance) 또는 저항은 전류의 흐름을 방해하는 정도를 나타내는 물리량으로, 다음과 같이 정의된다.이 때 V는 전압

리포트 | 12페이지 | 1,000원 | 등록일 2010.12.22

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TTL 기본 디지털회로 실험

표4. 실험순서1) AND Gate(1) 2입력 AND Gate① 7408칩을 사용하여 AND Gate 회로를 구성하고 입력 A, B 의 변화 에 따른 출력 Y의 상태를 기록하라 ... 를 오실로스코프로 측정하 파형을 도시하라.제 2장 UNIVERSAL Gate(NAND, NOR)1. 실험 목적- 논리회로에서 가장 많이 사용되는 Universal 게이트인 NAND ... 기자재 및 부품- 논리실험기(Digital Logic Lab. Unit), 오실로스코프, 7408(4조 2입력 AND Gate), 7432(4조 2입력 OR Gate), 7411

리포트 | 14페이지 | 1,000원 | 등록일 2007.03.16

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Battery Tester and Charging 회로 실험 예비보고서.hwp

-브릿지 정류회로- Auto battery Charging 회로DC sweep Vvar-I(R3)-I(R4)-실험에 사용하는 기기 및 부품① 공급전원 : AC 120Vrms② 변압기 ... ⑪ 트랜지스터 : BC547B 1개- 실험과 결과 측정6-1 Economical battery tester 회로가. PSPICE 를 통한 모의 실험⇒ 모의 실험 회로는 앞 페이지 ... 에서는 전 류가 흐르는 것을 볼 수 있었다.나. 실험을 통한 회로 구현⇒ bettery tester 에서는 위의 PSPICE에서 했던 모의실험 회로 소자 중, V1 에 충전된 전지

리포트 | 8페이지 | 1,500원 | 등록일 2007.10.09

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[공학]부울대수의 공리와 정리

가 나온다.실험결과△첫 번째 실습 (Two input for AND gate)Input1Input2Output000010111111△ 입력값< 회로도 >첫 번째 실습(AND gate ... ① 메뉴 바 Draw에 Get new Part 지정② Advance 선택 후 Search로 검색하여 7408(AND) gate 선택 Place&Esc를 클릭하여 회로를 그려준다 ... ) gate 선택 Place&Esc를 클릭하여 회로를 그려준다.③ STIM1을 선택 후 Gate의 좌측 Input을 그려준다.④ 이름은 Input 이름 수정 후 TimeStep을 각각의 값

리포트 | 6페이지 | 1,000원 | 등록일 2007.04.18

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mo-fet(모스펫) 공통 소스 증폭기

으로 오실로스코프를 사용해서 측정할 수 있다.[실험과정]그림 24-13. 3N187의 게이트 제어특성을 결정하기 위한 실험 회로0. 그림 24-12는 MOS-FET 3N187의 밑면이 ... 실험24. MOS-FET 공통 소스 증폭기[실험목적]1) MOS-FET의 드레인특성을 실험적으로 결정한다.2) FET 증폭기에 대한 여러 가지 바이어스를 고찰한다.3) MOS ... -FET 공통 소스 증폭기의 전압 이득을 측정한다.[실험 장비 및 재료]● DC power supply 2개, 디지털 멀티미터, dc 전류계(0~10mA)● 저항 : 1kΩ, 10kΩ

리포트 | 12페이지 | 1,000원 | 등록일 2009.10.18

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부울대수와 드모르간 정리 실험

와 드모르간 정리 실험1. 목적B00l 대수의 기본공리와 정리를 이해하고, De Morgan의 정리를 실험적으로 증명하는데 목적을 둔다.2. 이론(1) 부울대수? 부울대수는 논리회로 ... , NOT 7404, AND 7408, OR 7432 각 1개씩점퍼선, 작업공구(개인지참)4. 실험방법(1) 아래 회로를 구성하고, 출력 전압을 측정하여 표3-1에 기록하라. 또 ... 실험을 통해서 고생 끝에 그 원인을 알아냈는데, 그 원인은 실험(3)에서까지만 해도 잘 되던 HD74LS00P가 쇼트가 났던 것이었다. 그래서 실험(4)에서는 NAND회로를 구성

리포트 | 7페이지 | 1,000원 | 등록일 2008.04.28

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논리회로 실험 - 디코더, 인코더 결과보고서

실험 7. Decoder & Encoder 결과보고서1번 실험. 2단 2진 카운터-측정 사진 첨부 -실험에 대한 고찰2단 2진 카운터는 IC7476과 NAND GATE IC ... )은 디코더를 의미한다. 즉 카운터로 2진수 00,01,10,11 을 입력시출력으로 10진수 0,1,2,3이 출력되는 디코더이다.실험은 간단한 게이트2개만을 이용하여 구성하는 회로 ... 파형7) 핀 1에 A’, 핀 2에 B를 입력한 NAND gate 7420의 핀 6번 출력파형-측정 사진 첨부 -실험에 대한 고찰이번 실험과 앞에서 실험한 2진 카운터와의 가장 큰

리포트 | 12페이지 | 1,000원 | 등록일 2008.02.25

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MOSFET Current Source와 Source Follower 설계 예비보고서

, 구현, 측정, 평가한다.2. 이론- MOSFET은 drain과 gate에 연결되어 있으므로 MOSFET이 동작하는 경우에는 항상 saturation 영역에서 동작한다. 따라서 ... 의 drain의 전류는와 같이 얻어진다.- MOSFET의 gate전류는 거의 0A이므로은 저항 R을 따라 흐르고이므로와 같은 관계식을 얻을 수 있다.-가 역시 saturation 영역 ... 한 MOSFET를 사용한다면 기준전류와 같은 출력전류를 얻는 전류전원을 설계할 수 있다. 이러한 회로를 current mirror이라고 한다.-가 saturation 영역에서 동작

리포트 | 6페이지 | 1,000원 | 등록일 2009.03.18

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충북대학교 전기전자공학 디지털실험 7장예비보고서

실험 7. FPGA를 이용한 4비트 산술논리회로의 구현 및 검증목 적1. MyCAD에서 합성한 회로를 FPGA로 구현하는 방법을 익힌다.2. 실험 6에서 설계한 4비트 산술 논리 ... 까지의 실험처럼 개별 논리회로 소자를 이용하여 회로를 구현하는 것은 비용 및 시간이 많이 소요된다. 따라서 IC 칩으로 구현하기 이전에 FPGA(Field Programmable ... Gate Array)를 사용하여 회로의 설계를 확인하는 작업이 점차 일반화 되고 있다. FPGA는 기존의 PLD에 비해 더욱 유연하고 용도가 많아서 디지털 시스템의 구현시 거의

리포트 | 2페이지 | 1,000원 | 등록일 2008.02.18

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MOSFET 전압-전류 실험

실험 1. MOSFET 전압 - 전류 특성1. 목적금속-산화막-반도체 전계 효과 트랜지스터(Metal Oxide Semiconductor Field Effect ... Transistor : MOSFET)의 드레인 전류에 대한 드레인-소스 전압의 효과와 게이트-소스 효과, 드레인 전류와 게이트-소스 전압 사이의 관계를 알아본다. 시뮬레이션과 실험을 통하 ... Transistor)또는 MOS 트랜지스터는 금속막,산화막,반도체영역으로 구성된 트랜지스터의 일종이다.MOS 트랜지스터의 source와 drain은 실리콘 표면에 생성되며 gate의 양쪽

리포트 | 8페이지 | 1,000원 | 등록일 2008.01.24

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