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전전설2 전전설3 4bit adder 회로설계 mosfet 응용회로 mosfet current mirror 울산대 JFET and 회로 시립대 논리회로 디지털집적회로 전자회로설계실습
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"회로실험 gate" 검색결과 481-500 / 2,110건

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    서울시립대학교 전전설3 8주차 결과레포트(설계 성공적, A+, 코로나로 인한 시뮬레이션 실험, 하지만 이론 주석 깔끔)
    ) ‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 101. Introduction (실험에 대한 소개)가. Purpose of this LabMOSFET을 활용한 기본적인 회로 ... .소자 library를 등록하는 과정은 이전 실험에 종종 했으므로 설명은 생략하겠다.- N-Channel MOSFET실험 [2-1] 피크 전파 정류기 회로PSpice 회로[1-1 ... . Introduction (실험에 대한 소개)‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 3가. Purpose of this Lab
    리포트 | 10페이지 | 2,000원 | 등록일 2021.03.20
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    DC/DC 강압컨버터용 MOSFET의 TID 및 SEGR 실험 (TID and SEGR Testing on MOSFET of DC/DC Power Buck Converter)
    한 TID실험에서 방사선의 영향으로 문턱전압과 항복전압의 변화와 SEGR 실험에 적용된 5종류의 중이온 입자는 MOSFET의 게이트(gate)에 영향을 주어 게이트가 파괴 ... 트랜지스터), PWM-IC(펄스폭 변조 집적회로) 제어기, 인덕터, 콘덴서 등으로 구성되어있다. MOSFET는 스위치 기능을 수행하는데 코발트 60 (60Co) 저준위 감마발생기를 이용 ... 된다. MOSFET의 TID 실험은 40 Krad 까지 수행하였으며, SEGR 실험은 제어보드를 구현한 후 LET(MeV/mg/)별 cross section()을 연구하는데 있다. DC/DC
    논문 | 7페이지 | 무료 | 등록일 2025.06.15 | 수정일 2025.06.17
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    전자회로설계실습 8 예비보고서 MOSFET Current Mirror 설계
    전자회로설계 실습(11주차 예비보고서)소속전자전기공학부담당교수수업 시간학번성명예비 보고서설계실습 8. MOSFET Current Mirror 설계실습날짜교과목 번호제출기한작성자 ... * 모든 계산결과는 반올림하여 유효숫자 세 자리까지만 사용한다.그림 1의 회로와 같이 Current Source에서 M1, M2로는 2N7000 (Fairchild)을 이용하며 VCC ... 를 자세히 적어서 제출한다. (Gate Threshold Voltage와 On-State Drain Current 이용)Vt에는 VGS(th) = 2.1 V를 사용한다. 또한 On
    리포트 | 4페이지 | 1,000원 | 등록일 2022.03.29 | 수정일 2022.03.31
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    아날로그및디지털회로설계실습 결과보고서6
    로 세 경우 모두 입력전압과 큰 차이가 없지만 회로의 noise 성분 때문에 조금 커지는 양상을 보였다.전반적으로 실험의 결과는 잘 나와서 만족스러웠다. 다만 시험기간이 걸려 자료 ... 아날로그 및 디지털 회로 설계실습결과보고서 66. 위상 제어 루프(PLL)요약:6-4-1) PLL 회로를 회로도와 같이 설계하고 측정 5Vpp, 5kHz의 입력파형을 넣어준 결과 ... Filter), 가변 발진기(Voltage Controlled Oscillator)의 3가지 요소로 구성된 회로이다. 위상 검출기는 발진기의 입력과 출력 파형의 위상을 비교하여 그 차이
    리포트 | 14페이지 | 1,000원 | 등록일 2025.06.29
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    아주대학교 논리회로실험 / 8번 실험 Counter 에비보고서
    8번 실험 예비보고서전자공학과 / 학년 / 학번 : / 이름 :날짜 : / 담당조교님 :실험 8. Counter1. 회로 결선도※ 이때, 지면상 그리지 못한 일부 출력에는 저항 ... 를 이용한 디코딩과 인코딩 동작을 히해하는 것을 목적으로 한다.3. 실험 도구 및 소자IC 이름74HC08 (Quad 2-input AND Gate)Pin ... 다는 점에서 비동기식 카운터와 대비된다. 공통의 클록펄스에 동기화되어 작동하기에 상대적으로 빠른 연산 속도를 갖는다. 그러나 비동기식 카운터에 비해 회로가 복잡하다. 이번 실험
    리포트 | 5페이지 | 1,000원 | 등록일 2021.07.20
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    전자공학응용실험 - 다단 증폭기 결과레포트
    .9VCut-off2.5V2.1VSaturation5.99V1VCut-off77mV2.2VTriode5.99V1.1VCut-off26mV2.3VTriode(2) 실험회로2 ... 에서 VGS=1.94V, ID=80uA(3) 실험회로3 실험 3VinVoutAv(전압이득)1단 증폭기40mV119mV2.9V/V2단 증폭기40mV960mV24V/V(4) C 있음C ... 과 다르게 Gate에서의 미세전류가 흐르는 등 측정 값에 영향을 주었기 때문에 오차가 발생했다. 또한 함수 발생기를 활용하여 입-출력 파형을 알아보는 실험 3,4 에서는 함수발생기
    리포트 | 6페이지 | 2,000원 | 등록일 2021.12.20
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    10주차 a-Si LCD 패널 Transmittance, Alpha step 측정(정보디스플레이학과 AMD실험 보고서)
    a-Si LCD 패널 Transmittance, Alpha step 측정실험일: 2018.05.10실험 목적a-Si LCD 패널을 구성하고 있는 C/F나 TFT backplane ... 과 같은 각 Sheet의 Transmittance와 단차(Alpha step)을 측정하고, 소자 및 물리 / 광학적 특성을 분석하고 이해해본다.실험 장비 및 준비물a-Si LCD ... 패널 Hyperlink "http://www.Panelook.com" www.Panelook.com에서 찾은 두 a-Si LCD 패널의 정보이다. 이전 실험에서 분해한 패널
    리포트 | 14페이지 | 1,000원 | 등록일 2021.02.19 | 수정일 2021.03.20
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    CMOS 제조 공정 실험 레포트(예비,결과)
    Inverter 회로위의 그림1은 이번에 실험을 진행하였던 회로를 나타낸다. 여기서 V4는 입력 전압에 해당하는 Vin이고, V5는 VDD이다. 그리고 위쪽의 MOSFET이 PMOS, 아래쪽 ... 의 10%인 0.5V만 가해주었고, 또 저항을 1kΩ 대신에 4.7kΩ을 사용하였기 때문에 값이 작게 나온 것으로 생각된다.이번 실험은 이전보다 아주 간단한 실험이었으나, 회로 ... 었다. 그리고 실험 과정 중 회로 구성은 제대로 하였으나 결과가 잘 나오지 않는 고비가 있었는데, 오실로스코프에서 Auto 버튼만 눌러서 값을 맞춰주지 않았기 때문에 꽤 오랫동안 결과
    리포트 | 6페이지 | 2,500원 | 등록일 2021.11.08
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    서울시립대 전자전기컴퓨터설계실험3 예비레포트 10주차
    트랜지스터를 사용한 Common-Source 증폭기 회로를 설계하고 입력에 대한 출력을 확인한다.실험 방법 및 예상 실험 결과(Simulation)다음은 실험에 사용한 2N7000 ... 는 것을 방지해주는 역할을 한다고 볼 수 있다.[실험3] AC Analysis[3-1] [2-1] 회로에 대해 AC Analysis Simulation을 수행하고 OUT에 대한(a ... -Sourclation[실험4] Transient Analysis[4-1] [2-1] 회로에 대해 0.1xsin(2xpx1000xt) 입력 IN을 인가하고 Transient Analysis
    리포트 | 14페이지 | 2,500원 | 등록일 2022.03.10
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    아주대학교 논리회로실험 / 7번 실험 Shift Register 예비보고서
    7번 실험 예비보고서전자공학과 / 학년 / 학번 : / 이름 :날짜 : / 담당조교님 :실험 7. Shift Register1. 회로 결선도※ 이때, 지면상 그리지 못한 일부 ... 하고, 레지스터 Shift의 개념 그리고 작동원리를 실증해보는 것을 목적으로 한다.3. 실험 도구 및 소자IC 이름74HC00 (Quad 2-input NAND Gate)핀 구성함수 ... 출력에는 저항과 다이오드가 연결되어 있음을 가정한다.2. 실험 목적본 실험에서는 Register Shift에 대해 다룬다. 이전 실험에서 다룬 플립플롭은 1비트를 저장할 수 있
    리포트 | 5페이지 | 1,000원 | 등록일 2021.07.20
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    (A+/이론/예상결과/고찰) 아주대 논리회로실험 예비보고서3
    한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일:과목명: 논리회로실험교수명:조교명:분 반:학 번:성 명:전자공학부실험3 ... . 가산기와 감산기1) 실험목적1. 가산기(Adder)와 감산기(Subtracter)의 의미와 원리를 안다.2. Logic gate를 이용하여 반가산기, 전가산기, 반감산기, 전감산기 ... 를 구성할 수 있다.3. 불 대수식과 드 모르간 법칙을 이용하여 다양한 회로를 고안할 수 있다.2) 실험이론- 논리 회로에서의 연산: 디지털 컴퓨터들은 다양한 정보처리 작업을 수행
    리포트 | 7페이지 | 1,000원 | 등록일 2021.10.24
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    홍익대_디지털논리회로실험_4주차 예비보고서_A+
    되는 것이다. 이를 표로 정리하면 다음과 같다.1.6 응용 실험 (2)가 4-to-1 멀티플렉서로 동작하는 원리를 자세히 서술하시오.응용 실험(2) 회로에는 3-INPUT AND ... 1일 때 D3 값이 출력되는 것을 볼 수 있다.이 회로의 진리표는 다음과 같다.기본 실험(1)과 같은 것을 볼 수 있다. ... 디지털 논리실험 및 설계 4주차 예비보고서실험 준비1.1 멀티플렉서와 부호기(encoder)의 차이를 설명하시오.멀티플렉서는 여러가지의 입력 가운데 하나를 골라 그대로 출력하지
    리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15
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    서울시립대학교 전전설3 10주차 결과레포트(설계 성공적, A+, 코로나로 인한 시뮬레이션 실험, 하지만 이론 주석 깔끔)
    ) ‥‥‥‥‥‥ 91. Introduction (실험에 대한 소개)가. Purpose of this Lab이번 실험에서는 MOSFET을 활용한 Amplifier회로를 알아본다.나 ... (실험 결과)- N-Channel MOSFET[1-1] 다음 그림은 2N7000 NMOS 트랜지스터를 사용한 Common-Source 증폭기 회로이다. PSPICE로 증폭기 회로 ... plot에 근접한 결과를 보여주었다.또한, 설명한 바와 같이 전류 가 가 존재하는 [2-1]회로보다 더 많이 흐른다는 것을 볼 수 있는 실험이었다.3. Conclusion
    리포트 | 9페이지 | 2,000원 | 등록일 2021.03.20
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    논리 게이트 및 부울 함수의 구현 예비
    과 Gate의 구조 및 기능을 습득한다.부울 대수를 사용한 논리회로의 표현방식 및 등가회로를 익힌다.실험 이론(원리)논리값(=진위값)참, 거짓을 의미하는 값으로 디지털 신호가 ON ... 회로실험 예비보고서논리 게이트 및 부울 함수의 구현실험 제목논리 게이트 및 부울 함수의 구현실험 목적AND, OR, NOT, NAND, NOR, XOR, XNOR의 논리함수 개념 ... 을 나타내는 표준적인 방법은 신호선과 논리 기호와의 접점에 작은 원을 그리는 것이다.즉 입력 값에 반대의 결과 값이 출력되는 회로이다. NOT 논리회로의 타이밍 다이이어그램은 다음
    리포트 | 8페이지 | 1,000원 | 등록일 2021.04.20
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    [중앙대 전자회로설계실습 8 예비보고서] MOSFET Current Mirror 설계
    (1 kΩ, 10 kΩ, 1/2W) : 2개3.1 단일 Current Mirror 설계* 모든 계산결과는 반올림하여 유효숫자 세 자리까지만 사용한다.그림 1의 회로와 같이 ... 의 Data sheet로부터 (1/2)kn'(W/L)을 구한다. 사용한 수식 및 수치를 자세히 적어서 제출한다. (Gate Threshold Voltage와 On-Stage Drain ... 가 작아지므로 값은 커진다. 은 0.3V 이상이기만 하면 되므로 값이 줄어들어도 상관없다 .(D) = = 10 mA인 전류원을 OrCAD로 설계하여 회로도를 제출한다. (=500 Ω
    리포트 | 5페이지 | 1,000원 | 등록일 2021.08.09
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    (A+/이론/예상결과/고찰) 아주대 논리회로실험 예비보고서8
    한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일:과목명: 논리회로실험교수명:조교명:분 반:학 번:성 명:전자공학부실험8 ... map, IC gate, Truth Table74HC0074HC7674HC964) 실험과정 및 예상 결과실험 1. 6bit Shift Right Register실험 과정: 준비한 결선 ... . Shift Register1) 실험목적1. 시프트 레지스터가 무엇인지 이해하고 종류를 파악한다.2. 지난 실험의 J-K F/F를 이용하여 간단한 시프트 레지스터를 만들고 작동 원리
    리포트 | 7페이지 | 1,000원 | 등록일 2021.10.24
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    디지털 시계 회로 제작 보고서
    전기전자 기초실험 및 설계Term Project 보고서디지털 시계 회로 제작1. 실험 주제디지털 논리 회로를 이용한 디지털 시계 제작2. 실험 원리그림 1. 디지털 시계 회로그림 ... 1은 우리 조가 설계한 디지털 시계의 회로도이다. 이 회로를 구성하기 위해서는 ? 하부의 발진회로 및 분주회로와, ? 중반부에 74LS90과 74LS92로 이루어진 카운터의 동작 ... 원리, 그리고 ? 상부의 7-segment와 74LS47로 이루어진 7-segment 디스플레이 장치의 동작원리에 대한 이해가 필요하다.그림 2. 발진회로? 발진회로 및 분주회로
    리포트 | 6페이지 | 1,000원 | 등록일 2021.05.27
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    디지털 논리회로의 응용 멀티바이브레이터
    Exp#7. 디지털 논리회로의 응용 – 멀티바이브레이터실험 목표쌍안정 멀티바이브레이터인 래치와 플립플롭에 대해 이해하고 이를 응용한 회로를 구 성할 수 있다.단안정 멀티 ... 바이브레이터와 비안정 멀티바이브레이터에 대해 이해할 수 있다.실험 이론RS래치 (latch)래치는 1비트의 정보를 유지, 보관할 수 있는 회로이며 순차회로의 기본 요소이다. 래치의 정보 ... 에만 의해서 결정되는 복합회로를 설명하지 못하기 때문이다.제어장치가 있는 RS래치(Gated SR Latch)의 경우에는 clk신호에 따라서 래치의 작동이 제어된다. 통제신호인 Clk
    리포트 | 12페이지 | 2,000원 | 등록일 2022.03.03
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    전기전자기초개론실험/기계공학실험 설계 텀프로젝트
    전기전자기초실험 및 설계Term Project 보고서Digital Counter Clock1. 실험 주제7-Segment와 IC 논리회로를 활용한 디지털 카운터 시계 ... 를 전부 다 사용하지 않는 경우도 있음을 알 수 있었다. 이렇게 텀프로젝트를 통해 한 학기 동안 전기전자기초실험 및 설계라는 수업에서 배운 내용을 응용하여 실제로 팀원끼리 회로를 제작하고 실제로 구동을 해보면서 원리를 더 정확하게 배우게 되는 계기가 되었다. ... (Digital Counter Clock)2. 회로도그림 1 디지털 시계 회로그림 1은 7-Segment와 IC 논리회로를 활용한 디지털 카운터 시계이다. 이 회로를 구성하기 위해서
    리포트 | 7페이지 | 1,500원 | 등록일 2022.11.29
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    시립대 전전설2 Velilog 결과리포트 2주차
    4. 실험 결과ANDANDSchematic회로도구동 상태확인PIN설정설정ABX핀 설정값P63P67P191실제 핀버튼 스위치1버튼 스위치2LED 1①②③④HalfAdder반가산기 ... Schematic회로도구동 상태확인PIN설정설정ABSC핀 설정값P63P67P191P196실제 핀버튼 스위치1버튼 스위치2LED 1LED 2①②④5. 결론 및 토의토의-이번 실험 ... Velillog 2주차And 게이트와 HalfAdder 게이트Major전자전기컴퓨터공학부Subject전자전기컴퓨터설계실험2ProfessorStudent ID
    리포트 | 9페이지 | 1,000원 | 등록일 2021.04.16
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2025년 08월 07일 목요일
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