전자공학응용실험 - 다단 증폭기 결과레포트

소개글

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목차

1.실험제목
2.실험결과
3.고찰
4.고찰사함

본문내용

3. 고찰 :
첫 번째 실험에서 VDD를 6V로 주고 VG를 0.1V씩 증가시켜서 VD를 측정하여 Vth를 구하였다. 이때, 1.8V부터 VD가 감소하기 시작하여 1.9~2.2V사이에서 급격히 감소하는 것을 관찰할 수 있었다. 이론에서 1.7~8V사이에서 급격히 감소하는 것과 크게 다르지 않았다.

<중 략>

4. 고찰사항:
(1) 다단 증폭기의 입력단과 출력단은 입력 임피던스, 출력 임피던스 측면에서 어떤 조건을 만족해야 하는가?
-> 입력단 입장에서는 들어가는 입력 임피던스가 매우 커야 입력이 그대로 잘 들어갈 수 있다. 출력단에서는 출력 임피던스가 매우 작게 하여 이득이 줄어드는 현상을 막아야 한다. 그래서 CS증폭기와 소스팔로워를 다단증폭기에서 사용한다.

(2) 다단 증폭기에서 전체 전압 이득이 각 단의 전압 이득의 곱보다 작은 이유를 설명하시오.
-> 소스팔로워가 전압 이득이 1이 아니고 1보다 작지만 1에 가까운 이득을 가지고 있어 약간 감소한다. 그리고 다음 단계 증폭기로 넘어갈 때 출력 전압의 100퍼센트가 다음 단계의 입력 전압으로 들어갈 수 없다. 이상적이지 않기 때문에 어느정도 깎여서 들어간다

참고 자료

없음