"VHDL code"의 검색결과 입니다.

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"VHDL code" 검색결과 221-240 / 517건

gray code - binary code 변환

어 3개의 multiple output이 나오는 모듈을 설계한다. 3개의 Karnough map을 이용하여 최적의 logic network을 구현하고, VHDL로 coding을 하 ... 하였다.이렇게 해서 compile을 했더니 성공적으로 compile되는 것을 확인 할 수 있었다. ( 그림 첨부)VHDL code위에 설명한 것처럼 coding한 vhdl code ... Homework1< Gray code conversion >제목3-Input Binary to Gray code conversion개요3개의 binary input 이 입력이 되

Non-Ai HUMAN
| 리포트 | 4페이지 | 1,000원 | 등록일 2006.11.15

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FPGA 기반 DSP - User Component 생성 및 구동 방법

Component 생성7-Segment User Component를 VHDL 로 생성시킴Qsys Tool을 이용하여 VHDL Component 로 변환- 생성된 User Component ... 하여 Application에 해당하는 코드를 C언어로 구현한다.앞서 생성된 HW 파트와 Application 코드를 Compile, Linking 하여 최종 Elf 파일을 생성한다.결과 확인 및 고찰

Non-Ai HUMAN
| 리포트 | 3페이지 | 1,500원 | 등록일 2015.05.14

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서울시립대 전자전기컴퓨터설계실험2 제06주 Lab05 Pre

하면, 100ns마다 Input의 상태가 바뀌며, Input A, B, C의 경우의 수 8가지에 따라 Output도 8가지의 경우의 수로 1:1 대응함을 알 수 있다. 따라서 코드를 넣 ... = 1일 경우, Output Z = I[1]임을 알 수 있다. 따라서 코드를 넣고 하드웨어를 동작시키면 bus switch 3이 Low일 경우 LED 1은 bus switch 1 ... 있다. 코드를 넣고 하드웨어를 통해 확인해보면, bus switch 8이 1일 경우 LED 1, 2는 bus switch 1, 2의 상태와 동일할 것이다. 또한 bus switch

Non-Ai HUMAN
| 리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04

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서울시립대학교 전자전기컴퓨터설계실험2 제04주 Lab03 Pre

, Input A와 Input B의 And 관계에 있다는 코드를 작성해 주었다.Add .v fileProject –> Add Source를 클릭하여 방금 생성한 .v Source File ... 1을 사용하기 때문에, 핀 설정에 대한 코드를 Datasheet에 나와있는 대로 다음과 같이 적고, Save한다.Port Name 및 핀 번호Pin Assignment ... 을 클릭한다.Behavioral SimulationBehavioral Simulation을 위한 Test Bench 코드를 작성하기 위해, Verilog HDL Module을 마우스

Non-Ai HUMAN
| 리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04

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04-논리회로설계실험-예비보고서

의 코드를 받아서 N bit의 2진 코드로 해독하는 디코더와 N bit의 2진 코드를 받아 2 bit로 부호화 하는 회로를 VHDL을 이용하여 설계할 수 있다.2. 예비 이론(1 ... ) 디코더(decoder) 란?- 해독기, 엔코더의 역동작- N비트로 된 2진 코드는 서로 다른 정보2 ^{N}개를 표현할 수 있다.- 디코더는 입력선에 나타나는 n비트 2진 코드를 최대 ... 2 ^{N}가지 정보로 바꿔주는 조합논리회로이다.- 인에이블(enable) 단자가 있는 디코더와 각종 코드를 상호 변환하는 디코더도 있다.(2) 엔코더 란?- 부호화기로도 불린다.

Non-Ai HUMAN
| 리포트 | 9페이지 | 2,000원 | 등록일 2016.05.13 | 수정일 2021.07.28

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논리회로설계실습-비교기-MUX-ALU-결과보고서

후 process문을 사용하여 동작적 모델링 VHDL 표현 방식으로 코드를 작성하였다. case문을 사용하여 각각의 기능 선택 비트의 경우에 따라 수행하는 연산을 출력 Y값으로 나다. ... 비트 이진수 Y를 출력하는 산술논리연산장치(ALU)의 동작을 이해하고 설계한다. 소스 코드 작성 시, 함수와 프로시저를 포함한 패키지를 사용하여 작성한다. 테스트 벤치 작성을 통해 ... ) 소스 코드ALU MainPackage(2) 테스트 벤치 코드(3) Wave Form3. 고찰(1) 조원1의 고찰주어진 산술논리연산장치(이하 ALU)를 가산기능에서는 함수를, 감산

Non-Ai HUMAN
| 리포트 | 8페이지 | 1,500원 | 등록일 2018.01.10

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논리회로실험 5주차 예비보고서

예 비 보 고 서5주차부울대수의 간소화(2)Verilog HDL code 이용분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 목적- Verilog ... HDL 에 대해 이해하고 기본적인 문법을 익힌다.- 부울대수를 Verilog HDL의 형태로 표현하는 방법을 이해한다.- Verilog HDL code로 QuartusⅡ를 이용 ... 요소들을 가지며, 디지털 하드웨어를 여러 계층 레벨에서 표현하고 검증할 수 있다.? HDL (Hardware Description Language)하드웨어 기술 언어로서 VHDL

Non-Ai HUMAN
| 리포트 | 4페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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기본 게이트 설계 결과보고서

Form5) 결과 분석- 예비보고서에서 수기로 작성했던 AND 게이트 코드로 VHDL에서 작성하여 시뮬레이션을 돌려본 결과 입력을 2개로 갖는 AND 게이트의 성질을 갖는 결과 ... 벤치 코드4) Wave Form5) 결과 분석- 예비보고서에서 수기로 작성했던 OR 게이트 코드로 VHDL에서 시뮬레이션을 돌렸다. 그 결과 입력을 2개로 갖는 OR 게이트의 성질 ... - 예비보고서에서 수기로 작성했던 코드로 VHDL에서 작성하여 시뮬레이션을 돌려본 결과 F=X'+YZ의 진리표를 만족하는 결과가 나타났다. 시뮬레이션을 돌리기 전에 테스트 벤치 코드

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| 리포트 | 8페이지 | 1,000원 | 등록일 2014.07.25

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반가산기 & 전가산기 결과보고서

Form(4) 결과 분석- 예비보고서에서 작성했던 코드를 VHDL에서 작성하여 시뮬레이션을 돌려본 결과 진리표를 만족하는 결과가 나타났다. Schematic Design 기능을 활용 ... 분석- 예비보고서에서 작성했던 코드를 VHDL에서 작성하여 시뮬레이션을 돌려본 결과 전가산기의 진리표를 만족하는 결과가 나타났다. 구조적 모델링 기법도 활용하여 시뮬레이션을 돌렸 ... 코드동작적 모델링자료 흐름 모델링2) 테스트 벤치 코드3) Wave Form(2) Schematic Design1) Schematic 설계2) 테스트 벤치 코드3) Wave

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| 리포트 | 9페이지 | 1,000원 | 등록일 2014.07.25

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실험5. Decoder & Encoder 예비보고서

: 김경수 김지승실험5. Decoder & Encoder1. 실험 목적디코딩(decoding)과 인코딩(encoding)의 코드변환 동작에 관해 실험하고 그 동작원리를 이해한다.2 ... 이 존재하는 것이다 만약 n개의 입력이 들어오면 2의n승만큼의 출력이 존재한다. 보통 독립형의 집적 IC회로에 쓰이고 VHDL 이나 Verilog같은 하드웨어 언어 수단으로서 복잡 ... 는 기본적으로 디코더와 반대의 기능을 하는 조합 논리회로이다. input에서 10진수 혹은 8진수를 받아 output에서 2진수나 BCD와 같은 코드로 변환해준다. 2n개의 입력

Non-Ai HUMAN
| 리포트 | 10페이지 | 1,000원 | 등록일 2017.12.07

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BCD to Excess-3 Code Conveter

BCD to Excess-3 Code ConveterIntroductionVHDL code를 이해하고 BCD to Excess3 code converter logic을 VHDL ... /timing simulation을 실행시킨다. 그리고 board에 download하여 실제 동작상태를 확인한다. VHDL code를 확장시켜 logic equation으로 표현 ... ource code를 입력한다.이 코드는 case문을 사용하여 출력 “bcd”의 상태를 정의해 주고 있다. 출력 ex3를 입력이 들어올 때마다의 값을 정의하여 주고 있다.s

Non-Ai HUMAN
| 리포트 | 15페이지 | 1,500원 | 등록일 2010.11.02

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논리회로설계실험 프로젝트 8Bit 계산기

) 69 + 686) 조원 학번 마지막 두 자리 덧셈16 + 692. 관련 기술 및 이론(1) BCDBCD(Binary-coded decimal) 코드는 우리말로 ‘이진화 십진법 ... ’ 이라 한다. 십진법의 숫자들을 이진법으로 타나낸 비트들이 연속적으로 나열되어 있다. 보통 8421코드를 의미하는데, MSB부터 8, 4, 2, 1로 지정되어있다.BCD 코드의 4 ... 에 BCD코드를 사용하면 십진법의 계산이 가능하다 하지만 사람이 계산할 경우 BCD코드를 십진법으로 변환 한 후에 다시 BCD코드로 변환해주어야 하는 단점이 있다.십진수를 이진수

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| 리포트 | 11페이지 | 2,000원 | 등록일 2015.04.17

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06 논리회로설계실험 결과보고서(순차회로)

를 설계해본다.2. 실험 결과실험 1. JK 플립플롭 VHDL 코딩(1) JK FF 진리표JKQ(T+1)00Q(t)01010111Q’(t)(2) 설계 내용1) 소스 코드2) 테스트 벤치 ... 논리회로설계 실험 결과보고서 #6실험 6. 순차회로 설계1. 실험 목표JK 플립플롭을 VHDL을 이용해 설계해본다.레지스터에 대해 이해하고 VHDL을 이용해 시프트 레지스터 ... 3) Wave Form4) 결과 분석VHDL을 이용하여 JK 플립플롭을 설계하였다. JK 플립플롭은 입력 J와 K 에 따라 동작이 달라지는데 이를 위해 동작적 구문의 if

Non-Ai HUMAN
| 리포트 | 7페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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순차회로 설계 - 카운터 결과보고서

. 또 클럭 분주기의 기능을 이해하고 VHDL 코딩의 시뮬레이션에 활용한다.2. 실험 결과- 실험 1. 4비트 비동기식 업카운터 설계(1) 소스 코드- 변수 Y에 2진법으로 0~9 ... 회로설계 실험 결과보고서 #8실험 8. 순차회로 설계 - 카운터1. 실험 목표- 카운터의 종류와 각각의 기능에 대해서 이해를 하고, 이해한 내용을 바탕으로 VHDL 코딩 실습을 한다 ... 까지 오름차순으로 값이 카운팅되면 해당하는 수를 1개의 7 segment로 출력하는 카운터이다.- 업카운터의 기본 주파수를 2Hz로 설정하고 VHDL 모듈을 코딩하였다.- RoV

Non-Ai HUMAN
| 리포트 | 6페이지 | 1,000원 | 등록일 2014.07.25

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01 논리회로설계실험 결과보고서(And, or gate)

논리회로설계 실험 결과보고서 #1실험 1. 기본게이트 설계1. 실험 목표VHDL을 이용하여 AND gate와 OR gate를 설계한다.각 게이트를 설계 할 때, 동작적 모델링 ... F*************) 소스 코드동작적 모델링자료 흐름 모델링3) 테스트 벤치 코드4) Wave Form(1) 동작적 모델링 결과(2) 자료 흐름 모델링 결과5) 결과 분석 ... 는 것을 확인 할 수 있다.(2) OR GATE1) 진리표입력 X입력 Y출력 F0000111011112) 소스 코드동작적 모델링자료 흐름 모델링3) 테스트 벤치 코드4) Wave

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| 리포트 | 7페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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07 논리회로설계실험 결과보고서(RoV)

) 소스 코드2) 결과3) 결과 분석장치에 부착된 스위치를 통해 led를 점등시키기 위해 vhdl을 이용해 설계하였다. case 문을 이용하여 스위치를 뜻하는 입력 SW 값에 따라 ... 논리회로설계 실험 결과보고서 #7실험 7. RoV Lab7000 사용법1. 실험 목표RoV-Lab7000이 목표에 맞게 동작하도록 VHDL을 이용하여 설계한다.led와 7 s ... 입력에 따라 led 점등이 되는 것을 확인 할 수 있다.실험 2. 7 segment에 HELLO 출력1) 소스코드2) 결과3) 결과 분석if문에서 입력 digit_con의 각 자리

Non-Ai HUMAN
| 리포트 | 8페이지 | 2,000원 | 등록일 2014.09.27 | 수정일 2016.03.26

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03 논리회로설계실험 결과보고서(병렬가산기)

계산이 200ns동안 유지되는 이유는 테스트벤치에서 ‘wait for 100ns’ 구문 때문이다.실험 1. 10비트 병렬 가산기를 설계하시오(2) VHDL 코딩1) 소스코드2 ... ) 테스트 벤치 코드3) Wave Form4) 결과 분석이번엔 VHDL을 이용하여 병렬 가산기를 설계하였다. 매우 간단하게 설계가 되었는데,SUM ... 가산기3) 테스트 벤치 코드4) Wave Form5) 결과 분석8비트 병렬 가산기를 schematic & 모듈화 방식을 사용하여 설계하였다. 먼저 Full Adder를 sc

Non-Ai HUMAN
| 리포트 | 5페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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쿼터스 프로그램을 이용한 VHDL 실습(결과 포함)

실험 목적 : 쿼터스 프로그램을 이용한 VHDL 설계 결과와 스케메틱 설계 결과를 비교하고, 쿼터스 프로그램이 익숙해지도록 하기 위함차 례P r o j e c t 생 성D e s

Non-Ai HUMAN
| 리포트 | 7페이지 | 2,000원 | 등록일 2015.05.30

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서울시립대학교-전자전기컴퓨터설계실험2-제07주-Lab06_Pre

Simulation Result를 확인하면, clk1 or clk2가 발생할 때마다 output a or b가 변하는 것을 볼 수 있다. 따라서 코드를 넣고 하드웨어를 동작시키면 bus ... _in의 값을 q[3]에 넣어주는 것이다. 따라서 하드웨어에 코드를 넣고 동작시킨다면, bus switch 2를 올린 상태에서 button switch 1을 누를 때 ... , Register and SIPO, 서울시립대학교.Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소.Flip-flop, Wikipedia.

Non-Ai HUMAN
| 리포트 | 6페이지 | 1,500원 | 등록일 2017.09.04

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VHDL을 이용한 VGA Pattern Generator 설계

다.⑵ VHDL먼저 VGA_State1의 소자의 코드이다.라이브러리와 입출력포트를 지정해주고21줄~23줄 내부변수를 선언해준다.26~33줄 2분주코드를 나타낸다.35~52줄 800x ... VHDL 및 실습ReportVGA Pattern Generator제출일2013년 5월 19일최종기한2013년 5월 20일담당교수최 종 성 교수님학과전 자 공 학 과학번 ... 2009144029이름우 경 제1. 실습명 : VGA Pattern Generator2. 실습목표 :① 3색 세로줄 패턴을 VHDL로 설계 및 DE2동작확인하기② 3색 본인이름을 VHDL

Non-Ai HUMAN
| 리포트 | 16페이지 | 2,000원 | 등록일 2014.05.31 | 수정일 2014.06.02

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