"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,421-1,440 / 2,110건

기본논리회로 및 부울 대수, 회로의 간소화 및 Exclusive OR 회로

기초전자공학실험2실험날짜: 2008, 9, 121주차 기초전자공학실험21.Title기본논리회로 및 부울 대수, 회로의 간소화 및 Exclusive OR 회로2.Name금요일 오전 ... (Exclu있다.2변수 맵3변수 맵4변수 맵5.Simulation실험 1. 다음의 회로를 부울 대수의 공리 및 정리를 이용하여 두 회로가 같음을 증명하여라.회로1-1문제에서 주어진 데 ... 위하여 2번째 회로를 만들어 시뮬레이션 해보았다.결과는 위와 같았다. 먼저 처음에 시뮬레이션 해본 회로 1-1과 동일한 것을 확인할 수 있었다.이번 1번 실험은 부울 대수의 기본

리포트 | 40페이지 | 3,000원 | 등록일 2010.10.16

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[발광디스플레이 실험] CNT emitter의 전기적 특성 측정

실험 제목: CNT emitter의 전기적 특성 측정실험 날짜: 2011. 11. 24.실험 목적CNT emitter 소자를 조립하고, 고진공과 저진공에서 I-V c ... haracteristic을 측정하여 CNT emitter의 전기적 특성을 분석한다.4. 실험 도구 및 실험 방법1) Experimental instruments and Samples은풀 ... , power supply, multi meter, computer) : IV 특성 측정보호회로 : multi meter로의 과부하 방지Power supply 신호 변환 장치

리포트 | 6페이지 | 5,000원 | 등록일 2011.12.28

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Lab#5]플립플롭 래치 IC 실습

[실습 같은 R-S FF logic symbol에 해당하는 회로를 구성하기 위하여 TTL 74LS00 NAND gate IC의 전원, 입력, 출력 핀 번호를 먼저 기입하고 회로 ... 값을 얻을 수 있다. 이는 이후에 나올 카운터 원리의 가장 기초적인 역할을 한다고 생각된다.[실습 2]_NAND gate 회로를 이용한 CLK 있는 R-S Flip Flop 회로a ... )그림과 같은 회로에서 NAND gate 핀 번호를 기입하고 CLK있는R-S FF 회로를 구성한다.b)각 R,S입력에 대한 single pulse(CLK)의 up edge, 즉

리포트 | 17페이지 | 1,000원 | 등록일 2011.06.02

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JFET 및 MOSFET의 바이어스 회로 실험 예비레포트

JFET 및 MOSFET의 바이어스회로 실험1. 실험목적1) JFET와 MOSFET의 바이어스 회로에 대한 이론적 이해를 위해 선학습한다.2) JFET와 MOSFET의 여러 가지 ... 바이어스 횔를 구성하고 분석함으로써 직류 바이어스에 대한 개념을 명확하게 이해하고 실험을 통하여 이를 확인한다.2. 실험장비-JFET 2N5458, 저항 100Ω, 10㏀ ... 의 초대규모집적회로(VLSI)는 MOSFET으로 만들어진다. 또한 MOSFET은 아날로그 집적회로설계에도 많이 이용되고 있다.● JFETBJT가 2개의 PN접합을 가지고 있는 것

리포트 | 4페이지 | 1,000원 | 등록일 2011.12.19

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가산기_및_감산기_예보&결보

감산기에 대한 실험이다. 회로도는 XOR 게이트 및 AND 그리고 NOT 게이트만 사용하였기 때문에 실험 회로 꾸미는 것에는 아무런 문제 없었지만 결과 데이타가 제대로 나오지 않 ... 아 무척 어려웠다. 또한 새로운 실험기판으로 실험을 하였지만 역시 결과 데이타가 제대로 나오지 않았다. ※ 회로에 대한 이론 (위에서 이론값을 써 놓았기 때문에 다시 정리 ... ombinational logic network that adds 3 binary bits. From the truth table we can show that⇒ 이번 실험은 반 가산기 및 반

리포트 | 5페이지 | 2,000원 | 등록일 2010.10.04

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서강대학교 디지털논리회로실험 텀프로젝트

- 디지털논리회로실험 최종 보고서 ?Coffee House2013. 12. 17성 명소 속전자공학과학 년학 번지 도 교 수김영록 (인)0. 목차1. 서론2. 본론(1) Block ... 에 AEBO의 출력 w와 MSB를 제외한 현재금액의 나머지 bit들을 and gate로 묶어 현재금액이 qo[3..0]으로 그대로 나가도록 하였다.이제 추가적인 비교기 회로를 살펴보 ... 고 싶을 때 이 button을 사용할 수 있도록 하였다. 이제 구체적인 회로에 대한 기능설명은 아래의 본론에서 하도록 하겠다.2.본론(1) 전체 block diagram전체

리포트 | 36페이지 | 3,500원 | 등록일 2014.01.02

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[디스플레이 시스템 실험] LED

Display system laboratory 7th experimentLED에 대한 이해1. 실험 목적LED 전광판의 광학적 특성에 대해서 알아보고, 회로의 구동시 오실로스코프 ... 다. Gate가 열렸을 때 어떤 파장이 들어 가고 있는지 같은 것이 중요하다고 생각 한다. 그래서 세 개의 실험이지만 어차피 궁극 적으로 하나로 모이므로 위의 것을 동시에 말하도록 하 ... 어 보여주므로 gate 와 gate 사이가 16칸임을 알 수 있다.또한 이 실험에서 보아야 하는 것은 그래프가 완벽한 펄스 파형이 아니라는 것인데, data 가 인가 된 후 데이터

리포트 | 37페이지 | 5,000원 | 등록일 2012.01.01

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부울대수와 논리식의 간소화(결과)

' B를 표시하시오.표2-10 (이론/ 실험은 하지 못해서 실험값은 적지 않음)ABXY000000+5555+50055+5+50555.(a) NAND gate를 이용한 다음 회로 ... 회로를 완성하여 표 2-1을 완성하시오.표 2-1(이론/실험)AXY05 / 4.9870 / 0.022+50 / 0.0295 / 4.2432.(a) 그림 2-2와 같이 회로를 완성 ... 05 / 4.341+55 / 4.993AY05 / 2.549+55 / 4.145(b) 그림 2-3과 같이 회로를 완성하여 표 2-4를 완성하시오.표 2-4(이론/실험)AY00

리포트 | 5페이지 | 1,000원 | 등록일 2010.07.27

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플립플롭 (Flip-Flop)

이 반대로 바뀌는 기능을 수행한다.실험 4.74LS76을 이용하여 T Flip-Flop을 제작하여 확인하라.위의 회로는 74LS76을 이용하여, 문제에서 주어진 대로 회로를 구성한 것 ... Results1.실험1A.Data▶ NAND Gate를 이용한 SR Latch를 제작하여 확인하라.CLK S R = 0 0 0 →= 1 0 (No change)CLK S R = 1 ... 실험은 NAND Gate를 이용한 SR Latch를 제작하여 확인하는 실험으로 7400 1개(NAND게이트)를 사용하여 SR Latch를 구성하였다. 보드에 소켓을 이용하여 실제

리포트 | 29페이지 | 3,000원 | 등록일 2010.10.16

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2. CMOS회로의 전기적 특성[예비]

☞ 시뮬레이션 결과 NOR Gate의 특성을 보인다.2. 실험에서 사용하는 Philips 74HC04N의 데이터시트의 값을 이용하여 HC-CMOS logic family의 Logic ... 1. CMOS Inverter의 동작에 대해 설명하시오. 또한, CMOS NAND 게이트와 NOR 게이트의 회로도를 그려 보시오.기본적인 CMOS Inverter는 왼쪽 회로 ... 은 5.0V가 된다. 입력전압이 5.0V일 때는 반대로 NMOS가 on상태가 되고 PMOS가 off상태가 되어 출력전압은 0V가 된다. 따라서 이 회로는 논리적으로 인버터의 역할

리포트 | 4페이지 | 1,000원 | 등록일 2011.07.05

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[교육심리학의 성격과 영역] 교육심리학의 개념적 기초(교육심리학의 개념과 발달 및 영역, 연구방법) 및 이론적 기초(교육심리학 접근방법)

한다. 초기 교육심리학은 골턴(Galton, 1882-1911)의 유전형질과 개인차의 연구, 분트(Wundt)의 최초 심리학 실험실을 건설하여 심리학의 실험적 연구를 하였다. 20세기에 들 ... (Skinner)는 성장과 발달, 학습, 성격과 적응, 측정과 평가, 교수와 지도 등을 들고 있으며, 게이츠(Gates)는 발달, 학습, 측정과 평가, 성격과 적응으로 나누어 그 영역 ... 적 이론을 확립하기 위하여 과학적 실험적 방법을 주로 사용하며 행동수정 행동요법 등의 응용행동분석의 발전에 큰 영향을 미쳤다.초기에는 자극과 반응(S-R)에 관심을 가졌지만 신행동

리포트 | 6페이지 | 2,000원 | 등록일 2015.10.10

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아주대논리회로실험 9장 가산기감산기 결과(문답+빵판비교+고찰)

수 있는데, 이는 예비보고서를 작성하면서 회로도를 그릴때 바보같이 AND, OR, NOT gate를 사용해서 소자를 불필요하게 3개나 썼다. 하지만 실험 당일날 효율적으로 AND ... this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반:조 :학 번:성 명 ... :1실험9. 예비 16조 허성인실험7장 결과 16조실험 3. 가산기와 감산기(1) 예비보고서에서 구상한 반가산기를 구성하고 그 결과를 확인하라.그림 3-1. 반가산기 회로왼쪽

리포트 | 7페이지 | 2,000원 | 등록일 2011.12.21

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5.래치와 플립플롭[결과]

-결과 보고서-1. 실험결과(1) 예비과제 (1)에서 구한 R-S latch를 구성한 후 출력을 측정하라.회로도시뮬레이션INPUT (V)OUTPUT (V)SRQQ2004.99V ... 은 입력이 11일 때, 출력이 11이 되어 불안정한 값이 나오는 반면, 위의 회로는 입력값이 11일 때, 이전 값이 반전되어 출력되는 것을 알 수 있다. 측정한 실험값이 이론에 잘 ... 를 보관, 유지하는 데 사용하는 특징이 있으며 순차회로의 기본 구성요소이다. 첫 번째 실험과 두 번째 실험에서는 R-S 래치와 R-S 플립플롭을 구성하여 실험해보고 두 방식의 차이점

리포트 | 4페이지 | 1,000원 | 등록일 2011.07.05

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[발광디스플레이실험] Photolithography

발광디스플레이 실험 Photolithography실험 목적 : Photolithography 공법에 대해 익히고, Photolithography시 etching time과 PR ... -exposure time에 의한 패턴의 상태 변화 정도를 알아 볼 수 있다.실험 이론 :박막 제조 공정1. 세척(Cleaning)1) 유기 세척2) 무기 세척2. 증착 ... ) Soft Bake(소프트 베이크)3) Photo exposure(노광) 노광이란 photo mask를 통해 자외선 영역의 빛을 조사(照射)함으로서 mask상에 형성된 미세회로 형상

리포트 | 8페이지 | 10,000원 | 등록일 2013.06.14

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[전기.전자.결과레포트] Mosfet 특성실험

.5600.4779.325213. 검토 및 고찰실험1. 드레인 전류 특성 측정실험자1 : 우리는 첫 실험에서 주어진 회로대로 실험을 구성하고 인가한 Vgs와 Vds의 변화에 따라 Id ... 면서 회로 구성은 어렵지 않았으나 다리가 4개 달린 MOSFET를 실제로 보면서 회로를 구성했다는 것에 의의를 두는 실험이였다. 또한, 다른 MOSFET실험을 해보면 좋겠다는 생각 ... 을 해보았다.실험자2 : 드레인 전류 특성 측정 실험으로 전자회로1 시간에 배운 내용을 실제로 측정 해 볼 수 있었으며 Vds가 0~1사이에서 전류가 급격하게 증가하는 것을 볼 수

리포트 | 2페이지 | 1,000원 | 등록일 2011.07.17

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로직회로실습 보고서

의 회로를 구현하고 NAND 게이트의 진리표대로 입력에 대해서 출력이 작동하는 것을 LED lamp를 통해 확인하시오. 그리고, NAND gate의 입력 A, B와 출력 X에 걸리 ... .953. 실습 토의 (실험결과 요약 및 질문 사항)이번 실험은 오차가 거의 없었다. 회로를 구성하는 부분에 약간 어려웠지만 회로만 이해하면 의외로 만들기 쉬웠다. 일단, NAND ... 디지털 회로는 0V와 5V만 사용하므로 0V를 0, 5V를 1로 표현할 수 있다. 그러므로 진리표에서 나타내는 0과 1은 0V와 5V를 말한다. 그러면 우리의 실험결과를 확인해보

리포트 | 3페이지 | 1,000원 | 등록일 2011.09.22

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2 port Or gate 설계

1 장 . 설계 ( 실험 ) 배경 및 목표 VHDL 을 이용하여 2 Port OR-Gate 설계한다 . 2 Port OR Gate 을 Data Flow Modeling 으로 구현 ... is Begin O = I1 or I2; end Dataflow;3 장 . 설계 ( 실험 ) 내용 및 방법 - WebPack 을 이용하여 2 Port OR Gate 에 대한 ... = 0 / or_gate /I1 = 1, / or_gate /I2 = 1 이와 같이 포트 값을 변화시키며 Output 값을 도출 .4 장 . 설계 ( 실험 ) 결과 2. Test

리포트 | 12페이지 | 1,500원 | 등록일 2010.09.09

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실험(3) 예비 3-12,13,전압분배 바이어스 공통 콜렉터,베이스 증폭기

예비 3-12,13 전압분배 바이어스 공통 콜렉터,베이스 증폭기실험 목적? NPN 전압분배 바이어스 공통 콜렉터, 공통 베이스 증폭기의 직류 및 교류 파라미터를 이해 ... (혹은 그냥 Active Mode, 능동 상태) - 증폭회로 구성에 사용함① Emitter - Base의 PN접합면에, Emitter보다 Base쪽에 더 높은 전압을 가하게 되 ... 한다.입력저항: 베타*컬렉터에 달아준 저항출력저항: {입력신호전원의 내부저항/베타}ll 에미터에 달아준 저항전류증폭도: 베타전압증폭도: 1(1) 교류 증폭기의 AC 등가회로 ( AC

리포트 | 8페이지 | 1,000원 | 등록일 2011.10.23

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Maxplus II를 이용한 디지털 논리 회로 실험

디지털논리회로 실험(Maxplus II)정보통신공학과Maxplus II 프로그램은 모든 설계를 프로젝트 중심으로 관리한다. 프로젝트에 포함된 설계 파일 및 컴파일한 파일, 환경 ... 하여 output이 제대로 출력되는지 확인한다. 사용자가 설계하여 만든 논리 회로를 하나의 블록으로 하여 더 큰 프로젝트에 넣을 수 있는데 이렇게 하기 위해서 1-bit Full ... .③ Exclusive - OR gate를 이용하여 비교기를 설계한다. 이 XOR gate는 두 값이 같으면 1이 나오고 다르면 0이 나오는 gate이다.④ 2-bit ripple carry

리포트 | 4페이지 | 2,000원 | 등록일 2010.11.03

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예비04_Multiplexer Demultiplexer

하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 10.10.04 (월)과목명: 논리회로실험조교명: 유창승분 반: 월 ... 과 연결이 끊어진 것과 같다.III. 예비학습(1) 다음 회로도의 AND gate, OR gate와 Inverter를 결선하여 2x1 Mux를 설계해 보시오.※ 도움말 : AND ... 실험4 예비보고서전자공학도의 윤리 강령 (IEEE Code of Ethics)(출처: http://www.ieee.org)나는 전자공학도로서, 전자공학이 전 세계 인류의 삶

리포트 | 5페이지 | 2,500원 | 등록일 2010.10.19

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