"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,361-1,380 / 2,110건

4-bit Adder 회로 설계

설계실습 10. 4-bit Adder 회로 설계학과전자전기공학부학번조/이름담당교수수업시간실험일1. 목 적조합 논리회로의 설계 방법을 이해하고 조합 논리회로의 한 예로 가산기 회로 ... (NOR-NOR) 로직 회로를 설계하여라.(4) XOR gate를 이용하여 보다 간소화된 다단계 조합 논리회로를 설계하여라.(5) 4-bit Adder 회로를 위의 전가산기 회로를 이용해 설계하여라. ... 를 설계한다.2. 실험 준비물- 직류전원장치 1대- 멀티미터 또는 오실로스코프 1대- Bread Board 1대- 저항(330Ω) 10개- Hex Inverter(74LS04) 4

리포트 | 3페이지 | 1,000원 | 등록일 2010.10.08

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기본논리회로 및 부울대수, 회로의 간소화 및 Exclusive OR회로

를 통하여 회로의 형태와 사용된 Gate에는 차이가 있었지만 두 개의 회로가 같음을 확인 할 수 있었으며 분배법칙 성립 여부를 확인 할수 있었습니다.3.실험3A.Data첫 번째 회로 ... 과 우변이 동일함을 확인한다.5)을 K-map 을 이용해 부울함수를 유도하고 유도한 부울함수를 NAND Gate로만 회로를 구성하여 시뮬레이션 결과와 비교한다.6) 1~5)번 실험 ... 가하기 위하여 아래와 같이 시뮬레이션 회로를 구성하였다.실험2 앞면실험2 뒷면실험과정·AND Gate에 해당하는 IC칩과 OR Gate에 해당하는 IC칩을 이용하여 핸드아웃

리포트 | 75페이지 | 3,000원 | 등록일 2010.06.09

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[논리 회로, 회로 이론] 논리 회로 실험 AND, OR, NOT 게이트의 이해

// 4009, 4049 4069, 45844) 실험 방법4.1 AND 게이트의 실험AND 게이트에 해당하는 7408칩을 이용하여 키트에 회로를 구성한 뒤 입력에 대한 출력표 ... 를 작성하여 위 이론 부분의 AND 게이트 부분의 진리표와 동일한지를 확인한다.4.2 OR 게이트의 실험OR 게이트에 해당하는 7432칩을 이용하여 키트에 회로를 구성한 뒤 입력 ... 에 대한 출력표를 작성하여 위 이론 부분의 OR 게이트 부분의 진리표와 동일한지를 확인한다.4.3 NOT 게이트의 실험NOT 게이트에 해당하는 7404칩을 이용하여 키트에 회로를 구성

리포트 | 3페이지 | 1,500원 | 등록일 2005.08.08

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FET증폭기

실험 6. FET 증폭기1.이론개요BJT의 공통 베이스(CB), 공통 컬렉터(CC), 공통 이미터(CE) 증폭기에 해당하는 공통 게이트(CG), 공통 소스(CS), 공통 드레인 ... 적으로 작아 디지털 회로에 주로 사용되고 있다.BJT는 베이스 전류 IB를 조절하여 출력되는 콜렉터 전류 Ic를 제어하므로 전류 제어형 소자라고 하며, FET는 게이트 전압 VGS를 조절 ... 을 깊이 있게 고찰하기 위하여 그림2-1(a)은 n 채널 JFET에를 드레인에 인가하고 소스를 공통으로 구성한다.게이트 전압를 게이트에 인가하며 이러한 회로구성을 그림 2-1(a

리포트 | 10페이지 | 1,000원 | 등록일 2012.03.16

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FET bias 회로 (pre report 이론상세)

Analog circuit Lab.pre-report #5(FET 바이어스 회로)전자정보시스템 1조< 실험 제목 >FET 바이어스 회로< 실험 목적 >(1) 여러 종류의 FET ... 형 MOSFET의 Drain 궤환 바이어스 회로의 동작점을 결정한다.(5) 바이어스 동작점의 안정성을 이해한다.< 실험 이론 >1. FET 개념FET는 전개효과(Field ... 바이어스 회로 동작을 이해한다.(2) JFET의 전압 분배기 바이어스 회로의 동작점을 결정한다.(3) 공핍형 MOSFET의 Zero 바이어스 회로의 동작점을 결정한다.(4) 증가

리포트 | 8페이지 | 1,000원 | 등록일 2011.01.12

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[LCD실험]a-Si, Poly Si, TFT 특성 측정

urrent vs. Gate voltage의 변화를 보는 Transfer curve 이다.4. 실험결과A. UV-Vis spectrometer를 이용한 Transmittance 측정 ... a-Si, Poly Si, TFT 특성 측정1. 실험목표: Sigma Plot을 이용하여 a-Si과 Poly-Si의 Output, Transfer Curve, mobility ... , conductance, optical bandgap 등을 구하고 transmittance를 측정하여 optical bandgap을 구해본다.2. 실험장비a-Si (5000A

리포트 | 8페이지 | 6,000원 | 등록일 2012.07.11

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설계실습 8. 논리함수와 게이트 예비

설계실습 8. 논리함수와 게이트1. 목 적여러 종류의 게이트의 기능을 측정을 통하여 실험적으로 이해한다.2. 실험 준비물- 직류전원장치 1대- 오실로스코프 1대- Function ... Generator 1대- Bread Board 1대- Toggle Switch 2개- Quad 2 Input AND Gate (74LS08) 2개- Quad 2 Input OR ... Gate (74LS32) 1개- Hex Inverter (74LS04) 2개- Quad 2 Input NAND Gate (74LS00) 3개- Quad 2 Input NOR

리포트 | 3페이지 | 1,500원 | 등록일 2010.11.12

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MOSFET 특성실험

.35481.4011고찰이번 실험은 N-Channel MOSFET의 특성에 대해 알아보는 실험이었다. MOSFET은 Gate전압의 크기에 따라 전류의 량이 조절되는 소자라고 알고 있 ... 1. 실험제목 : 절연게이트 FET의 특성 실험2. 실험목표절연게이트 FET(Insulated Field Effect Transistor)의 동작원리를 배운다.3. 이론적 배경1 ... . MOSFET란MOSFET는 흔히 MOS라고 약하여 부르며 반도체 기억소자로 집적도를 높일수있는 특징이 있어 대규모 집적회로에 많이 쓰인다.MOSFET도 역시 전도채널의 형식

리포트 | 4페이지 | 1,000원 | 등록일 2011.10.28

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쌍안정 회로와 RS 래치

쌍안정 회로와 RS 래치1. 실험목적쌍안정 회로의 동작을 이해하고, 메모리 기본 소자의 개념을 파악한다.2개의 NOR 게이트 또는 2개의 NAND 게이트로 RS 래치를 구성 ... 하여 동작을 실험한다.래치가 어떻게 SPDT 스위치의 동작에서 debounce 시키는지를 증명한다.4개의 NAND 게이트와 하나의 인버터를 가지고 gated D 래치를 구성하고, 실험 ... 지금까지 실험한 조합논리 회로는 그 순간 인가된 입력 조합에 의해 출력이 결정된다. 그러나 조합논리만으로는 대부분의 실생활 응용을 실현할 수가 없다. 조합논리 회로에 대응하는 순서

리포트 | 4페이지 | 1,000원 | 등록일 2012.11.20

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설계실습 8. 논리함수와 게이트 결과

를 사용하여 NAND, NOR, XOR 게이트의 진리표와 등가회로를 작성하고 두 입력의 모든 경우에 대해 출력 전압의 값을 측정하라.[ NAND Gate ]XYF ... 이유는 무엇인지 기술하라.- 설계 실습이 잘 되었다. 이번 실험은 논리회로를 구성하여 그 출력을 확인하는 것으로 특별히 영향을 끼치는 외부 요인이 거의 없어 잘 되었다.(4) 무엇을 느꼈는가? 이 설계 실습을 동하여 무엇을 배웠는가? ... 001011101110[ NOR Gate ]XYF001010100110[ XOR Gate ]XYF000011101110출력전압이 0 논리 값일 때 0.11V,1 논리 값일 때 4.40V를 나타내

리포트 | 3페이지 | 1,500원 | 등록일 2010.11.12

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설계실습 10. 4-bit Adder 회로 설계 예비

설계실습 10. 4-bit Adder 회로 설계1. 목 적조합 논리회로의 설계 방법을 이해하고 조합 논리회로의 한 예로 가산기 회로를 설계한다.2. 실험 준비물- 직류전원장치 1 ... 를 설계하여라.(4) XOR gate를 이용하여 보다 간소화된 다단계 조합 논리회로를 설계하여라.(5) 4-bit Adder 회로를 위의 전가산기 회로를 이용해 설계하여라. ... 대- 멀티미터 또는 오실로스코프 1대- Bread Board 1대- 저항(330Ω) 10개- Hex Inverter(74LS04) 4개- Quad 2 Input NAND Gate

리포트 | 3페이지 | 1,500원 | 등록일 2010.11.12

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디지털실험 - Positive edge triggered master-slave D flip flop 설계 결과레포트

을 이용한 회로도를 설계한다.4. 구성된 회로도가 진리표 대로 작동이 되는지 입력에 따른 결과값을 예상하여 본다.5. 실험을 통해 동작 결과를 검증해 본다.6. 실험 결과를 바탕 ... 때문에 여기에 reset과 clear를 추가하였다.2. 시뮬레이션 결과3. 실험 결과 사진 회로도SRCDQQ11↑001Q : 0.15916VQ : 2.2248VSRCDQQ10xx01 ... flip을 설계하여 이것의 동작 특성과 reset, clear의 기능을 이해하는 데 주목적이 있었다.매번 설계실험을 하면서 느끼는 것이 회로를 구성하는데 있어 주의할 점은 생각

리포트 | 5페이지 | 1,000원 | 등록일 2012.03.09

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브레드보드 디지털논리회로 실험

디지털논리회로 실험(브레드 보드)정보통신공학과1. 서론디지털 논리회로를 구현하여 실험하기 위해서는 디지털 논리 게이트를 회로로 구현할 수 있는 기판이 필요하다. 일반적으로 대부분 ... 시켜주기 위해서 만들어졌다.브레드보드는 납땜을 하지 않고도 논리게이트 반도체 칩을 연결할 수 있도록 고안되었으며, 회로의 연결이 용이하도록 다양한 기능을 가지고 있다.2. 실험 내용풀 ... 한 디지털 논리 게이트들을 연결하여 원하는 기능을 수행할 수 있도록 회로를 구현하는데 필요한 부가적인 장치가 필요하다. 브레드보드(breadboard)는 이러한 요구사항을 만족

리포트 | 2페이지 | 1,000원 | 등록일 2010.11.03

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멀티플렉서와 디멀티플렉서

Pspice 시뮬래이션실험1.NAND gates와 Inverter로 구성한 먹스의 회로와 결과74HC153 으로 구성한 먹스의 회로와 결과실험2.AND gates와 Inverter ... 1. 실험의 목표-멀티플렉서와 디멀티플렉서의 이론적 원리와 구조를 이해하고 설계할 수 있다.(1) 사전에 멀티플렉서와 디멀티플렉서의 이론적 원리를 회로구조와 진리표를 분석 ... 하여 이해한다.(2) 실험 1의 (1)(2) 와 (3)을 통해서 NAND gates와 Inverter를 이용해 구성한 멀티플렉서와 멀티플렉서IC인 74HC153을 이용해 구성한 멀티플렉서

리포트 | 14페이지 | 1,000원 | 등록일 2010.12.20

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실험 6. 시프트레지스터와 카운터 (Shift Register & Counter)

F/F을 이용한 4단 2진 Down 카운터(8) NAND gate를 사용하여 Count-Up과 Count-Down할 수 있는 회로를 설계하라.4단 JK 플립플롭을 구성해서, 앞 ... 에는 Count-Down 회로를 설계하였는데 Negative Logic으로 10진 카운터를 만들기가 어려워서 NAND gate를 달지 못해서 Down 카운터로만의 기능을 한다. 위 ... < 예비보고서 : 실험 6. 시프트레지스터와 카운터 (Shift Register & Counter) >< 목 적 >시프트 레지스터와 링 카운터의 동작 원리와 특성을 이해

리포트 | 5페이지 | 2,000원 | 등록일 2012.03.11

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전자회로2- TTL GATE

NAND GATE와 TTL회로 실험 결과랑 같은 것을 알 수 있다.이는 TTL 게이트가 NAND 게이트와 같은 역할을 한다는 것이다.그리고 또한 입력-출력 전압 특성 그래프도 직접 측정 ... 는지 확인한다.기초 실험 회로인 TTL(NAND) 게이트 회로실험에 쓰인 TR (2N3904)실험 방법 : ① 위의 회로와 같이 Berad Bord에 TR(2N3904) 5개 와 저항 ... 1HighHigh0NAND GATE 진리표TTL 게이트 실험 결과표입력출력001011101110⑥ 입력전압(Low-0.2V)을 점점 증가시키면서 출력전압이 0이 되는 점,입력전압

리포트 | 8페이지 | 2,500원 | 등록일 2011.04.17

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Lab(2) 논리게이트 회로 실습

를 표의 빈칸에 기입하고 검토 받은 후 다음 실습을 진행한다.[실습1]TTL7408 AND gate - 2N3904 NPN TR - LED Interface 회로?그림을 참고 ... 란에 기입하시오.입력A B출력(Y)실습 이론0 00 11 01 101100110Figure 2. TTL7400 NAND gate 조합회로 -> XOR gate· 실험 결과 : 홀 ... 의 NAND게이트를 이용하여 여러 가지 게이트를 만들 수 있다.[실습 3] NAND-OR gate 조합회로의 진리표 완성하기?아래 회로를 구성하여 입력 0000~1111에 대하

리포트 | 16페이지 | 1,500원 | 등록일 2010.06.23

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JFET 및 MOSFET의 특성 실험 예비 레포트

JFET 및 MOSFET의 특성 실험1. 실험목적1) JFET의 동작원리를 이해하고 전압-전류관계를 실험적으로 측정하여 드레인 특성곡선과 전달특성 곡선을 결정한다.2 ... ) MOSFET의 동작원리를 이해하고 전압-전류관계를 실험적으로 측정하여 드레인 특성곡선과 전달특성곡선을 결정한다.2. 실험장비-JFET 2N5458, 저항 100Ω, 10㏀-MOSFET(D ... )또는 MOS 트랜지스터는 금속막, 산화막, 반도체영역으로 구성된 트랜지스터의 일종이다. MOS 트랜지스터의 source와 drain은 실리콘 표면에 생성되며 gate의 양쪽에 배치

리포트 | 7페이지 | 1,000원 | 등록일 2011.12.19

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6.시프트레지스터와 카운터[결과]

을 카운트할 수 있으며, 업카운터이므로 0부터 15까지 증가한 뒤, 다시 0으로 돌아가 증가한다. 위의 시뮬레이션 결과로부터 회로가 올바르게 동작함을 알 수 있다.② NAND gate ... 와 비교해보면 회로는 더 복잡하지만, 클럭이 동시에 입력되기 때문에 지연시간이 더 짧다. 위의 동작 특성을 보면 0에서 9까지 증가한 뒤, 다시 0으로 돌아가 증가한다.2. 실험결론 ... 을로를 이용하여 첫 번째 실험과 같이 동작하는 지 확인하는 실험이었다. 각 플립플롭의 Preset단자에는 AND gate가 연결되어 한쪽 단자를 공통 입력으로 묶어 Preset

리포트 | 11페이지 | 1,000원 | 등록일 2011.07.05

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기초전자 실험 1학기 기말과제

공급전압으로 AND, OR, NOR, NAND Gate를 구성한다.논리 Gate의 출력을 이용하여 자유롭게 디스플레이한다.[2] 실험 장비· 계측장비 : DMM· 부품만능기판 (1개 ... 를 얻게 된다. 정밀한 장비에서는 RIPPLE전압이 치명적인 영향을 주기 때문에 복잡한 평활회로를 필요로 하게 된다.논리 GateAND Gate입력 단자가 A, B 두 개일 때, 이 ... 들이 결합되는 네 가지 조합에 대하여 논리곱과 동일한 결과를 출력하는 회로. HYPERLINK "javascript:self.close();" OR Gate입력단자가 A, B 두 개

리포트 | 7페이지 | 1,500원 | 등록일 2010.10.19

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