"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,481-1,500 / 2,110건

아주대 논리회로실험 실험4 결과보고서

윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2011.10.5과목명: 논리회로실험교수명 ... 04 1개를 이용해서 멀티플렉서를 구성하는 실험이다. 회로도대로 IC를 빵판에 결선한다. 입력선으로는 2개의 선택입력(S0, S1), 1개의 enable(E), 4개의 데이터 입력 ... 멀티플렉서 기능을 하는 IC로써, 1번 실험과는 다르게 한 개의 IC로 멀티플렉서를 구성하였기 때문에 매우 간단하게 결선을 할 수 있었다. 입력선 들을 회로도대로 연결해주고 출력선

리포트 | 7페이지 | 1,000원 | 등록일 2012.02.29

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FET 특성분석 및 Single-Stage Amp 설계

= 100mV 일때의 출력 파형, Av=20B. Common Gate Amplifier : 실험 최대 증폭률 = 20그림 7. Common Gate Amp. 회로도그림 7 ... 차이는 실험 조건의 오차 범위 ±10% 범위 내에 들어오는 결과였다.2.3 입출력 특성을 비교하고 각 회로의 장단점을 설명한다.Common Source Amp.매우 높은 입력저항상대적으로 높은 출력 저항적당히 높은 전압 이득Common Gate Amp.낮은 입력 저항 ... 한다.2. Single-Stage Amplifier2.1 설계한 CS, CG, CD 회로를 구성하여 bias를 잡아본다.A. Common Source Amplifier : 실험 최대

리포트 | 10페이지 | 1,500원 | 등록일 2009.11.11

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아주대논리회로실험 8장.카운터 예비(기본구성+빵판+예상결과)

this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반:조 :학 번:성 명 ... 므로 클락은 첫 번째 플립플롭에만 인가하면 된다. 왼쪽에 첨부한 사진이 bread board에 회로를 구성한 사진이다.실험2) 3진 Counter ?동기식 CounterCLKA'B'AB ... 는 형태인데, 그 이유는 3진 카운터이기 때문에 따라서 각각의 클락에 따라 LED가 점등된다. 왼쪽에 첨부한 사진이 bread board에 회로를 구성한 사진이다.실험3-1) 7-s

리포트 | 6페이지 | 1,500원 | 등록일 2011.12.21

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BJT와 저항을 이용하여 Inverter 및 Nor-gate 를 설계

1장 OverviewA. 설계 목표BJT와 저항을 이용하여 Inverter 및 Nor-gate 를 설계B. 이론적 배경1. NOT Gate(Inverter)NOT 게이트는 1개 ... 입력과 1개의 출력으로 구성된 논리게이트이며, 이 게이트는 입력신호를 반전시키는 기능을 하므로 인버터(Inverter)라고 부른다.진리표스위칭 회로게이트 심볼트랜지스터 회로논리식 ... 동작파형2. Nor gate입력이 모두 0인 경우에만 출력은 1이 되고, 입력 중에 하나라도 1이 있는 경우는출력은 0이 된다.1 이 게이트는 OR 게이트와는 반대로 작동하는 게이트

리포트 | 15페이지 | 1,000원 | 등록일 2011.06.07

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실험1. PSPICE 이론 및 실습 예비보고서

1. 실험 목적본 실험을 통해? 이론을 통해 배웠던 각종 회로를 시뮬레이션 한다.? 실험을 시작하기 전에 회로를 미리 시뮬레이션을 통해 미리 결과를 알아본다.2. 관련 이론2.1 ... Ex) .ENDComment 카드- 주석처리, 회로 표현과 무관(*, $, ;)Ex) * R1 = 1K저항- Rxxxxx N1 N2 ValEx) R1 11 10 1K커패시터 ... 되는 전류IG(J10) JFET J10의 GATE로 유입되는 전류AC해석- V(2,3): 마디 2~3의 전압 진폭- VM(2): 마디2와 접지 사이의 전압과 진폭- VDB(R1

리포트 | 5페이지 | 2,000원 | 등록일 2012.03.19

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[논리회로실험]실험7예비보고서 복호기와 부호기

시켜 NOT gate를 지나 ‘0’이 회로에 입력되면 A,B,C모두 ‘0’이 입력되어 NAND gate를 거치면 모두 ‘1’이 출력되어 0111값을 가지게 된다.이 작동 원리 ... Ⅰ. 목 적카운터를 이용해 디코딩(decoding)과 인코딩(encoding)의 코드변환 동작에 관해 실험하고 그 동작원리를 이해한다.Ⅱ. Review Question그림 9 ... 는 각 비트를 반전하여 보수를 취하면 10진수에서 9의 보수값이 되므로, 자기 보수 코드라고도 불린다. 먼저 Excess-3코드의 결과값을 유추하고 회로를 해석해 보

리포트 | 4페이지 | 1,000원 | 등록일 2010.04.12

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전자회로실험12 MOSFET 차동증폭기 결과보고서

이다. 이 증폭기는 서로 대칭되는 MOSFET들을 차등 쌍으로 구성할 때 나타나는 특징을 이용하는 직접회로로써 직접회로에서 중요한 위치를 차지하고 있다. 이 실험을 통해 학생 ... . 보고서 작성위의 실험순서 마다 결과 값 및 해석을 다 하였고,보고서 작성 순서에 따라 다시한번 요약정리 하였습니다.1) 그림의 회로에 대해 기대되는 다음 값들을 계산하시오.ⓐ 대신호 ... 결과보고서실험12. MOSFET 차동증폭기20080653212조권태영1. 실험 목적본장의 기본 목적은 차동증폭기 (differential amplifier)의 특성을 측정하는 것

리포트 | 12페이지 | 1,000원 | 등록일 2012.06.24

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Full-adder

이번 주 실험은 Block Diagram/Schematic File 대신 Verilog HDL File 을 이용하여 디지털 회로를 구현하고, Simulation 후에 Input ... Adder를 구현하였다.우선 Gate-Level Modeling방법으로 작성하기 전에 S와 C의 Function을 product of sums으로 표현하자. 실험 ①에서 S와 C ... 음을 확인할 수 있었다. 또한, sum of products의 회로를 설계한 후에 얻은 실험값과 product of sums의 회로를 설계한 후에 얻은 실험값이 같음을 진리표를 통

리포트 | 7페이지 | 3,000원 | 등록일 2010.01.29 | 수정일 2023.06.21

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실험 5. 래치와 플립플롭 결과보고서

- -실험 5. 래치와 플립플롭(1) 예비과제 (1)에서 구한 R-S latch를 구성한 후 출력을 측정하라.< R-S latch 회로도 >< 회로 구성한 모습 >< 인가한 전압 ... >결론적으로 NAND게이트로 구성된 래치회로에서는 입력S와 R이 Active low신호로 동작하여 S=1, R=1일 때는 회로의 출력 Q가 변하지 않으며 Q'도 변하지 않는다. S ... =0으로 하면 세트기능이 수행되어 출력 Q=1, Q'=0이 되고, R=0으로 할 경우에는 리셋기능이 수행되어 출력 Q=0, Q'=1이 된다. 물론 NAND 게이트로 구성된 래치회로

리포트 | 8페이지 | 3,000원 | 등록일 2011.01.11

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아주대 논리회로실험 결과7-복호기와 부호기

한 출력 값을 얻을 수 없었지만 회로를 차근차근 오류의 원인을 파악함으로써 오류를 찾아 정확한 회로로 실험하니 Excess-3 Code에 정확한 값을 얻을 수 있었다.5) 7 s ... egment 표시기를 갖는 BCD 카운터< 그림 8. 7-segement 표시기를 갖는 BCD 카운터 >※ 토의 사항이번 실험은 교재의 실험 회로의 오류로 정확한 실험 결과를 얻을 수 없 ... 실험 7. 복호기와 부호기(Decoder & Encoder)1. 목 적카운터를 이용해 디코딩(decoding)과 인코딩(encoding)의 코드 변환 동작에 관해 실험하고 그

리포트 | 5페이지 | 1,000원 | 등록일 2010.04.04

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(전실결과)DC모터 드라이버

------------------------------실험목적H-Bridge의 원리를 이해한다.Labview와 DAQ를 이용하여 DC모터를 제어할 수 있는 회로를 구성한다.DC ... 하여 PWM파형을 출력할 수 있다.좀더 정확한 모터 제어를 위해 필요한 방법을 알아본다.각 회로에 사용한 칩들의 기능과 목적을 이해한다.실험결과실험 1 : 발진회로발진회로 파형발진회 ... 로 회로도실험결과분석 : 발진회로는 크리스탈을 사용하여 어떤 일정한 주파수를 가지는 파형을 만들어내는 회로이다. 위의 회로도를 보면 슈미트트리거 인버터 칩과 Y2크리스탈을 이용해서

리포트 | 11페이지 | 6,000원 | 등록일 2012.03.21 | 수정일 2015.09.04

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논리회로실험 멀티플렉서와 디멀티플렉서 결과보고서

139 1개Ⅲ. 실험방법실험 1. 멀티플렉서(1) Enable 입력을 갖는 4x1 멀티플렉서를 74HC20과 74HC04를 이용하여 다음 회로와 같이 구성한다. 여기서, E ... 를 이용한 4*1 멀티플렉서와 동일하게 동작하는 것을 확인할 수 있었다. ● 실험1 정리 - 실험(1)에서는 모든 값이 ‘1’이 되어야 ‘0’이 나오는 NAND GATE의성질을 이용 ... 하여 회로가 구성되었다. 책에서는 NAND GATE을 사용했지만, AND GATE 와 OR GATE를 사용하더라도 같은 회로를 만들 수 도 있었다. S값을 그대로 보내거나 혹은

리포트 | 5페이지 | 1,000원 | 등록일 2010.03.20

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가산기와 감산기

부터는 전가 산기를 사용한다. - 반가산기는 2개의 입력과 2개의 출력을 필요로 한다.반가산기 진리표회로구성 XOR GATE(7486)와 AND GATE(7408) IC를 이용하여 반가산 ... A, 입력 B, 자리올림수 입력) 모두 대등하게 동작한다. 하지만 회로상 에서 3개 입력이 대칭되어 있다고 할 수 없다.전가산기 진리표회로구성 XOR GATE , AND GATE ... 로 구현한 반감산기》회로구성 inverter하나를 추가하여 XOR GATE, AND GATE를 이용하여 반감산기 회로를 구성하였다. 회로구성은 간단하게 하였고, Vcc=5V

리포트 | 27페이지 | 1,500원 | 등록일 2009.10.04

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MOSFET 출력 특성, 문턱 전압 측정

실험 3. MOSFET 출력 특성, 문턱 전압 측정1. 실험 목적1) MOSFET의 기본 동작을 확인하기 위하여 ID vs VDS 출력 특성 곡선을 측정하고, channel ... 는 특징이 있어 대규모 집적회로에 많이 쓰인다. MOS는 Metal Oxide Semiconductor를 약칭한다. MOSFET도 역시 전도채널의 형식에 따라 n-채널, p-채널 ... 불린며 source와 drain 이 N형 반도체 이고 표면이 P형 반도체일 경우 N 채널 MOSFET 또는 NMOS라 불린다.MOS 트랜지스터는 디지털 회로에 광범위하게 쓰이

리포트 | 8페이지 | 1,000원 | 등록일 2010.05.24

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전자회로 jfet 리포트, ispice 연습문제, 문제 풀이부터 세밀하고 정확한 a+자료

전자회로 Final Report(1) FET 구조와 동작[1] FET의 종류① FET는 접합형과 절연 게이트형(MOS형)이 있고, 다시 각각 n채널형과 p채널형으로 나눈다.② 전 ... 극명은 드레인(D:drain), 소스(S:source) 및 게이트(G:gate)로 3단자이다.[2] 접합형 FET에 흐르는 전류(가) 전압을 가하는 방법과 흐르는 전류① VDS ... 사이에 공간이 없어지면 전류가 증가하지 않고 일정하게 흐르게 되는데 이 때의 전압을 핀치오프 전압이라고 한다.(1) 그림 5-11의 회로도를 이용하여 소신호용의 NPN 3가지

리포트 | 25페이지 | 3,000원 | 등록일 2013.06.07 | 수정일 2014.05.29

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가산기와 감산기

왼편과 같이 0V 가 나온다=>C0(≒0V)=논리적 0=>다량의 사진을 찍지 못하여 일부사진만을 첨부 하겠습니다.이번 실험은 logic gates를 이용하여 전가산기와, 전감산기 ... 실험3. 가산기와 감산기(2) 반가산기를 이용하여 전가산기를 구성하고 그 결과를 확인하라.입력출력xyzCS0*************10111010001101101101011111 ... 실험에서 측정한 입?출력 진리표입력[V]출력[V]xyzCS측정값논리적 수치측정값논리적 수치00089.9 m01.8 m000522.7 m04.96105077.2 m05.0310555

리포트 | 13페이지 | 1,000원 | 등록일 2010.12.20

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Flip-Flop의 종류와 특징 및 Flip-Flop을 구성하고 있는 작은 단위 Latch에 대하여 이해 실험레포트

NAND Gate만을 가지며 제어입력 C가 있는 Latch의 동작에 대하여 알아보기 위하여 회로를 구성하고 실험을 실시하였습니다. SR Latch에서 S는 Set을 의미하며, R ... -Flop을 제작하여 동작을 확인해 본다.4) 74LS76을 이용하여 T Flip-Flop을 제작하여 동작을 확인해 본다.5) 실험1~4를 FPGA 보드를 사용하여 회로도를 작성 ... 서 T플립플롭의 경우 JK플립플롭의 입력값에 같은 값이 들어간 경우입니다.5.SimulationEX5-1) NAND Gate를 이용한 SR Latch를 제작하여 확인하라.1. 회로

리포트 | 21페이지 | 3,000원 | 등록일 2010.06.09

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MOSFET 스위치

어 실험 하였다.2. MOSFET의 각 단자를 확인하고 그림 7.1의 회로를 구성하라. Vin이 접속되기 전에 드레인 전류가 흐르면 게이트와 소오스 사이에 1kΩ을 연결하라. 함수발생 ... :G), 드레인(Drain:D)의 특성을 알아보는 실험이었다. 회로 구성도 엄청 간단하여 금방 끝낼 줄 알았는데 측정을 해야 할 값들이 많았기 때문에 시간에 쫓겨서 오래 걸렸 ... 실험 #7 결과 보고서1. 실험 제목MOSFET 스위치2. 실험 목적? MOSFET의 드레인 특성을 실험적으로 결정한다.? MOSFET의 증폭기의 바이어스 방법을 알아본다

리포트 | 9페이지 | 1,500원 | 등록일 2010.04.17 | 수정일 2014.05.28

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AND,OR,NOT 게이트 예비보고서

게이트의 진리표와 논리식을 실험을 통해 확인한다.2. 기본 이론디지털 논리회로(Digital logic circuit)는 조합논리회로(Combinational logic ... 일지라도 논리 게이트의 조합으로 이루어져 있게 때문에 디지털 회로에서는 거의 필수적으로 다루어지는 요소이다.논리 게이트(Logic gate)는 영어 단어의 게이트가 의미하듯이 논리 ... 된다.3. 실험 방법1) NOT 게이트 실험(1) TTL 7404를 이용하여 그림 4-1 NOT 게이트 실험 회로를 구성한다.그림 4-1의 NOT 게이트 실험회로 구성시 그림 4-2

리포트 | 10페이지 | 2,000원 | 등록일 2011.11.21 | 수정일 2013.11.18

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전자회로실험10예비-J-FET의 특성

Report 실험 예비10. J-FET의 특성실험목적(1) 드레인 전류 ID에 관한 드레인-소스 사이의 전압 VDS의 영향을 결정한다.(2) ID에 관한 게이트-소스 사이의 역 ... 나간다. 이 때 빠져나간 전자를 보충하기 위하여 전원의 (-) 단자에서 전자들이 소스를 통하여 N-채널로 이동하게 되며, 전원이 공급되는 한 회로의 전류(전자의 이동)는 계속될 것이 ... -FET의 (a) N-채널, (b) P-채널 기호(2) JFET의 드레인 특성 (JFET drain characteristics)그림 10-5 드레인 특성 측정 회로그림 10-5

리포트 | 5페이지 | 1,000원 | 등록일 2011.11.15

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