"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,381-1,400 / 2,110건

2011.05.17 공통소스 증폭기

실험9. 공통소스 증폭기실험일시실험조( 2 조)공동 실험자공동 실험자학번성명학번성명학번성명MOSFET 증폭회로그림 6.1 공통 소스 회로그 이유는 왼쪽 그림처럼 회로를 구성 ... 하고, 입력을 인가해서 실험을 진행하면, 값이 잘 나오지 않기 때문이다.1) 그림 6.1의 DC bias를 해석하여 VD, VS, VG, ID, gm을 계산하시오.소신호 등가 회로 ... 형전압이득&이론값:실험값:=-0.136실험과정각 장비 간 접지 분리공통 소스 증폭기를 구현한 회로 사진(제거)(1)공통 소스 증폭기를 구현한 회로 사진(제거)(2)Power

리포트 | 7페이지 | 2,500원 | 등록일 2011.06.20

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10장결과레포트

, gate-source voltage, drain voltage를 각각 측정하라. M1과 M2의 동작영역은?(M1) :실험값오차율drain current1.02 mA2%gate-s ... .894㏀10㏀1.069.835㏀10㏀1.653. 설계실습내용 및 분석3.1 설계실습계획서의 3.1.1에서 설계한 회로를 구현하고 M1과 M2 각각의 drain current ... ource voltage1.6712 V12.3%drain-source voltage1.6712 V12.3%동 작 영 역saturation(M2) :실험값오차율drain current

리포트 | 3페이지 | 1,000원 | 등록일 2011.03.13

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기초전자 실험 1학기 기말과제

공급전압으로 AND, OR, NOR, NAND Gate를 구성한다.논리 Gate의 출력을 이용하여 자유롭게 디스플레이한다.[2] 실험 장비· 계측장비 : DMM· 부품만능기판 (1개 ... 를 얻게 된다. 정밀한 장비에서는 RIPPLE전압이 치명적인 영향을 주기 때문에 복잡한 평활회로를 필요로 하게 된다.논리 GateAND Gate입력 단자가 A, B 두 개일 때, 이 ... 들이 결합되는 네 가지 조합에 대하여 논리곱과 동일한 결과를 출력하는 회로. HYPERLINK "javascript:self.close();" OR Gate입력단자가 A, B 두 개

리포트 | 7페이지 | 1,500원 | 등록일 2010.10.19

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실험5예비[1].Latch&Flip-Flop

CKT과 Sequential Logic CKTCombinational Logic CKT는 Gate로만 이루어져 시간의 영향을 받지 않는 회로를 말하며, Sequential ... Logic CKT는 Gate와 저장 기능을 수행하는 메모리 요소(F/F)를 사용한 회로를 말한다.R-S F/F(R-S Latch with Enable)설명R-S Latch 회로 ... 한 T F/F의 출력파형4. 문 제NAND gate를 이용하여 클럭화되지 않은 R-S latch 회로를 구성하고 그 동작을 설명하시오.다른 조합회로들과 달리 피드백을 넣어 회로

리포트 | 7페이지 | 1,000원 | 등록일 2011.06.27

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[논리회로실험] 실험2. 드모르간의 법칙 예비보고서

실험 2. DeMorgan's Theorem1. 실험 목적1. 드모르강법칙을 이용하여 부울 논리식을 수정하여 간단하게 만든다.2. CMOS를 사용하여 논리회로를 구성 ... ollector74HC00 dual 4-input NAND gate5.6-kΩ 10% composition resister4. 실험절차이 실험에서 모든 IC들에 대하여 14번 핀에 Vcc ... 하고, logic tester를 이용하여 드모르강 법칙을 실험적으로 증명한다.2. 기초이론드모르강 법칙드모르강 법칙의 단계적 적용1. AND를 OR로 OR를 AND로 대치한다.2. 변수들에 역

리포트 | 6페이지 | 1,000원 | 등록일 2010.12.05

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(전실결과)Digital Circuit 2(엔코더측정회로)를 통한 모터제어

을 구성한다.각 회로에 사용한 칩들의 기능과 목적을 이해한다.실험결과실험 1 : 발진회로발진회로 파형발진회로 회로도실험결과분석 : 발진회로는 크리스탈을 사용하여 어떤 일정한 주파수 ... 이 분주회로로 들어간다.실험 2 : 분주회로분주회로 회로도74HC390 내부회로분주회로 파형실험결과분석 : 10진 카운터가 2개 내장된 74HC390을 이용하여 발진회로에서 출력된 1 ... 어서 4들어 사용하였다. 파형은 다음과 같다.실험 3 : 4체배 회로4체배 회로도4체배 파형12V일 때7V일 때실험결과분석 : 4체배 회로는 엔코더 카운터에서 엔코더의 기본 분해능

리포트 | 8페이지 | 6,000원 | 등록일 2012.03.21 | 수정일 2015.09.04

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SiC, GaN 화합물 반도체의 전력소자 응용

들의 도입으로 전력변환효율이 70%정도 향상되어 에너지소비를 저감시켜 지구온난화를 완화시켜줄 것으로 기대되기 때문이다.● 는 10kV 인버터회로에 사용되는 다이오드와 스위칭디바이스 ... 의 소재로 Si를 사용하였을 때와 SiC를 사용하였을 경우의 전력손실량을 실험적으로 측정하여 나타낸 것이다.- 한 쌍의 Si 다이오드와 IGBT스위칭 디바이스, SiC 다이오드 ... , SiC 파워디바이스에서는 기기의 냉각이 공냉으로 충분하여 간소화 소형화 할 수 있다.● 현재 사용되고 있는 Schottky Diode, 파워트랜지스터, 사이리스터, GTO(Gate

리포트 | 8페이지 | 1,000원 | 등록일 2014.10.13

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[토끼] Flip-Flop (플립플롭), JK 플립플롭, D플립플롭, T플립플롭의 설계 및 검증

플립플롭을 제작하여 동작을 확인하여 본다.● 4가지의 실험을 통해 위에 언급한 항목들의 이해하고 적용할수 있는 능력을 배양한다.실험 1 - NAND Gate를 이용한 SR Latch ... 회로를 직접 제작해 보고 동작을 확인한다실험 2 - 74LS74를 이용 D Flip-Flop 회로를 직접 제작해 보고 동작을 확인한다.실험 3 - 74LS76을 이용하여 JK ... Flip-Flop 회로를 직접 제작해보고 동작을 확인한다.실험 4 - 74LS76을 이용하여 T Flip-Flop 회로를 직접 제작해 보고 동작을 확인한다.4.Background0

리포트 | 48페이지 | 5,000원 | 등록일 2011.04.11 | 수정일 2014.06.08

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[디지털시스템실험(Verilog)] 32×32 Binary Multiplier 예비보고서

다.② Multiplier 모듈의 gate level 설계에 대한 고찰왼쪽의 논리회로도는 4×4 multiplier이다.비록 이번 실험에서 구현하게 될 32×32의 form은 아니지만,기본적인 모듈 ... Multiplier실험목표① 32×32 Unsigned Binary Multiplier를 gate level로 구현한다.② Unsigned Binary Multlplier를 확장 ... 디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 예비 보고서학부 : 학번 / 이름 :실험조 : 실험일 :실험제목32×32 Binary

리포트 | 2페이지 | 1,500원 | 등록일 2011.10.05

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Pulse 발생과 schmitt Trigger

Pulse 발생과 Schmitt Trigger 1. 실험목 표 (1) we can understand the operation principle of non-stable ... that generates a clock pulse ? RC oscillator, Logic gate oscillator, Crystal oscillator, Non-stable ... is low state. In contrast, When the input voltage lower triplevel, Output is high state. 3. 실험목 표

리포트 | 5페이지 | 2,000원 | 등록일 2011.11.06

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실험6예비[1].Shift.Register&Counter

Co고, NAND gate를 이용한 설계는 아래와 같이 이루어진다.먼저 gate를 이용해서 MUX회로를 설계한 상태에서 AND gate의 출력과 OR gate 입력에 Bubble ... 을 추가하면 기존 회로의 특성을 유지하면서 2개의 AND gate를 NAND gate로 수정하게 된다. 그 다음으로 2개의 입력이 NOT인 OR gate는 NAND gate로 고칠 수 ... 있고, Inverter는 NAND gate의 입력을 같게 해주어 만들 수 있다.회로 SEQ 회로 \* ARABIC 5. UP/DOWN 스위칭을 위한 MUX 기본 회로회로 SEQ

리포트 | 11페이지 | 1,000원 | 등록일 2011.06.27

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디지털회로 term project 2진수 곱셈기

와 Preset입력은 Low active입니다. 그래서 전부 High값을 입력하여 작동을 하지 않도록 했습니다. 또, 회로도에서 Q부분에 NOT gate로 또 다른 출력이 나오는데, max ... 사용함.11월 31일 -Clock를 실험실에 있는 빵판에서 끌어 옴. 회로가 정상작동 하지 않음. 회로 구성을 다시 살펴봄. 뭐가 잘 못 됐는지 찾아내지 못함.1 6월 2일 ... 와 OR gate로 들어가는데, NAND 게이트로 바꾸면서 뒤에서 들어오는 AND의 출력 값을 그대로 사용한 것입니다. NAND에 맞는 공식으로 바꿔서 회로를 재구성했더라면 매끄럽

리포트 | 14페이지 | 2,500원 | 등록일 2011.08.29

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기본논리회로 실험 사전 결과 보고서

기본 논리회로기본 논리회로1. 목적: 기본적인 논리회로 AND, OR, INVERT, NAND, NOR 회로에 대해서 알아본다.2. 실험장치: 오실로스코프 1개 직류전원(+5V ... 과 같이 2진수 시스템을 사용하게 됩니다. 이러한 2진수 시스템 정보의 처리는 게이트(Gate)라고 불리는 논리 회로에서 처리 됩니다. 게이트는 입력 논리의 특정 조건을 만족할 때 ... 은 0이된다.입력출력XYF*************. 실험 방법 및 로직 결과 - 아래에 주어진 회로를 구성하고 입력 전압에 대한 출력 전압을 측정하여 표에 기입하고 전압 측정은 0

리포트 | 19페이지 | 2,000원 | 등록일 2010.09.12

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PWM 제어회로 설계실습 내용 및 분석

4. 설계실습 내용 및 분석(1) PWM 제어회로① PWM 제어회로에서 오차 증폭기 및 비교기의 전달 특성에 관하여 논하시오.PWM 제어회로의 동작을 살펴보면, 우선 출력 전압 ... 과 기준 전압을 비교하여 생긴 오차를 오차증폭기로 증촉한다. 이 증폭된 전압은 비교기에서 톱니파와 비교되어 오차에 상응한 구형파 펄스를 생성한다.② PWM 제어회로를 구성한다.③ 톱 ... 었다.(2) Buck Converter① Buck Converter 회로를 구성한다.② PWM 제어회로를 이용하여 스위칭 신호를 넣는다.③ 입력 전원 Vi에 Power supply

리포트 | 5페이지 | 1,500원 | 등록일 2010.11.11

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디지털 게이트의 전기적 특성

을 이해하고 동작 특성을 실험을 통해 확인한다.? TTL IC를 이해하고 실험을 통해 Digital gate의 특성을 파악한다.2. 이론1) Digital logic gate? 디지털 ... 된다.00000100001110000010000011홀수 패리티와 짝수 패리티의 예패리티 발생기패리티 검사기3. 실험방법[ TTL 연결 방법 ][ NOT gate Test ][ EX ... -OR gate 구현하기 ][AND, OR, NOT gate 조합] [NAND 조합] [NOR 조합][EX-OR TEST]결과보고서실험번호실험일시( ) 분반 실험조( 조)학번성명학번

리포트 | 8페이지 | 1,500원 | 등록일 2010.07.14

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논리함수와 게이트

설계실습 8. 논리함수와 게이트학과전자전기공학부학번조/이름담당교수수업시간실험일1. 목 적여러 종류의 게이트의 기능을 측정을 통하여 실험적으로 이해한다.2. 실험 준비물직류전원장치 ... 1대오실로스코프 1대Function Generator 1대Bread Board 1대Toggle Switch 2개Quad 2 Input AND Gate (74LS08) 2개Quad ... 2 Input OR Gate (74LS32) 1개Hex Inverter (74LS04) 2개Quad 2 Input NAND Gate (74LS00) 3개Quad 2 Input

리포트 | 4페이지 | 1,000원 | 등록일 2010.10.08

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공학설계입문 최종보고서

지 않 그래서 빛 감지 센서로 사용할 수 있다.=>트랜지스터트랜지스터는 기본적으로는 전류를 증폭할 수 있는 부품이다.아날로그 회로에서는 매우 많은 종류의 트랜지스터가 사용 ... 되지만, 디지털 회로에서는 그다지 많은 종류는 사용하지 않는다.디지털 회로에서는 ON 아니면 OFF의 2치신호를 취급하기 때문에 트랜지스터의 증폭 특성에 대한 차이는 별로 문제가 되지 않 ... 는다.회로 기능은 대부분이 IC로 처리하는 경우가 많다.디지털 회로에서 트랜지스터를 사용하는 경우는 릴레이라고 하는 전자석 스위치를 동작시킬 때(릴레이는 구동전류를 많이 필요로 하기

리포트 | 30페이지 | 2,000원 | 등록일 2010.12.05

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전자회로실험11예비--J-FET의 특성

-to-gate 바이어스 (증가형 MOSFET에만 적용)VGS전압이 Rf를 통과하여 귀환 되므로 dc 안정성이 매우 좋다.(a) (b)그림 11-7 MOSFET 증폭기 회로 ... 의 drain-to-gate 바이어스이 회로에서는 VGS 전압을 VDS 보다 낮게 할 수 있다.예비과제(1) 공핍형 MOSFET와 증가형 MOSFET의 차이점을 설명하여라.- 공핍 ... Report 실험 예비10. J-FET의 특성실험목적(1) MOSFET의 드레인 특성을 실험적으로 결정한다.(2) MOSFET 증폭기의 바이어스 방법을 알아본다.기초이론FET

리포트 | 6페이지 | 1,000원 | 등록일 2011.11.15

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디지털 도어락 제작(전자/전기과 실습)

를 넘지 않아야 한다. 이런 사실을 바탕으로 뒤에 설명 되는 전원 회로 및 서보모터와 부저 등을 선택했다.(2) 전원부시중에서 흔히 사용되는 9V의 배터리는 실험에서 사용할 AT89C ... [디지털 도어락 제작]※ 제작 목표실험(4) 시간에 8051에 대해 공부하고 Trainning Board로 실습해본 바를 바탕으로 이를 응용하여 간단한 작품을 제작한다. 수업 ... .1. 제작품 소개실험4 시간에 실습해본 내용을 바탕으로 이를 응용하여 8051 계열의 CPU인 AT89S51을 이용해서 디지털 원격 도어락을 제작해 보기로 한다. 먼저 문을 열

리포트 | 19페이지 | 3,000원 | 등록일 2012.11.05

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Encoder, Decoder, Mux 예비레포트

할 수 있게 된다.실험 3. 8 by 3 Encoder 를 gate를 이용하여 설계하고, 모의실험을 통해 검증하라.위의 회로도는 8 by 3 Encoder를 gate를 이용하여 설계 ... 까지의 신호를 3비트의 2진수로 코드화 시키는 것 이었다.실험 4. 3 by 8 Decoder를 gate를 이용하여 설계하고, 모의실험을 통해 검증하라.위 회로는 3 by 8 Decoder ... 를 gate를 이용하여 설계한 회로이다. 위 회로의 시뮬레이션은 다음과 같다.Decoder는 2진화 되어있는 n개의 입력을 ,개의 출력으로 나타내는 것으로써 실험 4는 3비트

리포트 | 14페이지 | 1,000원 | 등록일 2010.10.16

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