"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,261-1,280 / 2,110건

결과보고서 실험 5. 래치와 플립플롭(Latch & Flip-Flop)

Qlast Q'NO CHANGENAND gate를 이용하여 클럭화되지 않은 R-S latch 회로→ R-S Latch의 실험에서 측정한 결과 값이 이론상의 값과 일치하는 것을 확인할 수 ... 을 측정하고 결과를 검토하라.입 력출 력SRCQQ`××0QQ`001QQ`0110110110111--클럭 입력을 가진 R-S F/F 회로→ 클럭 입력을 가진 R-S F/F 실험 결과 ... 하고 결과를 검토하라. 또 이결과를 7476 칩에 대한 측정 결과와 비교하라.입 력출 력JKCQ××0Q001Q01101011111Q'NAND gate를 사용한 JK F/F 회로도입 력출

리포트 | 3페이지 | 3,000원 | 등록일 2012.03.11

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플립플롭을 이용한 프로젝트 발표

활용의 활성방안과 인식개선을 위한 일본탐방기 Kwang Woon University 프로젝트 목적 기초전자 회로 실험 및 설계 강의 때 배운 이론과 이해를 통해 회로를 설계한다빗물 ... 일본탐방기 Kwang Woon University Contents 프로젝트 목표 프로젝트 개요 중요소자 관련이론 회로도 및 사용소자 소요부품 및 예산 편성 추진 체계 및 계획빗물재 ... 이 들어가 있다 . 2) IC 칩 (c- mos type 4011) NAND gate 가 들어가 있다 . X Y S빗물재활용의 활성방안과 인식개선을 위한 일본탐방기 Kwang

리포트 | 19페이지 | 3,000원 | 등록일 2013.03.17

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아주대 논리회로실험 실험3 결과보고서

윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2011.9.28과목명: 논리회로실험교수명 ... : 박성진 교수님분 반: 수 8.5~11.5학 번: 200820126성 명: 안효중< Chap.3 결과보고서 >[1] 실험 의의Logic gate를 이용해 반가산기, 전가산기, 반감산기 ... 고 그 출력을 알아보는 실험이다. 출력 S의 경우는 입력 A, B의 한 자리수 합이 될 것이고 C는 carry(합을 한 후 남는 올림수)가 될 것이다. 위 회로도와 같이 빵판

리포트 | 7페이지 | 1,000원 | 등록일 2012.02.29

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디지털공학1 - AND회로

① 실험 목적- AND회로는 논리적으로 두 변수의 값이 모두 1인 경우 그 결과 값이 1이 나오는지 실험을 통해 확인한다.② 과제- 전원 공급을 하여 PUSH 버튼을 사용해서 ... 은 AND 게이트의 기호 및 진리표와 AND 소자의 회로를 나타낸 것이다.⑤ 실험 방법1> BreadBoard판에 회로를 꾸민다.2> DC Power supply을 이용하여 전원을 공급 ... 수 있다.위의 실험 결과들을 보면 이론적인 진리표에서 나타나있는 것과 같이 2개의 이력값이 모두 ‘1’일 때 출력값 또한 ‘1’이 된다는 것을 확인할 수 가 있었다.AND GATE

리포트 | 5페이지 | 1,500원 | 등록일 2013.02.19

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전전컴실험Ⅱ 06반 제05주 Lab#04 [Arithmetic Logic, Comparator] 예비 보고서

. Reference (참고문헌) ‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥8< 초록 (Abstract) >이번 실험에서는 Xor gate를 사용한 1bit subtracter와 Behavioral ... 목 차< 초록 (Abstract) >‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 11. Introduction (실험에 대한 소개) ‥‥‥‥‥‥‥‥‥‥‥‥ 1가. Purpose of this ... 다. Hypothesis(Expected results) of this Lab & Basis of the assumption ‥‥ 22. Materials & Methods (실험 장비 및

리포트 | 9페이지 | 1,000원 | 등록일 2013.09.09 | 수정일 2013.09.15

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논리예비5 Decoder & Encoder

는 것은 집적회로화 되어있다. PCM통신에서는 아날로그디지털 변환기를 인코더라 한다.회로도블록도 (멀티플렉서)진리표3. 실험방법실험 1)? Function ... 실험 5. Decoder & Encoder1. 목적- 디코딩(decoding)과 인코딩(encoding)의 코드 변환 동작에 관해 실험하고 그 동작원리를 이해한다.2. 실험이론 ... type 7-segment LED, 저항 : 330Ω1) 디코딩(Decoding)- n비트의 2진 코드를개의 서로 다른 정보로 바꾸어 주는 조합논리회로- 입력 n개, 출력 m개인 디코더

리포트 | 5페이지 | 1,000원 | 등록일 2012.12.23 | 수정일 2013.11.07

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논리결과-2-CMOS 회로의 전기적 특성

이 생긴다고 명시되어 있다. 회로를 보면 4번 핀에서 8번 핀까지 총 4개의 gate를 지나게 된다. 실험 결과를 보면 총 gate를 지나는데 19ns의 전달 지연이 생겼다. 이것 ... 실험2. CMOS 회로의 전기적 특성1. 실험목적(1) COMS 회로의 전기적 특성을 이해한다.(2) 74HC시리즈를 실험을 통해 동작을 확인하기2. 실험기기(1) DC 전원 ... 의 전달 지연(Propagation delay)이 어느 정도인지 측정한 후에 데이터 시트와 비교해서 실험으로 도출된 값이 일치하는지 여부를 확인하는 실험이다. 위에 주어진 회로

리포트 | 8페이지 | 1,000원 | 등록일 2012.12.23 | 수정일 2013.11.07

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결과보고서 실험 7. 복호기와 부호기(Decoder & Encoder)

에 관해 실험하고 그 동작원리를 이해한다.< 실험 과정 및 결과 >1) 2단 2진 카운터2단 2진 카운터 decoding gate그림 2의 회로를 구성하여 그림 3에 다음의 파형 ... 한 NAND gate의 6번 핀 출력파형CLKAB→ 실험은 IC 7476과 NAND gate IC 7420으로 제작한 2단 2진 카운터의 결과 값을 보는 것인데, 일정한 주기의 clock ... 를 10진수 형태로 출력함 동시에 디코딩 하는 것을 확인하였다.2) 3진 카운터이 실험에서는 카운터 각각의 카운트 상태를 디코딩할 것이다. 그림 4의 회로를 연결하고 다음의 파형

리포트 | 8페이지 | 3,000원 | 등록일 2012.03.11

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산화 공정

산화 공정1.실험 목표실리콘이 집적회로에 많이 사용되는 중요한 이유 중의 하나는 훌륭한 산화층(oxide), SiO2를 형성할 수 있다는 것이다. 이 산화층은 절연체 ... 로서 MOSFET과 같은 소자 및 소자들 간의 영역에 사용된다. SiO2 형성을 위한 다양한 방법이 사용되고 있다. 그 중에서 이번 실험에서는 열 산화(Thermal oxidation)방법 ... 에 대해 소개할 것이다.산화 공정과 산화 기구의 기본 원리와 산화 막 성장에 영향을 미치는 공정 변수들에 대해 알아보도록 하자.2.실험 방법* cleaning 공정① H2SO4 와 H

리포트 | 9페이지 | 1,000원 | 등록일 2014.04.03

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8051 결과

. 이러한 회로를 관찰하는 다른 방법으로는, 두 개의 입력들이 서로 다르면 출력은 1이 되고, 두 개의 입력이 서로 같으면 출력은 0이 된다고 생각해도 된다.XOR gate입력 1입력 ... 다.2. 고찰이번실험은 KEIL사의 C-컴파일러, Keli uVision2를 사용하여 주어진 소스로 프로젝트를 만들고 디버그 툴을 이용하여 시뮬레이션 한 뒤에 시뮬레이션이 정상 ... 적으로 되는지 확인하는 실험이었다 디버그란 코딩한 후 시물레이션을 통해 확인을 하고 전기체크박스 (on off)가 칩 안의 메모리 공간대에 데이터가 잘 들어 갖는지 작동여부를 확인

리포트 | 3페이지 | 1,000원 | 등록일 2013.05.24

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[LCD실험] TFT-LCD 분석

수 있다.실험방법:조교의 지시에 따라 시뮬레이션 프로그램을 실행 시켜본다..spice 프로그램을 통해 panel의 등가회로를 만들어 보고, 저항, 유전율, 기생용량 등의 정보 ... LCD 실험 TFT-LCD 분해 및 분석 실험실험목적: TFT의 시뮬레이션을 통해 Channel의 W/L의 크기 결정으로 최적의 array설계를 하여 소비전력과 개구율을 증대 ... 시킬 수 있다.실험재료: Mychip Station Pro. (CAD Program)실험이론:TFT 설계화면의 크기가 정해진 후 그 해상도가 정해지게 되면, 각 sub Pixel

리포트 | 6페이지 | 10,000원 | 등록일 2013.06.14

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서강대학교 고급전자회로실험 1주차 예비보고서

고급전자회로실험2주차 예비보고서제 출 일 : 2012. 09. 05.학 과 :성 명 :1. 예비 보고 사항(1) NMOS와 PMOS의 세 가지 동작 영역을 설명하고, 각 동작 ... 내용대로 모의실험하여 보고하시오.실험 1. 회로도 및 시뮬레이션 결과회로도(0~2.1V)(1.4~2.0V,0~1.0V)(1.4~2.0V,1.0~5.0V)드레인 전압을 고정 ... layer을 채널이라고 한다. 이때, Oxide layer를 Capacitance라고 보면에 의해 Drain에 전압이 증가하면 Gate의 전압과의 차이가 줄어들어 Charge

리포트 | 4페이지 | 1,000원 | 등록일 2013.04.12

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[예비]실험4. Multiplexer & Demultiplexer

하는 회로이며 데이터 분배기라고 불린다. 즉, 1개의 입력을 갖고 4개의 출력물이 있는데 S1과 S0에 의해서 그 중 하나만 선택해서 출력하는 회로이다.?실험부품? DC 전원공급 ... +5V+5V0001?실험(Demultiplexer)- Enable을 갖는 1x4 디멀티플렉서를 74HC11과 74HC04를 이용하여 회로를 구성한다. 데이터 입력 D는 enable ... 4. Multiplexer & Demultiplexer?실험목적1. 멀티플렉서(Multiplexer)와 디멀티플렉서(Demultiplexer)의 원리를 이해하고 실험을 통해 동작

리포트 | 5페이지 | 1,500원 | 등록일 2013.09.28

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[기초회로실험] 29장. FET의 특성 예비레포트

전기회로실험2B반예비보고서주제29장. FET의 특성2조이름학번실험일15.11.16제출일15.11.16본인의 양심에 따라 성실히 작성하였습니다.1, 실험목적JFET의 구조에 대해서 ... 의 드레인 특성과 전달특성에 대해서 이해하고 실험을 통하여 확인한다.2. 관련이론트랜지스터와 함께 증폭, 발진 스위칭 등을 할 수 있는 반도체소자로 FET(field effect ... 형 FET(junction FET : JFET)와 절연게이트형 FET(insulated gate FET : IGFET, metal-oxide-semiconductor FET

리포트 | 8페이지 | 1,000원 | 등록일 2016.01.16 | 수정일 2022.10.09

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오실로스코프

. F LED : 과도입력주파수 지시램프이다. 본 실험에서는 GATE의 LED가 점멸하는 상태를 유지한다.7) FREQUENCY DIAL : 3)의 선택된 RANGE에서 출력주파수 ... 를 받아들일 때의 입력단자이다. 본 실험에서는 사용하지 않는다.10) SYNC OUT : 디지털 로직회로를 검사 할 때 신호출력단자이다. 본 실험에서는 사용하지 않는다.11) OUT ... 를 이 상태에 놓으면 수평선이 나타나고 그 위치가 기준 위치, 즉 0[V]의 상태이다. 본 실험에서는 파형의 기준위치를 조절할 때 사용한다.- DC 상태 : 일반적인 측정

리포트 | 4페이지 | 1,000원 | 등록일 2014.12.14

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전전컴설계실험2-7주차결과

of this Lab이번 실험은 조합 논리 회로에 대해 기본 개념을 이해하고 Mux와 BCD-to Excess 3 converter의 조합 논리 회로를 직접 설계하는 과정을 통해 ... (OR), 논리부정(NOT)의 세가지 기본 회로를 조합하여 구성한 논리회로 출력이 입력에 의해 결정된다.논리 Gate로만 구성되며, Flip Flop 같은 기억소자는 포함되지 않 ... )Hypothesis of this Lab & Basis of the assumption조합 논리 회로의 특성을 이해하고 실제 실험을 하기 전에 Xilinx 설계를 통해 이번 실험

리포트 | 20페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15

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실험3예비 Adder&Subtracter

[실험3] Adder & Subtracter1. 목적- Logic gate를 이용해서 가산기(adder)와 감산기(subtracter)를 구성한다.- 디지털 시스템의 기본 요소인 ... 가산기와 감산기의 기본 구조 및 동작 원리를 이해한다.2. 이론1) Half Adder(반가산기)- 반가산기 회로는 2진수 덧셈에서 맨 오른쪽 자리 계산을 위해 사용- 2개 ... 의 비트 A와 B를 더해 합 S와 자리올림 Co를 출력하는 조합 회로2) Full Adder(전가산기)- 전가산기 회로는 2개의 비트 A,B와 자리올림 Ci를 더해 합 S와 Co를 출력

리포트 | 4페이지 | 2,000원 | 등록일 2014.05.13

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MOSFET/Capacitor/반도체 신소재실험보고서

1. 실험 목적- 기본적인 반도체 공정 방법을 습득하고 이를 바탕으로, 실리콘 기반의 간단한 capacitor 구조를 제작하여 동작원리를 이해하고 capacitance ... -voltage 특성을 평가한다.2. 실험 이론* MOSFET- MOSFET은 n MOS(n-채널)와 p MOS(p-채널)로 구분된다. 각각의 형태는 각 소자에 흐르는 다수 저류 car ... rier에 의해 결정된다. 아래 그림에 두 종류의 회로 기호와 물리적 단면도가 표시되어 있다.N형은 전류가 나오는 방향이 Source이다.(두 단자 중에서 고전압이 쪽이 Drain이

리포트 | 23페이지 | 2,500원 | 등록일 2013.12.03 | 수정일 2013.12.05

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아주대 논리회로실험 프로젝트 FPGA로 Stop Watch 만들기

1. 설계 목적- FPGA를 이용하여 Stop Watch를 구현해보는 것이다. Quartus2 프로그램을 이용하여 Stop Watch가 작동할 수 있는 회로를 구성한 뒤 ... )를 이용하여 확장보드로써 브레드보드에 연결하여 실험을 진행한다.3) JP2 핀의 구성4) 플랫케이블에서 양쪽띠 핀 중 1번 핀을 찾는 방법: 케이블 끝 쪽에 삼각형 표시가 있 ... 해야 한다.연결보드 구성도연결보드와 빵판 연결가상도: POWER(전원공급기) 대신 USB 전원(5V 공급)을 이용하여 실험해야 한다.(무리한 전원 연결은 FPGA 보드 및 PC에 손상

리포트 | 15페이지 | 5,000원 | 등록일 2015.03.12

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디지털 공학 및 실습 예비레포트(5주차)

디지털 공학 및 실습 예비레포트(5주차)1. 실험 제목 : 부울대수2. 실험 목표 : NOT, AND, OR Gate를 이용하여 NAND를 구성하여 회로이해도를 높인다.3. 실험 ... 7404(Hex Inverter)- IC 7408(Quad 2-input AND)- IC 7432(Quad 2-input OR)4. 실험 순서1)(a), (b), (c)의 회로 ... 을 구하여라.5)회로를 구성하고 진리표에 따른 입력신호 A, B를 인가했을 때 출력 X의 논리값을 측정하여 기록하여라.*결선도**예상결과이번에 실험하게 되는 회로도의 논리식은 우선

리포트 | 5페이지 | 1,000원 | 등록일 2013.06.09

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