"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,241-1,260 / 2,110건

디지털회로실험(가위바위보게임)

회로의 문제로는 부득이하게 리셋버튼을 삽입하지 못하였고, 다른 실험 참가자들에 비해 단순 gate소자들로만 구성하려 했기 때문에 TTL소자를 많이 쓰게 되어 경쟁력이 있는 회로가 아니었다. ... 가 어떤 상태를 가질 것인지 판단하는 것이다. 장난감으로 많이 사용되고 있는 이 가위바위보 게임을 디지털 회로 시간에 gate소자들을 이용해 제작을 해보았다. 2. 설계의 중점목표 ... 했지만 이렇게 직접 만들어보고 실제로 동작하는 것을 보면서 뿌듯함과 동시에 한편으론 걱정이 되었다. 디지털 회로라는 과목이 쉽다는 생각은 안했지만 만들면서 벅차다는 생각을 하였고 빵판

리포트 | 11페이지 | 4,900원 | 등록일 2012.12.12 | 수정일 2020.06.23

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실험 8. Counter(예비)

, 74HC90, 74HC47, 7 Segment4. 실험 절차● 2단 2진 Counter - 비동기식 Counter (첫 번째 실험)① 회로를 구성한다.? J-K Flip-Flop ... 는 BCD Counter (세 번째 실험)① 회로를 구성한다.? 7490을 이용한 BCD Counter를 통해 0~9까지의 값을 얻음? 스위치를 이용해 2, 3번 핀이 GND에 연결 ... 된 후부터 동작● 7-Segment 표시기를 갖는 BCD Counter (네 번째 실험)① 회로를 구성한다.② 7447을 이용하여 0~9까지의 2진 값을 7-segment에서 0

리포트 | 2페이지 | 1,000원 | 등록일 2012.09.14 | 수정일 2014.01.01

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전자공학실험1 실험 9장 결과보고서 : 래치와 플립플롭

이 나온다. 이 실험 결과 출력에 delay가 생기는 것을 볼 수 있었다.(LED등이 짧게 깜빡이며 켜졌다.)9.5.3 JK flip-flop9) [그림 9.13]의 회로를 구성 ... ]을 완성하고 동작을 기술한다.[그림 9.16] 2-bit counter의 파형9.3 연습문제1) IC 74109에지트리거 플립플롭의 내부 회로도를 그리고 JK=11일 때 상승에지에서 gate들의 천이 상태를 timing diagram으로 그려서 동작을 설명하라. ... -전자공학실험1 결과보고서-9장 래치와 플립플롭실험날짜 : 2012년 5월 25일 금요일제출일자 : 2012년 6월 1일 금요일담당교수 :조원 :이름 :9.1 실험목적- SR

리포트 | 7페이지 | 1,000원 | 등록일 2013.01.31

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#6 디지털실험 결과

.▶ Discussionpart1과 거의 비슷하였기 때문에 실험이 어렵지 않았다.Part3.▶ 코드분석part2에서 설계한 Gated Dlatch의 조합을 이용하여 Clk에 따라 작동하는 플립플롭 ... (결과)Lab 6.디지털 실험이명진 교수님금(09:00 ~ 13:00)2007122043 김병주Due date - 2012.04.20. (금)Part 1▶ 코드분석assign ... 구문을 사용하여 AND게이트 조합과 NOR게이트를 이용하여 회로 설계▶ Compile 분석Total pins 4 = 3 (input- SW) + 1 (output- LEDR

리포트 | 4페이지 | 1,000원 | 등록일 2013.12.12 | 수정일 2014.04.22

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실험3 예비보고서

실험 3. Adder & Subtractor1. 실험 목적Logic gates를 이용하여 가산기(adder)와 감산기(subtractor)를 구성하여 동작을 확인해 보고 이 ... 낼 수 있다.3. 예비보고서(1) XOR gate(IC 7486)와 AND gate(7408)을 이용하여 반가산기를 구성하여 보아라.(2) 반가산기를 이용하여 전가산기를 구성하라 ... .(3) 이론의 반감산기의 진리표를 참고하여 부울 함수를 구하고 논리 회로를 구성하시오.[반감산기의 진리표] [B의 카노맵] [D의 카노맵]입력출력xyBD000(0)0(0)011(1

리포트 | 4페이지 | 1,000원 | 등록일 2013.01.01

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기본 논리 함수(결과)

를 이해한다. 진리표, 논리 다이어그램 및 Boole 대수에 의한 논리 함수의 표시 방법을 익힌다. 기본 논리 회로의 실험 방법을 익힌다.1. 서 론논리회로란 논리곱(AND), 논리 ... 시스템 제어공학과&기초전기전자실험2-02, 화요일 1,2,3,4교시기본 논리 함수(결과)1호서대학교 시스템제어공학과(S.N: 2, H.P: 010-8; E-mail ... 합(OR), 부정(NOT)의 기본적 논리소자를 연결하여 수치를 나타내는 신호를 처리하는 회로이다. 전자계산기의 연산장치같은 주요 부분에 사용된다.[1]네이버 백과사전의 요약 내용이

리포트 | 5페이지 | 1,000원 | 등록일 2012.07.01

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실험 6. Latch & Flip-Flop(결과)

지만 매우 빠르고 간편하게 실험을 할 수가 있었다. 여기서 바로 gate의 중요성이 또다시 한번 각인되는 것 같다. 정말 IC집적 회로는 무궁무진하다. 조금 이 내용과 내용이 벗어나 ... 수행 과정? 실험 1) R-S F/F? 실험 2,3) D F/F(gate 이용, IC이용)? 실험 4,5) J-K F/F(IC 이용, IC이용)※각 실험 모두 다음과 같은 절차 ... 로 볼 수가 있다. 또한 이번 실험에서 알 수 있는 것은 AND나 NAND gate에서 인풋의 개수에 상관없이 인풋 중에 0이 있다면 다른 인풋을 don't care하여도 결과 값

리포트 | 8페이지 | 1,000원 | 등록일 2012.09.14 | 수정일 2014.01.01

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플립플롭(결과)

소자들을 가진다. 이중 우리는 74LS00(Quad 2 - input NAND Gate)을 사용하여 enable 제어신호를 갖는 SR 래치 회로를 구성하여 실험을 하였다.2. 이 ... NAND Gate)을 이용하여 enable 제어신호를 갖는 SR 래치 회로 를 실험 하였다. 먼저 SR 값을 00으로 설정한 후 E 값을 0→1→0으로 변화시키면서 출력을 관찰 ... 에서 IC소자 74LS00(Quad 2 - input NAND Gate)을 이용하여 enable 제어신호를 갖는 SR 래치 회로를 실험 하였습니다. 먼저 SR 값을 00으로 설정한 후

리포트 | 4페이지 | 1,000원 | 등록일 2012.07.03

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MOSFET 특성 실험 PPT 발표자료

10282?Redirect=Log logNo=20099867227 http://dolicom.blog.me/10084139379 대학 전자회로 실험 책{nameOfApplication=Show} ... 1.목적 2.이론 : MOSFET 특성 MOSFET 소스 공통 증폭기 기초 3. 사용부품 및 계기 4. 실험 방법1] MOSFET의 소스, 게이트, 드레인 등 세단자의 특성 ... 을 실험적으로 결정한다. 2] MOSFET 증폭기의 바이어스 기법을 고찰한다. 3] MOSFET을 사용한 소스 공통 증폭기의 전압이득을 측정한다.MOSFET 또는 MOS 트랜지스터

리포트 | 14페이지 | 1,000원 | 등록일 2012.11.26

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전전컴설계실험2-7주차예비

(References)1.Introduction.(1)Purpose of this Lab이번 실험은 조합 논리 회로에 대해 기본 개념을 이해하고 Mux와 BCD-to Excess 3 c ... 논리 회로의 특성을 이해하고 실제 실험을 하기 전에 Xilinx 설계를 통해 이번 실험에 대한 모의 Simulation을 해본다. 응용과제인 BCD to Excess 3 Code ... 2009440138이름정필웅담당교수문용삼 교수님담당조교김민혁 조교님수업날짜2013.10.14-7주차 실험--목차-서론(Introduction)-실험목적-실험을 위해 필수 배경이론, 개념

리포트 | 15페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15

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디지털로직실험/최신 디지털 공학 실험8 논리 회로 간소화

실험 8논리 회로 간소화실험목표▣ BCD 무효 코드 검출기에 대한 진리표 작성.▣ 카르노 맵(Karnaugh mpa)을 이용한 표현식의 간소화.▣ 간소화된 표현식을 구현하는 회로 ... 한다 되도록 하고 무효 BCD 코드가 검출되면 경고 신호를 보내주는 회로를 설계할 것이다. 회로를 4비트로 설계할 수 있지만 8비트로도 쉽게 확장이 가능하다.실험 순서BCD 무효 ... 기 위해 X를 사용한다. 그림 8-4의 회로는 실험 순서 3의 표현식을 구현한 회로이긴 하지만, 출력은 전류를 유출(source)이 아닌 유입(sink)하기 위하여 반전되어 있다.5

리포트 | 24페이지 | 1,000원 | 등록일 2014.06.30

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[논실]예비3, 200820126, 안효중, 4조

32, 74HC04), 저항[4] 실험 절차① 반가산기(Half adder) ? XOR gate(74HC86)와 AND gate(74HC08)를 이용해 회로도대로 구성한다. 입력 ... 윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2011.9.21과목명: 논리회로실험교수명 ... : 박성진 교수님분 반: 수 8.5~11.5학 번: 200820126성 명: 안효중< Chap.3 예비보고서 >[1] 실험 목적Logic gate를 이용해 adder(가산기)와 s

리포트 | 3페이지 | 1,000원 | 등록일 2012.02.29

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10주차 결과 전자전기컴퓨터설계실험 3 (2014.05.30)

를 알고 실험을 통해 Oscillator의 기본적인 회로를 설계하여 이론과 실제적인 동작을 확인해본다.(2)Essential Backgrounds for this Lab ... ) quartz(수정,크리스탈)와 콘덴서(캐패시터)를 이용하여 만든다.3) Op-amp를 이용하여 phase shift 회로를 만든다.4) 7400속 Nand gate 2개를 이용하여 이용 ... 오실로스코프에서 주기는 대략 1.1s가 되기 때문에실험값 f=1/1.1=0.91Hz오차= (0.88-0.91)/0.88*100= 3.4%4.토론(Discussion)1)진동회로를 만드

리포트 | 11페이지 | 1,500원 | 등록일 2014.07.01 | 수정일 2014.07.03

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Gray code converter design - 디지털회로설계 프로젝트1

디지털회로설계설계11. 설계제목: Gray code converter design2. 개요B1, B2, B3 3개의 binary code input을 G1, G2, G3 3개 ... bit씩 증가하기 때문이다.(4)HDL전자공학에서 하드웨어 기술 언어(- 記述言語, hardware description language)는 전자회로를 정밀하게 기술하는 데 사용 ... 하는 컴퓨터 언어이다. 흔히 HDL이라고 줄여쓰기도 한다. 회로의 원하는 동작을 기술할 수도 있고, 원하는 회로 구조를 기술할 수도 있으며 시뮬레이션을 통해 제대로 동작하는지 검증

리포트 | 11페이지 | 1,500원 | 등록일 2014.02.17

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실험4 예비보고서

교재에서 언급한 디코더가 디멀티플렉서의 역할을 동시에 한다는 것을 확인할 수 있다.3. 예비보고서(1) 다음 회로도의 AND gate, OR gate와 Inverter를 결선 ... 실험 4. Multiplexer & Demultiplexer1. 실험 목적멀티플렉서(Multiplexer)와 디멀티플렉서(Demultiplexer)의 원리를 이해하고 실험을 통해 ... 를 AND, OR gate를 통해 구현시켜 나가는 원리를 간단하게 설명하여 보면 멀티플렉서의 경우 원하는 입력을 출력으로 내보내는 데이터 선택기와 같은 역할을 하고, 디멀티플렉서

리포트 | 10페이지 | 1,000원 | 등록일 2013.01.01

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BJT와 FET의 비교

BJT 와 FET 의 비교 ( 공통이미터와 공통 소스증폭기 ) 2 조목차 목차 실험목적 이론 회로도 실험기기 및 재료 실험 측정값 실험사진 비교목적 BJT 의 공통 이미터와 대응 ... ) 와 공통소스 ( cs ) 의 회로도실험기기 및 재료공통이미터 증폭기와 공통소스 증폭기 값 ( Ω ) 전압 (V) 전압 (V) 전압 (V) 전류 ( mA ) 전류 ( mA ... 되는 MOSFET 의 공통 소스 증폭기를 비교하는 실험을 진행한다 . 이 두 트랜지스터는 높은 전압이득을 얻을 수 있다는 장점 때문에 널리 사용되고 있다 . 둘을 비교

리포트 | 25페이지 | 2,000원 | 등록일 2014.03.28

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[예비]실험7. Shift Register

가지 상태 사이를 사이클릭으로 순환한다. 각 상태의 디코드 회로도 비교적 간단하므로 널리 이용된다.?실험부품? LED 6개? Resistor 330Ω 6개? 74HC00 ... (Input NAND gate)? 74HC76(Dual J-K flip plop)? 74HC96(5-Bit Shift Register)④실험과정 및 예상 결과?실험1. 6bit Shift ... 7. Shift Register?실험목적1. 실험에 사용하는 74HC76과 74HC96의 IC의 특성을 파악하고 Shift Register의 동작 원리와 특성을 이해한다.?실험

리포트 | 5페이지 | 1,500원 | 등록일 2013.09.28

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플립플롭을 이용한 프로젝트 발표

활용의 활성방안과 인식개선을 위한 일본탐방기 Kwang Woon University 프로젝트 목적 기초전자 회로 실험 및 설계 강의 때 배운 이론과 이해를 통해 회로를 설계한다빗물 ... 일본탐방기 Kwang Woon University Contents 프로젝트 목표 프로젝트 개요 중요소자 관련이론 회로도 및 사용소자 소요부품 및 예산 편성 추진 체계 및 계획빗물재 ... 이 들어가 있다 . 2) IC 칩 (c- mos type 4011) NAND gate 가 들어가 있다 . X Y S빗물재활용의 활성방안과 인식개선을 위한 일본탐방기 Kwang

리포트 | 19페이지 | 3,000원 | 등록일 2013.03.17

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실험 2. CMOS 회로의 전기적 특성(예비)

실험 2. CMOS 회로의 전기적 특성1. 실험 목적-CMOS 회로의 전기적 특성 이해2. 주요 이론논리 소자는 VIL보다 낮은 범위의 입력 전압은 논리 0으로 인식하며 VIH ... 보다 높은 범위의 입력 전압은 논리 1로 인식한다. VIL보다 높지만 VIH보다 낮은 범위의 입력은 논리 값이 불확실한 구간이므로 이 범위의 전압을 디지털 회로에서 사용하면 그 결과 ... 해야 한다. 이 때 필요한 것이 Schmitt trigger이다.논리 신호가 논리 회로 속을 전파할 때 생기는 지연 시간. 논리 신호의 시간에는, 상승 지연 시간 Trd와 하강 지연

리포트 | 2페이지 | 1,000원 | 등록일 2012.09.14 | 수정일 2014.01.01

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7. MOSFET Common Gate and

7. MOSFET Common Gate andCommon Drain Amplifiers실험목적? MOSFET 공통 게이트 증폭기에 대해 조사한다.? MOSFET 공통 드레인 증폭 ... 과 전압 이득을 구하면(14.9)(14.10)(14.11)를 얻을 것이다.(14.2)실험순서1. 그림 7-5와 같이 회로를 구성한다.2. 신호 발생기에서 10kHz, 200m정현파 ... 한다.5. 측정된 값을 이용하여 즉폭 이득 값을 계산하여 표 7-2에 기록한다.참고문헌 : 브레드보드와 PSPICE를 이용한 전자회로 실험(정원섭, 김훈, 차형우 공저)

리포트 | 12페이지 | 1,000원 | 등록일 2012.06.22

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