"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,141-1,160 / 2,110건

MultiSim 을 이용한 회로 모의 실험 보고서

실험 제목:Multisim을 이용한 모의 회로 실험실험 목적: Multisim 사용 방법을 완벽히 숙지하고 주어진 회로도를 보고 Multisim을 이용하여 모의 회로를 구성 해보 ... 를 떼어내고, 양단의 전압과 임피던스(합성저항값)만을 알면 그 소자에 흐르는 전류를 구할수 있다.실험원리 및 실험방법, 배치도1.전압 분배회로로서 저항이 똑같은 값이므로 전압은 각각 ... (amplitude) V1=0.99V가 측정되어젓다.우리조가 앞선 실험에서 실제로 측정하였을때는 Vin 1.60V v1=0.84V가 측정되었는데 이유는 이론적으로 회로에는I=V/R=2

리포트 | 23페이지 | 2,500원 | 등록일 2015.06.06

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[컴퓨터공학기초설계및실험1 예비레포트] RS 및 D 래치(Latch) / JK,T 및 D 플립플롭(Filp Flop)

의 간단한 변형으로, 인버터와 두개의 NAND 게이트 또는 두 개의 NOR 게이트로 구성되는 회로를 게이티드(gated) D(data 약자) 래치라 한다. D 라고 하는 하나 ... 는다는 것은 데이터를 저장하는 의미가 있다.참고문헌이재수/공학도를 위한 알기쉬운 디지털공학/한올출판사/2001.02.25이원석,정길수/논리회로실험/생능출판사/2010.03.05예비 ... 컴퓨터 공학 기초 설계 및 실험1예비보고서실험제목:RS 및 D 래치(Latch) (예비)JK, T 및 D 플립플롭(Filp Flop) (예비)예비보고서제목 및 목적제목RS 및 D

리포트 | 7페이지 | 1,500원 | 등록일 2015.04.12

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아주대 전자회로실험 설계예비2 CMOS OP AMP 설계

으로 제조된 CMOS는 TTL에 비해 소비 전력이 적고 직접도가 높은 논리회로를 구현할 수 있다.MOSFET은 Gate와 Source간의 전압차로 인해 발생하는 Drain-Source ... (Complementary metaloxidesemiconductor)는 P-MOS와 N-MOS의 단점을 보완하기 위해 만들어졌으며 마이크로프로세서나 SRAM 등의 디지털 회로를 구성 ... 하는데 이용된다.CMOS는 P channel과 N channel의 MOSFET을 전원 전압 V_dd와 V_ss간에 직렬로 구성하고 입력을 두 소자의 Gate에 연결, 출력은 P-MOS

리포트 | 4페이지 | 1,500원 | 등록일 2014.10.05 | 수정일 2017.08.03

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[예비]실험9. RAM

이 된다. Selection input이 1이 되면 다른 input들에 의해 회로의 동작이 달라진다. Read/Write input이 0이면 첫 단의 두 AND gate에는 1 ... input으로 회로를 동작시키고 Read/Write input으로 데이터를 쓰고 읽는 기능을 수행하며 데이터를 쓸 때 input값을 쓰는 것을 알 수 있다.?실험부품? 오실로스코프 or ... gate)? 74LS89(64-bit RAM with open collector outputs)④실험과정 및 예상 결과?실험1. 2-bit RAM- 위와 같이 2-bit RAM

리포트 | 4페이지 | 1,500원 | 등록일 2013.09.28

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Universal 게이트 실험 - NAND, NOR

1실험목적 및 기본 개념논리회로에서 가장 많이 사용되는 Universal 게이트인 NAND, NOR 게 이트의 기본 논리동작 및 특성을 실험을 통하여 이해하는 것을 목적으로 한다 ... . NOR 게이트의 기호, 진리표는 다음 그림과 같다.NOR Gate gate Symbol NOR Gate 진리표3) 다단계 NAND, NOR 회로- 이미 설명한 바와 같이 NAND ... 및 부품논리실험기(Digital Logic Lab. Unit), 오실로스코프, 7400(4조 2입력 NAND Gate), 7402(4조 2입력 NOR Gate)3실험결과1

리포트 | 6페이지 | 1,000원 | 등록일 2012.11.16

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논리회로실험 5주차 결과보고서

)을 Quartus Schematic을 이용하여 회로도를 그려보고 비교하여라.[ 간소화 전 ] F = A`BC + A`BC` + A`B`CAND Gate 3개, NOT Gate 3개, OR ... Gate 1개를 사용하였고,매우 복잡한 회로로 표시되었다.[ 간소화 후 ] F = A`(B+C)AND, OR NOT Gate 가 각각 1개 씩 사용하였고,간소화 전보다 훨씬 간결 ... 결 과 보 고 서5주차부울대수의 간소화(2)Verilog HDL code 이용분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1

리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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전자전기컴퓨터설계실험2(전전설2)7주차예비

에 대해 알 수 있는 실험이었으며 또한 counter 회로를 구현해볼 수 있는 실험이었다. State machine은 우리 일상속에서도 많이 사용되는 회로로 관련 제품들(자판기 등)에 대ne ... 수님실험조교 : 이 영 택실 험 일 : 2015년 11월 02일학 번 : 2012440이 름 :Ⅰ. 서론 (Introduction)1. 실험의 목적(Purpose of this ... Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 순차회로를 이해하고 순차회로 중 플립플롭 회로에 대해 이해한다.2. 배경 지식(Essential

리포트 | 17페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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논리회로실험 2주차 결과보고서

결 과 보 고 서2주차(실험1)NOT Gate를 이용한 실험장비 사용법분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.00과정 1[표 4] 1개 Not ... .991 v과정 3[그림 3] Breadboard[표 6] 3개의 Not Gate 결과 값inputoutputAXYZ0 V4.98 v0.06 v4.96 v5 V0.03 v5.002 ... .008 v0 V5 V4.004 v5 V0 V4.003 v5 V5 V4.002 v실험고찰1. 실험과정 3, 4, 5 표의 결과 값(v)을 논리 값으로 바꾸시오[표 10] 3개의 Not

리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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실험4결과 MUX&DMX

0 0 1 0) (1 1 0 0 0 1)위와 같은 회로 전체를 대신하는 74HC139를 사용하여 같은 회로를 구성하였다. 출력 Y0~Y3이 NOT gate를 통과한 듯 ... 하면 손쉽게 만들어낼 수 있다. 앞서 실험한 회로와 정확하게 동일한 I/O 특성을 보인다. Multiplexer IC는 다양한 곳에 사용될 수 있는데, 데이터를 저장하고, 읽어내어 처리 ... 을 할 필요 없이 단순하게 Demultiplexer를 구현할 수 있다. 주의할 점은 출력값이 invert되어 나온다는 것 하나이다. NOT gate를 추가로 연결하면, 회로 구성을 한

리포트 | 6페이지 | 3,000원 | 등록일 2014.05.13

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Digital Circuit1-Digital Gate & Flip-flop(결과)

에 연결한다.회로 칩을 작동시키려면, Vcc핀에 +5V 값을 넣어줘야 칩이 작동이 되면서, NOT Gate가 작동된다.따라서 DAQ의 +5V를 Vcc핀에 연결하면 된다.실험 결과로 A ... :03월 20일(수)제출일자:03월 26일(월)실험목적Digital Gate를 IC를 이용해 구현하는 방법을 익힌다.Flip-flop을 구성하고 동작 원리를 이해한다.실험결과실험 ... 1 :OR Gate(74HC32)실험결과분석 :OR Gate( )의 논리식은 X·Y=Z로 표기할 수 있다.그에 따른 진리표(True Table)은 다음과 같다.진리표에 따르

리포트 | 17페이지 | 1,000원 | 등록일 2013.03.31

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예비 counter

)의 코드변환 동작에 관해 실험하고 그 동작원리를 이해2. 실험이론Counter: 디지털 시스템에 있어서 카운터는 계수능력을 갖는 회로로서 주로 계수에 사용된다. 컴퓨터에서는 데이터 ... 1. 실험목적- 카운터의 동작원리와 특성을 이해- 2진 시스템에서의 숫자표시와 2진 카운터에 대해 이해- 카운터를 이용해 디코딩(decoding)과 인코딩(encoding ... Positive-AND Gates- 2진 또는 3진 카운터에서 나오는 값을 확인하는데 사용operation condition :2.0 LEQ V _{CC} LEQ 6.0 [ Typ

리포트 | 5페이지 | 1,500원 | 등록일 2013.12.26

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논리 게이트 예비보고서

? 실험 제목 - 논리 게이트 ?실험 목적1. AND, OR, NOT, NAND, NOR, EXOR, EXNOR의 논리함수 개념과 Gate의 구조 및 기능을 습득.2. 논리회로 ... 의 표현방식 및 등가회로를 익힘.관련이론(1) NOT (Inverter)NOT 게이트는 하나의 입력변수로 수행되는 연산으로, 역(inverse) 또는 보수(complement) 연산 ... 때 출력이 1이 되는 논리회로를 말한다. 기호 및 진리표는 다음과 같음(3) AND 게이트AND 게이트는 두 입력 변수 중 어느 하나의 논리라도 0이게 되면 출력이 0이 되는 논리

리포트 | 5페이지 | 1,000원 | 등록일 2014.06.03

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Quartus II와 Modelsim 사용법 및 FPGA를 이용한 검증 결과

는 Not gate X 입력 값의 출력 값이 된다. 따라서 X의 변화에 따라서 Y의 값도 같이 변화가 있는 것을 확인할 수 있다.2. 실험 고찰1. Not Gate 한 개 사용 ... 결 과 보 고 서3주차실험 2 : Quartus II 와 ModelSim 사용법 및FPGA를 이용한 검증1. 실험 결과본 실험은 아래 두 과정을 통해 Quartus II ... 와 ModelSim 사용법을 익히는 데 목적이 있다.또 DE2-115 FPGA로 결과 값을 확인하고 검증한다.- Quartus II 프로그램을 이용하여 NOT Gate 1개에 input

리포트 | 6페이지 | 2,000원 | 등록일 2014.01.06

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서강대학교 전자회로실험 3주차 결과보고서 - PSpice 사용법 및 시뮬레이션 실습

inverter의 기능을 한다고 볼 수 있다.4. 실험 결과 및 discussion1) DC sweep아래 그림 7과 같이 OP-AMP를 이용한 회로를 설계하고 OP-AMP의 입력 전압 ... 에서 OP-AMP 설정 기본 값으로 vpos=+15V, vneg=-15V로 되어있는 것을 확인 할 수 있었다.2) DC Parametric sweep실험 회로도는 다음과 같다.그림 ... urrent)이다. 실험 회로도를 위와 같이 구성했을 때 I가 0.25mA로 측정되었다. 하지만 우리가 원하는 값은 2.5mA이므로 10배를 증가시켜야 했다. 이를 위해 MbreakN

리포트 | 21페이지 | 1,000원 | 등록일 2014.11.30

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쉬프트 레지스터 예비보고서

으로 내보낼 수 있게 된다. 병렬입출력형 쉬프트 레지스터실험방법 & 시뮬 & 시뮬해석1. SN7474를 이용하여 의 회로를 구성하라. 먼저 PRESET 단자를 잠시 0으로 하였다가 1 ... 도시뮬 결과시뮬해석실험1번의 경우 SN7474를 이용하여 회로를 구성한 것으로 SI를 통하여 직렬데이터를 병렬데이터로 변환하는 시스템이다. 처음에 PRESET제어를 통해서 모든 ... 어라CLR을 hight에 고정하고 ring counter을 동작시켜라.회로도시뮬 결과시뮬해석실험2번의 경우 링 카운터에 대한 실험이다. 순차적으로 하나씩 동작하게 하는 회로이며 다른

리포트 | 10페이지 | 1,000원 | 등록일 2014.06.03

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전자재료 실험 결과 보고서

과 목 : 전자재료실험과 제 명 : 결과보고서담당교수 : 이재찬 교수님학 과 : 신소재공학부학 년 : 2학년학 번 : 2012310291이 름 : 윤용승1. 실험 목적 ... Capacitor는 전기회로에서 전하를 저장할 수 있는 장치이다. 전하를 저장하는 역할 이외에도 직류전류를 차단하고 교류전류만 흘려보내는 역할을 하기도 한다. 두개의 전도체로 이루어져 있 ... 에서도 Capacitor의 두께에 따른 Capacitance와 누출 전류 (Leakage Current)를 측정하여 그 경향성을 분석해 보려 한다.2. 실험 이론(1) 파울리 배타원리

리포트 | 13페이지 | 1,000원 | 등록일 2014.12.11

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[공학]BASIC GATES (예비보고서)

(논리회로 실험)실험 3. BASIC GATES(예비 보고서)5조학부 : 전자공학부학번 : 200020325이름 : 류병철제출일 : 2005. 9. 30.1. 배경이론*논리값 ... 학교 전기 정보 공학부 자료실.Digital Design _ Wakerly디지털 논리 회로 실험 _ 김동원외.2. 1. 실험 방법 (1)에서처럼 2-input gate를 이용하여 3 ... 값은 변하지 않으나 전류값만 증폭되는 버퍼(Buffer)가 있다.*논리게이트 (Logic Gate) ???????????논리회로의 입력이나 출력은 그림1-1과 같이 논리 0 또는

리포트 | 24페이지 | 3,000원 | 등록일 2007.06.20 | 수정일 2015.08.26

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논리회로) Pro_VSM 드모르간법칙

- 기본 회로를 구현하여 브레드보드와 로직박스의 사용법에 대하여 익힌다.- DeMorgan`s Laws을 회로로 구현하여 확인한다.3. 실험 내용 ① 2Input-AND, OR, NOT gate에 해당하는 칩의 동작을 LED를 통하여 확인하고 진리표와 비교 분석 하시오. ... 1. 실험 제목 : 브레드보드와 로직박스 사용 및 Pro-VSM을 이용한 회로 시뮬레이션2. 실험 목적 - Pro-VSM을 이용해서 미리 회로를 검증하고 분석 및 구현한다.

리포트 | 1페이지 | 1,000원 | 등록일 2013.06.09

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서강대학교 디지털논리회로실험 3주차결과

디지털논리회로실험실험3. Decoders and Encoders담당교수 : 김 영 록제 출 일 : 2013. 10. 01.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... . equation을 구하였다. 이를 Inverter와 OR Gate를 이용하여 구성한 회로는 다음과 같다.▲ 2-to-4 Decoder의 SchematicDecoder는 하나 ... 0001011011101101110110111Target을 위와 같이 두고 만든 logic으로 실험한 결과값들이 위와 동일하게 출력되어 맞는 Logic임을 확인하였다. 실제 Gate들을 이용

리포트 | 8페이지 | 2,000원 | 등록일 2014.01.02

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논리회로실험) ALU 예비보고서

장치라고 부른다. ALU 은 지난 실험 간에 사용되었던, AND, OR, XOR, NOT 등의 GATE 회로들을 포함하여, 덧셈, 뺄셈, 곱셈, 나눗셈 등을 수행하는 연산 논리회로 ... 값의 크기가 ‘크다’, ‘작다’ 등으로 비교를 한다.- 논리 연산 장치이전 실험에서 다루었던 논리 연산자들 AND , OR , XOR, NOT 등의 GATE를 통해 그 수 치를 ... 예 비 보 고 서12주차실험 11 : ALU1. 실험 목적- ALU 의 원리를 이해하고, 특성을 실험으로 익힌다.2. 기본 실험 이론* ALU 란 무엇인가? ??- ALU

리포트 | 3페이지 | 2,000원 | 등록일 2014.01.06

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