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"cise" 검색결과 141-160 / 523건

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    경도측정 예비보고서(고체재료실험)
    )이 문제가 된다. 그림 3.c의 indentation size effect(ISE)는 작은 scale에서 압흔의 크기가 작아질수록 경도가 증가하는 경향이 관찰되는 것이다.앞서 설명 ... 부하로 인해 재료 변형에 대한 시료의 저항을 나타내는 측정치? 긁힘 경도(scratch hardness) : 날카로운 물체의 마찰로 인해 시료가 파단(fracture) 또는 영구 ... )의 형태와 다양한 크기로 A부터 K까지의 scale이 있고, 압입자는 120°의 원뿔 다이아몬드(diamond cone) 형태와 강구(steel spheres) 형태가 있다. 이 중
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 1,000원 | 등록일 2020.05.08 | 수정일 2020.05.11
  • 디시설 - 기본적인 디지털 논리회로 설계
    *************001101100101010111001111112. ISE 또는 Quartus에서 새로운 프로젝트를 생성하고 Block Diagram/Schematic을 이용해[그림 3-14]의 회로를 설계하라. 설계된 회로도 ... 는 다음에 나타내라.3. 자일링스 ISim의 테스트 벤치에서 입력 신호 A, B, C에 대한 Stimulus를 입력하거나, 알테 라 시뮬레이터의 vwf에서 시뮬레이션 입력 신호 A ... , B, C에 대한 파형을 입력한 후 시뮬레 이션을 실행한다. 각 입력에 대한 시뮬레이션 결과를 [표3-7]에 작성하고 시뮬레이션 결과 화면을 캡처하여 넣어라.ABCF1F2시뮬레이션
    Non-Ai HUMAN
    | 리포트 | 10페이지 | 1,000원 | 등록일 2019.07.20
  • 서강대학교 디지털논리회로실험 레포트 3주차
    \* ARABIC 22) DecodersDecoder는 하나의 code쳬계를 다른 code체계로 변환하는 논리 회로이다. 다수의 입력과 출력을 갖는데, 일반적으로 입력이 출력 ... 에 비해 더 적은 bit수를 갖고 입력 code와 출력 code 사이에 1대1 mapping 관계를 갖는다. 일반적인 형태의 decoder는 그림 3과 같다. 그림에서처럼 enable ... 신호가 존재할 경우, 이 신호들의 상태가 만족되어야 정해진 기능으로 동작한다. 그렇지 않을 경우 이 decoder의 출력은 어떤 입력들에 대해서도 “disable”에 해당하는 c
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    | 리포트 | 12페이지 | 1,000원 | 등록일 2020.08.12 | 수정일 2020.08.26
  • 전자응용실험 3장 예비 [BJT 출력 특성 측정]
    에 콜렉터-베이스 접합의 공핍 영역은 대부분 콜렉터쪽으로 늘어난다. 콜렉터 전류는 베이스에서 전자의 기울기에 비례하는 확산 전류(diffusion current)이다. 전자의 기울기 ... 된다. 이 모델은 1970년 H. K. Gummel과 H. C. Poon에 의해 제안된 charge-based 모델로 그림 3.4에 나와 있다. 즉, 바이폴라 트랜지스터의 전류-전압식 ... 전류를 각각 모델화 한 것이다.C_JE와C_JC는 각각 베이스-에미터 접합, 베이스-콜렉터 접합의 접합 커패시턴스를 나타낸 것이다.C_DE와C_DC는 각각 베이스-에미터 접합
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,500원 | 등록일 2020.11.15
  • 영어
    . Her new house is very small.2. They like soccer very much.3. The cheetah runs very fast.4. She made ... to succeed.10. I can't allow you to behave like that.11. It smells delicious.12. She resembles her ... mother.13. Her mother made us delicious food.14. The children appeared on the stage.15. Blue made
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    | 리포트 | 11페이지 | 1,500원 | 등록일 2019.08.28
  • 서울시립대학교 전자전기컴퓨터설계실험2 제03주 Lab02 Post
    Post-lab Report전자전기컴퓨터설계실험Ⅱ3주차. 『HBE-ComboⅡ-SE』board,Lab#02 『Xilinx Spartan3』FPGA chip,『ISE』digital ... - Lab#02 『HBE-ComboⅡ-SE』board,Lab#02 『Xilinx Spartan3』FPGA chip,『ISE』digital design tool, 서울시립대학교 ... 한다.Result of ProgrammingInput A = 0, Input B = 0, C_in = 0Input A, Input B, C_in에 각각 해당하는 Bus Switch 1, Bus
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2017.09.04
  • 오셀로 3막 1장,2장,3장 분석 레포트
    적 차원의 비평까지 매우 다양하다. 브래들리(A.C. Bradely)와 하일만(Robert Heilman)은 이 극을 보통 사람에 대한 드라마로 해석함으로써 인종주의적 범주를 초월 ... teal it; but she so loves the token,For he conjured her she should ever keep it,That she reserves it ... poor, too weak, for my revenge.Now do Isee ‘tis true. Look here, Iago,All my fond love thus do I blow
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 2,000원 | 등록일 2020.12.04
  • Sequential Logic DesignⅡFSM and Clocked Counter
    )Introduction (실험에 대한 소개)Purpose of this Lab : state machine에 대해서 알아보고 Moor machine과 Mealy Machine을 ISE 프로그램 ... 을 설정한다. 그 후 기본으로 작성된 Text Fixture 파일을 Simulation 조건에 맞도록 다음과 같이 수정한다.ISE 시뮬레이션 프로그램인 Isim을 이용하여 시뮬레이션 ... -bit up counter아래의 조건에 맞추어 Source를 작성해 본 후 실험결과를 확인해 본다.Input : Clock, Reset, Up, Load, Load
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    | 리포트 | 13페이지 | 1,000원 | 등록일 2016.04.06
  • 시립대 전전설2 [2주차 결과] 레포트
    전자전기컴퓨터설계실험 ⅡPost-reportHDL을 사용한 디지털회로 설계 툴 (Xilinx ISE) 사용법1. Introduction (실험에 대한 소개)가. Purpose ... 의 입력을 받아 올림수(C)의 합(S)과 새로운 올림수 두 개의 출력을 출력하는 가산, 즉 두 비트를 더하여 합과 올림수를 만들어내는 회로로 2진 비트를 쓰는 컴퓨터 회로이다. 그림 ... 과 같이 A, B를 각각 입력 단자로 하는 논리합은 S, 자리올림은 C로 나온다. 그러나 이 AND, OR, NOT 등을 사용한 간단한 회로에서는 더욱 하위에서의 자리올림을 처리
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    | 리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 근전도의 생리 및 기본 개념 EMG physiology
    EMG physiology basic conceptionNervous tissuePlasma membrane : outer boundaries of the cell ... Function 1) Maintain cell’s integrity 2) Produce sustain ion concentration gradients and electric charge ... structural molecules 1) Protein (45~49%) 2) Carbohydrate (2~10%) 3) Lipid (45~49%) : phospholipid, c
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    | 리포트 | 68페이지 | 4,000원 | 등록일 2018.10.30
  • Combinational Logic Design ⅠArithmetic Logic and Comparator
    (참고문헌)Introduction (실험에 대한 소개)Purpose of this Lab : 연산회로에 대해서 알아보고 반가산기, 전가산기 및 4-bit 가산기를 ISE 프로그램 ... (A, B)를 더하여 합(S)과 자리 올림 수(C)를 산출하는 논리 회로Truth table전가산기두 개의 입력 비트와 자리올림의 입력비트(Carry IN: Ci)를 합하여 합 ... 조건에 맞도록 다음과 같이 수정한다.ISE 시뮬레이션 프로그램인 Isim을 이용하여 시뮬레이션 진행한다.프로그래밍을 하기 위해 implementation으로 돌아와 Generate
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    | 리포트 | 17페이지 | 1,000원 | 등록일 2016.04.06
  • 전자회로 설계 및 실험2, 19. 푸시-풀 증폭기 결과보고서
    한다.3. B급 푸시-풀 상보 대칭(complementary-symmetry) 음성 증폭기 동작을 관찰한다.4. 이 증폭기에서의 직류 바이어스, 전류 및 파형을 관찰한다.기초 이론B급 ... 는 거의 B급에 가깝게 동작하는 중전력 트랜지스터인데, 두 트랜지스터의 동작 영역 간의 Dead Band로 인한 크로스 오버(cross over) 왜곡이 발생할 수 있다. 이를 방지 ... 파라미터:.MODEL Q2N2102 npn+IS=1.1791e-10 BF=79.3546 NF=1.42901 VAF=30.134+IKF=0.640083 ISE=7.91563e-12 NE
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2018.09.19
  • 전자전기컴퓨터설계2 HBE-COMBO ll VerilogHDL 실습6 [예비레포트]
    bit up counter 설계Input : Clock, Reset, Up, Load, Load EnableOutput : Count OutClock이 Rising Edge일 때 ... )를 넘어서면 다시 0부터 Count 시작나. Materials(Equipments, Devices) of this Lab(1) Xilinx ISE다. Matters that ... 가. supposed result(1) Procedure of the Lab 1.4bit up counter 설계Input : Clock, Reset, Up, Load, Load
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2017.10.19
  • 실험1. BJT DC 특성
    다.{dI _{C}} over {dV _{CE}} ��(V _{BE} =상수)`= {dI _{C}} over {dV _{CB}} = {ISe ^{{V _{BE}} over {NFV ... 실험1. BJT DC 특성1. 실험 목적BJT(Bipolar Junction Transistor)의 DC 특성인beta _{F}-I _{C},I _{C}-V _{CE} 특성 ... }의 콜렉터 전류에 대한 변화, 즉,beta _{F}-I _{C} 특성을 측정한다.2) BJT의 log(I _{C})vsV _{BE} 특성에서 포화전류 IS를 구한다.3) BJT의I _{C
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2017.10.12
  • Combinational Logic Design Ⅱ Decoder, Encoder and Mux
    )Introduction (실험에 대한 소개)Purpose of this Lab : 조합논리회로에 대해서 알아보고 디코더 및 MUX회로를 ISE 프로그램을 이용하여 설계해본다. 이를 이용 ... 에 맞도록 다음과 같이 수정한다.ISE 시뮬레이션 프로그램인 Isim을 이용하여 시뮬레이션 진행한다.프로그래밍을 하기 위해 implementation으로 돌아와 Generate ... Switch 3, 4입력 S : BUS Switch 8출력 Q : LED 1, 24 : 1 MUX 회로를 설계하시오입력 A, B, C, D : 버튼 스위치 1, 2, 3, 4입력 S
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    | 리포트 | 16페이지 | 1,000원 | 등록일 2016.04.06
  • 전자전기컴퓨터설계실험2(전전설2) (3) Logic Design using Verilog HDL
    (베릴로그)는 전자회로와 시스템에 사용되는 하드웨어 기술 언어로, 회로 설계, 검증, 구현 등 여러 용도로 사용할 수 있다.C언어와 비슷한 문법을 가져서 사용자들이 쉽게 접근할 수 ... 있도록 만들어졌다. ‘if’나 ‘while’과 같은 제어 구조도 동일하며, 출력 루틴 및 연산자들도 거의 비슷하다. 다만 C 언어와 달리, 블록의 시작과 끝을 중괄호 기호를 사용 ... 및 사용법(1)Xlinx ISE(Integrated Synthesis Environment)(2)HBE-COMBO Ⅱ1.1. Verilog HDL1.1.1. Verilog 어휘
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    | 리포트 | 84페이지 | 2,000원 | 등록일 2019.10.11 | 수정일 2021.04.29
  • 로지스틱 허브 마케팅,로지스틱 허브 정의,로지스틱 허브 사례분석,브랜드마케팅,서비스마케팅,글로벌경영,사례분석,swot
    prestigious universities of Hungary and companies Key factorsLogistics hub Government Industry s ... uppori RotterdamLessons form Dubai Rotterdam “ Make trade easier, faster and cost effective for all ... Stake-holders through continued improvement of business process and application of technology.” Dubai
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    | 리포트 | 30페이지 | 2,500원 | 등록일 2018.06.05
  • 성인실습 문헌고찰, case-급성신부전
    (pharymgitis)등 급성 질병을 앓았는지 소변색이 점점 짙어지거나 혼탁해졌는지 질 문하기2) 혈액검사· 혈중질소 노폐물 수치가 중요· 혈청 creatinine은 점차↑하여 1주 ... 출 판사. 581-582▶ 질병관리본부 http://cdc.go.kr/CDC/intro.html▶ 서울대학교병원 의학정보 http://www.snuh.org/health/tv ... .do▶ 서울아산병원 http://www.amc.seoul.kr/asan/healthinfo/disease/diseaseDetail.do?contentId=31699▶ HiDoc
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    | 리포트 | 30페이지 | 3,500원 | 등록일 2020.09.08
  • 미국식, 영국식 영어의 차이와 쓰임새
    the house.- 부사거의 -않다는 영국영어에서는 scarcely+긍정어로 표현하고 미국영어에서는 almost+부정어로 표현합니다.e.g) 영국식 : I had scarcely ... 대TillResister계산서BillCheck우편번호Post codeZip code시작 요리StarterAppetizer횡단보도Zebra crossingCross walk포장 ... Inquir면으로 볼 때 과장되거나 불필요한 요소를 생략한 특징이 있는 반면 영국의 철자는 고유의 모습을 갖고 있는 특징이 있습니다.- 미국식 영어로는 's'를 영국식 영어에서는 모두 'c
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2019.08.30
  • Sequential-Logic-Design-Ⅱ-FSM and Clocked-Counter
    hypothesis and the result나. Data analysis (compare results, reasons of error)5. Conclusion (결론 ... (Abstract) >이 실험에서는 먼저 값을 증가시키고 감소를 시키는 state machine에 대해서 알아보고 Moor machine과 Mealy Machine을 ISE 프로그램 ... 을 이용하여 설계해보았다. 또 이를 넘어서서 4-bit up counter, 더 나아가 8-bit up/down counter, 더 복잡한 연산을 포함하는 moore state
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    | 리포트 | 25페이지 | 3,000원 | 등록일 2016.04.06 | 수정일 2017.03.08
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2026년 01월 07일 수요일
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9:43 오전
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