"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 1,081-1,100 / 2,110건

아주대 논리회로실험 실험예비3 가산기와 감산기(Adder & Subtractor)

실험 3. 가산기와 감산기(Adder & Subtractor) 예비보고서● 이론(1) 반가산기(Half adder)두 개의 2진수를 더하여 합(Sum) S 와 자리 올림 ... (Carry) C를 출력하는 조합논리 회로입력출력xyCS0*************10(2) 전가산기(Full adder)두 개의 2진수와 아랫자리의 자리 올림을 더하여 합(Sum) S ... 와 자리 올림(Carry) C를 출력하는 조합논리 회로입력출력xyzCS0000000101010010111010001101101101011111(3) 반감산기(Half-s

리포트 | 8페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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9주차 결과 전자전기컴퓨터설계 실험 3 (2014.05.16)

영역이라고 한다.회로구성예상결과값실험결과-이론상 0.5V의 threshold voltage를 넘으면 전류가 흐르기 시작하고 이후 급격하게 증가하게 된다. 실험에서 사용한 npn타입 ... 해석을 할 수 있다.5.결론(Conclusion)아직 전자회로 시간에 MOSFET이 끝나지 않아 BJT에 관해 제대로 숙지 하지 못하였다. 그렇기 때문에 실험도 어려웠고 정확한 실험 ... (Introduction)-실험목적-실험을 위해 필수 배경이론, 개념방법(Materials and Methods)-실험 도구 및 재료-실험 절차와 방법실험결과(Result)-측정 결과토론

리포트 | 15페이지 | 1,500원 | 등록일 2014.07.01 | 수정일 2014.07.03

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[아주대] 논리회로실험 8장 예비(Counter)

어 counting되는 결과를 관찰한다. 3개의 출력이 존재하므로 3개의 AND gate를 사용한다.< 실험 3-1 >74HC90 소자를 이용하여 위와 같이 회로를 구성하고 R0 ... 에 다다르면 다시 0으로 시작되는 회로이다. 플립플롭을 이용하여 구성한 카운터와 BCD 카운터를 사용하여 실험한다. 플립플롭을 사용하는 경우 비동기식 카운터와 동기식 카운터로 나눌 수 ... PROCEDURES< 실험 1 >위와 같이 J-K 플립플롭소자를 이용하여 2단 2진 비동기식 카운터를 구성하고 각각의 출력상태를 AND gate로 묶어주어 counting되는 결과를 관찰

리포트 | 7페이지 | 2,000원 | 등록일 2013.09.25

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[아주대] 논리회로실험 6장 예비(Latch & Flip-Flop)

, 74HC76, 74HC10, LED, 330Ω저항, 74HC574 PROCEDURES실험1)위와 같이 NAND gate를 이용하여 R-S F/F회로를 만들고 각각 입력C와 S, R ... 에 따른 진리표를 작성한다.실험2)위와 같이 NAND gate와 inverter를 이용하여 D F/F회로를 구성하고 각각의 입력 D와 C에 다른 출력을 관찰하고 진리표를 작성 ... 한다.실험3)D F/F소자인 74HC574로 회로를 구성하여 74HC574에 대한 입출력 관계를 측정한다.실험4)3-input NAND gate와 2-input NAND gate를 이용

리포트 | 10페이지 | 2,000원 | 등록일 2013.09.25

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[예비]실험5. Decoder & Encoder

)? 74HC148(8-to-3 line Octal Priority Encoder)④실험과정 및 예상 결과?실험1.- 74HC08과 74HC04를 이용하여 아래의 encorder 회로 ... 하여 출력 값을 관찰하고 기록한다.?실험3.- NAND gate와 not gate를 이용하여 밑의 10진수를 Excess-3코드로 변환하는 encorder를 구성한다. excess-3 ... 5. Decoder & Encoder?실험목적1. 디코딩(Decoding)과 인코팅(Encoding)의 코드 변환 동작에 관해 실험하고 동작원리를 이해한다.?실험이론? 디코딩

리포트 | 5페이지 | 1,500원 | 등록일 2013.09.28

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[7주차] Transistor의 응용 회로 실험 2 예비레포트

과 목 :전자공학실험1담당 교수 :구현철 교수님학 과 :전자공학부요 일 :조 :제 출 일 :Transistor의응용 회로 실험2(예비)전자공학실험1 보고서제출일조점수학번성명실험 ... 제목Transistor의 응용 회로 실험 2실험목적MOSFET Transistor의 기본적인 특성을 이용하여 스위치로서의 동작을 확인한다.전반기 다이오드와 트랜지스터를 이용한 실험 ... 을 정리한다.실험내용Transistor의 스위치로서의 동작, 디지털 회로실험준비물트랜지스터, 저항, Power Supply, 멀티미터, 함수발생기1. 실험 1에서 예상되는 결과

리포트 | 6페이지 | 3,000원 | 등록일 2013.10.28

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[7주차] Transistor의 응용 회로 실험 2 결과레포트

므로 NOR Gate의 출력결과를 갖는다. 또한 두 번째 실험은 두 입력값이 모두 1일 때만 출력 값이 0이 나오고 그 외의 입력에서는 1이 출력되는 회로인 NAND Gate ... 과 목 :전자공학실험1담당 교수 :구현철 교수님학 과 :전자공학과요 일 :조 :제 출 일 :Transistor의응용 회로 실험2(결과)전자공학실험1 보고서제출일조점수학번성명실험 ... 제목Transistor의 응용 회로 실험 21. Experiment Results1) Digital Logic using Transistor실험 1-(a)-1 회로도실험 1-(a)

리포트 | 5페이지 | 3,000원 | 등록일 2013.10.28

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논리회로실험 실험6 Latch & Flip-Flop 결과보고서

F/F (Gate 이용)구성 사진 :- 실험 1의 회로에 변화를 줘서 3-INPUT AND Gate를 이용한 J-K F/F를 설계하고 결손도에 따라 브레드보드에 회로를 설치한다. ... (Gate 이용)- 실험 과정 및 이론 :S-R F/F의 R부분만 NOT 게이트를 통과시켜 S로 연결한 회로이다. 이렇게 회로를 구성함으로써 D F/F은 S-R F/F의 S, R ... 7주차 결과보고서실험 6 Latch & Flip-Flop▶실험과정 및 결과◈ 실험 1 : R-S F/F구성 사진 :- 74HC00게이트 4개를 사용하여 결손도를 참고하여 회로

리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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전전컴실험Ⅱ 06반 제03주 Lab#02 [『HBE-ComboⅡ-SE』, 『ISE』] 예비 보고서

2”을 위한 실험 순서 및 구현 방법1. Project Navigator program을 사용하여 XOR GATE 회로를 만든 후 저장한다.2. JTAG를 이용하여 HBE ... 에서 HBE-COMBO II –SE의 Bread board에 직접 만들었던 회로를 ISE Project Navigator program(XILINX)을 사용하여 구현하는 실험이 ... 은 디지털 논리 회로 실험에서 가장 많이 사용하는 기본 Peripheral로 구성하였다. BreadBoard를 탑재하여 장비의 기본 peripheral 이외의 다양한 회로를 실험

리포트 | 14페이지 | 1,000원 | 등록일 2013.09.09 | 수정일 2013.09.15

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아주대학교 논리회로실험 실험4 예비보고서

IC칩 안에는 앞서 실험에서 구성한 회로가 들어 있을 것이라 예상할 수 있다.ⅱ) Demultiplexer☞ Enable을 갖는 1x4 디멀티플렉서를 74HC11과 74HC04 ... 를 이용하여 다음 회로와 같이 구성한다. 데이터 입력 D는 enable 입력의 역할도 동시에 함을 주목하여 실험한다.☞ 다음 표와 같이 입력을 가한 뒤에 출력 Y3, Y2, Y1, Y0 ... XXXXXX000111000+511010+5010110+5+50111☞ Truth Table을 살펴보면 앞선 실험과 다른 결과가 나온 것으로 보이는 이유는 앞선 실험의 구성 회로

리포트 | 10페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02

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[예비]실험8. Counter

쪽 그림과 같이 출력이 나오고 4개의 출력상태를 AND gate를 이용하여 묶어주어 각각의 clock시간에 따라 0에서 3에 해당하는 AND gate에 출력이 나타나게 된다.?실험 ... ’010101010B100110011B’011001100AB(=0)100010001A’B’(=1)010001000AB’(=2)001000100A’B(=3)000100010실험1의 회로는 앞 ... 것이다. 3개의 출력상태를 가지므로 3개의 AND gate로 묶어주었고 3진 카운터가 될 것이다.?실험3-1. 7-segment 표시기를 갖는 BCD Counter- 74HC90

리포트 | 5페이지 | 1,500원 | 등록일 2013.09.28

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아주대 논회실 논리회로실험 실험5 예비보고서

1. 실험 목적- NOT gate와 AND gate를 이용하여 Decoder와 Encoder를 구성하고 디코딩(decoding)과 인코딩(encoding)의 코드변환 동작에 관해 ... 실험하고 그 동작원리를 이해한다.- NAND gate를 이용하여 Excess-3 코드를 구성하고 동작을 확인하고 4x2 Encoder와 차이점을 알아본다.- 74HC148 IC ... - 8 to 3 Priority Encoder4. 실험 과정 및 예상 결과2X4 DecoderNOT gate 두 개와 AND gate 네 개를 이용하여 2x4 Decoder를 구성

리포트 | 8페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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기본 게이트 설계 결과보고서

과 목 : 논리회로설계실험과 제 명 : 기본 게이트 설계담당교수 : 국태용 교수님담당조교 : 김태경 조교님학 과 : 전자전기공학과학 년 : 3학 번 :이 름 :제 출 일 ... : 2014. 3. 27논리회로설계 실험 결과보고서 #1실험 1. 기본 게이트 설계1. 실험 목표AND, NOT, NAND, OR, XOR, NOR 게이트의 기호와 기본적인 동작 특성 ... 을 이해고, 실험을 통해 동작적 모델링과 자료 흐름 모델링 방법으로 기본 게이트들을 설계하고, 진리표를 통해 게이트를 설계하는 법을 익힌다.2. 실험 결과실험 1. 2개의 입력을 가진

리포트 | 8페이지 | 1,000원 | 등록일 2014.07.25

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아주대 논회실 논리회로실험 실험6 예비보고서

특성을 이해해본다.2. 실험 이론-Latch(래치)래치는 비동기 기억소자로서 하나 이상의 비트들을 저장하기 위한 디지털 논리회로이다. Latch는 하나의 데이터 입력, 하나의 클럭 ... gate4. 실험 과정 및 예상 결과1) R-S F/F- C가 High 인 동안에 입력이 출력에 반영된다.SRCQ(t)001Q(t-1)0110:Reset1011:Set1111xx0Q ... 1. 실험 목적- 여러 종류의 Flip-Flop을 구성하여 그 동작 특성을 알아본다.- 반도체 memory (RAM : Random Access Memory)를 플립플롭을 이용

리포트 | 6페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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555 타이머, not gate 실험 결과보고서

, not gate 회로를 제작하고, 555 timer 에 대해 알아보자실험원리그림 1 555 타이머의 내부 구조 그림 2 555 타이머의 핀 배치도555 타이머는 안정적이고, 여러 용도 ... 듯이 입력을 하면 출력값은 입력값의 반대의 값이 나오게 된다. 즉 not gate의 성질은 입력값을 뒤집에 주는 (반전의 의미) 기능을 한다.실험방법실험 1그림 71. 그림 7과 같 ... 는 지 확인한다.실험 2그림 81. 그림 8과 같은 회로를 구성한다. (V_s=6V)2. input의 전압을 0V~+V_s 또는V_s 이상의 값으로 변화시켜 가면서 출력 전압을 관측

리포트 | 7페이지 | 1,500원 | 등록일 2013.11.09

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[A+ 예비보고서] 아주대 논리회로실험 실험3 '가산기& 감산기'

실험 3 예비보고서1. 실험목적-Logic gates를 이용하여 가산기(adder)와 감산기(subtractor)를 구성하여 동작을 확인해본다.-디지털 시스템의 기본 요소인 가산 ... 에 더함으로써 구할 수 있다. 이 방법에 의하면 뺄셈은 전가산기를 사용하는 덧셈이 된다. 그러나, 뺄셈을 직접 수행하는 논리 회로를 구성하여 뺄셈을 할 수도 있다. 이번 실험에서는 전 ... 과 차이점을 이해한다.2. 실험이론●가산기(adder)-이번에 실험할 가산기에는 전가산기(full adder: FA)와 반가산기(half adder: HA)가 있는데, 간단

리포트 | 5페이지 | 1,000원 | 등록일 2015.03.27

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[아주대] 논리회로실험 8장&9장 결과(Counter&RAM)

에서 공급전류원은 5V DC 전압을 사용했다.< 실험 1 >< 실험 1 > 회로도실험 결과 구성한회로 사진위와 같이 회로를 구성하여 2단 2진 비동기식 카운터를 만들었다. clock ... 의 출력 4개가 시간에 따라 서로 다른 4개의 상태를 가지도록 하였다. 각각의 상태를 AND gate를 사용하여 연결하고 각각의 출력이 counting되는 모습을 살펴보았다.< 실험 ... ⑶AB’(=2)001000100⑷A’B(=3)000100010< 실험1 > 실험 결과 사진⑴⑵⑶⑷⑸실험1에서는 예비보고서에서 작성한 바와 같이 위의 진리표를 따라 AND gate

리포트 | 6페이지 | 2,000원 | 등록일 2013.09.25

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아주대 논회실 실험6 결과보고서

을 갖는 Latch with Enable(Gate 이용)1) 실험과정 및 결과? 74HC00과, 74HC04를 이용하여, Enable 값을 갖는 Latch를 만든다.2) 고찰 ... (Gate 이용) 만들기1) 실험과정 및 결과? 74HC10과, 74HC00을 이용하여, JK-FF의 동작과 비슷한 Enable 값을 갖는 Latch를 설계 ... 는 실험이었는데, JK플립플롭이 아니므로 gate로 구현되었기 때문에 생기는 문제가 있었다. 그것은 반전기능의 문제였다. 다른 J K C 에 따른 값은 원래 JK-FF의 진리표와 똑같이

리포트 | 5페이지 | 1,500원 | 등록일 2014.03.10 | 수정일 2014.03.21

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아주대 전자회로실험 설계 예비보고서 2. CMOS 증폭단 설계

수 있는 실험회로를 찾았고 그 결과 Degeneration을 사용한 회로를 구성하고자 계획하고 직접 실험하였다.3. 실험 이론* MOSFET- MOSFET의 경우 기존 BJT ... 설계 2. CMOS 증폭단 설계1. 실험목적CMOS 증폭단을 설계하여 CMOS의 증폭 여부와 특성을 확인한다.2. 설계준비이번 설계실험은 Common Source (공통소스단 ... 능동부하 증폭단의 특성을 측정하는 실험도 했다. 따라서 처음에는 다른 설계를 하기 위해서 많이 고민하였다. 이번실험에서 원하는 주제는 공통소스 증폭단을 만들어서 특성을 알아보

리포트 | 9페이지 | 1,500원 | 등록일 2015.10.06

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전전컴설계실험2-5주차결과

Simulation을 수행하시오.-실험과정1) 1-bit Full Adder의 Logic도를 이해한다.2) Gate Primitive Modeling 방법으로 설계하기 위해 다음과 같은 c ... 차 실험--목차-서론(Introduction)-실험목적-실험을 위해 필수 배경이론, 개념-실험의 가설 및 근거방법(Materials and Methods)-실험 도구 및 재료-실험 ... 절차와 방법실험결과(Result)-측정 결과의 도식적 표현-측정 결과의 설명4.토론(Discussion)-실험의 가설과 일치 여부-실험 측정 결과의 해석 및5.결론

리포트 | 23페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15

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