"회로실험 gate"의 검색결과 입니다.

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"회로실험 gate" 검색결과 941-960 / 2,110건

NAND, NOR, XOR 게이트 디지털회로실험 예비보고서

디지털회로실험 결과보고서-Lesson 3 예비NAND, NOR, XOR 게이트1. NAND 게이트 동작 확인NAND gate시뮬레이션 결과결과 예측입력출력ABCDEFG ... 고 실험에 임하기 때문에 결과를 미리 쉽게 예측할 수 있었고 논리도를 설계하는 것도 어렵지 않았던 실험이다.4.XOR 등가 회로XOR 등가회로결과 예측입력출력ABCDE ... 00000011011001111000XOR 게이트의 등가회로이기 때문에 위 논리도의 결과는 예비실험 3의 XOR게이트의 결과값과 동일한 값이 나와야 한다. 시뮬레이션 결과 동일한 결과를 얻을 수 있

리포트 | 6페이지 | 1,000원 | 등록일 2010.05.23

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경북대학교 전자공학실험1 올A+ 결과보고서 10장

1. 실험목적- 바이폴라 접합 트렌지스터의 전류-전압 특성을 알아보고 전류-전압 특성을 이용하여 직류 등가 회로와 소신호 등가 회로의 모델 파라미터를 얻는다.- BJT 트랜지스터 ... 의 동작점과 동작점 안정화를 위한 바이어스 회로의 설계에 대해서 실험한다.2 .실험내용실험 1 ① 실험전에 사용될 BJT의 정상여부 판별.*CMOS invertor와 BJT ... 에 반드시 맞는 표현은 아니다. 그러나 가장 간단한 구조의 경우에는 맞는 표현이다. 이 경우에 PMOS의 gate width는 보통 NMOS의 2배 정도를 사용한다. 이유- 표면

리포트 | 10페이지 | 3,000원 | 등록일 2015.11.04 | 수정일 2022.03.28

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전자회로실험(MOSFET CS, CG, CD 증폭기 결과보고서)

을 측정할 것이다. 이 실험을 바탕으로 각 증폭기의 구조와 동작원리를 이해하도록 한다.2.실험결과1) CS (Common-Source) Amplifier(1) 의 회로를 구성하시오 ... 하면 이득 값이 증가한다.2) CG (Common-Gate) Amplifier(5) 의 회로를 구성하시오.(V _{DD} =15V,```R _{D} ``=`1.5㏀,```R _{G1 ... 증폭기와 CD증폭기의 특성을 알아보는 실험 이였다. 이번 시험은 회로구성은 쉽게 할 수 있었다. 결과적으로, CS,CG증폭기를 보면 이득 값이 1보다 큰 것을 볼 수 있었고, CD

리포트 | 6페이지 | 1,000원 | 등록일 2016.11.02

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아주대 논리회로실험 실험결과7 복호기와 부호기 (Decoder & Encoder)

실험 7. 디코더와 인코더 결과보고서● 실험 결과 분석실험 1. 2단 2진 카운터 (시뮬레이션 대체)그림 2의 회로를 구성하여 그림 3에 다음의 파형을 그리시오.1) 출력 A ... 를 입력한 NAND gate의 6번 핀 출력파형8) 핀 1에 A, 핀 2에 B를 입력한 NAND gate의 6번 핀 출력파형실험 2. 3진 카운터 (시뮬레이션 대체)이 실험에서는 카운터 ... 파형7) 핀 1에 A’, 핀 2에 B를 입력한 NAND gate 7420의 핀 6번 출력파형실험 3. 10진 디코더를 갖춘 BCD 카운터 (시뮬레이션 대체)7490은 NBCD

리포트 | 9페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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보고서-RS Latch,D Latch

}Q0*************000101NOR gate(TTL IC 7402)를 사용하여 그림 1과 같이 회로를 꾸민다. 표 1에 따라 각각의 입력에 따른 출력을 살펴본다. 이 ... latch의 진리표3. D latchNOR(7402), AND(7408) 및 INV(7404, 실제에서는 7402의 남은 gate를 쓰는 것이 편리하다)를 사용하여 그림 2와 같이 회로 ... RS-Latch 및 D-Latch이름학번실험 3 : RS-Latch 및 D-Latch1. 실험 날짜 : 13. 10. 10 목2. 실험 결과 : 1) RS latchRSbar{Q

리포트 | 4페이지 | 1,000원 | 등록일 2014.11.25

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아주대 논회실 논리회로실험 실험1 결과보고서

할 때 신중해야 할 것이다.실험 2의 회로 결선도2. 고찰-실험 의의기본적인 logic gates(AND, OR, NOT, NAND, NOR, XOR)에 대해서 이해하고 이러 ... 되어 있는 AND, OR, NOT gate를 이용하여 회로를 구성하고 입력 값에 따른 출력 값을 확인하는 실험이었다. 종류는 AND, OR, NOT gate 세 가지 밖에 없 ... 지만 이 세 개의 게이트로 NAND gate, NOR gate를 포함한 여러 가지 논리회로를 구성할 수 있었다.실험1)에선 두 개의 입력 값을 받는 게이트를 이용하여 세 개의 입력 값

리포트 | 6페이지 | 1,500원 | 등록일 2014.04.08 | 수정일 2015.04.16

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연세대학교 전자회로 1차 프로젝트

전자회로 설계실험Class: 화3, 목 1,2정 성 욱 교수님나 태 희 조교님◎Spec 정리 표-problem 11.각 트랜지스터의 W/LM1M2M3M4M5M6W/L74um/0 ... 1055.56M621.324mV1.V _{DD} =2.5V2. 0.25um≤Length of gate≤2um3. 0.25um≤Width of gate≤100um4. Body of ... 에 연결시켜서 큰 gain의 손실을 막아주는 역할이다. 여기서 말하는 Buffer의 정의는 서로 다른 두 회로가 있을 때 두 회로 사이를 전기적 문제가 생기지 않도록 결합해주는 역할

리포트 | 10페이지 | 2,000원 | 등록일 2016.12.06

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실험10 Digital logic(예비)

]005500.2050.2550.2-실험 방법(1)Inverter를 그림의 회로와 같이 연결 한 후 V1의 값을 0V와 5V를 인가한 후 출력전압을 측정 한다.(2)NOR gate ... 예비보고서Digital Logic실험일 :제출일 :학 번 :이 름 :- 실험목적트랜지스터의 이용하여 inverter 및 nor gate를 구성한다.입력전압에 따른 inverter ... 및 nor gate 출력 전압을 측정한다.트랜지스터를 이용하여 구성한 inverter 및 nor gate의 원리를 이해한다.- 실험원리 및 이론1)Inverter- 입력전압V

리포트 | 4페이지 | 1,000원 | 등록일 2014.12.11

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4장 MOSFET CS amplifier 예비

4. MOSFET CS amplifier학부: 전자공학부성명:과목: 전자회로실험지도교수:제출일: 2014.09.29.월학번:◎ 실험목적MOSFET 증폭기의 바이어스 방식을 공부 ... _{S}=I _{ D}R _{ S} (식1)V_{ G}=0V 이므로V_{ GS}=0-V _{ S}=-I _{ D}R _{ S} (식2)2. 실험에 사용될 회로도그림 2의 회로는 N ... )◎ 실험방법① 그림 2의 실험 회로도와 같이 실험회로를 구성하고, VDD를 15V로 조정하시오. 정현파 발생기의 출력을 1000Hz에서 최소로 조정한다.② 스위치 S1을 닫

리포트 | 6페이지 | 1,000원 | 등록일 2015.11.29

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디지털실험 한학기 예비&결과 모음

의 결과이다. 0.031V가 측정되었다. 디지털 실험에서 이 값은 0으로 처리할 수 있다. 위의 실험 결과와 같이 생각해 보면 이 회로는 NOT gate와 등가인 것을 알 수 있다.실험 ... 그림 회로이다. 왼쪽 붉은 집게가 입력이고 오른쪽 집게가 출력이다. 그라운드는 아래쪽에 모아 놨다.이번 실험에서 사용한 전원공급장치이다. 0V와 5V를 줘야하기 ... 회로이다. A와 B둘 중 하나라도 5V가 들어가면 저항에 5V가 걸리면서 출력이 5V로 출력될 것이다.이것을 이용하여 gate d latch를 만든다. 게이트

리포트 | 1페이지 | 4,000원 | 등록일 2014.09.15

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실험5 단상 위상제어 정류기

은 신재생 에너지, 전기자동차 등과 같은 주요 산업 분야에 널리 사용되는 실용학문이다. 본 실험에서는 전력변환 회로에 대해 소개하고(전력전자-산업전자 수업내용), 이에 대한 ... 인 0.05를 total time으로 사용하였습니다.실험(5) Team Project 단상 반파/전파 회로2.2. 과제2-반파 위상제어 정류회로: R-L부하2.2.1. sc ... 회로실험(5) Team Project 단상 반파/전파 회로2.3. 과제3-전파 위상제어 정류회로: RL부하(L이 커서 정전류원으로 가정)실험(5) Team Project 단상 반파

리포트 | 9페이지 | 2,000원 | 등록일 2015.06.12

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[아주대]논회실 예비 실험1. Basic Gates

-input NOR gate 예상결과입력출력ABCY00010010010001101000101011001110실험2): 회로도와 예상결과입력출력ABXYZ00101010101011111111회로결손도 ... 실험1. Basic Gates실험 목적 eq \o\ac(○,1) Logic gates의 종류와 동작에 대해 이해한다. eq \o\ac(○,2) Boolean equation ... 과 De Morgan의 법칙을 이해한다.실험 이론 eq \o\ac(○,1) Logic gatesLogic gate의 종류에는 NOT, OR, AND XOR 등이 있다.논리 연산을 수행

리포트 | 6페이지 | 1,000원 | 등록일 2014.09.04

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아주대 논리회로실험 실험예비7 복호기와 부호기 (Decoder & Encoder)

실험 7. 복호기와 부호기 (Decoder & Encoder) 예비보고서● 이론(1) 복호화(Decoding)2진수를 10진수로 바꿔주는 것으로 카운트 상태를 AND gate ... 1,2,3,4 의 출력값이 위의 주어진 표와 같이 나오게 된다. 결국 위의 표와 같은 원하는 출력을 얻을수 있는 인코딩 회로가 구성된 것이다.● 실험 시뮬레이션1) 2단 2진 ... 카운터그림 2의 회로를 구성하여 그림 3에 다음의 파형을 그리시오.1) 출력 A의 파형2) 출력 A’의 파형3) 출력 B의 파형4) 출력 B’의 파형7420의 NAND gate의 4

리포트 | 12페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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실험10. 소스 공통 증폭기 예비보고서

와 MOSFET의 차이는?☞ JFET은 동작에 있어 항상 역방향 바이어스가 되어야 한다. 즉, gate 전압이 음전압이므로 회로의 응용 및 설계에 불편을 가져다주는 경우가 많 ... 실험10. 소스 공통 증폭기실험 목적1. MOSFET의 드레인(drain)특성을 실험적으로 결정한다.2. FET 증폭기에 대한 바이어스 방식을 공부한다.3. MOSFET 소스 ... 가 FET의 기판으로부터 절연되어 있기 때문에, 절연 게이트 FET(IGFET - Insulated Gate FET)라고도 한다. 게이트와 기판은 SiO2 절연막에 의해 분리된 커패시터

리포트 | 7페이지 | 1,000원 | 등록일 2016.05.03

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[컴퓨터공학기초설계및실험2 보고서] Ripple-Carry Adder (RCA) design

고 바로 gate를 사용하여 구현하였다. 아래의 회로도 처럼 2-input XOR gate 2개와 2-input NAND gate 3개를 사용하여 1-bit full adder ... 컴퓨터 공학 기초 설계 및 실험2 보고서실험제목: Ripple-Carry Adder (RCA) design제목 및 목적제목Ripple-Carry Adder (RCA) design ... 이해하고 이해한 가산기 내용을 바탕으로 RCA를 설계하는 데에 목적이 있다.원리(배경지식)Adder(가산기)는 입력에 의해 출력이 결정되는 조합 논리 회로(combinational

리포트 | 20페이지 | 2,000원 | 등록일 2015.04.12 | 수정일 2015.04.24

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전전컴설계실험2-2주차예비

와 올림수용의 회로로 구성되어 있다.(3)Hypothesis of this Lab & Basis of the assumption이번 실험은 TTL시리즈를 이용하여 디지털회로의 Gate ... of the Lab 1.-OR Gate 실습회로-(2) Procedure of the Lab 2.실험에서 XOR Gate는 TTL 7486으로 구현되므로 A,B와 Y단자는 TTL ... 의 스위치를 조작하여 각각의 경우에 LED 불이 들어오는지를 실험하여 기록한다.-XOR Gate 실습회로-(3) Procedure of the Lab 3.반가산기를 구현할 때

리포트 | 9페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15

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전지전자기초실험 연산 회로 설계 실험 결과레포트

전기전자 기초실험 결과보고서제9장 연산 회로 설계 실험학과학년학번분반실험조성명전기전자공학26. 실험과정 및 결과측정::: 4비트 덧셈기/뺄셈기>>WAVEFORM(1) SEL이 0 ... . 결과보고서① 자리 올림 예견법(carry look ahead)의 장단점을 조사하고 위의 회로와 비교하시오.위 그림의 입력 A, B를 x, y라 놓으면 2진 ... +p_3 p_2 g_1 +p_3 p_2 p_1 g_0 +p_3 p_2 p_1 p_0 c_0각각의 방정식은 3개의 레벨 지연에 의한 회로와 대응하는데 - 발생 alc 전파 신호에 대

리포트 | 7페이지 | 1,000원 | 등록일 2017.12.01

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실험 5. 래치와 플립플롭(Latch & Flip-Flop)

) NAND gate를 이용하여 클럭화되지 않은 R-S latch 회로를 구성하고 그 동작을 설명하시오.입 력출 력상 태SRQQ`0011INVALID0110SET1001RESET ... 1101NO CHANGENAND gate를 이용하여 클럭화되지 않은 R-S latch 회로※ 입력에 따른 Latch의 동작 설명위와 마찬가지로 NAND gate로 구성된 Latch ... 변함11이전 Q'이전 QNAND gate를 사용한 JK F/F 회로도Master F/F은 시간 펄스가 상승할 때 동작하고, Slave F/F은 시간 펄스가 하강할 때 동작한다.?이

리포트 | 3페이지 | 2,000원 | 등록일 2012.03.11

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디지털실험 2예비 논리 게이트

예비보고서실험 2. 논리 게이트실험 목적1. AND, OR, NOT, NAND, EXOR, EXNOR 의 논리함수 개념과 Gate의 구조 및 기능을 습득한다.2. 논리 회로 ... 의 표현방식 및 등가회로를 익힌다.실험 이론1. NOT (Inverter)NOT 게이트는 하나의 입력과 출력을 가지는 연산으로, 역(inverse) 또는 보수(complement) 연산 ... 의 검출, 코드변환 등에 사용된다.예비보고서 문제1. 을 SN7402로 구성하고 (단, 저항은 삭제) 실험 6의 내용을 관찰하라.SN7402를 이용하여 의 회로를 꾸민 모습이다. 4

리포트 | 10페이지 | 1,000원 | 등록일 2014.09.30

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실험3결과 ADD&SUB

이다. XOR gate가 있는 74HC86과 AND gate가 있는 74HC08을 사용하였다. 실제로 사용하는 회로 구성요소도 적어, 가장 쉽게 구성할 수 있었다. Carry ... 와 가수를 입력받아 빌림이 없는 차와 빌린수 두 가지 출력을 내보낸다. 회로상으로 보았을 때, AND gate로 들어가는 입력 중 하나가 invert된다는 점만 차이가 있다. 즉 ... 번 실험에서 수행한 크게 두 가지의 대표적인 연산 회로는 논리적 연산을 수행하는 모든 종류의 컴퓨터 속에 내장된 ALU의 가장 기본적 요소라고 할 수 있다. 굉장히 중요하고, 광

리포트 | 5페이지 | 3,000원 | 등록일 2014.05.13

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