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디멀티플렉서 디지털시스템실험 컴활1급 필기 up down counter 7segment FPGA bcd to 7 segment bpsk 기초디지털실험
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"4bit binary" 검색결과 1-20 / 1,087건

  • 자료 표지
    4 to 2bit binary encoder 설계 베릴로그
    . 입력이 4비트로 들어오면 맨 뒷자리 부터 0이 몇 번째 idx에 처음으로 등장했는지 확인해야함 . 이 회로는 AND게이트를 하나 사용해서 EI가0이면 아무값도 안나오게하 ... -//// File : en2_TB.v// Generated : Fri May 4 12:35:33 2018// From : c:\My_Designs\en\en\src\TestBench\en2 ... -#10 D=4'b1001; EI=0;#10 D=4'b1101; EI=0;#10 D=4'b0000; EI=0;#10 D=4'b0010; EI=0;#10 D=4'b0100; EI=0
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    | 리포트 | 18페이지 | 2,500원 | 등록일 2021.04.09
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  • 자료 표지
    [부산대학교][전기공학과][어드벤처디자인] 9장 4비트 Binary Adder, 2's Complement 4비트 Adder / Substrator 연산회로(9주차 결과보고서) A+
    어드벤처디자인 결과보고서4비트 Binary Adder, 2’s Complement4비트 Adder / Substrator 연산회로학과: 전기공학과학번:이름:실험 목적2의 보수 ... 에 대한 이해를 바탕으로 Binary 4-Bit 가/감산기를 이해한다. Binary 4-Bit 가/감산기를 구성하고 동작을 파악한다.실험 방법TTL IC를 이용하여 그림 9.1의 회로 ... 1S0Overflow2-3-0101X4-3-0111X74+1011O-1-1-1110X-1-1+0000O2-(-3)4-(-3)7+4-1+(-1)-1-(-1)자리 올림 예견법의 장단점
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,000원 | 등록일 2021.04.25
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  • 자료 표지
    아주대학교 논리회로 / VHDL 설계 과제 보고서 (4 bits Gray to Binary code conversion)
    1. 논리회로 설계 내용 및 동작 원리 설명A) 알고리즘4비트 그레이 코드를 4비트 2진 코드로 변환 하 는 일반적인 알고리즘은 다음과 같다 .1. 4비트 그레이코드를 입력 ... 하고 B1에 출력한다.5. 출력된 B1와 G0 (LSB)의 입력값을 XOR 연산하고 B0 (LSB)에 출력한다.B) 진리표와 최소식위 방식은 그레이코드를 4비트 2진코드로 변환 ... 한다.2. G3 (MSB) 값을 그대로 B3 (MSB) 값에 출력한다.3. 출력된 B3과 G2의 입력값을 XOR 연산하고 B2에 출력한다.4. 출력된 B2와 G1의 입력값을 XOR 연산
    Non-Ai HUMAN
    | 리포트 | 4페이지 | 1,000원 | 등록일 2020.05.29 | 수정일 2020.06.05
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  • 자료 표지
    4bit binary up/down counter
    *Digital Design Term Project4 Bit Binary Up/Down CounterContents - Structural Description State ... is following TE = X'D'C'B'A' + XDCBA 3. Self-stopping counter 4-bit binary up/down counter(Fig 6-13 ... . Integrated Circuit There are some integrated circuits. This IC is very similar to 4-bit binary up/down c
    Non-Ai HUMAN
    | 리포트 | 10페이지 | 1,000원 | 등록일 2010.11.19
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  • 자료 표지
    [Flowrian] 4 Bit Binary Counter (TTL 74163) 회로의 Verilog 설계 및 검증
    본 회로는 4 비트 바이너리 카운터 회로 (TTL 74163) 으로서 0에서 15 까지의 이진수를 순차적으로 세는 카운터이다. 리셋을 포함하여 모든 신호는 클럭의 상승에지에 동기 ... 되어 동작하며, 4 비트 데이터를 병렬로 입력하는 기능, 2개의 카운터 인에이블 단자, 카운터 최대값 15에 도달했음을 알려주는 단자 등이 있다.TTL 74163 회로에 대한 문서
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 1,000원 | 등록일 2012.08.27
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  • 자료 표지
    [Flowrian] 4 Bit Binary Up/Down Counter (TTL 74193) 회로의 Verilog 설계 및 검증
    동작사양본 회로는 4비트 이진수를 증가하는 방향으로 혹은 감소하는 방향으로 카운팅하는 카운터회로이다. 다른 카운터와 다른 특징은 카운팅 증가와 감소 클럭이 별개로 사용된다는 점이
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 1,000원 | 등록일 2012.09.29
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  • 자료 표지
    [Flowrian] 4-Bit Binary Full Adder (TTL 7483)의 Verilog 설계 및 시뮬레이션 검증
    - TTL 7483회로에 대한 문서에는 게이트들로 구성된 조합논리회로도가 제공되지만 본 문서에서는 레지스터 전송 수준(RTL, Register Transfer Leverl)에서 동일한 논리를 구현하도록 설계한다.
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,000원 | 등록일 2012.05.05
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  • 자료 표지
    논리회로실험 첫번째 프로젝트 BCD to 7segment 가산기 결과
    하는 방법이다. 2진수는 주로 4비트가 활용된다. 각 비트마다 8,4,2,1의 숫자가 대응 되서 한자리 수를 표현하는데, 다른 방법으로는 4,2,2,1 또는 7,4,2,1 등이 있 ... egment Decoder- BCD-to-7세그먼트 디코더는 디코더의 일종으로, 4비트로 구성된 BCD 값을 입력으로 받아들여 7 segment에 각 디스플레이가 출력 값이 되어 표시기 ... ) 소스코드BCD adder1bit adder- 구조적 모델링을 사용하여 bcd 가산기를 설계하였다. 먼저 한자리 수 가산기를 작성하였는데, 그에 해당되는 bcd는 4bit 2진수이
    Non-Ai HUMAN
    | 리포트 | 10페이지 | 1,500원 | 등록일 2021.10.01
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  • 판매자 표지 자료 표지
    기초전자회로및실험2 -ALUs(Arithmetic logic units)를 이용한 n-bit 계산기 설계
    (74147) 소자를 이용해서 2 진수로 변환 . 이를 4bit adder(74283) 2 개를 이용하여 구현한 8bit BCD to Binary 를 통해 binary 로 변환 ... bit) 74185 ( Binary to BCD converter ) 7447 (BCD to7segment) BCD code 7SegmentPSPICE 결과 3 PSPICE ... 3. 곱셈기 ( 승산기 ) : 2 진수 곱셈 방식과 구현 4. 나눗셈기 ( 제산기 ) : 2 진수 나눗셈 방식과 구현 5. 출력 : 각각의 사칙연산의 결과값을 배타적으로 출력하기
    리포트 | 15페이지 | 1,000원 | 등록일 2023.06.22 | 수정일 2023.06.25
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  • 판매자 표지 자료 표지
    [부산대 어드벤처 디자인] 9장 2의보수 및 4비트 가,감산기 예비보고서
    1. 실험목적2의 보수에 대한 이해를 바탕으로 Binary 4-Bit 가/감산기를 이해한다. Binary 4-Bit 가/감산기를 구성하고 동작을 파악한다2. 실험 이론감산기
    리포트 | 7페이지 | 2,000원 | 등록일 2024.03.15 | 수정일 2024.04.15
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  • 자료 표지
    디시설, 디지털시스템설계 실습과제 7주차 인하대
    했다. 우선 input으로 enable신호를 선언해 주었고, 4비트 input binary_in과 16비트 output decoder_out을 선언해 주었다. i는 integer(32 ... 비트)로 선언해주었다. sensitivity list에 enable과 binary_in을 넣어서 두 값 중 하나의 변화라도 있으면 동작하도록 했다. 이후 always문 내부 ... 하고 enable이 0이면 output에는 모두 0이 저장된다. 이어 enable이 1일 때 다시 binary_in==i 연산의 결과가 1인지 0인지 판별하여 1일경우 해당 output 비트
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    | 리포트 | 3페이지 | 1,500원 | 등록일 2021.08.31
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  • 자료 표지
    연세대 디지털논리회로 프로젝트 (QM method 구현하기)
    를 확인할 때 is_1bitgap함수를 사용하는데 그것은 다음과 같다.2-2) is_1bitgap(bin1, bin2)이 함수는 두 binary number를 입력으로 받아서 bit ... 의 차이를 계산하는 함수이다. 각 bit끼리 비교하며 서로 같은 경우 그대로 두고 서로 다른 경우 ‘-‘로 바꾸어 준다. 비교를 끝낸 후 하나의 bit만 다른 경우 바뀐 binary ... .Line 5: 각 solution안에 있는 각 term들에 대하여,Line 7~11: 각 term에 해당하는 binary number의 각각의 bit들을 하나씩 literal로 바꾸
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    | 리포트 | 11페이지 | 10,000원 | 등록일 2021.12.12
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  • 자료 표지
    [서울시립대] 전자전기컴퓨터설계실험2 / Lab08(결과) / 2021년도(대면) / A+
    ] 4-bit up counter의 출력 값을 single FND에 표시하시오.Source codeTestbenchPIN testbench 시뮬레이션 결과 설계한 4-bit up c ... odeTestbenchPIN testbench 시뮬레이션 결과 설계한 Piezo의 동작을 확인하는 모습(3) [실습 3] 0000~1001, 즉 0~9까지 값을 가지는 4-bit bcd 입력을 받 ... odeTestbenchPIN testbench 시뮬레이션 결과 설계한 Logic의 동작을 확인하는 모습(5) [실습 5] 8-bit 2’s complement signed binary 입력을 받
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    | 리포트 | 17페이지 | 2,000원 | 등록일 2022.07.16
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  • 자료 표지
    [예비보고서] 7.논리함수와 게이트
    bits Binary code를 앞서 정의한4 bits Thermometer code로 변환하는 Decoder를 의미한다. 진리표와 회로도는 다음과 같다.B1B0T3T2T1T00 ... Binary to Thermometer 디코더의 기능에 대해 설명하고, 그 정의에 따라 진리표를 만들고, 2x4 회로도를 설계한다.(답안)Decoder는 N개의 입력과 개의 출력 ... 어, 이전 상태에서 가장 우측에 존재하던 0이 하나씩 1로 바뀌는 듯한 코드를 의미한다.즉, 2x4 Binary to Thermometer Decoder란 입력으로 들어온 2
    리포트 | 4페이지 | 1,000원 | 등록일 2023.01.03
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  • 자료 표지
    DES 암호화 프로그램(파이썬)
    )))print("아스키코드 : ", ascii_values)print("이진수표기 : ", binary_values)2. 8자리 아스키코드로 구성된 문자열(평문)을 비트열로 출력하기, t) ... 8자리 영문문자열을 입력받아 DES 암호 알고리즘을 통해 암호화 및 복호화를 하는 프로그램목차1. 원리2. 파이썬 소스코드 설명3. 파이썬 소스코드4. 실행 결과[부록] 별도 ... 으로 결정된다. DES는 64비트의 블록 암호화 알고리즘으로 56비트 크기의 암호화키로 암호화된다. 따라서 생성 가능한 암호화키는 최대 256(약 7200조)가지이다. 암호
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    | 리포트 | 14페이지 | 1,000원 | 등록일 2022.04.29 | 수정일 2022.05.10
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  • 자료 표지
    (A+/이론/예상결과/고찰) 아주대 통신실험 예비보고서11
    }는 bit duration이다. (R _{b}는 bit에서의 bit rate이다.)unipolar random binary 신호의 power는 똑같은 진폭의 unipolar s ... equences (PRBS)Pseudo-random binary sequences은 완전히 random한 비트 열은 아니지만, 의사적으로 random해 보이도록 만들어진 패턴을 갖는 비트 ... 한다. 오실로스코프의 화면은 그림 1.7과 닮아야한다.4. 그림 1.7에서 sequence의 길이가 몇 bit인가? (Table 1.2의 첫 번째 줄에 써라)각 sequence에서 1
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2021.10.24
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  • 자료 표지
    fpga bcdconverter
    module의 원리는 4가지 방법으로 설명가능하다. 본 설계에는 입력을 8비트로한다.1. Binary number를 왼쪽으로 1bit씩 shift 한다.2. 왼쪽으로 shift되었을 때 값 ... 한 Verilog Module에 대한 설명Binary to bcd converter module의 원리는 4가지 방법으로 설명가능하다. 본 설계에는 입력을 8비트로한다.1 ... . Binary number를 왼쪽으로 1bit씩 shift 한다.2. 왼쪽으로 shift되었을 때 값이 5이상이면 3을 더한다.3. 1,2번을 반복한다4. binary 가 8bit
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    | 리포트 | 20페이지 | 2,000원 | 등록일 2021.05.05
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  • 자료 표지
    논리회로실험(VHDL 및 FPGA실습) 이론 및 실험결과 레포트
    알아본다.2. Background1) Binary Representation이번 실험에서 구현할 4bit full adder & subtracter는 Binary Code를 이용 ... + XY'Ci' + XYCiCo = X'YCi + XY'Ci' + XYCi' + XYCi3) 4 bit full adder & subtracter4비트 가/감산기(4 bit ... +yM:1 -> s=x-y 가 된다.이를 적용해 4비트 가/감산기를 설계하면 다음 그림과 같다.설계한 4 bit 가/감산기를 Xilinx에 VHDL code로 만들고 다음 예제를 적용
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    | 리포트 | 53페이지 | 8,000원 | 등록일 2022.01.25 | 수정일 2022.02.08
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  • 자료 표지
    디지털시스템설계실습_HW_WEEK9
    adder의 citical path delay를 계산해보는 시간이었다.파라미터의 숫자를 바꿔줌으로써 n-bit의 cla adder가 되는 것을 통해 간단하게 큰 비트의 adder ... 가 생성되는 것을 알 수 있었고, Report Analysis를 통해 세부적인 정보를 확인할 수 있었다. 또, 4비트와 32비트의 citical path delay를 보면 4비트일 ... 때는 6.672ns였는데, 32비트에서 7.416ns로 된 것을 보면 bit가 커질수록 critical path delay가 길어진다는 것을 증명할 수 있는 시간이었다.
    리포트 | 8페이지 | 2,000원 | 등록일 2023.06.11
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  • 자료 표지
    서울시립대 전전설2 Lab-08 예비리포트 (2020 최신)
    고 8-bit (unsigned) binary number가 주어진다고 하면 왼쪽으로 한 비트씩 옮기다가 100’s, 10’s, 1’s 각 칸에 5이상의 값이 채워지는 경우 3을 더한 ... 후 다시 왼쪽으로 한 비트씩 옮기는 과정을 거치면 된다. 다 옮겨서 binary칸에 값이 없을 경우 그 옆에 있는 값들이 최종 bcd 값이 된다.3. 실험 방법[실습 1] 4 ... 는 것을 확인할 수 있다. input이 버튼 1에서 버튼 8로 갈수록 진동수가 크고 주기가 짧은 고음이 출력된다.[실습 3] 0000~1001, 즉 0~9의 값을 가지는 4-bit
    Non-Ai HUMAN
    | 리포트 | 17페이지 | 1,500원 | 등록일 2021.09.10
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2025년 12월 28일 일요일
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