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24진 카운터 digital watch vending machine vhdl d플립플롭cadenc vhdl 디지털 시계 10진 카운터
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"Edge decoder" 검색결과 1-20 / 74건

  • 자료 표지
    트랜스포머 블록과 윤곽선 디코더를 활용한 딥러닝 기반의 피부 병변 분할 방법 (Deep Learning based Skin Lesion Segmentation Using Transformer Block and Edge Decoder)
    한국정보통신학회 김지훈, 박경리, 김해문, 문영식
    논문 | 8페이지 | 무료 | 등록일 2025.04.17 | 수정일 2025.05.10
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    기초실험1 7 segment counter 결과보고서(틴커캐드)
    결과보고서학 과학 년학 번조성 명전자공학과실험 제목7Segment_Counter실험 결과1. 7 segment: 7 segment decoder와 7 segment LED를 연결 ... 해 Decoder에 입력되는 이진수에 따라 대응되는 10진수의 표기를 LED를 통해 확인할 수 있었다. 입력은 0000부터 1111까지 실험을 진행했으며, 아래는 실험 결과 ... 된다고 생각할 수 있다. Clock이 10번째 진행되면 0으로 초기화되어 다시 0000부터 시작하고, Q0는 5번, Q1은 2번, Q2는 1번, Q3는 0번의 falling edge를 갖
    리포트 | 8페이지 | 1,000원 | 등록일 2023.03.12 | 수정일 2023.11.29
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    서강대학교 21년도 디지털논리회로실험 9주차 결과레포트 (A+자료) - ROM, RAM, Dot matrix, key matrix
    디지털논리회로실험 9주차 실험 보고서목적- 메모리 소자들(ROM, RAM)의 동작 원리와 활용 방법을 이해한다.- Address decoding의 개념과 구현 방법을 이해한다. ... * 8 = 64k * 8bits = 512kbits의 용량을 갖게 된다.위의 그림은 EPROM의 내부 구조를 보여준다. Address 신호들은 decoder의 입력으로 들어가게 되 ... 고, decoder는 216개의 주소 중 하나를 activate하게 된다. 그 주소에 해당하는 data가 data bus를 통해 외부로 출력되게 되는데, 이 때 Chip
    Non-Ai HUMAN
    | 리포트 | 35페이지 | 3,000원 | 등록일 2022.09.18
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    VHDL_5_Digital Watch, 1초 생성기, 60진24진 카운터, MUX, FND decoder
    가 되면 초기화.21~30)클럭이 rising_edge이면 cnt에 1을 더함. 그리고 그것이 24999999면 sig를 토글함으로써 clock이 50MHz 진동했을 때 sig 출력 ... ~23)nRst가 Low면 모든 값 초기화.25~27)rising_edge일 때 carry는 0을 유지하고 temp_one은 지속적으로 1씩 상승.28~31)temp_one 즉 일 ... )rising_edge면 1의 자리인 temp_one에 1을 더함.25~29)십의 자리가 2일 경우에는 일의자리가 4일 때 모든 값 초기화.30~34)십의 자리가 2가 아닌 경우, 즉
    Non-Ai HUMAN
    | 리포트 | 22페이지 | 2,000원 | 등록일 2021.09.23 | 수정일 2022.04.04
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    12. Stopwatch 설계 예비보고서 - [아날로그및디지털회로설계실습 A+ 인증]
    디지털 회로의 출력은 대개 2진수로 표현되어 있으므로 이를 10진수 방식인 7-segment LED 로 바꿔 주기 위해 Decoder 를 사용해야 한다.일반적으로 7-segment ... decoder 는 0~9 까지 10개의 숫자를 나타내기 위해 4개의 입력 bit 가 필요하며, 7개의 segment 를 점등하기 위해 7개의 출력 bit 가 필요하다.실험 ... HC192 는 UP 카운터 핀에 클럭 인가 시 클럭 rising-edge 마다 (Q3 Q2 Q1 Q0) 값이 0000 -> 0001 -> 0010 -> … -> 1001 반복
    Non-Ai HUMAN
    | 리포트 | 11페이지 | 1,000원 | 등록일 2022.11.16 | 수정일 2023.01.03
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  • 자료 표지
    VHDL_4_counter, sequence detector, 4way traffic light counter, Soda vending machine
    _edge일 때 동작시키도록 하면 만들 수 있다.클럭을 넣으면 첫 번째 플립플롭은 그것에 맞춰서 1, 0의 상태가 바뀐다. 두 번째 플립플롭은 첫 번째 플립플롭의 변화에 맞춰서 변하 ... 는데 Falling_edge일 때 바뀌므로 첫 번째 플립플롭이 1에서 0으로 바뀔 때 상태가 바뀐다. 이후 같은 과정을 반복하여 상승카운터를 만들 수 있는 것이다.Clk ... ) JKFF의 출력을 임시로 저장할 signal 선언14) clock 또는 reset 신호 발생시 동작16) reset = 1 이면 0으로 초기화17) falling_edge일 때
    Non-Ai HUMAN
    | 리포트 | 34페이지 | 2,000원 | 등록일 2021.09.23 | 수정일 2022.04.04
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  • 자료 표지
    아주대 논리회로실험 실험8 Counter 예비보고서
    여 표시이 T F/F으로 구성된 비동기식 Counter의 경우 CLK signal이 rising edge일 때마다 toggle되므로, Counter의 각 비트는 앞의 F/F의 데이터 ... 로 일대일로 대응하여 표현하는 코드로 이러한 BCD코 드 코드를 통해 동작하는 Counter를 BCD Counter라고하며, BCD Code를 Decoding한 결과는 7 Segment ... 면 J/K F/F의 입력이 모두 1이고, CLK signal에 버블이 달려있으므로 falling edge마다 이 전에 가지고 있는값이 toggle된다. 두 F/F 모두 초기데이터가 0
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,000원 | 등록일 2021.05.07 | 수정일 2021.07.23
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  • 자료 표지
    부산대학교 기전실 스톱워치 설계
    에 Rising/Falling Edge가 발생할 경우 결과값을 토글하여 0과 1을 출력합니다. 이는 함수발생기의 CLOCK PULSE와 연결된 게이트를 거쳐 카운터로 들어가며, 토글 값이 1 ... 자리 카운터의 CLK로 입력시킵니다.동기식 10진 카운터 회로도동기식 6진 카운터 회로도5. 연결에 주의하며 카운터 각 자리의 값과 7 segment decoder, 그리고 7 s ... Flop에 저장하는 단순한 구조입니다. 두 숫자는 7bit로 표현 가능하므로, 7474 소자 4개로 구성할 수 있습니다.D Flip Flop은 CLK의 Edge가 발생할 때 D가 0
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 2,500원 | 등록일 2021.07.20 | 수정일 2023.06.06
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  • 자료 표지
    (A+/이론/예상결과/고찰) 아주대 논리회로실험 결과보고서9
    에 따라 각각 다이오드 한 개 씩 출력됨을 확인하였다.? 이론값과 실험값은 동일하여 성공적이었다.? 위의 회로는 마치 2x4 decoder의 동작을 보이고 있다.? 비동기식인 카운터 ... 위해서는 segment의date sheet가 필수적이다.? 실험의 대략적인 개요는 아래와 같이 표현할 수 있다.BCD to 7 segment decoder -> Display ... 는 구조 때문에 전송지연이 있다. 실험 1에서 2단2진 비동기식 Counter를 만들어 실험한 것을 보면, 상위 F/F은 Clock이 falling edge일 때마다 A값이 5V
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,000원 | 등록일 2021.10.24
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  • 자료 표지
    [논리회로설계실험]VHDL을 통해 구현한 RAM
    는 decoder로 구성되며, 데이터를 읽어들일수는 있지만, 바꾸지는 못한다. 출력단자로 들어온 입력값을 주소값으로 인식하여, ROM상에 저장된 위치를 주소값으로 찾아 저장된 데이터 ... do번 실습에서 쓰이는 알고리즘Flipflop을 이용하고, rising edge방식을 채택하며, enable값이 1일 때 동작한다. We값을 통해 ram배열안에서 read/write ... 기)가, we=1이면 write(저장)가 이루어진다. Rising edge방식이므로 xx5ns에서 실행이 일어난다. 다음표는 write가 모두 끝난 후(125ns까지), ram안에 주소값
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    | 리포트 | 15페이지 | 2,000원 | 등록일 2021.06.26
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  • 판매자 표지 자료 표지
    [마이크로컨트롤러]외부인터럽트
    . CPU 는 PC(program counter) 에 따라 순차적으로 메모리에서 명령어를 fetch 하여 명령어 해석기 (instruction decoder) 에서 명령을 해독 ... 0 1 - 1 0 INTn 이 하강에지 (falling edge) 에서 비동기적으로 인터럽트 요구 1 1 INTn 이 상승에지 (rising edge) 에서 비동기적으로 인터럽트
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    | 리포트 | 13페이지 | 1,500원 | 등록일 2022.10.10
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  • 자료 표지
    [서울시립대] 전자전기컴퓨터설계실험2 / Lab03(예비) / 2021년도(대면) / A+
    형의 경우에는 부호를 유지하고, unsigned reg 자료형의 경우에는 unsigned 값으로 취급한다.- 하드웨어 레지스터를 모델링하기 위해 사용될 수 있다. 그 예로, edge ... : false) else문 다음의 문장을 실행한다.- 형식- if문을 이용한 3X8 Decoder의 설계(6) reg 형 변수 a가 있을 때, 다음과 같이 값을 입력한 후의 a 값을 조사
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16
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  • 자료 표지
    종래의 차동증폭기를 사용한 인공위성 배터리 셀 전압 감시 시스템 (Satellite Battery Cell Voltage Monitor System Using a Conventional Differential Amplifier)
    한국항공우주학회 구자춘, 최재동, 최성봉
    논문 | 6페이지 | 무료 | 등록일 2025.05.24 | 수정일 2025.05.27
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  • 자료 표지
    VHDL실습 디지털 시계
    를 설정해줬다.fnd decoder 로 일의자리수와 십의자리수를 표현해야 하므로 4bit로 출력하기 위해 (3 down to 0)을 써줘서 4비트를 나타내주었다.리셋이 되면 일 ... 의자리와 십의자리를 모두 0으로 만들고, 클럭이 rising edge 일 때,일의자리가 9가 아니면 1을 더해주고 9면 0이 된다. 십의자리는 5가 아니면 1을 더해주고 5면 0 ... 설계한 60진 카운터를 확인할 수 있다.12진 카운터12진 카운터의 코드는 다음과 같이 짰다. 60진 카운터와 마찬가지로 fnd decoder 로 표현하기 위해 4비트로 표현해 주
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    | 리포트 | 14페이지 | 2,000원 | 등록일 2019.04.20
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    연세대학교 전기전자공학부 20-1학기 기초디지털실험 week 5 보고서
    and a decoder inside. Figure 3. is one example of a text-LCD control logic.Figure 3. example of s ... decoder. The first counter is counter x2000. Counter x2000 increases its output by one at each ... positive edge of the clock signal until 1999 and repeat this operation from 0. This output is used for
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    | 리포트 | 14페이지 | 3,000원 | 등록일 2020.08.18
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  • 자료 표지
    디지털 시스템 실험 Simple Computer 3 결과보고서
    만을 만들기 때문에 명령어를 받아올 수 없어 직접 입력하는 것이다. 반면 바로 밑의 always문을 보면 CLK가 rising edge일 때 WR값이 1이면 A주소의 SRAM값에 입력 ... 으로는 Control Unit의 구성요소인 Instruction Decoder와 Program Counter를 설계한다.먼저 Instruction Decoder는 13bit ... . 다음으로 이 Instruction 값을 Instruction Decoder의 입력값으로 주어 각각의 Control Signal로 분배해준다. 마지막으로 Program Counter
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    | 리포트 | 4페이지 | 1,500원 | 등록일 2016.04.08
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  • 자료 표지
    디지털 시스템 실험 RAM(Random Access Memory) 예비보고서
    를 저장하고 있다. 따라서 주소에 접근하기 위해 4-to-16 Decoder를 이용하고 있다.1.4 Cell Arrays and Coincident Selection위 회로는 두 개 ... 의 2-to-4 Decoder를 이용하여 16*1 RAM을 구현한 것이다. Row Decoder는 주소 값에서 높은 2bit의 주소를 선택하며, Column Decoder는 낮은 2 ... 11은 주소 값 1011에 저장된 Data 값이다.2. RAM의 기능2.1 WriteRAM에 데이터를 저장하는 기능이다. CLK이 positive edge이고 WE(Write
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2016.04.08
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  • 자료 표지
    디지털 논리회로 Xilinx와 key, dot matrix를 활용한 패턴 저장, 표출
    RLED 는 dot matrix 의 상 하 shift 에 관련되어 있다. C 는 clock 으로, clock 이 riging edge 일 때 작동하므로 clock 입력에 D flip ... 기 때문에 row 출력은 3비트의 row 주소를 decoder로 받으며 8자리 output에 모두 인버터를 달아주어 전체적으로 모든 row에 불이 들어오는 것 처럼 보이도록 설정
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    | 리포트 | 17페이지 | 2,000원 | 등록일 2020.12.03
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    서울시립대학교-전자전기컴퓨터설계실험2-제09주-Lab08-Post
    으로 나누면, 0.001911초가 된다. 1MHz와 time scaling을 하면, 1초에 1911번의 rising edge(count)와 falling edge가 발생함과 동일 ... 다른 7 Segment를 켜기 위해, 각 음계의 if문에 각기 다른 BCD를 넣는다(flag 변수). 이를 다른 always문에서 decoding한 후, 7 Segment에 High
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04
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    아주대학교 논리회로 실험 설계 예비보고서
    의 CLKA는 5Mhz Clock과 바로 연결한다. 10진 counter를 7442 Decoder와 연결하였다.※7-segment FND507의 Datasheet3번과 8번 단자 ... 는데, IC 7447이 그 역할을 한다. BCD data를 7seg control signal로 decoding해주는 특별히 구별되는 decoder기능을 하기 때문이다. 이 part ... 할 수 없음을 고려하고, 이를 해결하기 위해 74151 MUX와 7447 Decoder를 이용해 회로를 구성한다. MUX는 필연적으로 control signal이 필요할 수 밖에 없
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    | 리포트 | 10페이지 | 2,000원 | 등록일 2016.06.14
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2026년 01월 12일 월요일
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