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"CPLD" 검색결과 1-20 / 84건

구조를 고려한 CPLD 저전력 알고리즘 (A CPLD Low Power Algorithm considering the Structure)

(사)디지털산업정보학회 김재진

논문 | 6페이지 | 무료 | 등록일 2025.06.25 | 수정일 2025.06.28

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효율적인 CPLD 저전력 알고리즘에 관한 연구 (A Study of Efficient CPLD Low Power Algorithm)

한국디지털콘텐츠학회 윤충모, 김재진

논문 | 5페이지 | 무료 | 등록일 2025.06.25 | 수정일 2025.06.28

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시간 제약 조건 안에서 전체 수행 시간을 개선한 CPLD 기술 매핑 (A CPLD Technology Mapping improved total running time under Time Constraint)

한국정보기술학회 장인갑, 김재진, 허윤석

논문 | 7페이지 | 무료 | 등록일 2025.06.04 | 수정일 2025.06.09

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CPLD를 이용한 침입자 방지용 보안 시스템 제작 (Fabrication of Security System for Preventing an intruder Using a Complex Programmable Logic Device(CPLD))

한국센서학회 손기환, 최진호, 권기룡, 김응수

논문 | 무료 | 등록일 2025.06.15 | 수정일 2025.06.17

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CPLD를 이용한 Monochrome/Color 실시간 변환기 설계 및 구현 (Design and Implementation of CPLD-Based Monochrome to Color Real Time Converter)

대한전자공학회 尹宰茂, 姜雄紀, 陳台錫, 이장명

논문 | 9페이지 | 무료 | 등록일 2025.06.01 | 수정일 2025.06.05

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시간 제약 조건 하에서 저전력을 고려한 CLB구조의 CPLD 기술 매핑 알고리즘 (CLB-Based CPLD Technology Mapping Algorithm for Power Minimization under Time Constraint)

대한전자공학회 김재진, 김희석

논문 | 8페이지 | 무료 | 등록일 2025.02.25 | 수정일 2025.03.06

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캡슐형 무선 내시경의 양방향 통신을 위한 CPLD 기반의 제어기 설계 및 구현 (CPLD-based Controller for Bi-directional Communication in a Capsule Endoscope)

대한의용생체공학회 이정현, 문연관, 박희준, 원철호, 이승하, 최현철, 조진호

논문 | 1페이지 | 무료 | 등록일 2025.03.18 | 수정일 2025.03.28

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CPLD 소자를 사용한 DDS 방식의 고속 주파수 호핑용 디지털 주파수 합성기의 설계 (Design of the Digital Frequency Synthesizer for HighSpeed Frequency Hopping by the DDS Method using CPLD)

한국정보통신학회 김기래

논문 | 6페이지 | 무료 | 등록일 2025.06.30 | 수정일 2025.07.05

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초음파 촉각 구현을 위한 CPLD를 사용한 Shift Register기반다채널 초음파 집속 지연 제어 방법에 대한 연구 (A Study on the Shift Register-Based Multi Channel Ultrasonic Focusing Delay Control Method using a CPLD for Ultrasonic Tactile Implementation)

한국센서학회 신덕식, 박준헌, 임영철, 최준호

논문 | 6페이지 | 무료 | 등록일 2025.07.09 | 수정일 2025.07.11

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“CPLD” 에 관한 조사

1. CPLD 의 정의FPGA 비해 CPLD를 정의하는 여러 특징들이 있다. 많은 디자이너들은 CPLD는 빠르게 부트 하도록 싱글칩에 비 휘발성 메모리를 임베디드한 디바이스라는 ... 것에 대해 인식한다. 추가로 핀-투-핀 타이밍은 5ns이내로 아주 빠르다. 이에 다른 기준은 CPLD의 구조에 대해 재검토함으로 완벽하게 이해할 수 있다.전통적으로 CPLD ... 된 PTs는 보통 마크로 셀이 참조한다. 이런 구조의 전형적인 예는 래티스 ispMACH4000 CPLD에서 찾아볼 수 있다. 이런 특징적인 구조는 빠른 로직과 간편한 타이밍 분석 등

Non-Ai HUMAN
| 리포트 | 7페이지 | 1,000원 | 등록일 2011.03.20

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[FPGA설계] FPGA와 CPLD

FPGA와 CPLD1. FPGA(1) FPGA란?FPGA(field programmable gate array, 현장 프로그래머블 게이트 어레이)은 프로그래머블 논리요소 ... 으로 변경되었다. 복합 프로그래머블 논리 소자 (CPLD)는 비슷한 역할을 할 수 있는 소자이다.(2) 구조일반적인 기본 구조는 컨피규어블 논리 블록 (configurable ... 를 바꾸든가 해야한다.참고로 FPGA의 가격은 대강 1년에 30%안팎으로 떨어지는 경향이 있다. 그리고 당연하지만, 수량에 따라 그 단가가 많이 차이가 난다.2. CPLD(1

Non-Ai HUMAN
| 리포트 | 6페이지 | 1,500원 | 등록일 2012.06.18

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설계 제안서 CPLD

기종형태 변형 가능.***CPLD 제어부 발진부 전원부 LCD*EPM 240G P100C5*오실레이터 OSC 1MHZ*레귤레이터 LM2575T-5V*YMS202-01Lwww

Non-Ai HUMAN
| 리포트 | 15페이지 | 2,500원 | 등록일 2009.07.20

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논리회로설계 실험 기본게이트 설계

논리회로설계 실험 예비보고서 #1실험 1. 기본게이트 설계1. 실험 목표CPLD와 FPGA에 대해 알아보고 그의 활용을 알아본다. 또한 전기전자 논리회로 교과목의 기초지식 ... 방법으로 설계하고 그에 따른 파형으로 설계한 결과를 확인한다.2. 예비 이론(1) CPLD, FPGA란?1) CPLD(Complex Programmable Logic Device ... , 비용을 절감 등의 장점을 갖는다. CPLD 구조를 살펴보면 내부 여러 개의 LAB(Logic Array Block)와 LAB의 연결선인 PIA으로 되어 있으므로 몇 개의 매크로

Non-Ai HUMAN
| 리포트 | 6페이지 | 1,500원 | 등록일 2021.10.01

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전전설2 실험2 예비보고서

, PAL, CPLD, FPGA 에 대하여 차이점, 장단점을 조사하시오.PROM의 장단점- PROM은 1회에 한해서 새로운 내용을 기록할 수 있는 롬을 말한다. 이 말은 사용 ... 속도가 느리고 고급HW언어개발자가 부족하다. 개발환경 사전 구축이 어렵다.CPLD의 장단점- 대량생산으로 집적 회로를 제조하는 경우는 ASIC를사용하지만, 개발에 걸리는 기술 ... 이 있다. 제조사는 설계이후에 수정할 수 없도록 할당된 덜 유연한 FPGA 버전으로 싸게 팔 수 있다.- 비교적 저렴한 단가로 높은 성능을 구현할 수 있다. CPLD 보다 높은 유연

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| 리포트 | 8페이지 | 2,000원 | 등록일 2022.11.30

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서울시립대 전전설2 Lab-02 예비리포트 (2020 최신)

의 압축파일과 라이선스 파일을 다운로드 받을 수 있다.- PROM, PAL, CPLD, FPGA에 대하여 차이점, 장단점을 조사하시오.우선 위 네 가지는 모두 PLD ... 은 점점 집적도가 올라가는 시대의 흐름에 감당하지 못했다. CPLD는 이 문제를 해결하기 위해 많은 SPLD를 블록으로 포함하여 연결하여 집적도를 높였다. PAL에 비해 더 많 ... 은 gate와 I/O pin을 가지고 있다. 하지만 이런 CPLD 역시 구조적으로는 PAL과 비슷하기에 집적도의 문제를 해결할 수 없었고 이런 구조적인 배열을 바꿔 나타난 것이 FPGA

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| 리포트 | 10페이지 | 1,500원 | 등록일 2021.09.10

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오디오믹서용 디지털-아날로그 하이브리드 이중화 시스템 개발 (Development of Digital/Analog Hybrid Redundancy System for Audio Mixer)

한국인터넷방송통신학회 김관웅, 조주필

논문 | 6페이지 | 무료 | 등록일 2025.06.15 | 수정일 2025.06.17

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서울시립대 전전설2 Lab-02 결과리포트 (2020 최신)

PAL을 많이 썼지만 PAL은 점점 집적도가 올라가는 시대의 흐름에 감당하지 못했다. CPLD는 이 문제를 해결하기 위해 많은 SPLD를 블록으로 포함하여 연결하여 집적도를 높였 ... 다. PAL에 비해 더 많은 gate와 I/O pin을 가지고 있다. 하지만 이런 CPLD 역시 구조적으로는 PAL과 비슷하기에 집적도의 문제를 해결할 수 없었고 이런 구조적인 배열 ... 을 바꿔 나타난 것이 FPGA이다. AND/OR Gate의 조합 논리로 이루어진 CPLD와 달리 FPGA는 LUT(Look up table)와 D Flip-Flop으로 이루어진 기본

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| 리포트 | 15페이지 | 1,500원 | 등록일 2021.09.10

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플래시 메모리, 프로그래머블 논리장치(PLD) ,SRAM ,DRAM , MROM , EPROM , PROM , FRAM , PRAM , MRAM , 메모리 조사 대체과제 만점 , 논문까지 참고 및 없는 내용 없음 사기적

고, 속도가 빠른 편이다.CPLDs (Complex Programmable Logic Devices) : CPLD는 Altera에서 상업용으로 제품화되어 쓰이고 있다. 메모리나 특별 ... 한 논리함수를 구현하기 위한 Embedded Array Block을 가지고 있다. CPLD는 빠른 성능이 나 정확한 타이밍의 예측이 필요로 하는 곳에 적합하다 또한 XOR, MUX ... , tri-state gates 지원한다.FPGAs (Field Programmable Gate Arrays) : FPGA는 CPLD와 달리 PLD의 블록간의 연결에 Array

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| 리포트 | 19페이지 | 3,300원 | 등록일 2021.08.30

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[서울시립대] 전자전기컴퓨터설계실험2 / Lab02(예비) / 2021년도(대면) / A+

들도 설계하기 부적합하다.2. Materials and Methods가. 실험 장비HBE Combo-II SE3. Prelab(1) PROM, PAL, CPLD, FPGA에 대하 ... 으로 싸게 팔 수 있다. 이런 설계개발은 일반적인 FPGA에서 만들었고 좀 더 ASIC와 비슷한 고정된 버전으로 변경되었다.- CPLD와 FPGA의 가장 큰 차이점은 구조적인 차이이 ... 다. CPLD는 하나 이상의 프로그램되는 상대적으로 적은 수의 동기 레지스터를 제공하는 곱의 합 논리 어레이로 구성된 제한적인 구조이다. 이러한 것은 지연을 더 예측가능하게 하

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| 리포트 | 9페이지 | 2,000원 | 등록일 2022.07.16

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논리회로 (정연모) 기말 전체 족보 정리

. ring counter5. dynamic RAM6. CPLD7.concatenation8.RTL2.1)두개의 ‘0’이 이어서 입력이 되면 ‘1’을 출력하는 moore type

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| 시험자료 | 2페이지 | 1,500원 | 등록일 2022.04.07

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