"서강대학교.디논실"의 검색결과 입니다.

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서강대 디논실 ttl-logic 결과 vhdl segment 1bit alu booth multiplier 디지털논리회로 5 2 bit 비교기

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"서강대학교.디논실" 검색결과 1-20 / 31건

서강대학교 디지털논리회로실험 4주차 결과보고서

1. 실험목적1) Multiplexer의 동작원리와 활용방법을 이해한다.2) Exclusive-OR gate의 동작원리와 활용방법을 이해한다.3) Three-state 소자의 동작원리와 활용방법을 이해한다.2. 배경이론 및 실험방법Multiplexer는 n개의 입력신호..

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| 리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 5주차 결과보고서

1. 실험목적1) Exclusive-OR회로를 이용한 비교회로의 구현 및 동작원리 이해2) 기본 gate를 이용한 half-adder 및 full-adder의 구현 및 동작원리 이해-ISE를 이용한 symbol library 생성 및 활용3) 연산회로의 동작 및 sig..

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| 리포트 | 13페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 8주차 결과보고서

1. 실험목적1) Shift RegistersShift registers의 구조와 동작원리를 이해한다.Shift register를 활용하여 multiplier를 구성한다.2. 배경이론 및 실험방법Shift register란 개별적인 flip flop들의 연결에 의해 구..

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| 리포트 | 14페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 6주차 결과보고서

1. 실험목적1) Flip-flop의 종류를 파악하고 각각의 동작원리를 이해한다.SR-, D-, JK- flip-flopsSet up time과 hold time에 대해 이해한다.2) Resisters의 동작원리를 이해한다.3) ISE의 simulation 기능에 대해..

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| 리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 9주차 결과보고서

1. 실험목적1) 메모리 소자들의 동작 원리와 활용 방법을 이해한다.Read Only Memory(ROM)Random Access Memory(RAM)2) Address decoding의 개념과 구현 방법을 이해한다.3) ROM을 이용해서 임의의 기능을 수행하는 com..

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| 리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 7주차 결과보고서

1. 실험목적1) CountersCounter의 구조와 동작원리를 이해한다.비동기/동기 counters2) State machine designMealy and Moore machines를 구분하고 각각의 동작 특성을 이해한다.State machine을 분석하고 설계할..

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| 리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 10주차 결과보고서

1. 실험목적1) Digital-to-analog 변환(DAC)- Digital 신호를 analog 신호로 반환하는 회로의 동작 원리를 이해한다.- DAC IC(DAC0808)의 구동 방법을 배운다.2) Analog-to-digital 변환(ADC)- Analog 신호..

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| 리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 3주차 결과보고서

1. 실험목적1) 일반적인 binary decoder의 동작 원리를 이해한다.2) 7-segment decoder의 동작원리를 이해한다.3) Encoder의 동작원리를 이해한다.4) 표시장치(display devices)의 동작원리를 이해한다.2. 배경이론 및 실험방법..

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| 리포트 | 8페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 2주차 결과보고서

1. 실험목적1) TTL logic gates의 동작 방법을 익힌다.2) Logic level과 noise margins, 그리고 fanout에 대해 이해한다.3) Gates를 이용하여 구현된 임의의 논리 함수가 최소화 될 수 있음을 확인한다.4) Wired OR lo..

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| 리포트 | 7페이지 | 1,000원 | 등록일 2021.10.02

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서강대학교 디지털논리회로실험 - 실험 9. Memory Elements : ROM/RAM 예비 보고서

디지털논리회로실험예비 보고서[11주차]실험 9. Memory Elements : ROM/RAM1. 실험 목적1) 메모리 소자들의 동작 원리와 활용 방법을 이해한다.2) Address decoding의 개념과 구현 방법을 이해한다.3) ROM을 이용해서 임의의 기능을 수..

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| 리포트 | 7페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 5. Arithmetic comparator, Adder and ALU 예비 보고서

1. 실험 목적1) Arithmetic comparator를 기본 게이트 및 VHDL로 구현한다.2) 1-bit full adder를 기본 게이트 및 VHDL로 구현한다.3) 3-bit ripple-carry adder를 기본 게이트 및 VHDL로 구현한다.2. 관련 ..

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| 리포트 | 9페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 2. Digital Logic Gates 결과 보고서

디지털논리회로실험서강대학교 전자공학과2017년 2학기 결과레포트실험2. Digital Logic Gates실험2. Digital Logic Gates1. 실험목적1. TTL

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| 리포트 | 10페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 2. Digital Logic Gates 예비 보고서

디지털논리회로실험예비 보고서[2주차]실험 2. Digital Logic Gates1. 실험 목적1) TTL의 동작 원리를 확인한다.2) 주어진 진리표를 논리식으로 최적화한다.3) 논리식을 TTL로 구현하여 그 동작을 확인한다.4) Xilinx ISE로 설계된 회로를 F..

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| 리포트 | 7페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 6. Flip-flops and Shift Registers 예비 보고서

디지털논리회로실험예비 보고서[7주차]실험 6. Flip-flops and Shift Registers1. 실험 목적1) Flip-flops의 종류와 용도를 알아본다.2) SR latch, gated D latch의 동작 원리를 이해한다.3) D flip-flop, JK..

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| 리포트 | 10페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 7. Finite State Machines 결과 보고서

디지털논리회로실험결과 보고서[8주차]실험 7. Finite State Machines1. 실험 개요1) Finite state machine (FSM) 회로를 설계하고 분석할 수 있는 능력을 갖춘다.2) Mealy와 Moore state machine을 구분하고 각각의..

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| 리포트 | 10페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 7. Finite State Machines 예비 보고서

디지털논리회로실험예비 보고서[8주차]실험 7. Finite State Machines1. 실험 목적1) Finite state machine (FSM) 회로를 설계하고 분석할 수 있는 능력을 갖춘다.2) Mealy와 Moore state machine을 구분하고 각각의..

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| 리포트 | 12페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 8. Multiplier Design 결과 보고서

디지털논리회로실험(EEE2052-01)서강대학교 전자공학과2017년 2학기 결과레포트실험8. Multiplier Design1. 실험개요1) 4비트 곱셈기의 구조와 원리를 이해

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| 리포트 | 4페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 5. Arithmetic comparator, Adder and ALU 결과 보고서

디지털논리회로실험결과 보고서[5주차]실험 5. Arithmetic comparator, Adder and ALU1. 실험 개요1) Arithmetic comparator를 기본 게이트 및 VHDL로 구현한다.2) 1-bit full adder를 기본 게이트 및 VHDL..

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| 리포트 | 8페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 4. Multiplexer, Demultiplexer and Comparator 결과 보고서

디지털논리회로실험(EEE2052-01)서강대학교 전자공학과2017년 2학기 결과레포트실험4. Multiplexer, Demultiplexer and Comparator1. 실험

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| 리포트 | 18페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 9. Memory Elements : ROM/RAM 결과 보고서

디지털논리회로실험결과 보고서[11주차]실험 9. Memory Elements : ROM/RAM1. 실험 개요1) 메모리 소자들의 동작 원리와 활용 방법을 이해한다.2) Address decoding의 개념과 구현 방법을 이해한다.3) ROM을 이용해서 임의의 기능을 수..

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| 리포트 | 6페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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