"논리회로설계실험"의 검색결과 입니다.

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FPGA 게임 논리회로 verilog vhdl 실험12 멀티플렉서 두더지 잡기 디코더와 인코더 비동기 카운터 plc 자소서

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"논리회로설계실험" 검색결과 1,841-1,860 / 2,284건

18 단안정 및 비안정 멀티바이브레이터예비결과보고서 디지털공학실험

와 전류 제한용으로 저항 330Ω을 사용하라.펄스폭이 설계 내용과 대략 같은지를 검사하라. 보고서에 회로를 그려 넣고 실험 결과를 기술하라.이번 실험 결과 예상표18-1 74121 단 ... 트리거 논리●비안정 멀티바이브레이터로 구성된 555 타이머의 듀티-사이클 및 주파수 측정●555 타이머를 이용한 비안정 멀티바이브레이터 설계 및 시험■사용부품74121 단안정 멀티 ... 바이브레이터를 사용하였다. 이번 실험에서는 비안정 멀티바이브레이터의 구성 요소를 자세히 알아보고 주파수와 듀티-사이클을 시험한다. 심층 탐구에서는 one-shot도 설계할 것이다.대부분

리포트 | 12페이지 | 1,000원 | 등록일 2008.11.16

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논리설계 - 플립플롭을 MAX-PLUS II 로 실습을 한후 결과 보고서

를 저장할 수 있는 소자로서, 임의의 주어진 시간에서 기억소자에 기억되어있는 2진 정보가 순서 논리 회로의 상태에 대한 정보를 가지고 있어 입력 신호와 동작하여 출력신호를 결정(기억 ... InputOutputCLKTQ↑0Q(변화 없음)↑1Q' (반대값)실험 실습의 구체적 절차- RS 플리플롭- 회로도- NOR 게이트로 구성된 RS 플립플롭- NAND 게이트로 구성된 RS 플립플롭 ... -1이 ERROR가 생기는데 이것을 보안하는 한 가지 방법입니다. D 플립플롭의 논리 회로를 보면 입력상태가 그대로 출력이 됩니다.즉 그말은 D=0이면 Q=0 이고 D=1 이면 Q

리포트 | 11페이지 | 1,000원 | 등록일 2009.12.15

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시프트레지스터와 카운터

는 보통 클럭이라 부르는 입력에 의하여 동작할 때 수나 상태의 시퀀스를 통해서 나타낼 수 있는 논리 회로이다. COUNTER의 출력은 어떤 주어진 시간에 그 안에 들어 있는 2진수 ... .(7) J-K F/F을 이용하여 4단 2진 Down 카운터를 설계하라.(8) NAND gate를 사용하여 Count-Up과 Count-Down할 수 있는 회로를 설계하라.(9) J ... -K F/F를 사용하여 10진 리플 카운터를 설계하라.(10) 10진 동기식 Up 카운터를 설계하라. 시프트트 레지스터A. Parallel In/Serial Out위 실험은 Prese요이다.

리포트 | 20페이지 | 1,000원 | 등록일 2010.12.20

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순서논리회로 설계를 D, T, JK, SR 플립플롭으로 나타냄.

' AB' BC' CX1X2Z결 론(Conclusion)• 이번 과제는 우리 주변의 순서논리회로를 다양한 플립플롭(D, T, SR, JK)으로 설계해 보는 것이었다. • 5가지의 상태 ... Table 8.2 Karnaugh Map 8.3 회로도 9. 출력 회로 10. 결론(Conclusion)개 요 (Outline)• 문제 제기 : 우리 주변에서 순서논리회로를 이용 ... 들을 바탕으로 D, T, S-R, J-K Flip-Flop을 이용한 회로 를 설계하시오.개 요 (Outline)• 기본 골격은 페르시아의 왕자(Prince of Persia) 의 게임

리포트 | 28페이지 | 8,000원 | 등록일 2010.06.24

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4-bit 전가산기(Full Adder)설계와 2의 보수를 이용한 감산기 설계

이상이 없는 것을 알게 되었다.5. 토의저번 시간에 설계한 Full Adder를 component에 연동하여 회로를 설계해 보았다. Full Adder 코딩은 어렵지 않 ... 였는데, 익숙하지 않은structure(구조적) 표현을 사용하여 시행착오가 많았던 것 같다. 다만 Component의 이용에 익숙해진다면, 좀 더 복잡한 회로도 합리적으로 설계할 수 ... 있을 것 같다. 이번 실습을 통하여 복잡한 회로는 component를 이용하여 여러 개의 소스파일로 설계할 수 있음을 알게 되었다. 가산기와 감산기를 simulation하면서 한

리포트 | 14페이지 | 1,500원 | 등록일 2010.06.24

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논리게이트 예비보고서 입니다

REPORT실험1장. 예비 보고서논리 게이트1. 실험 제목- 논리 게이트 (Logic Gate)2. 예비보고서(1) 인터넷에서 74LS00 계열의 AND, OR, NOT ... . 즉, 설계파일 DESIGN1.DSN 이 회로도 폴더(Schematic1), 회로도(Page1), 회로도 에 사용된 부품을 가진 파일(Design Cache)을 포함하고 있다.그림 ... OrCAD Dessign Desktop/Capture.exe를 실행하면 OrCAD Capture의 주화면이 다음과 같이 디스플레이 된다.그림 OR1. 기본 화면2. 설계파일의 생성

리포트 | 7페이지 | 1,000원 | 등록일 2009.05.15

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실험 1. BASIC GATES

Floating 상태를 없애주기 위해 달아주는 pull-up 저항에 대해서도 공부하였다. 이를 토대로 앞으로 실험할 모든 논리회로에 적용하여 신호의 error와 delay를 최소화하고, 경제적으로 이득이 있는 회로의 설계능력을 기르는데 적용할 수 있다. ... this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: '08. 9. 20과목명: 논리회로실험교수명 ... 로 두 개를 비교한 실험이다. Open collector 출력에서는 직접적으로 High, Low의 논리 레벨이나 기타 출력을 얻을 수 없고 다른 회로에 종속되어야만 어떤 값을 취하

리포트 | 8페이지 | 2,000원 | 등록일 2009.03.10

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가산기, 감산기

디지털 논리 회로 1학년 2학기 4. 조합 논리 회로 1. 가산기와 감산기 ( / )반가산기와 전가산기의 구조와 원리를 설명할 수 있다. 반감산기와 전감산기의 구조와 원리를 설명 ... 할 수 있다. 설계된 가산기와 감산기를 실험하여 동작 원리를 설명할 수 있다.1. 가산기가산기의 종류 : 반가산기, 전가산기, n비트 가산기반가산기 : 2개의 2진수를 덧셈(2개 ... (그림4-19) 반가산기의 카르노도 표현SC반가산기 (HA)ABS(Sum)C(Carry)(a) 회로(b) 블록도(그림4-20) 반가산기의 회로와 블록도다음 중 반가산기의 S(합

리포트 | 31페이지 | 2,500원 | 등록일 2010.11.20

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[디지털회로실험]가산기

예비보고서실 험 주 제 :실험2.가산기과 목 :디지털회로실험학 번 :분 반 :이 름 :1.실험 제목: 가산기2.관련 이론가산기란?이진수의 덧셈을 하는 논리 회로이며 디지털 회로 ... 기 때문에 단수를 크게하는 자리올림수 신호 (캐리어 신호)의 부분을 따로 계산하여 단수를 줄이는 방법이 자주 행해진다. 이 자리올림수 신호를 다른 논리회로로 생성하는 방법을 자리올림수 예측 (영어: carry look ahead)라고 부른다.3.실험의 이론적 결과 ... , 조합 회로의 하나이다. 전자계산기가 발명된 당시에는 진공관에 의해서 구성되었고 현재는 집적 회로로 설계되어서 다양한 기능을 가지는 것이다.입력신호 전압의 덧셈을 출력하는 디지털

리포트 | 4페이지 | 1,000원 | 등록일 2008.09.20

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결과07_Decoder&Encoder

하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 10.11.08 (월)과목명: 논리회로실험조교명: 유창승분 반: 월 ... F학 번: 200920148성 명: 이슬기200920148_이슬기_결과07_Decoder&Encoder.hwpI. 실험결과1) 2단 2진 카운터그림 2의 회로를 구성하여 그림 3 ... 는 것이다. 실험 결과, 각 DCBA 값은 Excess-3 code와 일치했다. 이런 회로의 구성을 통해 마치 회로가 Excess-3의 체계를 갖는 것처럼 동작하는 것이다.5) 7

리포트 | 6페이지 | 3,000원 | 등록일 2010.11.10

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결과05_Latch&Flip-flop

하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 10.10.25 (월)과목명: 논리회로실험조교명: 유창승분 반: 월 ... 에 대한 고찰이번 실험에서는 여러 종류의 플립플롭을 설계하여 그 동작을 알아보았다.먼저, 첫 번째 실험에서는 R-S F/F에 대해 실험했는데, 이 회로는 R, S 두 개의 상태 중 하나 ... 실험5 결과보고서전자공학도의 윤리 강령 (IEEE Code of Ethics)(출처: http://www.ieee.org)나는 전자공학도로서, 전자공학이 전 세계 인류의 삶

리포트 | 4페이지 | 3,000원 | 등록일 2010.11.04

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[기계자동차 공학실험] LabVIEW를 이용한 7-segment simulation 실험

을 사용하여 논리식을 구현한다.4) 논리식에 맞게 게이트를 사용하여 논리회로를 설계한다.● 실험 내용1. 진리표 작성10 진수SW 1 SW 2 SW 3gfedcba012345670 0 ... LabVIEW를 이용한7-segment simulation 실험● 실험 목표슬라이드 스위치 3개로 배운 이론을 이용하여 7-segment를 0부터 7까지 켤 수 있다. 이 회로 ... 를 설계하여 LabVIEW8.0 프로그램으로 이를 실행해본다.● 수행 과정1) 변수를 3개로한 진리표를 작성한다.2) 진리표에 맞게 3변수 카르노 맵을 작성한다.3) 불 대수식

리포트 | 4페이지 | 3,000원 | 등록일 2009.03.25

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예비02_CMOS 회로의 전기적 특성

한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 10.09.13 (월)과목명: 논리회로실험조교명: 유창승분 반: 월F학 ... 번: 200920148성 명: 이슬기200920148_이슬기_예비02_CMOS 회로의 전기적 특성.hwpI. 목적High-speed CMOS logic family인 74HC시리즈 ... 의 전기적 특성을 이해하고 실험을 통해 동작을 확인한다.II. 이론 및 유의사항(a) CMOS inverter◆ CMOS inverter와 BJT inverter의 차이점CMOS

리포트 | 5페이지 | 2,500원 | 등록일 2010.10.19

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정전기 교수학습과정안(유의미학습)

않는 성질을 가리킨다.이렇게 학습과제가 구속성과 실사성을 지닐 때 ‘논리적 유의미가’를 가진다.?인지구조어느 한 시점에서 학습자가 유용하게 사용할 수 있는 개념, 원리 및 이론 등 ... 으로 이루어진 학습자의 현재 지식 체계를 말한다. 학습자가 논리적 유의미가를 갖추고 있어도 그와 관련된 인지구조를 가지고 있다면 무의미한 학습이 될 뿐이다. 이렇게 논리적 유의미가 ... 는 것이다.?개념도?개념도: 개념들 사이의 위계와 관계를 보여주는 그림이다.?교육과정 계획과 수업의 설계개념도는 인지구조를 이루고 있는 개념들의 수평적 관계 뿐만 아니라 수직적인

리포트 | 7페이지 | 1,000원 | 등록일 2011.11.11

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★합격자소서★ 하이닉스 자기소개서

라 성취감이 주는 큰 기쁨을 배울 수 있었습니다.논리회로 설계 및 실험 과목을 들으며 매우 간단한 Flip-flip, Multiplexer의 이론부터 시작하여 직접 32비트 CPU ... 설계, 더 나아가 64비트 CPU 설계를 할 첫 기회가 있었습니다. 처음에는 조금 막연했지만, 첫 번째 실험이 끝나자 저는 너무도 기쁘게 다음 실험을 기다릴 수 있었습니다. 기본적인 ... 할 것입니다.반도체 실무 설계 팀이 직접적으로 산업 전반의 흐름을 읽기에는 힘들다고 생각합니다. 설계 실무 지식을 기반으로 메모리 산업의 세계적인 흐름을 따라 메모리 설계의 방향

자기소개서 | 3페이지 | 3,000원 | 등록일 2011.05.14

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전가산기와 전감산기 실험8.hwp

실험 8. 전가산기와 전감산기1. 실험 목적전가산과 전감산의 산술연산을 실행하는 회로의 설계법에 대해 공부한다.2. 기본 이론전가산기와 전감산기는 3비트를 더하거나 뺄 수 있 ... 한다.3. 사용기기 및 부품FPGAMax+plus II program4. 실험과정각 실험에 대해 제시된 회로를 Altera MAX_ plus program을 이용하여 구현 ... 오. 다음 회로에 대해 전가산기의 출력을 구하는 원리를 설명하시오.(a) 실험 1과 2의 회로(b) 실험 3의 회로2. 실험 2에서 전가산기의 C0는 올바른 결과를 나타내

리포트 | 10페이지 | 1,000원 | 등록일 2009.04.30

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2010상반기 대우조선해양 최종합격 자기소개서

- 전공기본 3 A+7.디지털시스템실험 - 전공기본 2 A+8.전자회로Ⅰ - 전공기본 3 A+9.마이크로컨트롤러실험 - 전공기본 2 A+10.논리회로 - 전공기본 3 A+3. (필수 ... ) 차원에서 정리하여 기술하십시오. ( 800자 이내 )대우조선해양의 전장설계, 종합설계분야에 1,2지망으로 지원하였습니다. 배를 인간으로 가정했을 때, 전장설계분야는 근육과 같 ... 습니다. 튼튼한 뼈대에 걸 맞는 근육이 있어야 최고의 성능을 발휘할 수 있다고 생각합니다. 전기장치와 제어장치의 적절한 구성과 최적의 성능을 이끌어 낼 수 있도록 설계할 수 있

자기소개서 | 3페이지 | 3,000원 | 등록일 2010.09.15

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마이크로프로세서를 이용한 LED와 7-Segment 응용 실험

가 주목 받고 있다.그러므로 실험에 앞서, 반도체와 논리회로에 대한 배경 지식이 필요하다. 또한, 실험의 모든 코딩은 C언어를 통해 이루어지므로 C언어에 대한 전반적인 이해를 갖춰야 ... 3.1 C언어3.2 Keil C Compiler3. 실험목적Ⅳ. 실험방법Ⅴ. 결과 및 토의Ⅵ. 결론Ⅰ. 요약21세기 초에 들어선 지금 전 세계의 과학기술계는 IT ... 함에 따라 실험적으로 조작할 수 있는 물질의 크기가 점차 작아져 20세기 중반 이후의 마이크로미터 영역에서 나노미터 영역으로 접어들게 되었다. 또한, 반도체 산업의 발전으로 현재 판매

리포트 | 24페이지 | 1,500원 | 등록일 2010.06.23

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충북대학교 전기전자공학 디지털실험 7장예비보고서

실험 7. FPGA를 이용한 4비트 산술논리회로의 구현 및 검증목 적1. MyCAD에서 합성한 회로를 FPGA로 구현하는 방법을 익힌다.2. 실험 6에서 설계한 4비트 산술 논리 ... 까지의 실험처럼 개별 논리회로 소자를 이용하여 회로를 구현하는 것은 비용 및 시간이 많이 소요된다. 따라서 IC 칩으로 구현하기 이전에 FPGA(Field Programmable ... 사용되고 있다.본 실험에서는 MyCAD 프로그램을 사용하여 합성된 회로를 FPGA 칩으로 구현하여 회로의 동작을 테스트한다. 은 MyCAD를 이용하여 설계된 회로로부터 FPGA 칩

리포트 | 2페이지 | 1,000원 | 등록일 2008.02.18

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주파수응답 및 필터의 이해

(PULL) : TTL/CMOS 논리회로의 입력파형으로 고정논리레벨을 갖는 파형을 인가할 때 사용하는 조절 스위치. 푸쉬/풀에 따라TTL/CMOS 모드 선택된다. ? TTL/CMOS ... 필터실험① 저항과 캐패시터를 이용하여 고역통과 필터를 구성하고, 주파수 응답을 측정한다. 필터는 입력 신호의 주파수에 따라 그 응답이 달라지므로 여러 주파수를 회로에 인가하여 크기 ... 주파수응답 및 필터의 이해1. 실험 목적1) 주파수 응답 및 필터에 대한 이론을 학습한다.2) PSIM(소프트웨어)의 사용법을 익힌다.3) 고주파 통과 필터(HPF : High

리포트 | 12페이지 | 1,000원 | 등록일 2010.12.22

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