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"logic2" 검색결과 101-120 / 6,395건

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    연세대학교 기초디지털실험 5주차 예비레포트 (finite state machine)
    and design computer programs and digital logic. It is used to simulate sequential logic which ... be seen in pic 1, FSM is consist of combinational logics and state register. State register stores ... present state and finds next state. The combinational logic calculates the output and following state
    Non-Ai HUMAN
    | 리포트 | 17페이지 | 2,500원 | 등록일 2021.08.31 | 수정일 2022.12.15
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    한양대 디지털 IC 개요 및 조합논리회로
    , NAND 등 GATE를 그린다.Logic Circuit을 통해 회로에 직접 설계해보며 입력 데이터를 각각 다르게 주며 바뀌는 출력 데이터를 알아낸다.Chapter 2. 관련 이론 ... Chapter 1. 실험 목적Truth Table을 통해 Karnaugh Map (K-map)을 작성해본다. 작성한 K-Map을 통해 Logic Circuit을 AND, OR ... . Algebraic(대수) 간략화 방식 2. K-MAP 3. Quine-McCluskey 방식이 있다. 1번은 정확하지만 한 눈에 보기 어려운 단점이 있고, 3번은 표를 이용
    리포트 | 5페이지 | 2,000원 | 등록일 2023.03.21
  • 연세대 전기전자공학부 20-2학기 기초디지털실험 6주차 예비보고서
    programmable logic(PL).2. Theory- SoCSoC(System on Chip) is an integrated circuit that holds the ... 1. ObjectivesThe goal of this experiment is learn ARM processor and carry out the basic logic. In ... entire components of a computer or electronic system in one chip. CPU and logic core are implemented in
    Non-Ai HUMAN
    | 리포트 | 3페이지 | 1,000원 | 등록일 2021.04.15 | 수정일 2021.10.06
  • 서울시립대 전전설2 Lab-01 결과리포트 (2020 최신)
    가 입력서 편리하다.- TTL과 CMOS의 입력 및 출력 전압, 전류에 대하여 조사하시오.TTL 입력부의 경우 0V~0.8V까지가 LOGIC 0에 해당하고 0.8V~2.0V ... 는 Indeterminate region이라 하여 값이 어떻게 인식될지 모르는 구간이며 2.0V~5.0V가 LOGIC 1에 해당한다. TTL 출력의 경우 0~0.4V가 LOGIC 0에 해당 ... 하고 0.4~2.7V가 Indeterminate region, 2.7~5V가 LOGIC 1에 해당한다.TTL에서 전류의 경우 2.7V(high)가 인가됐다고 가정했을 때 최대값
    Non-Ai HUMAN
    | 리포트 | 15페이지 | 1,500원 | 등록일 2021.09.10
  • 아주대학교 논리회로실험 / 1번 실험 예비보고서
    , NOT, XOR, NOR, NAND )를 이해한다.2. Logic 회로 구성 법칙인 진리표, 불대수, Logic Diagram에 대해 이해한다.3. 드 모르간 (De Morgan ... 1주차 실험 예비보고서전자공학과 / 학년 / 학번 : / 이름 :날짜 : / 담당조교님 :실험 1. Basic Gates1. 실험 목적1. Logic Gate ( AND, OR ... ) 법칙에 대해 이해한다.2. 실험 이론논리회로컴퓨터는 일반적으로 0(Low) 혹은 1(High)의 이진수로 데이터를 처리한다. 이처럼 전기 신호를 논리값으로 인식하고 처리
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,000원 | 등록일 2021.07.20
  • 판매자 표지 자료 표지
    논리적 실증주의, 논리적 경험주의, 반증주의, 과학혁명론의 개념과 한계 점을 설명하시오.
    서 론Ⅱ본 론■논리적 실증주의(Logical Positive)1)개념2)한계점■논리적 경험주의(Logical Empiricism)1)개념2)한계점■반증주의 ... ◐과제내용논리적 실증주의, 논리적 경험주의, 반증주의, 과학혁명론의 개념과 한계 점을 설명하시오.1. 논리적 실증주의2. 논리적 경험주의3. 반증주의4. 과학혁명론〈 목 차 〉Ⅰ ... (Falsificationism)1)개념2)한계점■과학혁명론(Scientific Revolution)1)개념2)한계점Ⅲ 결 론※문헌참고 및 출처Ⅰ. 서 론과학철학(Philosophy of science
    리포트 | 3페이지 | 3,000원 | 등록일 2024.04.15
  • 판매자 표지 자료 표지
    How can we make proper decisions
    Intuition : I just feel like.... : I don’t know why but… abstract Rationality (=logical thinking) + regrets ... a decision of your own2. Decisions are double-sided 3. Convert decisions into actions without hesitation{nameOfApplication=Show}
    리포트 | 6페이지 | 2,000원 | 등록일 2025.04.03
  • Vivado를 이용한 BCD to 7segment decoder의 구현 예비레포트
    Vivado를 이용한 BCD to 7segment decoder의 구현예비레포트1. 실험 제목1) Vivado를 이용한 BCD to 7segment decoder의 구현2. 실험 ... Logic Unit)산술 논리 장치(Arithmetic Logic Unit)는 두 숫자의 덧셈, 뺄셈 같은 산술연산과 OR, AND, NOT 같은 논리연산을 계산하는 디지털 회로이 ... 을 계산하는 데 필요한데, 간단한 회로조차도 작은 산술논리장치를 지니고 있다.2. BCD 코드 및 논리회로모든 컴퓨터는 내부적으로 이진법에 의해 동작하지만 사람은 이진수를 사용하지 않
    Non-Ai HUMAN
    | 리포트 | 4페이지 | 1,000원 | 등록일 2022.08.26 | 수정일 2022.08.29
  • 판매자 표지 자료 표지
    [A+, 에리카] [A+] 2021-1학기 논리설계및실험 Flip-Flops, Latch 실험결과보고서
    Chapter 1. 실험 목적Flip-Flop과 latch에 대해 이해하고, 이 동작원리를 회로 설계를 통해 확인할 수 있다.Chapter 2. 관련 이론ü ... Combinational logic circuit vs Sequential logic circuit- 조합논리회로: 메모리가 없어도 현재 입력만으로도 출력이 결정된다.- 순차논리회로: 메모리가 상태 ... - nor 게이트 2개로 구성되어 있고, 입력 S와 R을 이용하여 상태를 조절할 수 있다. 그에 따른 출력 Q와 Q’이 있다.- S=1, R=0일 때 Q만 1이 출력되는 set
    리포트 | 7페이지 | 2,500원 | 등록일 2023.02.28
  • [서울시립대] 전자전기컴퓨터설계실험2 / Lab01(예비) / 2021년도(대면) / A+
    의 소자에는 이러한 정전기에 대한 보호회로를 내장하고 있 지만 그래도 주의하여 취급하는 것이 좋다.(2) TTL- TTL(Transistor-Transistor Logic)은 바이폴라 ... logic circuit)- 출력신호는 입력신호뿐만 아니라 이전 상태의 논리값에 의해 결전된다. 조합 논리회로와 기억소자로 구성되며 기억소자가 퀘환을 형성한다. (기억소자는 2진 ... C로, 4개의 2-input OR 게이트가 들어있는 IC이다.- 전원전압(Vcc)은 5V(최소 4.75, 최대 5.25)이며 “High” logic level로 인식되는 입력전압
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16
  • VHDL_5_Digital Watch, 1초 생성기, 60진24진 카운터, MUX, FND decoder
    인 펄스 하나를 만들 수 있다.시뮬레이션에서는 1초를 볼 수 없기 때문에 부호를 2,500번째 클럭에서 바뀌도록 했다.2.소스코드 설명1~2)std_logic 형 선언을 위한 ... 다. 2x1 MUX를 이용하여 시계의 시간을 바꿀 수 있는 기능을 추가한다. 이 모든 것을 FND로 출력되게 하면 완성된다.2.소스코드 설명1~2)std_logic과 std ... 실습제목: 1초 생성기1. 주제 배경 이론DE2 보드는 클럭으로 50MHz를 사용한다. 이것은 1초에 50,000,000번 진동한다는 뜻이다. 한 번 진동하는데 걸리는 시간
    Non-Ai HUMAN
    | 리포트 | 22페이지 | 2,000원 | 등록일 2021.09.23 | 수정일 2022.04.04
  • (A+/이론/예상결과/고찰) 아주대 논리회로실험 예비보고서1
    . Basic Gates1) 실험목적1. Logic gates의 이해2. Logic 회로 구성 법칙의 이해- Boolean equation의 이해- De Morgan의 법칙 이해2 ... 복리에 대한 책임: 공중의 안전, 건강, 복리에 부합하는 결정을 할 책임을 질 것이며, 공중 또는 환경을 위협할 수 있는 요인을 신속히 공개한다.2. 지위 남용 배제: 실존 ... ) 실험이론· 기본 Logic gates에는 AND, OR, NOT, BUFFER가 있으며, 기본 gate의 확장으로는 NAND, NOR, XOR, XNOR 가 있다.· 가해지는 전압
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,000원 | 등록일 2021.10.24
  • 판매자 표지 자료 표지
    연세대학교 기초디지털실험 1주차 결과레포트
    implementing and testing the logic circuit by simulation waveform and PYNQ board.Ⅱ. Research on theoryA digital ... logic circuit does operation with binary signals, 0 and 1. There are various kinds of gate such as ... hould be written in order of size, ‘, base, number, like 2’b11.1. Design Source Add & CreationAfter c
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 5,000원 | 등록일 2021.08.18 | 수정일 2023.01.07
  • Verilog 언어를 이용한 Sequential Logic 설계 결과레포트
    Verilog 언어를 이용한 Sequential Logic 설계결과레포트1. 실험 제목1) Verilog 언어를 이용한 Sequential Logic 설계2. 실험 결과
    Non-Ai HUMAN
    | 리포트 | 3페이지 | 1,000원 | 등록일 2022.11.06
  • 판매자 표지 자료 표지
    디지털전자회로 2021 퀴즈5 해답
    를 (a)의 형대로 표시하시오 [2]. 또한 (2)의 형태로 precomputation 과정을 보여주면서 변환하시오. [2]2) 아래 partial product 계산 ... . [4]2. 아래 문제들을 푸시오. [12]1) 아래 timing parameter 표를 통해 flip-flip, 2-phase latch, pulsed latch ... 의 maximum logic propagation delay (tpd)와 minimum logic contamination delay (tcd)를 각각 구하시오. (Clock cycle
    Non-Ai HUMAN
    | 시험자료 | 7페이지 | 2,500원 | 등록일 2022.11.07
  • 0905 논리게이트 레포트
    디지털 공학 및 실습(예비레포트)1. 제목 : 기본 논리 게이트 조사 ( 1 주차)2. 목적 : 앞으로 다루게 될 기본적인 개념을 조사한다.3. 내용 :디지털 논리 회로의 일종 ... 으로, [그림]의 표준 논리 기호에 나타난 것처럼 두 개 이상의 입력과 하나의 출력으로 구성된다. 하단의 진리표(truth table)에 따라 동작하는 논리곱(logical c ... 에 나타난 것처럼 두 개 이상의 입력과 하나의 출력으로 구성된다. OR 게이트는 하단의 진리표(truth table)에 따라 동작하는 논리합(logical sum)을 구현한 것
    리포트 | 2페이지 | 2,000원 | 등록일 2024.06.16
  • 판매자 표지 자료 표지
    한양대 Verilog HDL 3
    으로 1초마다 FPGA starter Kit가 바뀌는 Verilog를 설계하고 실행해본다.Chapter 2. 관련 이론Verilog에 사용되는 Blocking과 Non-blocking ... , Non-blocking은 value ... )의 assign, function문에는 blocking을 사용하고, 순차회로 (sequential logic)의 always문와 latch design에서 Non-blocking을 사용
    리포트 | 7페이지 | 2,000원 | 등록일 2023.03.21
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    삼성전자 회로설계직 합격자소서
    개발팀에서 logic 설계를 진행했습니다. 선배들의 설계 노하우들을 통해 RTL design을 진행하며 더욱 흥미롭게 설계를 진행했습니다.특히, 신호 제어 방식에서 흥미를 느꼈 ... direction 신호를 추가하여 설계하는 과정에서 큰 성취감을 얻을 수 있었습니다.인턴 기간동안 설계한 것은 MDDI의 일부분에 불과합니다. 입사 후에는 logic design ... 의 모든 과정을 경험하며 혼자서도 MDDI를 logic design할 수 있는 전문 엔지니어가 되겠습니다. 또한, IC의 성능을 끊임없이 향상시켜 독보적인 MDDI 세계 시장 점유
    자기소개서 | 4페이지 | 3,000원 | 등록일 2024.02.11
  • [서울시립대] 전자전기컴퓨터설계실험2 / Lab06(결과) / 2021년도(대면) / A+
    Post-reportSequential Logic 1실험날짜 :학번 :이름 :1. Introduction가. 실험의 목적Verilog HDL 언어를 사용하여 Sequential ... Logic을 설계 및 실험(Flip-Flop, Register, SIPO 등)하고, 설계한 로직을 시뮬레이션하기 위한 벤치를 작성하고 장비로 동작을 확인한다.나. 실험 이론(1 ... ) 플립플롭 회로a. 래치(Latch)- 2개의 NOR 게이트로 구성된 래치의 동작SETRESETOUTPUT00변화 없음10Q = 101Q = 011Invalid (Q = / Q
    Non-Ai HUMAN
    | 리포트 | 18페이지 | 2,000원 | 등록일 2022.07.16
  • A TALE OF TWO CITIES-COMPETING LOGICS AND
    and Performance Logics in the Mutual Fund Industry Part 2, Boston type 2 차 세계대전이 끝내고 미국인 대부분의 자산관리 ... A TALE OF TWO CITIES: COMPETING LOGICS AND PRACTICE VARIATION IN THE PROFESSIONALIZING OF MUTUAL ... 는 trusteeship logic 과 보스턴을 중심으로한 사회적 관계를 통해서 기준이 형성됨 보스턴 타입 : Trustee logicTrustee and Performance Logics
    Non-Ai HUMAN
    | 리포트 | 14페이지 | 3,000원 | 등록일 2021.02.14
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2025년 10월 28일 화요일
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