"레지스터 설계"의 검색결과 입니다.

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atmega128 전자계산기 구조 verilog ssafy 스텝 모터 구동기 디지털시스템실험 중앙대 마이크로 쉬프트 레지스터 atmega128 프로젝트

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"레지스터 설계" 검색결과 1,021-1,040 / 2,202건

마이크로 과제1-3

REPORT(마이크로프로세서응용 및 실험)제출일자: 2011. 11. 15 학번:이름:조 :설계과제스위치 입력은 External interrupt 사용Timer interrupt ... 조절PWM 주기 = 10msecⅠ. 설계 목표7-segment와 LED를 설계과제에 맞게 구현 될 수 있도록 회로를 설계하고프로그램 소스를 설정하여 Timer/Counter기능 ... , TIMER3 CAPT)-SPI 전송완료-UART 수신완료, 송신완료, data register empty-ADC 변환완료-EEPROM Ready-Analog comparator

리포트 | 20페이지 | 1,000원 | 등록일 2012.04.01

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VHDL에 관하여

에서 블럭이라는 개념은 현재 이 레벨에서는 존재하지 않으며, 앞서 설명한 절차적 설계 단계에 해당 하는 레벨이다.다음 단계로서 RTL 레벨은 레지스터간의 동작을 표현한 레벨 ... VHDL 소개HDL이전의 하드웨어 설계에서는 주로 레이아웃 편집기(layout editor)나 스키메틱 편집기(schematic editor)를 이용해 작은 블록을 설계하고 이것 ... 을 이용해 큰 블록을 설계하는 상향식 설계(bottom-up)를 했다. 하지만 설계해야 할 회로의 규모가 커지고 복잡도 가 증가 함에 따라 이러한 방법은 한계에 도달하게 되

리포트 | 8페이지 | 1,000원 | 등록일 2013.01.24

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4-bit Right Shift Register

register이므로 데이터를 오른쪽 방향으로 쉬프트 하는 vhdl 코드를 설계한다.② Describe how do you solve the problem.4bit right shift 이 ... 과 목 :과 제 명 :담당교수 :학 과 :학 년 :이 름 :학 번 :제 출 일 : 2010. 4. 15. 목4-bit Right Shift Register1. Purpose4 ... bit shift register의 동작원리와 기능을 이해한다. vhdl code안에서 process문과 if문이 어떻게 쓰이는지도 알아본다. ISE프로그램을 이용하여 4 bit

리포트 | 9페이지 | 1,500원 | 등록일 2011.06.06

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전전컴설계실험2-9주차예비

, 응용과제의 Moore State machine을 구현함으로써 순차 논리 회로를 직접 설계하는 과정을 통해 이론적인 내용과 실제 Simulation과 하드웨어 장비동작으로 검증 ... 해본다.(2)Essential Backgrounds for this Lab-Counter입력펄스에 따라 미리 정해진 순서대로 상태 변이가 진행되는 레지스터를 카운터라고 한다. 입력펄스 ... 되면 ...-5-4-3-2-1 감소하는 것으로 가정한다.2.Materials & Methods(1)Procedure of Lab-Lab 14-bit up counter를 설계하시오

리포트 | 10페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15

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컴퓨터기술, 기술임용, ★컴퓨터, 컴퓨터분야 평가항목별 정리, 전문계고교과서, 전공서적컴퓨터 분야.

(base-register addressing mode) : 베이스 레지스터의 내용과 명령어의 오퍼랜드의 내용을 더해서 유효 주소를 결정한다. 이 방식은 기억장치에서 프로그램의 재배치 ... I3 컴퓨터I31 컴퓨터 구조I311 디지털 논리 회로고등학교 디지털논리회로Ⅳ. 조합 논리 회로 (p97)0. 조합 논리 회로 설계. 조합 논리 회로의 설계 순서0) 시스템 ... 의 분석과 변수 정의조합논리 회로를 설계하기 위해 입력 변수의 수와 출력 변수의 수를 정하고 각각에 적당한 변수를 할당한다.1) 시스템의 입출력 변수 간의 진리표 작성2) 간소화된 출력

리포트 | 45페이지 | 9,000원 | 등록일 2011.02.26

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3차원 형상 역공학 실습 보고서

화 하여 이를 다양한 방법으로 최적화시켜 완벽한 3차원 형상하고, 데이터를 구현하는 3D Reverse Modeler로써, 제품 설계에서 CAD/CAM/CAE/CAT 및 컴퓨터 ... 게 되는데 View>Explode Shells명령을 실행해 이미지들을 해시한다.3. Register각각의 방향에서 스캔한 이미지를 하나로 합치기 위해 특징이 되는 부위에 포인트를 찍 ... . Export완성된 이미지를 추출하여 Catia에서 확인해본다.? 3D형상 역공학 응용사례?역설계 : 실물로부터 디지털화 된 형상 및 색상 데이터를 얻어 cad나 catia에서 설계

리포트 | 10페이지 | 1,500원 | 등록일 2013.06.23

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포토 레지스트 공정/ Photo regist 공정/감광액 코팅/TFT 공정/ 컬러필터 공정

: 증착 과정 후 다시 한번 세정 과정을 진행함 . 4. PR 도 포 : 좀 더 원하는 모양으로 증착하기 위해서 기판 위에 PR 을 코팅해줌 . PR(Photo Regist ... ) 6. 현 상 과정 : 현상액을 이용하여 자외선과 반응한 노광 영역과 노광되지 않은 영역 외 감광액을 선택적으로 제거하여 설계 패턴을 유리판에 구현하는 공정 . 7. 식 각 과정

리포트 | 15페이지 | 3,000원 | 등록일 2014.12.22 | 수정일 2015.05.15

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[Flowrian] FSM with Datapath 방식 최대공약수 계산기의 Verilog 설계 및 시뮬레이션 검증

비트 Ripple-Carry 뺄셈기 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 8 비트 비교기 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 8 비트 레지스터 ... 본 문서에서는 아래의 모듈들은 Verilog 언어로 설계하여 시뮬레이션 검증을 하였다.- 2 입력 8 비트 멀티플렉서 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 8 ... : RT 수준 Verilog 설계 및 시뮬레이션 검증- 전체 동작을 제어하는 유한상태머신 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 최대공약수 연산을 수행하는 데이터

리포트 | 38페이지 | 3,000원 | 등록일 2011.10.11

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레지스터 실험 예비보고서

실험 제목레지스터(Register) 실험실험 목적레지스터의 기본 원리를 이해한다.시프트 레지스터(Shift register)를 이용한 카운터의 동작을 이해한다.기본 이론레지스터 ... (Register) 및 쉬프트레지스터(Shift-Register)n개의 플립플롭(Flip-Flop)에다 n bit를 기억시키는 장치를 레지스터(register)라고 하며, 자유로이 ... 펄스에 따라 왼쪽 또는 오른쪽으로 이동시키는 쉬프트 레지스터(shift-register)로도 사용한다.그림 SEQ 그림 \* ARABIC 1. 레지스터의 동작유형에 따른 종류쉬프트

리포트 | 7페이지 | 1,000원 | 등록일 2011.09.16

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텀프로젝트

마이크로프로세서 응용 및 실험학 번:이 름:학 과:당 당 교 수:제 출 일 자:2011년 12월 20일1. 설계과제의 목표 및 제한조건2. 서론○설계과제관련 이론 배경- 컴퓨터 ... 011inputyesTri-state(Hi-Z)10XoutputyesOutput Low(Sink)11XoutputyesOutput High(Source)레지스터기능리셋 시의 값DDR ... Port의 풀업관계? DDR- Data Direction Register? DDRA, DDRB, DDRC, DDRD, DDRE, DDRF, DDRG? “0” = Input, “1

리포트 | 19페이지 | 2,500원 | 등록일 2012.04.01

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스텝 모터 구동기

위한 범용 이동 레지스터 (Universal shift register)의 사용 방법을 배운다. 이를 바탕으로 BJT 트랜지스터와 범용 이동 레지스터를 이용하여 스텝 모터 구동기 ... 를 설계한 후 그 동작을 확인한다.2. 실습 준비물- 4 비트 범용 이동 레지스터(74LS194) 1개- 4상 스텝 모터 1개- ULN2003AN IC- 저항 150Ω 4개, 1 ... 설계실습 4. 스텝 모터 구동기학과전자전기공학부학번조/이름담당교수수업시간실험일1. 목적단극 스텝 모터(Uni-polar step motor)의 동작 원리와 스텝 모터를 조종하기

리포트 | 2페이지 | 1,000원 | 등록일 2010.10.08

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마이크로 프로세서의 종류와 기능

, 이를 MPU라고 부를 때는 이것이 곧 마이크로프로세서를 의미한다. 이것은 일반 컴퓨터의 중앙처리장치에서 주기억장치를 제외한 연산장치, 제어장치 및 각종 레지스터들을 단지 1개 ... 를 많은 소자를 사용하여 전용으로 설계하게 된다. 마이크로컴퓨터에서처럼 마이크로프로세서를 사용하여 컴퓨터를 설계하면 CPU가 하나의 IC 소자로 간단히 구성되므로 전체 시스템이 소형 ... 를 요구하게 되고, 연산처리에 하는 레지스터로써 결과값을 저장하는 어큐뮬레이터(Accumulator)의 비중이 커지게 된다. 한마디로 MPU는 연산이 주목적인 CPU다. 이러

리포트 | 16페이지 | 1,800원 | 등록일 2013.01.01

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{컴퓨터의이해 2017}컴퓨터에서 입력장치, 중앙처리장치, 출력장치, 기억장치에 대하여 자세히 설명한다.컴퓨터의이해 최신 스마트 폰 하나를 선정하고 입력장치, 중앙처리장치, 출력장치, 기억장치에 대하여 자세히 설명한다. 2차원바코드에 대하여 다음의 내용을 A4 용지 2페이지 내외로 서술 하라.2차원 바코드의 종류와 사용 사례를 조사하라. 본인의 이름과 소속

에서 산술 연산을 수행하는 회로이다디코더프로그램의 명령 코드 부분을 분석하여, 명령어의 실행을 제어하는데 사용되는 장치이다레지스터임의의 데이터에 대한 처리 결과를 일시적으로 저장 ... 한 조합을 이루고 있다. 앱 실행에서부터 게임 플레이, 비디오 스트리밍에 이르는 대부분의 기능이 놀라운 속도로 실행된다. 또한 다양한 기능을 빠르고 강력하게 사용할 수 있게 설계

방송통신대 | 11페이지 | 5,000원 | 등록일 2017.03.15 | 수정일 2022.06.04

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마이크로 과제4

마이크로프로세서 응용 및 실험학 번:이 름:학 과:당 당 교 수:제 출 일 자:1. 설계과제의 목표 및 제한조건2. 서론○설계과제관련 이론 배경- 컴퓨터(computer) ... Multiplexer Selection Register)- 0 1 1 0 | 0 0 0 0 사용- AVCC 단자를 사용하기 위해 0 1 로 설정- ADLAR = 1 변환결과값을 ADCH/L에 저장 ... - ADMUX = 0x60; 설정 완료? ADCSRA(ADC Control and Status Register)- 1 1 1 0 | 1 1 1 1 사용- ADEN = 1 로 하

리포트 | 18페이지 | 1,000원 | 등록일 2012.04.01

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시프트 링 카운터 결과

레지스터의 내용에 5를 더하는 기능을 갖는다. J-K FF을 사용하여 회로를 설계하라.→ 회로를 설계하면 다음과 같은 진리표가 작성 될 것이다.CountPulseQ1Q2Q3Q*************01031011401005110160110711118100090001101010110011121100130101141110150111160000 ... (결과) 실험 10·10. 5. 15(목)시프트 레지스터 및 링 카운터정보통신전자공학부20062688 박!!!1. 필요한 결과표 10-1E.IC1IC2IC3Q1Q2Q3Q4Q5Q6 ... LED50LLDDD1DLLDD2DDLLD3DDDLL4LDDDL5LLDDD6DLLDD7DDLLDClockQ1Q2Q3Q4Q5그림 10-5 실험 2(d)에 대한 순환형 시프트 레지스터

리포트 | 8페이지 | 1,000원 | 등록일 2011.04.25

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제9장 - 브릿지 정류기 예비레포트

의 다이오드를 사용하는 설계방식이 중앙탭 트랜스와 2개의 다이오드를 사용한 방식보다 생산단가 절감에 효과적이다. 브리지 정류 다이오드의 가장 큰 특징은 입력되는 전압과 동일한 전압 ... , EVM , 0~ 100mA DC밀리 전류계·레지스터 : 2700Ω, 5600Ω 1/2W, 100Ω 1W, 250Ω 2W, 500Ω 5W·캐패시터 : 2개의 100μF 50-V·반도체

리포트 | 4페이지 | 3,000원 | 등록일 2013.12.23

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[Flowrian] 덧셈 연습기 회로의 Verilog 설계 및 시뮬레이션 검증

Verilog 설계 및 시뮬레이션 검증- 4 비트 레지스터 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 십진수 동일 값 검사 : RT 수준 Verilog 설계 및 ... 본 문서에서는 아래의 모듈들은 Verilog 언어로 설계하여 시뮬레이션 검증을 하였다.- 전가산기 : Dataflow 수준 Verilog 설계 및 시뮬레이션 검증- 십진수 한 ... 자리 덧셈기 : 구조수준 Verilog 설계 및 시뮬레이션 검증- 십진수 두 자리 덧셈기 : 구조수준 Verilog 설계 및 시뮬레이션 검증- D 타입 플립플롭 : RT 수준

리포트 | 46페이지 | 1,500원 | 등록일 2011.09.27 | 수정일 2014.08.19

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modelsim velilog로 구현한 mips pipelining

registers each 32 bits longreg_mem rem1(Read1,Data1); // 레지스터 메모리로부터 data 읽어옴reg_mem rem2(Read2,Data ... 컴퓨터구조프로젝트(MIPS Pipeline 설계)MIPS Pipeline 설계: 본 프로젝트는 다음과 같은 과정을 따라 수행하였다.목표: Modelsim을 이용하여 Verilog ... HDL 언어로 MIPS Pipelining를 설계한다.(1) Verilog HDL로 각 단계별 Module 설계(2) Pipeling 설계(3) 주어진 Data를 연산 후

리포트 | 9페이지 | 5,000원 | 등록일 2010.07.22 | 수정일 2015.07.17

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[Flowrian] 커피 자판기 회로의 Verilog 설계 및 시뮬레이션 검증

커피 자판기 회로는 10개의 모듈로 구성된다.- 12 비트 레지스터 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 8 입력 12 비트 멀티플렉서 : RT 수준 ... Verilog 설계 및 시뮬레이션 검증- 12 비트 비교기 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 12 비트 리플 캐리 덧셈기 : RT 수준 Verilog 설계 및 ... 시뮬레이션 검증- 12 비트 덧셈 뺄셈기 : 구조수준 Verilog 설계 및 시뮬레이션 검증- 타이머 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 커피 제조 회로 : 구조수준

리포트 | 56페이지 | 2,000원 | 등록일 2011.09.24

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컴퓨터 구조 및 설계 [4판_ARM버전]_3장 요약

다. 컴퓨터 설계자들은 많은 그래픽과 오디오응용들이 바이트나 하프워드 벡터에 대하여 같은 연산을 수행한다는걸 알게 되었고, 64비트 덧셈기에서 올림수 전달 과정을 분리시키면서 8기의 8비트 ... 의 길이를 갖는다. 당연히 곱셈에서도 오버플로우의 문제는 발생한다.◎곱셈 알고리즘과 하드웨어의 순차적 버전승수는 32비트 승수 레지스터에 있고, 64 비트 곱 레지스터는 0 ... 64비트 피승수 레지스터가 필요하다.승수의 최하위 비트는 피승수를 곱 레지스터에 더할지 말지를 결정한다.◎부호있는 수의 곱셈이 알고리즘은 부호를 계산에서 제외시키고 31번 반복

리포트 | 5페이지 | 1,000원 | 등록일 2011.11.01

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