"레지스터 설계"의 검색결과 입니다.

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atmega128 전자계산기 구조 verilog ssafy 스텝 모터 구동기 디지털시스템실험 중앙대 마이크로 쉬프트 레지스터 atmega128 프로젝트

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"레지스터 설계" 검색결과 661-680 / 2,200건

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컴퓨터의 구성과 컴퓨터로 인해 가질 수 있는 직업

된다터 번지를 임시로 기억한다. 명령 계수기는 프로그램의 수행 순서를 제어하며 명령 해독기는 명령 레지스터에 기억된 명령을 해독하여 각 장치에 필요한 신호를 발생시킨다. 이러한 구성 ... 요소를 거쳐 명령어를 실행하는데 명령어 실행은 명령 인출 단계와 실행 단계를 거친다.명령 인출단계는 주기억장치에서 명령을 읽어 명령 레지스터에 저장하기까지를 말한다. 실행단계 ... 는 명령 레지스터의 명령을 해독하고 필요한 신호를 발생시켜 실제로 명령을 처리한다.다음으로 연산장치는 프로그램의 산술적인 연산과 논리적인 연산을 수행하고 비교 및 판단, 데이터의 이동

리포트 | 6페이지 | 1,000원 | 등록일 2016.09.07

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☆3일완성★컴퓨터활용능력시험 1급 필기 정리(컴활 1급 필기)

보드):컴퓨터를 구성하는 모든 장치들이 장착되고 연결되는 기판-컴퓨터버스:CPU와 주변장치간의 데이터 전송에 사용되는 통로 역할을 함, 내부버스(레지스터간 연결), 외부버스(데이터 ... 은 상황이 발생할 경우 현재 작업을 일시 중단하고 발생된 상황을 우선 처리한 후 실행중인 작업으로 복귀하여 계속 처리하는 것3)콘솔:표준 입력, 출력장치4)레지스터:cpu내부 ... 에서 처리할 명령어나 연산의 중간값 등을 일시적으로 저장하는 기억장치. 메모리 중 액세스 속도가 가장 빠르고, 플립플롭이나 래치등을 연결하여 구성함-레지스터의 크기=컴퓨터가 한번에 처리

시험자료 | 5페이지 | 2,000원 | 등록일 2020.03.24 | 수정일 2020.05.20

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디지털논리회로실험(Verilog HDL) - Real-time clock, counter

, loads 300,000 into timer? Can design using oscillator, register, and down-counter.2. 실험2.1 Part Ⅱ: Real ... 버튼을 누르면 설정된 시간부터 시간이 흘러가는 카운터 설계*조건? HEX 7-6은 시간(1~24시 표기), HEX 5-4는 분, HEX 3-2는 초를 나타낸다.? KEY0을 누르 ... , and KEY1 to reset the counter to 0.? 시간이 증가/감소하는 카운터*조건? HEX1-0에 0-99까지 표시하는 카운터를 설계한다.? 기본적으로 0에서 시작

리포트 | 8페이지 | 1,000원 | 등록일 2019.08.29

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06 논리회로설계실험 결과보고서(순차회로)

논리회로설계 실험 결과보고서 #6실험 6. 순차회로 설계1. 실험 목표JK 플립플롭을 VHDL을 이용해 설계해본다.레지스터에 대해 이해하고 VHDL을 이용해 시프트 레지스터 ... 2. D FF 8개를 가지는 병렬 레지스터 스케메틱 설계1) 스케메틱 설계2) 테스트 벤치3) Wave Form5) 결과 분석schematic 설계에서 이미 존재하는 D 플립플롭 ... 기 때문에 설계한 8비트 병렬 레지스터가 정상작동 함을 확인 할 수 있다.실험 3. 8비트 시프트 레지스터 VHDL 코딩(1) D FF 진리표CLKDQ(T+1)100111(2) 설계

리포트 | 7페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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타이머와 카운터 예비보고서

Counter Register) : TCNTn (n=0,2)TCNT7TCNT6TCNT5TCNT4TCNT3TCNT2TCNT1TCNT0타이머/카운터 레지스터로 실제로 시스템 내부 클럭수 ... 할 수 있다. 예를 들어 TCNT0=0x06 이라고 레지스터 값을 지정해주면 6부터 카운팅이 시작된다.?- 출력 비교 레지스터(Output Compare Register ... Flag Register) : TIFROCFn : 출력 비교 플래그. 타이머값 TNCTn과 비교 레지스터 값 OCRn이 같을 때 플래그 OCFn이 SET된다. 이 플래그는 해당

리포트 | 8페이지 | 1,000원 | 등록일 2015.11.09

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2010310961.이동녕.HW1

tatement①Describe what is the problem.이번에 설계한 register는 4bit right shift register로써 input이 들어가면 clock의 주기마다 한 칸 ... .04.13Purpose이번 실습은 right shift register를 VHDL을 이용해 programming하고, 그에 대한 결과를 확인하기 위한 testbench를 짜는 것 ... 이 목적이다. Right shift register는 1bit의 input에 대해 clock의 주기가 한번 돌 때마다 1bit씩 오른쪽으로 shift 시키는 register로써, 이

리포트 | 7페이지 | 1,000원 | 등록일 2015.06.07

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디지털시스템 실험(SR Latch, JK, D FF, Register, Shift Register, Register를 이용한 가산기)

디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2014 전기전자공학부이름 : 전기전자전파공학부 ... 고찬규(7조)학번 : 2011171059실험제목Latch & Flip-Flop실험목표1. SR Latch 를 설계한다.2. SR Latch 를 이용하여 D-Type Positive ... -Edge-Triggered Flip-Flop 을 설계한다.3. D Flip-Flop 을 이용하여 Negative-Edge-Triggered JK Flip-Flop 을 설계한다.4

리포트 | 5페이지 | 1,500원 | 등록일 2014.11.03

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전자전기컴퓨터설계2 HBE-COMBO ll VerilogHDL 실습6 [결과레포트]

한 Moore machine과 Mealy machine을 응용하여 주어진 상태를 가지는 Moore state machine을 설계한다.. Purpose of this Lab스테이트 ... 머신(State Machine)에 대해 이해하고 학습한다.Moore Machine 회로를 설계한다.Mealy Machine 회로를 설계한다.나. Essential ... 을 이해하고 이를 토대로 주어진 상태를 가지는 Moore State Machine를 설계하였다.Procedure of the Lab 1. : 아래 조건을 가지는 Moore

리포트 | 15페이지 | 1,000원 | 등록일 2017.10.19

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VHDL에 의한 논리 시스템 해석 및 설계

VHDL에 의한 논리 시스템 해석 및 설계12.1 하드웨어 기술언어의 개요하드웨어 기술 언어 (HDL : Hardware Description Language)는 회로 설계 ... 용 언어를 말하는데, 하드웨어를 소프트웨어와 같이 프로그래밍하고, 컴퓨터의 도움을 받아 알기 쉽고 정확하게 회로를 설계하기 위한 것이다.지금까지 회로 설계의 문제점은 직접 손으로 회로 ... 의 IC에 수백만개의 트랜지스터가 집적되는데 세부적인 회로를 사람이 그려서 하는 것은 그만큼의 시간과 인력이 든다. 도면을 그리는 회사와 설계회사 사이에 같은 사양을 다른 방향

리포트 | 38페이지 | 5,000원 | 등록일 2017.12.30

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ARM 어셈블리코드로 작성한 부동소수점 수(Floating point number) 퀵정렬(Quicksort)

하기 쉽게 레지스터별 주석까지 달아놓았고 자세한 설명은 보고서를 참고하시면서 디버깅해보시면 이해하기 쉬우실 겁니다.-----------보고서 Introduction---------- ... ---본 보고서는 어셈블리 프로그램 설계 및 실습 과목의 프로젝트 결과 보고서이다. Arm 32bit 명령어를 사용하였고 little endian 방식으로 코드를 작성하였다. 지금

리포트 | 3,000원 | 등록일 2016.12.19

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06 논리회로설계실험 예비보고서(순차회로)

을 VHDL을 이용해 설계해본다.레지스터에 대해 이해하고 VHDL을 이용해 시프트 레지스터를 설계해본다.2. 예비 이론(1) latchclock 입력을 갖지 않는 2진 기억소자이다. 기억 ... ) 레지스터레지스터는 플립플롭의 집합이다. 플립플롭은 1bit의 정보를 저장 할 수 있으므로, n-bit register는n bit의 정보를 저장하는 n개의 플립플롭으로 이루어진 그룹 ... 을 말한다.레지스터는 동작 방법에 따라 병렬 레지스터(parallel register)와 시프트 레지스터(shift register)로나뉘는데, 병렬 레지스터는 2진정보의 저장을 위해

리포트 | 9페이지 | 3,000원 | 등록일 2014.09.27 | 수정일 2021.04.15

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영상처리,무인주차시스템 졸업캡스톤

졸업캡스톤 설계 계획서/보고서0. 연구 과제명:적외선 센서와 영상처리를 이용한 무인 주차관리 시스템 모델1. 참여연구원성 명학 번역할연구 분야이동규12074743조장설계,프로그램 ... 김태현12080700조원설계,프로그램2. 연구 배경 및 목적0.0. 연구 배경백화점, 고층빌딩, 공공시설 등의 대형주차장의 주차료 징수와 주차장 안내등에 많은 인력이 소모되고 그 ... 의 강력한 명령어들이 대부분 단일 클럭으로 진행된다.- 8비트 레지스터가 32개 있으며 16MHz에서 16MIPS 동작속도를 가지고 곱셈기 동작시 2사이클 소요- 128K

리포트 | 5페이지 | 2,500원 | 등록일 2016.10.12 | 수정일 2019.03.19

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마이크로프로세서 결과보고서 2장 - LED ONOFF 해보기

마이크로프로세서 설계 실험 결과보고서2장 LED ON/OFF 해보기13목 차2 - 1 실험 소개································22 - 2 실험 내용 ... .ASM 으로 저장한다.; STANDARD HEADER FILEPROCESSOR16F84; --- REGISTER FILES 선언 -----; BANK 0INDFEQU00HTMR0EQU ... 변환되었는가를 이해합시다. 그리고 Step into를 선택하여 한 명령어 씩 수행시키면서 화면 내용들을 관찰합시다. 특히 Special register 영역의 내용과 Dump

리포트 | 14페이지 | 3,000원 | 등록일 2016.06.25 | 수정일 2016.06.27

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전자전기컴퓨터설계2 HBE-COMBO ll VerilogHDL 실습2 [예비레포트]

) for this LabVerilog HDL 문법 : HDL 기반 설계의 장점설계 시간의 단축설계의 질 향상특정 설계기술이나 공정과 무관한 설계낮은 설계 비용표준 HDL 및 사용 ... 자의 확대효율적인 설계관리Verilog HDL 문법 : 어휘규칙여백 : 어휘 토큰들을 분리하기 위해 사용되는 경우를 제외하고는 무시주석 : HDL 소스코드의 설명을 위해 사용되며, 컴파일 ... 값이 바뀌며, 할당에서부터 다음 할당까지 값을 유지Reg : 절차적 할당문에 의해 값을 받는 객체의 자료형, 할당 사이의 값을 유지, 하드웨어 레지스터를 모델링하기 위해 사용

리포트 | 19페이지 | 1,000원 | 등록일 2017.10.19

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Verilog HDL을 이용한 7-세그먼트디코더와 시프트 레지스터

디지털회로개론실험 예비보고서HDL을 이용한 설계7-세그먼트 디코더시프트 레지스터0. 실험목적7-세그먼트와 시프트 레지스터를 HDL을 이용하여 설계해봄으로써, Verilog HDL ... 을 사용한 회로 설계 방법과 Quartus Ⅱ의 사용법을 익힌다.1. 이론. 7-세그먼트 디코더0) VHDL로 표현library Ieee;use ieee.std_logic_1164

리포트 | 3페이지 | 1,500원 | 등록일 2010.06.18

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컴퓨터 구조 및 설계 [4판_ARM버전]_4장 요약

과 파이프라이닝의 기본 개념을 제공한다. 또한 AMD X4 마이크로프로세서를 설명한다.□기본적인 MIPS 구현MIPS 명령어 집합의 핵심 부분의 구현을 설계하려 할 때, 핵심이 ... 카운터(PC)를 프로그램이 저장되어 있는 메모리에 보내서 메모리로부터 명령어를 가져온다.2. 읽을 레지스터를 선택하는 명령어 필드를 사용하여 하나 또는 두 개의 레지스터를 읽 ... 는다. 워드 적재 명령어는 레지스터 하나만 읽으면 되지만, 대부분의 다른 명령어는 레지스터 두 개를 읽는다. 이 두 단계 이후에 명령어 실행을 끝내기 위해 필요한 행동들은 명령어 종류

리포트 | 8페이지 | 1,500원 | 등록일 2011.11.19

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10. Shift Register 와 Shift Counter - 복사본

기초 전자회로 설계 및 실험2013년 2학기담당교수 :1주차제출일 :학과:전자통신공학과학번:이름 :연락처:Chapter 10. Shift Register와 Shift ... shift register와 디코더를 이용하여 설계한 타이밍 신호 발생기이다. 그림 10.2는 Johnson counter의 회로를 나타낸 것이다.3. PSpice모의실험(1 ... Counter1.실험 목표① Shift register와 Shift counter의 특성 및 동작원리를 이해할 수 있다.② Shift register와 Shift counter 응용회로

리포트 | 5페이지 | 1,000원 | 등록일 2014.11.26

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연산회로 예비보고서

할 레지스터(sum register)와 플립플롭(carry storage)을 가산기에 연결하면 곧 직렬 가산기 회로가 된다. 클럭 펄스가 들어올 때마다A`,``B가 한 비트씩 전가산기 ... 비트의 가산을 할 수 있는 가산기이다. 그림 4⒜에서와 같이 시프트 레지스터 두 개에 각각A`,``B를 넣어LSB가 오른쪽 끝에 오도록 하고 전가산기의 합과 자리올림을 저장 ... 에 들어가며, 여기서 가산되어 나온 합은 레지스터에 저장되고 자리올림은 플립플롭에 일시 저장되었다가 다음 비트의 가산에 자리올림 입력으로 들어간다. 또 만일 여러 개의 입력을 가산

리포트 | 3페이지 | 1,000원 | 등록일 2015.12.20

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계산기(Calculator) 설계 (쿼터스 설계)

컴퓨터구조 보고서제목Calculator(계산기) 설계학과전자공학과학번2000000성명홍길동제출일소요시간① Calculator 구조, 정의외부 입력(switch)으로는 SA[4 ... bit], SB[4bit], SIR[1bit], START[1bit]내부 Register A[4bit], B[4bit], IR[1bit], C[1bit] 를 갖는다.ALU 부분은 FA ... 를 이용하여 감산Logic을 더해 가감산기를 만든다.(add, subtract 연산)DISP[4bit]는 출력신호로써 IR(Instruction Register), C(Carry

리포트 | 7페이지 | 2,000원 | 등록일 2015.01.27

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Lab#08 Application Design1

가 설계된다.3) Piezo소리의 높낮이를 조절하지는 못하지만, 주파수를 조정하여 소리를 발생할 수 있는 출력장치이다. 멜로디 드으이 소리나 경고음 등을 표현할 수 있다. 음성주파 ... -Segment Controler Design일단 주어진 교안 코드에서 오류가 있었는데, SEG_COM register를 4비트로 주고, case안에서 8비트값을 대입시켰다. 문제 ... 없이 잘 돌아간 이유는, 8비트값을 대입했지만, 레지스터의 한계는 4비트 까지였으므로, 오버플로가 발생하여 오버플로 값들을 삭제하고 4비트 까지만 받아들인 것으로 추정한다. 데이터

리포트 | 30페이지 | 1,500원 | 등록일 2016.09.11

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