"and게이트"의 검색결과 입니다.

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전전설2 1주차 논리게이트 and or not clk de2보드 fpga and or 실험 디지털논리설계 전전설3 nand게이트 and게이트

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"and게이트" 검색결과 561-580 / 5,142건

[일반물리실험] 자유낙하

{2} at ^{2} `[이론 3] Photogate 센서와 Picket Fence? Photogate는 게이트 사이를 지나는 물체의 이동 시간과 속도를 측정 ... . 실험장치 및 실험절차 (Apparatus & Procedure)- 컴퓨터 및 캡스톤 프로그램- 인터페이스 장치- 피켓펜스 (0.03m, 0.05m)균일한 간격으로 불투명한 영역 ... 을 가진 플라스틱 조각- 포토게이트피켓펜스의 움직임을 측정하는데 사용된다.1. 캡스톤 프로그램에서 record 버튼을 누른다.2. 포토게이트 센서에 불이 들어오지 않은 것을 확인한 후

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| 리포트 | 11페이지 | 1,000원 | 등록일 2021.03.09

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2021 생활속의 물리(A+) 퀴즈(중요한 것)정리 [멕시코시티 진동수 ~ 방사선까지]

/news.php?idx=-46771https://kin.naver.com/qna/detail.nhn?d1id=11&dirId=1119&docId=211175088&qb=6rG066y ... 8IOyXsOyEseuKpeugpQ==&enc=utf8§ion=kin.ext&rank=1&search_sort=0&spq=0각 물체가 고유진동수와 같은 주파수의 외력을 받 ... 지 않는 비휘발성 기억장치이다. 각 셀은 플로팅 게이트와 트랜지스터로 이루어져 있으며 플로팅 게이트에 전자를 채우거나 비우는 방식으로 데이터를 기록하거나 지운다. ROM이 전환

시험자료 | 7페이지 | 2,000원 | 등록일 2023.03.25

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임베디드 시스템 레포트

를 덜 소비한다.3. DIP(Dual Inline Package) and SOIC(small-outline IC): DIP 와 SOIC 는 IC 패키지의 일종이다.1) DIP ... 적 회로로 MOSFET 소자를 기반으로 사용한다.- 잡음이 적고 집적도가 높으며 CMOS게이트는 스위칭 순간에만 전력을 소모하기 때문에 전력소모가 적은 저전력이며 제조공정이 간단 ... 하다.- 평면 기술이기에 반도체 표면에 적합하다.4. Period and Frequency of Signal- Period = 1/Frequency로 Period와 Frequency

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| 리포트 | 5페이지 | 1,000원 | 등록일 2020.11.02

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LabView 기초 보고서 1주차

를 이용해서 1.8과 32를 입력시켜준 후에 실행시킨다.연습 1-3. 불리언 연산프런트패널블록 다이어그램(와이어링)프런트 패널에서 토글 스위치 6개를 배열하고 AND 게이트와 OR ... 게이트를 통해서 토글 스위치끼리 연결해준다.연습 1-4. 문자열과 문자열함수프런트패널블록 다이어그램(와이어링)문자열과 numeric control을 블록 다이어그램에서 format

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| 리포트 | 4페이지 | 2,500원 | 등록일 2020.10.25

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2020하반기실리콘웍스 - 합격자소서

My Passion & Future지원동기 및 향후 계획과 포부에 대하여Guide> 당사를 알게된 경위와 지원하게 된 동기에 대해 상세히 적고, 입사 이후 계획과 자신의 포부 ... 전력전송'이라는 목표를 가지고 수신부 회로를 설계했습니다. 12V의 DC를 307kHz의 사각파로 바꿔야 했기에 컨버터, 오실레이터, 게이트 드라이버 등의 소자를 이용 ... 했습니다. 컨버터를 통해 12V를 5V로 강하했고, 이 전압은 오실레이터를 거쳐 307kHZ의 사각파로 출력되었습니다. 그후 교류 전압을 게이트 드라이버로 인가했고, 페이즈 차에 의해 5와 -5

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| 자기소개서 | 3페이지 | 3,000원 | 등록일 2021.04.12

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[최종합격]연세대학교 컴퓨터대학원 학업및연구계획서

를 수강하여 기초를 쌓았습니다. 이후 올해 9월부터는 자대 Vision&Learning Lab의 학부 연구생으로 들어가서 Multi-modal learning ... 었습니다. 실습에서 AND, OR Logic gate의 delay를 비교했을 때, AND gate는 rise time과 fall time delay가 1.4배 차이가 났지만, OR ... 게이트의 fall time delay는 rise time delay에 비해 40배 차이가 났었고, 이 원인을 transistor level의 PMOS, NMOS sizing 차이라고

자기소개서 | 4페이지 | 7,000원 | 등록일 2024.02.16 | 수정일 2024.02.19

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인천국제공항공사 통신직 전공 문제 복원

는?255.255.255.0 255.255.255.192 255.255.255.2408. IP 분배 해주는 장비를 모두 고르시오? 라우터 스위치, 허브, 브릿지, 게이트웨이9 ... 로주고 y11 계산6. 회로주고 V2 전류 구하라(Superposition으로 계산)작년 1차면접 21명(원래 5배수인데 작년 3배수) & 최종 9명총 7명 뽑았음..피티 면접 ... 에 강하다?(FM 특징?)7. 전력 최소 소모하는 논리게이트는? TTL8. L,C 특성 아닌것? 주파수 0일때 컷, 에너지 저장 소비한다. 답 : L에 일정한 전류흐르면 V=09

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| 자기소개서 | 3페이지 | 5,000원 | 등록일 2021.12.13

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디지털 회로에 대한 완벽 설명 레포트입니다. 이걸로 A+받았습니다.!

는 AND항으로 구성되고, 2단계는 OR항으로 만들어진 논리식이다. (예: AB'＋A'B)쉽게 말해서 두 개이상의 곱셈항들이 더해지는 형식이라고 말 할 수있다.최소항은 표준 곱의 항 ... 기에 표준 SOP가 아니고 단순히 SOP형식이라고 할 수 있다.（２） POS는 (Product Of Sum)의 약자이고, 구성의 1단계는 OR항으로 구성 되고, 2단계는 AND항으로 만들 ... 가 된다.3. 비교기에 대하여 설명 하시오.비교기는 두 개의 데이터를 비교하여 무엇이 더 큰지, 작은지, 같은지를 판정하는 회로이다. Exclusive NOR 게이트를 사용한다.1

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| 리포트 | 12페이지 | 3,000원 | 등록일 2021.01.07

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(A+/이론/예상결과/고찰) 아주대 논리회로실험 결과보고서 1

을 작성 하는 것이었다. 그런데 실험 1에 대해 착오가 있었다. PPT에 적힌 말의 뜻을 잘못 이해하여 예비 보고서에는 게이트만 바꿔서, 그러니까 두 개의 AND gate를 두 개 ... 하여 입력에 따라 원하는 결과가 출력되는 회로를 만들 수 있다.1) 실험 과정 및 결과실험1- AND gate 실험결과결선도 [실험(1), 실험(2)]실험 결과A=0V, B=0V, C ... ) 3-input AND gate(SN54LS11, SN54S11 .... etc) data sheetLogic diagramFunction tablePin c

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| 리포트 | 8페이지 | 1,000원 | 등록일 2021.10.24

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노태우부터 문재인까지 7개 정권 말 레임덕 현상 어떤 것이 있었는지에

하고는 대부분의 시간을 교도소를 자유롭게 출입했다는 의혹이 제기되기도 하였다.이용호 게이트는 김대중 정부의 또 다른 비리 사건이다. 2001년에 G&G 그룹의 이용호 회장이 계열사의 전 ... _정리[3] 김대중 정부_이용호 게이트, 진승현 게이트, 김홍일, 김홍업 씨 구속1_사건 개요1) 사건의 배경2) 사건의 발단3) 사건의 전개2_정리[4] 노무현 정부_지방선거 참패 ... 와도 연루되어 있었다.2) 사건의 발단김영삼 정권 말에 터진 이른바 ‘한보 게이트’는 한보 그룹과 현철 씨를 모두 몰락시킨 사건이었으며 김영삼 정부는 한보 게이트 이후로 사실상 제 기능

리포트 | 18페이지 | 2,000원 | 등록일 2023.07.28

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기초전자회로실험 - D래치및 D플립플롭 예비레포트

에 의한 영향을 제거하는 방법에 대한 입증15-(2) NAND 게이트와 인버터를 이용한 게이티드 D 래치 구성 및 시험15-(3) D 플립-플롭의 데스트 및 래치와 플립-플롭의 몇 가지 ... 를 띄고 있는 것으로 각각의 비트마다 독립적으로 On/Off가 가능하다．접점 용량이 작기 때문에 대전류용으로는 부적합하다．[1]4.7486 quad XOR 게이트 :2입력 ... 의 Exclusive OR게이트가 6개 들어있다. [2]5.7400 quad NAND 게이트 :2입력의 NAND게이트가 4개 들어있다. [2]6.7404 hex 인버터 :[2]7.7474

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| 리포트 | 14페이지 | 2,000원 | 등록일 2021.02.27

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Counter 회로제작 (기초공학실습, KAIST)

함으로써 게이트의 지연시간에 의한 에러를 막아준다. 하지만 카운터의 단수가 증가할수록 AND 게이트의 입력수 증가, 게이트의 복잡성 등 단점이 따르게 된다.[리플 counter][동기 ... 에야 원하는 동작을 시킬 수 있다.이러한 어려움을 극복하기 위해 설계된 것이 싱크로노스 카운터이다. 이는 각 단의 출력과 클럭 펄스를 AND로 묶어 다음 단의 입력단으로 연결 ... . DISCUSSION & CONCLUSIONJ- K flip-flop은 Negative Edge Trigger 특성을 가진다.J-K flip flop 하나만 떼어 놓고 보았을 때, 두 입력 값

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| 리포트 | 8페이지 | 1,500원 | 등록일 2020.12.31

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공통 게이트 증폭기 [A+/고찰사항포함/결과레포트] 전자회로실험, 고찰사항

실험 제목 : 공통 게이트 증폭기1. 실험 결과 및 분석(1). 실험회로 1에서 값을 12V, 값을 0V, 값을 6V로 두고, 값이 4V로 두고, 저항 값이 2kΩ인 경우 DC ... 은 and 이므로 saturation 모드로 동작한다.(2).값을 0V, 전압을 0V ~ 6V는 500mV 간격으로 변화시키면서 의 DC 전압을 측정하여 표에 기록하고, 입력-출력 ... 것이다. 이러한 오차에 대해서는 결론 및 고찰에서 자세히 설명할 예정이다.2. 결론 및 고찰-결론이번 실험을 통해 공통 게이트 증폭기에 대해 잘 이해할 수 있게 되엇다.실험절차

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| 리포트 | 14페이지 | 1,000원 | 등록일 2021.06.19 | 수정일 2024.02.28

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Verilog HDL을 이용한 로직게이트설계 및 FPGA를 통한 검증 예비레포트 NAND2,NOR2.X

1. 실험 제목 [Verilog HDL을 이용한 로직게이트설계 및 FPGA를 통한 검증]2. 실험 목적-Hardware Description Language(HDL)을 이해 ... programmable gate array)란 설계가능 논리 소자와 프로그래밍이 가능한 내부 회로가 포함된 반도체 소자이다. 설계 가능 논리 소자는 AND, OR, XOR, NOT, 더 복잡 ... 한 디코더나 계산기능의 조합 기능같은 기본적인 논리 게이트의 기능을 복제하여 프로그래밍을 할 수 있다. 대부분의 FPGA는 프로그래밍 가능 논리 요소에 간단한 플립플롭이나 더 완벽

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| 리포트 | 4페이지 | 1,000원 | 등록일 2021.06.20

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디지털회로실험 멀티플렉서와 디멀티플렉서 결과보고서

게이트 입력값 하나를 입력시킨 NAND게이트의 출력값을 두개로 나누어 또 다른 NAND 게이트에 입력시키면 AND 게이트의 역할을 하게되고, C와 같은 결과값이 나온다.2. 결론반 ... 가산기 : A NAND게이트와 B NAND게이트의 출력값을 다른 NAND게이트에 연결하면 그 값은 NAND 진리표에 따라 S와 같이 나오게 된다. A 게이트의 입력값 하나와 B ... 는데 NOT게이트가 필요했다. 이미 브레드보드가 복잡했으므로 트렌지스터 대신 Cin bar를 수동으로 따로 연결하는 방식을 택했다. 마찬가지로 S 와 COUT 연결섴을 LED에 연결

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| 리포트 | 7페이지 | 3,000원 | 등록일 2021.04.16

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광운대학교 전기공학실험 실험6. 논리조합회로의 설계 결과레포트 [참고용]

해당회로의 개선점은 존재한다. 회로 설계시 부울대수조작이 간편한 OR, AND게이트 등으로 회로를 구성했으나, 공학적으로 유리한 NAND, NOR게이트의 사용을 지양했다. 회로 ... 1. 실험 명논리조합회로의 설계2. 실험 개요논리게이트 조합을 통해 보다 복잡한 논리적 함수관계를 구하는 연습을 진행하며, 이를 통해 논리함수를 효율적으로 단순화 시킨다. 이 ... 구성시 Basic 게이트로 구성한 회로를NAND, NOR로 변환 표현하지 못한 점이 개선점이다. 또한 조합회로 뿐만 아니라 순차회로를 활용한다면 설계한 회로의 품질이 올라갈 것이

리포트 | 9페이지 | 1,500원 | 등록일 2024.01.02

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동국대 대학원 산업시스템공학과 자기소개서 및 연구계획서

경력, 취업을 해서 OOOO 업계에서도 R&D 경력을 갖고 있습니다. 동국대학교 대학원 산업시스템공학과 어느 연구실을 가더라도 저의 역량을 잘 발휘해 연구를 해낼 수 있을 것이 ... 절차를 통합하여 의사 결정 트리를 개선 연구, 남북간 무역에서 SCM기반 물류계획의 적용 연구, 중소기업을 위한 이벤트 CRM의 효과적인 적용을 위한 유선 통합 CRM 게이트웨이 ... 관련 연구를 하였습니다. 취업을 해서 R&D 연구를 할 때는 레고마인드스톰을 활용한 스마트팩토리 플랫폼 개발 연구, 다면체 생성을 통한 NG공구경로 생성시스템 개발 연구

자기소개서 | 2페이지 | 3,800원 | 등록일 2023.03.07

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시립대 전전설2 Velilog 예비리포트 3주차

문법- 참고문헌 1) 참고2) AND Gate- 출력은 논리 입력의 곱과 같음3) NAND Gate- AND 게이트와 NOT 연산을 조합한 결과3. 실험 장비 및 부품 ... 목록실험 목적배경 이론실험 장비실험 전 과제AND GATENAND GATE실험 전 응용 과제 preview1bit Full Adder –Gate Primitive Modeling1 ... 문헌1. 실험 목적Verilog HDL문법을 이해해보자AND gate 설계NAND gate 설계Full adder 설계 (두 가지 방법으로)2. 배경 이론1) Verilog HDL

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| 리포트 | 9페이지 | 1,000원 | 등록일 2021.04.16

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[기초회로실험]Flip-flop 회로

에서는 현재값의 보수로 출력이 된다. 다음은? JK 플립플롭의 회로도이다.기본적으로 SR 플립플롭에 출력 Q와 Q’을 각각 입력 J와 K에 AND 게이트를 연결한다. 그 출력값 ... 을 받아 결정된다.동일한 플립플롭의 경우에도 NOR게이트, NAND게이트 등 여러가지 요소들로 구현이 가능하다. 플립플롭은 여러개를 조합하여 레지스터, 메모리를 구성한다. 예를들어 8 ... 단자와 2개의 출력Q와bar{Q}로 구성된 순서 논리 회로를 RS래치 또는 RS flip-flop이라 한다. 이 회로는 두 개의 NAND 게이트나 두 개의 NOR 게이트로 구성

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| 리포트 | 6페이지 | 2,500원 | 등록일 2021.04.02

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gate를 이용한 결합, 분배, 보수성의 법칙 설계

③ 오실로스코프를 이용한 NOT Gate④ NAND Gate를 이용한 AND Gate⑤ NOR Gate를 이용한 OR Gate⑥ 결합 법칙(OR-OR)⑦ 분배법칙(OR-AND, AND-OR ... )⑧ 분배법칙(AND-OR, OR-AND)⑨ 흡수법칙⑩ 보수성의 법칙(NOT-AND)⑪ 보수성의 법칙(NOT-OR)2. 실험 목적오실로스코프의 사용법과 측정법을 배우고 NOT ... Gate의 펄스 파형을 확인한다.여러 가지 게이트를 이용하여 회로를 구성하고 출력값이 High(1)인지 Low(0)인지 알아보는 실험이다.불 대수 법칙을 게이트에 적용하여 회로를 구성

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| 리포트 | 26페이지 | 1,500원 | 등록일 2020.11.15 | 수정일 2022.04.23

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