"VHDL code"의 검색결과 입니다.

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vhdl 세계 시계 7segment 회로 개수 fpga 프로젝트 vhdl 사각형 vhdl 스탑워치 vhdl calculator

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"VHDL code" 검색결과 481-500 / 517건

VHDL 을 이용한 디지털 시계 만드는 최종 보고서

VHDL 최종 보고서목 차 설계의 목표 자료조사 사용부품 사용장비 구현방법 기대효과 일정계획 ( 블록도 ) 프로그램 소스설계의 목표 무엇을 만들 것인가 ? 스톱워치를 만들 예정 ... 2 일까지 : 서적 및 인터넷 조사 11 월 9 일까지 : 소스코드 작성 11 월 16 일까지 : 부품 및 시장조사 11 월 23 일까지 : 회로 구성 11 월 30 일

Non-Ai HUMAN
| 리포트 | 20페이지 | 2,000원 | 등록일 2010.12.23

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[디지털논리회로]Digital clock design

설계 포트폴리오학부(과)명전파공학과프로그램 명전파공학 프로그램성 명권명진학 번20001165교과목 명디지털 논리회로년도 / 학기2005/2교과목 코드51956담 당 교 수김기만 ... ounter and mod-60 counter② Draw the logic diagram by Quartus-II③ Simulate the designed circuit- VHDL ... - Block diagram3. 설계 결과 및 검증Quartus_II Wave form file- VHDL 소스로부터 나온 타이밍- Block diagram 소스로부터 나온 타이밍- 두

Non-Ai HUMAN
| 리포트 | 10페이지 | 1,500원 | 등록일 2006.06.21

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디지털시스템설계_마이크로프로세서_Shifter&Alu의설계

되어야 하므로, 이때는 무조건 RLamount를 01000 으로 만들어 주면 간단하게 해결된다.위의 사항을 VHDL로 표현한 코드와 주석은 다음과 같다.먼저 16bit 4 to 1 ... mux의 코드는 다음과 같다.entity mux16_4_1 isport(input_0,input_1,input_2,input_3 : in std_logic_vector ( 15 ... 를 이용한 shifter의 코드는 다음과 같다.architecture shifter_16 of shifter issignal sel3, sel2, sel1, sel0 : std

Non-Ai HUMAN
| 리포트 | 13페이지 | 1,500원 | 등록일 2008.02.19

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Brown, Vranesic McGraw Hill 5장 문제풀이.

*교과서 5장의 5.5, 5.24, 그리고 5.25의 문제를 풀기 바랍니다.(단, 5.5는 VHDL CODE로 작성하여 simulation까지 완성하시기 바랍니다.)5.5) 8

Non-Ai HUMAN
| 리포트 | 10페이지 | 2,500원 | 등록일 2009.06.05

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임베디드 stepping motor

IO-mode에서 화살표 키에 의해 제어되는 리눅스 제어 프로그램과 VHDL 코드를 완성하라. 즉, 화살표 키의 키는 방향을 바꾸고, 상하 키는 모터의 속도를 바꾼다 ... . 방향을 바꾸는 경우 모터에 무리가 가지 않도록 부드러운 방향 전환이 가능하도록 제어 코드를 작성하였다.

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| 리포트 | 3,000원 | 등록일 2005.07.10

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[ALU] 4bit ALU

코드(때로 이것을 줄여서 "op code"라고 부른다)을 포함하고 있는 기계 명령어, 하나 또는 그 이상의 연산자 그리고 형식코드로 구성된다. 연산코드는 수행해야 할 연산이 무엇 ... 인지를 ALU에게 알려주며, 연산자는 그 연산을 위해 사용된다(예를 들어 두 개의 연산자를 서로 더하거나 논리적으로 비교하라는 연산일수도 있다). 형식코드는 연산코드와 함께 결합 ... 과, 그 안에서 수행된 연산들은 게이트 회로에 의해 통제되는데, 게이트 회로는 다시 각 연산코드에 대해 특별한 알고리즘이나 순서를 사용하는 순차 논리 장치(sequence logic

Non-Ai HUMAN
| 리포트 | 4페이지 | 1,000원 | 등록일 2003.11.27

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[디지털공학]VHDL을 이용한 신호등구현

(2) VHDL 소스 코드library IEEE;use IEEE.STD_LOGIC_1164.ALL;use IEEE.STD_LOGIC_ARITH.ALL;use IEEE.STD ... ; Yb : out bit; Rb : out bit)(6) 설계과정에서 발생한 문제 및 해결과정처음 VHDL Coding 당시에는 state

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| 리포트 | 5페이지 | 5,000원 | 등록일 2005.07.11

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[VHDL] memory설계 using VHDL

VHDL을 이용해서 memory를 설계하고,컴파일 후, 시뮬레이션한 결과(source code)-- This source is VHDL source of memory.-- 16 ... university-- This source is free.-- Reference: Digital circuit design using VHDL (한올 출판사)-- library

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| 리포트 | 4페이지 | 1,000원 | 등록일 2003.05.29

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vhdl을 사용한 신호등 설계

if (reset = `1`) then -- reset이 1이면, 카운트를 리셋count `0`);c_state

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| 리포트 | 5페이지 | 1,000원 | 등록일 2007.01.19

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[디지털논리회로] dash Watch (STOP WATCH) VHDL로 설계하기[쿼터스]

--------------------- 69. VHDL 코딩 --------------------------------------- 610. Simulation ---------- ... 는 것이었다. 그 친구의 논리도 들어보면 맞지만 내가 생각해낸 논리역시 정확하다고 믿었기에 그대로 밀고 나갔다. 나의 논리는 위 코드에서 나와있듯이 50M번을 돌았을 때가 0.01 ... 하였다.이것으로 컴퓨터구조 텀 프로젝트 보고서를 마치겠습니다. 감사합니다.14. 참고자료? 디지털 시스템 설계를 위한 VHDL 기본과활용. - 박세현, 그린.1998? 디지털공학 및

Non-Ai HUMAN
| 리포트 | 30페이지 | 2,500원 | 등록일 2009.05.09

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lg전자최종지원서

는 VHDL을 이용하여 Spartan Board의 LCD에 일반적인 손목시계와 비슷한 동작을 하고, 거기에 추가 기능을 더한 디지털시계를 구현하는 것이었습니다. 학교 앞 고시원까지 이사 ... 를 했고, 한 달간 피나는 노력을 한 결과, 저희 팀은 Spartan Board에 디지털 시계의 시간, 날짜, 초시계가 동작하도록 하는 알고리즘 코드를 완성할 수 있었습니다. 하지 ... 는 방법은 알아내질 못했던 것입니다. 그 방법은 교수님께서 LCD 출력참고파일로 주신 소스코드를 약간 수정하는 것이었는데, 착시 현상을 이용해야 하는 방법을 그 누구도 알아내

Non-Ai HUMAN
| 자기소개서 | 4페이지 | 3,000원 | 등록일 2011.04.04

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[asic] vhdl을 이용한 전가산기 설계

로 이루어진 반가산기 두개와 or게이트 하나와 같음을 알 수 있다.2. VHDL code와 파형1) 전가산기(Dataflow)library IEEE;use IEEE.std_logic

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| 리포트 | 5페이지 | 1,000원 | 등록일 2004.05.03

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[하드웨어 언어]VHDL로 작성한 차량 제어 프로그램

속도에 따라 적정 거리 이하일 경우 경보를 울리고 LED3를 켜주고 충돌예상이 될 경우 브레이크를 제어하고 경보는 해제한다.3. VHDL codinglibrary IEEE;use ... 이어준 코드이다. Component 문을 사용해서 위에서 작성한 각각의 블록의 포트를 선언해 주고 port map을 사용해서 각각에 맞게 포트를 맞춰 준다.Top Block ... Diagram4.VHDL simulation1)차간거리제어먼저 차간거리제어에서 차간 거리와 자차 속도는 고정 시켜놓고 상대방 속도를 변화 시켜서 브레이크가 제어 되는 것을 확인해 보

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| 리포트 | 19페이지 | 1,000원 | 등록일 2006.05.28

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전자자물쇠(VHDL)

기간 동안 해당 key 입력값을 유지하도록 했다. 이때 key는 임의 순간에 오직 1개의 key 입력만 받는다고 가정한다.1.2 VHDL 코드 설계library ieee;use

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| 리포트 | 9페이지 | 2,000원 | 등록일 2007.04.07

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논리회로 설계실험 농구전광판

등이 들어간다.3)전광판의 결과물은 LCD와 SEVEN_SEGMENT에 출력 할 수 있다.4)한 학기 동안 배운 VHDL을 충분히 복습하여 본다.5)실습시간동안 배운 것 외의 기능 ... . 전의 소스코드보다 간단해 진다는 것을 알 수 있었다.ㄹ)BASKETBALL_DATA entityentity BASKET_DATA isPort ( FPGA_RSTB : in STD

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| 리포트 | 24페이지 | 2,000원 | 등록일 2009.07.10

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lg히타치최종지원서

캡스톤 설계 1등을 했습니다. 이 경험으로 전 최고의 성취감과 임베디드 시스템의 전문가가 되고자 하는 목표를 정할 수 있었습니다.'Top Secret'3학년 프로젝트는 VHDL ... 을 이용하여 Spartan Board의 LCD에 시계를 구현하는 것이었습니다. 한 달의 노력으로 어렵사리 코드를 완성할 수 있었습니다. 그런데 5개의 팀 중 저희 팀만 유일하게 LCD

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| 자기소개서 | 4페이지 | 3,000원 | 등록일 2011.04.04

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[asic] vhdl을 이용한 시계 설계

VHDL을 이용한 디지털 시계 설계4) 현재는 달과 일을 각각 설정하게 되어 있다. 여기서 일을 증가시켜서 월이 설정되도록 설계하여라.먼저, 수정 이전상태의 VHDL소스를 보

Non-Ai HUMAN
| 리포트 | 8페이지 | 1,000원 | 등록일 2004.05.03

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자판기(vending machine) VHDL

의 key 입력만 받는다고 가정한다.1.2 VHDL 코드 설계library ieee;use ieee.std_logic_1164.all;use ieee.std_logic

Non-Ai HUMAN
| 리포트 | 8페이지 | 2,000원 | 등록일 2007.04.12

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[전자공학] Modelsim & Synplify & ISE를 이용한 VHDL 시뮬레이션

: 이 상 철..PAGE:31. Function 시뮬레이션1. 합성 및 시뮬레이션 할 VHDL 코드를 작성한다.2. test_vector를 작성한다.(모델심에서의 test ... 시뮬레이션저장해 놓은 VHDL 코드를 하위 모듈부터 컴파일을 시킴니다.(오른쪽 하단의 compile 버튼을 누르면 됩니다.)Digital Communication 소모임 I작성자 ... ..PAGE:1Modelsim & Synplify & ISE를 이용한VHDL 합성 및 시뮬레이션2003. 11. 24Digital Communication I이 상 철my-s

Non-Ai HUMAN
| 리포트 | 39페이지 | 1,000원 | 등록일 2003.11.25

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7segment

. 05. 19.디지털논리- 7 Segment -/Problem. 7-Segment■ 문제 개요VHDL을 이용하여 7-Segment를 나타내어라.■ 문제분석 및 풀이방법▶개요7 ... 이 10진수로 볼 때 0, 1, 2, ... , 7과 같이 차례로 변화되므로 0부터 7까지 세는 카운터라고 말하기도 한다.▶BCD카운터BCD 카운터는 10개의 BCD 코드값(0000

Non-Ai HUMAN
| 리포트 | 13페이지 | 1,500원 | 등록일 2008.05.21

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