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EasyAI “viterbi decoder” 관련 자료

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+정보통신개론 ) 다음과 같은 (12,..등록일 2023.08.24 | 총 9,744자 | 12페이지 | 5,000원

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"viterbi decoder" 검색결과 1-20 / 61건

변형된 레지스터 교환 방식의 비터비 디코더 설계 (Design of Viterbi Decoders Using a Modified Register Exchange Method)

대한전자공학회 이찬호, 盧承孝

논문 | 10페이지 | 무료 | 등록일 2025.05.16 | 수정일 2025.05.22

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이중 Viterbi 복호기를 가지는 반율 공간-주파수 부호화된 직교 주파수분할다중화 (A Half-Rate Space-Frequency Coded OFDM with Dual Viterbi Decoder)

한국정보처리학회 강석근

논문 | 8페이지 | 무료 | 등록일 2025.05.07 | 수정일 2025.05.17

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Radix-4 비터비 디코더를 위한 효율적인 ACS 구조 (An Efficient ACS Architecture for radix-4 Viterbi Decoder)

대한전자공학회 김덕환, 임종석

논문 | 10페이지 | 무료 | 등록일 2025.05.16 | 수정일 2025.05.22

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다중 표준용 파라미터화된 비터비 복호기 IP 설계 (A Design of Parameterized Viterbi Decoder for Multi-standard Applications)

한국정보통신학회 박상덕, 전흥우, 신경욱

논문 | 8페이지 | 무료 | 등록일 2025.05.13 | 수정일 2025.05.18

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순서적 역방향 상태천이 제어에 의한 역추적 비터비 디코더 (Trace-Back Viterbi Decoder with Sequential State Transition Control)

decoding techniques with sequential backward state transition control in the trace back Viterbi ... decoder. The Viterbi algorithm is an maximum likelihood decoding scheme to estimate the likelihood of ... to achieve the area-efficiency VLSI chip design with high throughput in the Viterbi decoder in which

논문 | 12페이지 | 무료 | 등록일 2025.06.10 | 수정일 2025.06.16

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PRML 신호용 저 전력 아날로그 병렬처리 비터비 디코더 개발 (Fabrication of a Low Power Parallel Analog Processing Viterbi Decoder for PRML Signal)

대한전자공학회 김현정, 김형석, 손홍락

논문 | 무료 | 등록일 2025.05.16 | 수정일 2025.05.22

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비교 연산을 개선한 SPEC-T 비터비 복호기의 구현 (A SPEC-T Viterbi decoder implementation with reduced-comparison operation)

대한전자공학회 방승화, 임종석

논문 | 9페이지 | 무료 | 등록일 2025.05.13 | 수정일 2025.05.18

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비터비 복호 알고리즘 처리를 위한 DSP 명령어 및 하드웨어 회로 (New DSP Instructions and their Hardware Architecture for the Viterbi Decoding Algorithm)

대한전자공학회 李在晟, 선우명훈

논문 | 9페이지 | 무료 | 등록일 2025.02.25 | 수정일 2025.03.06

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비터비 복호기를 이용한 OFDM-WLAN의 채널등화 및 샘플링 클럭추적 (Viterbi Decoder-Aided Equalization and Sampling Clock Recovery for OFDM WLAN)

대한전자공학회 김형우, 한동석, 임채현

논문 | 10페이지 | 무료 | 등록일 2025.04.16 | 수정일 2025.05.10

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실시간 COFDM시스템을 위한 효율적인 구조를 갖는 비터비 디코더 설계 (The viterbi decoder implementation with efficient structure for real-time Coded Orthogonal)

대한전자공학회 황종희, 정덕진, 이승열, 김동순

논문 | 14페이지 | 무료 | 등록일 2025.03.13 | 수정일 2025.03.28

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레일레이 채널에서 성능 향상을 위한 DVB-T용 비터비 디코더의 아키텍쳐 (Novel Viterbi Decoding Architecture for DVB-T with Improved Performance in Rayleigh Channels)

대한전자공학회 吳姃姸, 朴奎鉉, 李丞晙

논문 | 9페이지 | 무료 | 등록일 2025.02.25 | 수정일 2025.03.06

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쓰기 동작의 에너지 감소를 통한비터비 디코더 전용 저전력 임베디드 SRAM 설계 (Low Power Embedded Memory Design for Viterbi Decoder with Energy Optimized Write Operation)

대한전자공학회 당호영, 신동엽, 송동후, 박종선

논문 | 7페이지 | 무료 | 등록일 2025.05.10 | 수정일 2025.05.18

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DVB-T 수신기를 위한 대규모 병렬처리 GPU 기반의 비터비 복호기 구현 (Implementation of Viterbi Decoder on Massively Parallel GPU for DVB-T Receiver)

대한전자공학회 이규형, 이호경, 허서원

논문 | 9페이지 | 무료 | 등록일 2025.02.12 | 수정일 2025.02.15

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Clock-gating 방법을 사용한 저전력 시스톨릭 어레이 비터비 복호기 구현 (Low-Power Systolic Array Viterbi Decoder Implementation With A Clock-gating Method)

한국정보처리학회 류제혁, 조준동

논문 | 6페이지 | 무료 | 등록일 2025.04.25 | 수정일 2025.05.14

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UWB시스템을 위한 고속 저복잡도 2-비트 레벨 파이프라인 비터비 복호기 설계 (High-Speed Low-Complexity Two-Bit Level Pipelined Viterbi Decoder for UWB Systems)

대한전자공학회 구용제, 이한호

논문 | 12페이지 | 무료 | 등록일 2025.05.13 | 수정일 2025.05.18

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1000BASE-T의 4조 PAM-5 신호 상에서 동작하는 비터비 디코더의 구현 (Implementation of a Viterbi decoder operated in 4 Dimensional PAM-5 Signal of 1000Base-T)

onvolutional encoder and PAM-5, and the receiver uses the Viterbi decoder. In this paper, we implement a ... Viterbi decoder which can correct two pair errors and operate at the least 125 MHz clock speed ... decoder with a logic analyzer. 한국정보통신학회 한국정보통신학회논문지 정재우, 정해

논문 | 10페이지 | 무료 | 등록일 2025.06.29 | 수정일 2025.07.04

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Radix-4 트렐리스 병렬구조 및 역방향 상태천이의 제어에 의한 역추적 비터비 디코더 (Radix-4 Trellis Parallel Architecture and Trace Back Viterbi Decoder with Backward State Transition Control)

-4 trellis parallel architecture and backward state transition control trace back Viterbi decoder ... features, this paper addresses a novel Viterbi decoder which is composed of branch metric c ... unified Viterbi decoder. Moreover, any additional circuit and/or peripheral control logic are not

논문 | 13페이지 | 무료 | 등록일 2025.06.10 | 수정일 2025.06.16

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Viterbi Decoder

6. Viterbi Decoder콘볼루션 부호화기는 SNR(신호대잡음비)이 매우 낮아서 수신된 신호에 오류가 생기기 쉬운 경우에 사용한다. 콘볼루션 부호화기는 원신호에 적절한 양

리포트 | 9페이지 | 1,000원 | 등록일 2012.11.21

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Viterbi decoder Matlab 설계

Viterbi decoder 알고리즘Viterbi decoder 알고리즘은 트렐리스도로 표현할 수 있다. 그림 2는 구속장(K)이 3, 부호율이 1/2인 Viterbi ... )가 들어오면 출력으로 2 비트 부호어가 나가게 되어있으므로, Viterbi decoder에서는 2 비트 부호어를 단위로 하여 데이터를 처리한다. 이 부호어와 수신된 2 비트간의 거리 ... 를 복원하게 된다.(a) Encoder trellis diagram(B) Decoder trellis diagram그림 2. 길쌈부호기와 Viterbi decoder 트렐리스

리포트 | 5페이지 | 2,000원 | 등록일 2012.11.02

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Viterbi Decoder설계

『Viterbi Decoder (K=3 and rate=1/2)』◎ Module viterbi◦ Purpose : TOP LEVEL MODULE OF DECODER PART ... ◦ File name: viterbi.v◦ Modules used : compute_metric.v compare_select.v

리포트 | 13페이지 | 2,000원 | 등록일 2010.10.28

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