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"Lab04" 검색결과 1-20 / 2,922건

  • 자료 표지
    매트랩 과제6 18.05.04
    >> for x_iter=1:100for y_iter=1:100comp=(50-x_iter)/50*2+(50-y_iter)/50*2*i;mid_val=0;numx=0;while (abs(mid_val) x_ind=1:100;>> y_ind=1:100;>> figure(..
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    | 리포트 | 1페이지 | 1,000원 | 등록일 2021.02.07
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  • 자료 표지
    서울시립대 전전설2 Lab-04 결과리포트 (2020 최신)
    전자전기컴퓨터설계실험Ⅱ결과리포트Lab-04 Combinational Logic-1작성일: 20.10.101. 실험목적Verilog HDL을 사용해 비교기 등 ... 완전히 두 값이 동일할 경우에는 eq=1이 나오도록 작성했다.- 테스트벤치- 시뮬레이션 결과- ucf 파일4. 실험 결과교수님께서 In lab-04 당일에 combo box test ... 을 의미하는 LED 3에만 불이 들어왔다.5. 토의In lab-04 시간 처음에 assign문 한 줄로 어떻게 carry와 sum이 한 번에 나타나는 4-bit adder를 만들
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    | 리포트 | 15페이지 | 1,500원 | 등록일 2021.09.10
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  • 자료 표지
    [서울시립대] 전자전기컴퓨터설계실험2 / Lab04(결과) / 2021년도(대면) / A+
    . Materials and Methods가. 실험 장비HBE Combo-II SE3. Result of this lab(1) [실습 1] one-bit 반가산기를 if 문을 사용
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 2,000원 | 등록일 2022.07.16
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  • 판매자 표지 자료 표지
    서강대학교 23년도 마이크로프로세서응용실험 4주차 Lab04 결과레포트 (A+자료)
    마이크로프로세서응용실험 4주차 실험 보고서목적- 논리, 연산, 곱셈, 나눗셈, shift, rotation과 같은 데이터 처리 명령어들을 수행시키며, 레지스터에 저장되는 결과와 flag의 변화를 이해한다.- Flag들의 종류와 역할에 대해 이해한다. flag가 set되..
    리포트 | 68페이지 | 1,000원 | 등록일 2024.03.24 | 수정일 2024.09.02
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  • 자료 표지
    [서울시립대] 전자전기컴퓨터설계실험2 / Lab04(예비) / 2021년도(대면) / A+
    Pre-reportCombinational Logic 1날짜 :학번 :이름 :1. Introduction가. 실험의 목적Verilog HDL 언어를 사용하여 Combinational Logic을 설계 및 실험하고, 설계한 로직을 시뮬레이션하기 위한 벤치를 작성하고 장비..
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    | 리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16
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  • 자료 표지
    Lab#04 Combinational Logic Design 1
    Post-Lab ReportLab#04 Combinational Logic Design 1@ Arithmetic Logic and Comparator담당 교수강 상 혁담당 조교실 ... 험 일실 험 조학 번이 름Contents1. Introduction3가. Purpose of this lab3나. Essential backgrounds32. Materials ... . Result of the lab12가. Inlab1. Full subtractor12나. Inlab2. 4bit subtractor15다. Inlab3. Comparator17
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    | 리포트 | 24페이지 | 1,500원 | 등록일 2016.09.11
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  • 자료 표지
    전전컴실험III 제04주 Lab03 OPAMP Post
    (0) Purpose of this Lab.이번 실험은 Operational Amplifier의 특성을 이해하고, 이를 활용한 가산기와 감산기를 설계하는 것을 목표로 한다.(1 ... ) Result of this Lab.[1-0] Operational amplifier를 사용하기 위하여 칩의 pin diagram을 살펴 보고 +/- 전원 전압을 바르게 인가하시오 ... .04V이며, 두 신호의 위상이 180도 차이가 나는 것을 확인할 수 있다.[그림 4][1-2] 2개의 입력 신호를 subtract하는 회로를 operational amplifier
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    | 리포트 | 5페이지 | 2,500원 | 등록일 2017.02.05 | 수정일 2017.03.26
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  • 자료 표지
    전전컴실험III 제05주 Lab04 OPAMP2 Pre
    (0) Purpose of this Lab.이번 실험에서는 Operational Amplifier를 이용하여 instrumentation amplifier Circuit를 설계 ... (Required theory) for this Lab 계측 증폭기지난 실험에서는 두 입력 신호의 차를 증폭하여 출력하는 차동 증폭기를 설계하였다. 하지만 이러한 차동 증폭기는 전압원 ... .(*)실험에 사용할 741 operational amplifier에 대한 data sheet를 함께 첨부한다.[그림 2][그림 3](2) Pre-lab & Simulation[1-1
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    | 리포트 | 6페이지 | 2,000원 | 등록일 2017.02.05
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  • 자료 표지
    전전컴실험III 제05주 Lab04 OPAMP2 Post
    (0) Purpose of this Lab.이번 실험에서는 Operational Amplifier를 이용하여 instrumentation amplifier Circuit를 설계 ... 한다. 이 회로의 특성을 파악하고, 가변저항을 이용하여 회로의 이득을 손쉽게 조정할 수 있다는 것을 확인하는 것을 목표로 한다.(1) Result of this Lab.[1-1] 3 ... 하지만 차동 증폭기가 가지고 있던 단점이 보완된 회로라고 생각하면 된다.Pre lab에서 언급하였듯이 [그림 1]에서 나타낸 회로의 왼쪽 두 Op-amp에서는의 이득이 나타난다
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    | 리포트 | 7페이지 | 2,500원 | 등록일 2017.02.05 | 수정일 2017.03.26
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  • 자료 표지
    [A+]전전컴실험I Lab04 Post PSpice를 이용한 전기회로의 시뮬레이션
    . Introduction (실험에대한소개)‥‥‥‥‥‥‥‥‥‥‥‥ 2-6가. Purpose of this Lab‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 2나. Essential ... Backgrounds (Required theory) for this Lab ‥‥‥‥‥‥‥‥‥ 2-62. Materials & Methods (실험장비및재료와실험방법) ‥‥‥7-9가. 실험을통해 ... 구하고자하는데이터와이를획득하기위한실험순서‥‥7-8나. Materials(Equipments, Devices) of this Lab ‥‥‥‥‥‥‥‥‥‥‥‥‥‥8다. Matters
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    | 리포트 | 16페이지 | 1,000원 | 등록일 2017.11.24
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  • 자료 표지
    [A+]전전컴실험I Lab04 Pre PSpice를 이용한 전기회로의 시뮬레이션
    )‥‥‥‥‥‥‥‥‥‥‥‥ 2-4가. Purpose of this Lab‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥ 2나. Essential Backgrounds (Required ... theory) for this Lab ‥‥‥‥‥‥‥‥‥2-42. RreLab‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥5-6가. PreLab 1.‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥‥5-63 ... . Materials & Methods (실험장비및재료와실험방법) ‥‥‥7-9가. Materials(Equipments, Devices) of this Lab
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    | 리포트 | 15페이지 | 1,000원 | 등록일 2017.11.24
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  • 자료 표지
    (완전 세세한 정리, 끝판왕) 시립대 전전설2 4주차 Lab04 예비 레포트 Combinational Logic 1
    전자전기컴퓨터공학부 설계 및 실험2Pre La-04Combinational Logic 1실 험 날 짜학 번이 름목차1. 실험 목적 ... _adder U1 (s1, z, s, temp_c2 );In-Lab 실습 1 ~ 3 과제에서 수행할 코드를 작성하고 Synthesize – XST 단계까지 수행하시오.실험방법 참조3. 실험
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    | 리포트 | 13페이지 | 2,000원 | 등록일 2020.07.27 | 수정일 2020.09.24
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  • 자료 표지
    실험2 제06주 Lab04 Post Comparator
    . Introduction1) Purpose of this Lab2) Essential background for this Lab2. Result of this Lab1) Measured ... data and description of Lab 1 (1-bit Subtracter)2) Measured data and description of Lab 2 (4-bit ... Subtracter)3) Measured data and description of Lab 3(1-bit Comparator)4) Measured data and description of
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17
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  • 자료 표지
    실험2 제06주 Lab04 Pre Comparator
    . Introduction1) Purpose of this Lab2) Essential background for this Lab2. Method1) Procedure of Lab 12 ... ) Procedure of Lab 23. Predata of this Lab1) Lab 1 of 1-bit Comparator2) Lab 2 of 4-bit Comparator4
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    | 리포트 | 7페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17
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  • 자료 표지
    서울시립대 전자전기컴퓨터설계실험2 제05주 Lab04 Pre
    교안 – Verilog HDL 실습 Lab#04 Combinational Logic Design, Arithmetic Logic and Comparator, 서울시립대학교 ... Pre-lab Report전자전기컴퓨터설계실험Ⅱ5주차. Combinational Logic DesignArithmetic Logic and Comparator실험 날짜2016 ... (included - Xilinx Spartan3 FPGA Chip)Pre-Lab실험 방법[실험 1] Half Adder 설계Add SourceSource Code모듈을 지정해주
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04
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  • 자료 표지
    서울시립대 전자전기컴퓨터설계실험2 제05주 Lab04 Post
    고 Programming 하는 것이 더 간단할 수 있다.Reference교안 – Verilog HDL 실습 Lab#04 Combinational Logic Design, Arithmetic Logic and Comparator, 서울시립대학교. ... Post-lab Report전자전기컴퓨터설계실험Ⅱ5주차. Combinational Logic DesignArithmetic Logic and Comparator실험 날짜2016 ... 다.Discussion4-bit Full Adder SubtractorPre-Lab과의 비교 결과, 4-bit full Adder Subtractor가 정상 작동함을 확인할 수 있었다.1-bit
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2017.09.04
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  • 자료 표지
    서울시립대 전자전기컴퓨터설계실험2 제04주 Lab03 Post
    Post-lab Report전자전기컴퓨터설계실험Ⅱ4주차. Verilog HDL실험 날짜2016. 9. 26학번이름Professor조교Expected ResultsAND Gate ... 을 확인할 수 있다. 따라서 4-bit Full Adder가 제대로 동작함을 확인할 수 있다.DiscussionAND Gate ProgrammingPre-Lab과의 비교 결과 ... , AND Gate가 정상 작동함을 확인할 수 있었다.AND Gate ProgrammingPre-Lab과의 비교 결과, NAND Gate가 정상 작동함을 확인할 수 있었다.1-bit
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2017.09.04
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  • 자료 표지
    서울시립대학교 전자전기컴퓨터설계실험2 제04주 Lab03 Pre
    Pre-lab Report전자전기컴퓨터설계실험Ⅱ4주차. Verilog HDL실험 날짜2016. 9. 26학번이름Professor조교실험 소개실험 목적HDL(Hardware ... Design Tool (Version - 14.7)HBE-ComboⅡ-SE Board (included - Xilinx Spartan3 FPGA Chip)Pre-Lab실험 방법[실험 1 ... Switch 2를 동시에 눌렀을 때에만 LED 1에 불이 꺼질 것임을 예상할 수 있다.Reference교안 – Verilog HDL 실습 Lab#03 Verilog HDL, 서울시립대학교
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04
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    (완전 세세한 정리, 끝판왕) 시립대 전전설2 4주차 Lab04 결과 레포트 Combinational Logic 1, 전자전기컴퓨터설계실험2,
    전자전기컴퓨터공학부 설계 및 실험2Pre La-04Combinational Logic 1실 험 날 짜학 번이 름목차1. 실험 결과
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    | 리포트 | 18페이지 | 2,000원 | 등록일 2020.07.27 | 수정일 2020.09.24
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    실험2 제04주 Lab02 Pre 4 Bit Full Adder
    . Introduction1) Purpose of this Lab2) Essential background for this Lab2. Method1) Procedure of Lab 12 ... ) Procedure of Lab 23) Procedure of Lab 33. Predata of this Lab1) Lab 1 of Half adder2) Lab 2 of 1-bit ... Full adder3) Lab 3 of 4-bit Full adder4. Summarize5. Reference1. Introduction1) Purpose of this
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17
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2025년 12월 28일 일요일
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