"논리회로실험"의 검색결과 입니다.

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"논리회로실험" 검색결과 921-940 / 4,683건

[공학기술]Digital 논리회로 실험에 관한 보고서(예비레포트)

12. Digital 논리회로 실험에 관한 보고서학과전자전기공학부학번20021296조성명김완섭점수☞목표digital 논리회로의 하나인 TTL NAND gate의 동작원리를 알아보 ... 다. 결과에비해 0에 가까운 값이 측정되었다.Q3를 결선한 TTL NAND회로위에서처럼 V2를 5V로 고정시키고 V1을 0~5V까지 변화 시킬 때의 출력파형을 관찰해 보았다.그리고

리포트 | 7페이지 | 1,000원 | 등록일 2007.07.29

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[디지털논리회로설계실험]디지털 논리회로 설계실험 예비보고서 5장 기본 연산 회로

제 5장 기본 연산 회로⑴ 실험 목적연산회로의 기초가 되는 반가산기, 전가산기, 반감산기, 전감산기의 구성 및 동작특성을 실험을 통하여 이해하며 학습한다.⑵ 관련 이론2.1 반 ... 가산기 (HA : Half Adder)]반가산기는 [그림 5-1]과 같이 2개의 1Bit 2진수 A,B를 더하여 그의 합(S)과 자리올림수(C)를 출력하는 논리 연산회로이다.반 ... 가산기의 진리표, 논리식, 논리회로는 [그림 5-2]와 같다.[그림 5-1 반 가산기의 블록선도][그림 5-2 반 가산기]InputOutputABSC*************101

리포트 | 11페이지 | 2,000원 | 등록일 2005.03.30

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아주대논리회로실험 7장시프트레지 예비보고서(기본구성+빵판+예상결과)

하여 report를 작성하였음을 서약합니다.학 부: 전자공학부과목명: 논리회로실험교수명:분 반:조 :학 번:성 명:1실험9. 예비 16조 허성인실험7. 예비보고서 16조1. 실험 목적시프트 ... +55+50+50+50060+50+50+52) 집적회로 시프트 레지스터이 실험은 7496 5비트 shift-right 레지스터를 사용한다. 이 IC는 5개의 master-slave Rm이다. ... counter)와 동기식카운터(synchronous counter)의 구조와 동작 원리에 대해 이해하고, 여러 가지 카운터의 구성 방법도 알아본다.2. 실험 이론1) 시프트

리포트 | 8페이지 | 1,500원 | 등록일 2011.12.21

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[논리회로실험] 비동기 카운터

)하거나 디지털 시스템의 제어를 순차적(sequencing)으로 실행하는 순서 논리회로이다.카운터는 다음과 같이 크게 비동기와 동기의 두 가지로 구분된다.(1) 비동기 카운터 ... 도 하며, 카운터 회로에 쓰이는 모든 Flip Flop에 클럭펄스를 인가하여고 출력이 동시에 변화하는 카운터로서, 하드웨어가 비동기 카운터에 비해 복잡하다.또한 카운터는 카운트 방향 ... 다.【앞의 회로도 설명】Q3Q2Q1Q00*************11010001010110011110001001101010111100110111101111Q0가 0에서 1로 바뀔 때

리포트 | 7페이지 | 1,000원 | 등록일 2003.06.02

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서강대학교 전자공학과 4학기(2학년 2학기)의 디지털논리회로실험 레포트입니다

과 활용 방법을 익힌다.(4) FPGA를 이용해 간단한 논리 회로를 구현하고 동작을 확인한다.1. 제목Lab 3. Decoders and Encoders2. 실험 목적(1) 일반적인 ... 실험 시간을 많이 지연시키기도 하였고, 이론적인 지식이 별로 없는 상태에서 실험을 하여 여러모로 아쉬운 실험이었다.이번 실험을 통해 TTL 소자와 CMOS 소자를 이용해 회로 ... 1. 제목Lab 2. Digital Logic Gates2. 실험 목적(1) TTL 및 CMOS logic gates의 동작 원리를 확인한다. Logic level과 noise

리포트 | 9페이지 | 2,000원 | 등록일 2011.03.27 | 수정일 2021.09.20

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[디지털 논리 회로 실험]디지털 논리 회로 실험,실습(Half/Full Adder, 4-bit Adder/Subtracter)

디지털 논리 실험()-결과 보고서-Chap 6 7담당조교 *** 조교님전기전자공학부044**** ***044**** ***1.실험 결과Chap6. Half/Full ... AdderChap7. 4-비트 Adder/Subtracter2.실험분석 및 고찰Chap6. Full Adder의 진리표입력출력XYCinSCout0 ... 에 X와 Y와 Cin의 입력 시간이 조금씩 차이가 났다. 해결책은 이 문제를 해결하는 방법은 각 레벨에서의 딜레이가 없도록 회로를 다시 설계해야 한다. 이는 처음에 S = X

리포트 | 4페이지 | 2,000원 | 등록일 2005.10.17 | 수정일 2023.05.27

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[논리 회로 실험]디지털 논리회로 프로젝트 Ripple Adder와 CLA(Carry look ahead) Adder의 비교

은 코딩이 복잡하지만 지연시간과 해저드 발생구간이 적다.Ripple Adder의 모양CLA Adder의 모양디지털 논리회로 PROJECT #1 ... 라 우리가 미리 계산한 C1을 input으로 택하는 방식이다. 이렇기 때문에 Gate수는 많고 회로가 조금 복잡하지만 지연시간이 줄어들고 input들이 거의 동시에 Full Adder

리포트 | 6페이지 | 2,000원 | 등록일 2005.10.26 | 수정일 2023.05.27

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디지털논리회로실험 예비리포트 2. AND OR NOT NAND NOR EX-OR

디지털논리회로 실험 자필 예비리포트2. AND OR NOT NAND NOR EX-OR다운 받아보시면 아시겠지만모든 예비리포트가 10점 만점에 10점 또는 11점(가산 1점 포함)짜리입니다.

리포트 | 3페이지 | 1,000원 | 등록일 2009.11.08

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논리회로 실험 레포트(디코더 인코더 및 다중화기 역다중화기)

들 을 이용한 논리회로 구성밥법을 공부한다.3. 실험 이론:①디코더: 디코더는 이진코드(binary code), BCD 코드(binary-coded-decimal code), 기타 ... 1. 실험 제목: 디코더/인코더 및 다중화기/역다중화기2. 실험 목적: ⑴디코더와 인코더의 동작원리 및 특성을 살펴본다.⑵다중화기와 역다중화기의 동작원리 및 특성을 이해하고 이 ... 여러가지 코드들을 코드가 없는 형태로 바꾸는 변환회로를 일컫는다. 정보의 이산량은 디지털 컴퓨터에서 2진 코드로 표현된다. n 비트의 2진 코드는 코드화된 정보 요소를 2개

리포트 | 5페이지 | 1,000원 | 등록일 2009.10.31

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[디지털 회로 이론 실험] 디지털 논리회로 실험 이론 및 예비 레포트 모음

§ 실험 목적∎AND, OR 논리의 진리표를 결정한다.∎Switch(릴레이)의 직렬, 병렬 연결로 AND, OR 논리를 구성한다.∎Switch의 개념을 공부한다.§ 실험 이론 ... 디지털 논리는 단지 두 개의 조건만을 취급한다 : 논리 “1” 또는 논리 “0”. 스위치는 CLOSE(ON) 또는 OPEN(OFF), 전등(LED)은 ON 또는 OFF, 전압펄스 ... 의 有 또는 無, 정펄스(+) 또는 부펄스(-), 전류 흐름의 방향(→←), 자력선 방향(→←) 등이 논리 “1”과 “0”에 각각 대응한다.조건1: A가 true(ON)이고 B

리포트 | 3페이지 | 1,000원 | 등록일 2005.07.12

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[논리회로실험] 감 산 기

5 . 감 산 기[목 적]1.반감산기와 전감산기의 원리와 구성회로를 이해한다.2.감산기의 동작을 실험을 통하여 확인한다.[기본이론]1. 반감산기(Half Subtractor)반 ... 감산기 회로는 2개의 비트를 빼서 그 차를 구하는 조합회로이다. 그런데 0-1을 빼는 경우에는 위 자리에서 수를 빌려오는 자리빌림(Borrow)이 있어야 뺄셈이 가능하다. 따라서 피

리포트 | 5페이지 | 1,000원 | 등록일 2003.04.25

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[논리회로실험] 동기식카운터

은 모든 플립플롭이 동시에 동작하므로 한 상태와 다음 상태사이에 잠정적인 중간 상태가 존재하지 않는다는 점이다. 그러나 회로가 복잡해 진다는 점에 있어서는 카운터에 비하여 취약 ... 를 하나의 회로로 실현할 수 있다. 업(up)입력이 1 일 때 T 입력들이 앞의 플립플롭의 정상 출력 Q 에 따라서 결정되므로 회로는 위로 증가하는 카운터가 되며, 다운 카운(down ... )입력이 1 이면 Q' 의 출력이 T 입력 상태들을 결정하게 되므로 회로는 아래로 감소하는 카운터 기능을 실현하게 된다. 만일 업 입력과 다운 입력 신호가 모두 0 이면 레지스터

리포트 | 8페이지 | 1,000원 | 등록일 2003.04.15

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각종 그래프와 사진,수식이 첨부된 논리회로 실험 (BASIC GATE) 결과 레포트

를 측정한 결과③ Z를 측정한 결과※ 결과값은 A,B 값 오른쪽에 보이는데, 실험결과와 동일한 것을 알 수 있다.(4) 그림 3 (a)와 (b) 회로를 구성한 후 각 점 (X,,Y ... 한 것을 알 수 있다.◆ (b)- 회로3 (b)의 실험결과를 이용하여 Truth table을 그리면 다음과 같다.inputoutputABCXYUVW ... 하며 s다음과 같다.- 위 실험의 결과로 4개의 NAND gate로 XOR gate의 동작이 가능함을 알 수 있다.(6) 그림 4와 같이 각각의 회로를 구성한 후 그 결과를 측정

리포트 | 13페이지 | 2,000원 | 등록일 2008.02.28

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[논리회로] 실험. 인코더와디코더

을 수행하는 조합 논리 회로로서 여러 개의 입력 단자 중 어느 하 나에 나타난 정보를 여러 자리의 2진수로 코드화하여 전달.자판에서 눌린 건반 하나의 신호를 해당 문자의 2진 코드 ... 실험 6. 인코더와 디코더1. 목적1)인코더의 원리 이해.2)인코더와 디코더의 원리를 이용해 각종 코드를 만들 수 있는 능력을 키움.2. 기본이론1)인코더디코더와 정반대의 기능 ... 하여 8진수를 네 자리의 2진수로 부호화하기 위한 진리표 작성2)디코더코드 형식의 2진 정보를 다른 코드 형식으로 바꾸는 회로.2진 코드를 해독(decoding)하여 이에 대응

리포트 | 5페이지 | 1,000원 | 등록일 2003.05.14

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논리회로 실험 (결과) 멀티플렉서 디멀티플렉서 (먹스)(디먹스) Multiplexer Demultiplexer

을 서약합니다.학 부: 전자공학부제출일: 07.10.6과목명: 논리회로 실험교수명: 박성진 교수님조: 10조학 번: 200320474 200320463성 명: 이준범 이영길실험 4 ... plexer실험 사진》①회로구성우리조가 구성한 실험 회로는 위의 사진과 같다. 총 4개의 IC (1개의 invert와 3개의 and) 를 이용하여 회로를 구성하였고, Data ... 의 목적지로 반드시 연결하여야 하는 응용분야에서 매우 유용한 소자이다.실험 1.(3) 4x1 멀티플레서 Ic인 74HC153을 이용하여 다음 회로를 구성한다.《Multiplexer

리포트 | 10페이지 | 2,000원 | 등록일 2007.10.06

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디지털논리회로실험 장비사용법 및 시뮬레이션 툴 사용법

로 본 전원 공급기에 전류를 흘려 본 전원 공급기를 파손시키는 수가 있다. 따라서, 이 경우에는 다이 오드를 통해 부하에 전원을 공급한다.(2) 논리실험장치 - 디지털 논리눈 논리값 ... ‘0’, ‘1’ 중 어느 하나에 할당시켜 실세계를 표현한다. 논리실험장 치란 그러한 논리소자의 기본적인 특성을 확인하고 실험하는 장치 중 하나이다.◎ 사용법1. 전원전압을 사용전압 ... 1. 제 목 : 장비 사용법 및 시뮬레이션 툴 사용법2. 실험목적 : 실험실의 각종 측정장비의 명칭과 기능 및 사용법을 이해한다.3. 이 론(1) 파워서플라이 - 모든 전기기기

리포트 | 2페이지 | 1,000원 | 등록일 2007.11.21

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[디지털논리회로설계실험]디지털 논리회로 설계실험 예비보고서 6장 대소 비교 회로 및 다중 출력 회로

⑴ 실험 목적대소 비교 회로, 일치회로 및 다중 출력 회로를 설계하여, 각 회로의 구성 및 동작 특성을 실험을 통하여 이해하며 학습한다.⑵ 관련 이론 2.1 대소 비교 회로대소 ... 다. 즉, 이 회로는 입력 A, B를 비교하여 W, X, Y에 두 수의 비교 결과를 출력하는 조합 논리 회로이다. 1bit의 2진수 A, B 2개를 비교하여 W, X, Y에 두 수 ... 의 비교 결과를 출력하는 1bit 2진 비교기의 진리표 및 논리회로는 [그림 6-1]과 같다.[그림 6-1 1bit 2진 비교기]또한 2개 이상의 입력단자와 하나의 출력 단자를 갖

리포트 | 10페이지 | 1,500원 | 등록일 2005.03.30

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디지털 논리회로 실험, 부울법칙 및 드모르간, 글리치, 해저드, half/full adder 실험 예비 보고서

을 이해한다.⑤ 해저드를 제거하는 방법을 이해한다.⑥ Half Adder와 Full Adder의 구성과 동작 원리를 이해한다.⑦ Adder을 이용하여 간단한 논리회로를 직접 구성 ... 해본다.2. 기본이론1) 효율적인 논리 회로를 만들기 위해서는 최적화된 부울 방정식이 필요하다. 부울 방정식을 만드는 방법으로 부울 법칙과 드모르간 정리가 사용된다.부울 대수 법칙 ... 하는 노이즈 펄스로 인해 일어나는 컴퓨터의 일시적인 오동작. 잘못된 출력이나 시스템 충돌을 일으키는 원인이 된다. 하드웨어적인 문제.해저드(Hazard) : 논리 회로에서 입력 논리값

리포트 | 5페이지 | 1,500원 | 등록일 2009.07.18

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[공학기술]Digital 논리회로 실험에 관한 보고서(결과보고서)

12. Digital 논리회로 실험에 관한 보고서학과전자전기공학부학번20021296조성명김완섭점수표 1. NAND gate의 입출력 관계 특성그래프의 꺾인 점에서의 vi값Q3 ... 소자들을 통해 디지털 회로가 어떻게 구성되어지는지 실험을 통해 알아 볼 수 있었다. 오실로스코프상에서 XY PLAN으로 그래프가 점으로 구성이 되어 변화되는 기울기가 심하여 정확 ... 결론1학년 때 기초논리회로 시간에 배운 TTL NAND gate의 동작원리를 알아 볼 수 있었고, 부하를 점점 늘려서 달아봄으로써, 출력측에 같은 소자를 몇 개나 부하로 연결 될

리포트 | 2페이지 | 1,000원 | 등록일 2007.07.29

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논리회로실험- D/A CONVERTER, A/D CONVERTER 결과보고서

에 참가하여 실험을 완성하였다. 처음에 RESET을 잘못시켜주어서 7490칩이 제대로 COUNTER 동작하지 않아서 실험이 힘들었다. 먼저 보고서의 그림대로 회로를 구성한 뒤 출력 값 ... 9장 D/A CONVERTER & A/D CONVERTER 결과보고서(1) D/A converter1) 그림 4의 회로를 구성한다.2) Single pulseclock으로 s ... 음을 확인할 수 있다.**실험1에 대한 토의D/A CONVERTER에 관한 실험이었다. 실험 첫날 목요일에는 1번실험이 나오지 않아 부득이하게 다음날 금요일 아침에 다른반실험

리포트 | 10페이지 | 1,000원 | 등록일 2008.02.25

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