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전전설2 계산기 전전설1 전전설3 우선순위 인코더 시립대 논리회로 디지털시스템실험 전전설1 예비 전자공학과
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"전자전기컴퓨터설계실험2" 검색결과 41-60 / 1,602건

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    전자전기컴퓨터설계실험2(전전설2) (3) Logic Design using Verilog HDL
    Logic Design using Verilog HDLpost-lab report과목명전자전기컴퓨터설계실험2담당 교수전공 학부전자전기컴퓨터공학부학번성명제출 일자Logic ... . 실험 이론2.1. HDL전자공학에서 하드웨어 기술 언어(Hardware Description Language)는 전자회로를 정밀하게 기술하는 데 사용하는 컴퓨터 언어이다. 흔히 ... Design using Verilog HDL(3주차)post-lab report1목 차Ⅰ. 서론 (03)1. 실험 목적 (03)2. 실험 이론 (03)2.1. HDL (03)2.2
    Non-Ai HUMAN
    | 리포트 | 84페이지 | 2,000원 | 등록일 2019.10.11 | 수정일 2021.04.29
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    전자전기컴퓨터설계실험2(전전설2) (1) TTL Gates Lab on Breadboard
    설계실험2담당 교수전공 학부전자전기컴퓨터공학부학번성명제출 일자목 차Ⅰ. 서론 (03)1. 실험 목적 (03)2. 실험 이론(03)2.1. TTL (03)2.2. OR Gate ... TTL Gates Lab on Breadboardpost-lab reportTTL Gates Lab on Breadboard(1주차)post-lab report과목명전자전기컴퓨터 ... (03)2.3. XOR Gate (04)2.4. Adder (06)Ⅱ. 본론 (08)1. 실험 장비 (08)2. 실험 방법 (10)2.1. OR Gate (10)2.2. XOR
    Non-Ai HUMAN
    | 리포트 | 19페이지 | 2,000원 | 등록일 2019.10.06 | 수정일 2021.04.29
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    전전설2 파이널 프로젝트 디지털시계 (전자전기컴퓨터설계2 실험 파이널 프로젝트)
    TIMEreg [4:0] HOUR;reg [5:0] MIN;reg [5:0] SEC;reg [2:0] DAY;reg [3:0] HOUR_ONE;reg [3:0] MIN_ONE;reg ... ,ENTRY_MODE = 4'b0010,DISP_ON_OFF = 4'b0011,LINE1 = 4'b0100,LINE2 = 4'b0101,LINE3 = 4'b0110,DELAY_T = 4 ... : if (CNT == 150) STATE = LINE1;LINE1 : if (CNT == 19) STATE = LINE2;LINE2 : if (CNT == 19) STATE
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    | 리포트 | 73페이지 | 5,000원 | 등록일 2019.11.09
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    전자전기컴퓨터설계실험2(전전설2) (6) Flip-Flop and Register, SIPO
    실험2담당 교수전공 학부전자전기컴퓨터공학부학번성명제출 일자목 차Ⅰ. 서론 (03)1. 실험 목적 (03)2. 실험 이론 (03)2.1. Combinational Logic (03)2 ... Flip-Flop and Register, SIPOpost-lab reportFlip-Flop and Register, SIPOpost-lab report과목명전자전기컴퓨터설계 ... 으로 구현하고, 설계한 논리를 시뮬레이션하기 위한 테스트 벤치를 작성하고 장비로 동작을 확인한다.2. 실험 이론2.1. Combinational Logic디지털 회로 이론에서 조합
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    | 리포트 | 44페이지 | 2,000원 | 등록일 2019.10.12 | 수정일 2021.04.29
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    [전자전기컴퓨터설계실험2] Verilog를 이용한 디지털 시계 (알람, 스탑워치, LED 기능 포함)
    _E, LCD_RS, LCD_RW, PIEZO;output [7:0] LCD_DATA, LED;wire LCD_E, PIEZO;reg LCD_RS, LCD_RW;reg [2:0 ... 0100, LINE2 = 4'b0101, DELAY_T = 4'b0110, CLEAR_DISP = 4'b0111; integer CNT, CNT_M;reg CLK_M;
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    | 리포트 | 81페이지 | 5,000원 | 등록일 2020.09.07
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    전자전기컴퓨터설계실험2(전전설2) (8) 7-Segment and PIEZO Control
    7-Segment and PIEZO Controlpost-lab report7-Segment and PIEZO Controlpost-lab report과목명전자전기컴퓨터설계실험2 ... 담당 교수전공 학부전자전기컴퓨터공학부학번성명제출 일자목 차Ⅰ. 서론 (03)1. 실험 목적 (03)2. 실험 이론 (03)2.1. 7-Segment (03)2.2 PIEZO (04 ... 으로 구현하고, 설계한 논리를 시뮬레이션하기 위한 테스트 벤치를 작성하고 장비로 동작을 확인한다.2. 실험 이론2.1. 7-Segment7-세그먼트 표시 장치(seven-segment
    Non-Ai HUMAN
    | 리포트 | 22페이지 | 2,000원 | 등록일 2019.10.12 | 수정일 2021.04.29
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    전자전기컴퓨터설계실험3 2주차 결과 보고서 Passive Filter(점수 9/10)
    Passive Filter학 과전자전기컴퓨터공학부실험일2018년도 1학기이 름서론실험 목적R, L, C로 구성된 circuit의 filter들의 magnitude and ... 2-1두 번째 실험은 Low Pass Filter에 새로운 저항을 추가한 회로, Figure 2-1과 같이 설계하여 진행하였다. 첫 번째 실험과 마찬가지로 R1은 226.7 ... Filter를 설계하여 실험을 진행하였다. 여기서는 저항을 R1=156Ω, R2=56Ω을 이용하여 Simulation을 진행하였다.Figure 4-2Figure 4-2는 저항
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2020.03.28 | 수정일 2020.03.31
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    전자전기컴퓨터설계실험1(전전설1) (2) 계측기2(오실로스코프, 함수 발생기)
    계측기2(오실로스코프, 함수 발생기)post-lab report계측기2(오실로스코프, 함수 발생기)post-lab report과목명전자전기컴퓨터설계실험1담당 교수전공 학부전자전기 ... 컴퓨터공학부학번성명제출 일자목 차Ⅰ. 서론 (03)1. 실험 목적 (03)2. 실험 이론 (03)2.1. 함수 발생기(Agilent 33220A) (03)2.2. 오실로스코프 ... . 오실로스코프의 편리한 기능 (06)Ⅱ. 본론 (07)1. 실험 장비 (07)2. 실험 방법 (07)3. 실험 결과 (09)3.1. 오실로스코프의 프로브 보정 (09)3.2. 주어진
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    | 리포트 | 16페이지 | 2,000원 | 등록일 2019.05.18 | 수정일 2021.04.29
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    전자전기컴퓨터설계실험2(전전설2)2주차예비
    (Purpose of this Lab)Xilinx 프로그램 중 schematic을 이용하여 최종적으로 ripple carry full adder를 설계하고 주어진 실험값들과 HBE ... language)말 그대로 하드웨어를 표현하는 언어라는 뜻으로 전기, 전자회로적인 특성을 기술하는 언어이다. 원하는 동작을 구현할 수도 있고 구조 또한 기술 가능하다. C 등등 ... 으로는 Breadboard를 가지고 있어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정
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    | 리포트 | 12페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계실험2(전전설2)2주차결과
    (Purpose of this Lab)Xilinx 프로그램 중 schematic을 이용하여 최종적으로 ripple carry full adder를 설계하고 주어진 실험값들과 HBE-ComboⅡ ... language)말 그대로 하드웨어를 표현하는 언어라는 뜻으로 전기, 전자회로적인 특성을 기술하는 언어이다. 원하는 동작을 구현할 수도 있고 구조 또한 기술 가능하다. C 등등의 다른 언어 ... 고 있어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정에서 사용하는 클럭
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    | 리포트 | 15페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계실험3(전전설3)2주차결과
    \o "1-3" \h \z \u Hyperlink \l "_Toc414807352" Ⅰ. 실험목적2 Hyperlink \l "_Toc414807352" Ⅱ. 배경이론 및 지식2 ... Underdamping이므로 R2L 의 조건에 따라 시뮬레이션에서의 값을 입력해보면 해당 조건을 만족한다는 것을 알 수 있다. 실험결과도 시뮬레이션과 오실로스코프의 파형도 일치하는 것을 알 ... 이체 임피던스라고 했을 때 A=B가 되는 임피던스 매칭이 있어야 최대 전력이 전달된다.2. 오실로스코프의 임피던스 매칭과 그 오류실제 실험에서 보면 고주파로 갈수록 그 값이 불안정
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    | 리포트 | 19페이지 | 2,000원 | 등록일 2017.02.09
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    전자전기컴퓨터설계실험2(전전설2)1주차결과
    으니 주의한다.Ⅴ. 결론 (Conclusion)TTL의 게이트들을 이용하여 전기적 신호를 이용하여 adder를 실제 구현해볼 수 있는 실험이었다. 그 중 TTL 자체의 동작원리 ... PostReport주 제: Lab#01 TTL gates Lab on Breadboard지도교수 : 신 창 환 교수님실험조교 : 이 영 택실 험 일 : 2015년 9월 14일학 ... 로 즉, 트랜지스터와 트랜지스터를 조합한 논리 회로를 말한다. 일반적으로 5V 단일 전원의 집적 회로로 만들어졌다.2. OR Gate, XOR Gate■OR Gate: 입력 중
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    | 리포트 | 14페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계실험2(전전설2)6주차결과
    번호”;2. 기기와 연결 및 구동.Impact를 실행하고 프로그램을 해줘 기기와 연결을 하고 구동한다.Ⅲ. 실험결과 (Results)1. 4비트 SIPO BCD TO EXCESS-3 ... PostReport주 제: Lab#06 Sequential_Logic_Design_Ⅰ@ Flip-Flop, Register and SIPO지도교수 : 신 창 환 교수님실험조교 ... : 이 영 택실 험 일 : 2015년 10월 26일학 번 : 2012440이 름 :Ⅰ. 서론 (Introduction)1. 실험의 목적(Purpose of this Lab
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계실험2(전전설2)6주차예비
    으로는 Breadboard를 가지고 있어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정 ... 수님실험조교 : 이 영 택실 험 일 : 2015년 10월 26일학 번 : 2012440이 름 :Ⅰ. 서론 (Introduction)1. 실험의 목적(Purpose of this ... Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 순차회로를 이해하고 순차회로 중 플립플롭 회로에 대해 이해한다.2. 배경 지식(Essential
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계실험2(전전설2)3주차예비
    를 구현하고 이를 FPGA를 이용하여 구현한다. 또한 gate primitive modeling 과 behavioral modeling의 차이를 이해하고 설계한다.2. 배경 지식 ... 에서 그 차이가 있다.나. Verilog HDLVerilog는 HDL 중 하나로 전자 회로 및 시스템에서 쓰이며 회로 설계 및 검증, 구현 등의 용도로 사용된다. Verilog 코딩 ... PreliminaryReport주 제: Lab#03 Verilog HDL지도교수 : 신 창 환 교수님실험조교 : 이 영 택실 험 일 : 2015년 10월 6일학 번
    Non-Ai HUMAN
    | 리포트 | 18페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계실험2(전전설2)4주차예비
    Backgrounds for this Lab)가. 2의 보수컴퓨터에서 뺄셈을 인식하는 법은 다음과 같다. 예를 들어 2-2=0과 같은 뺄셈은 2+(-2)=0처럼 덧셈의 연산 ... 의 표현을 한다. 보수란 말 그대로 채워주는 수라 할 수 있는데 예를 들어 세 자리 십진수에서 1의 보수는 99라 할 수 있다. 컴퓨터의 경우 2진수를 사용하므로 예를 들어 네 자리 ... = 1A = 4'b1111 B= 4'b1111 EQ = 1Ⅳ. 토론 (Discussion)가. 감산기 모델링앞서 설계한 1bit 감산기는 2의 보수를 사용하여 가산을 방식을 취하
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    | 리포트 | 16페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계 실험3(전전설3) 2주차 예비
    :목차Ⅰ. 실험목적 2Ⅱ. 배경이론 및 지식 2Ⅲ. 실험장비 및 재료와 실험방법 4Ⅳ. 사전보고서 5[1-1] 5[1-2] 6[1-3] 7[2-1] 7[2-2] 7[2-3] 7[2 ... -4] 7[2-5] 8[2-6] 9[3-1] 10[3-2] 10Ⅴ. 참고문헌 10Ⅰ. 실험 목적 (Purpose of this Lab)RLC회로를 통해 캐패시터와 인덕터라는 소자 ... & method)■실험장비 및 재료함수발생기 (Function Generator)함수발생기란 전자 신호인 파형을 발생시키기 위한 장치이다. 보통 규칙적인 파형에 대한 주파수 계측
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    | 리포트 | 11페이지 | 2,000원 | 등록일 2017.02.09 | 수정일 2017.02.12
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    전자전기컴퓨터설계실험2(전전설2)9주차결과
    .핀 설정은 NET “소자이름” LOC = “P번호”;2. 기기와 연결 및 구동.Impact를 실행하고 프로그램을 해줘 기기와 연결을 하고 구동한다.Ⅲ. 실험결과 (Results ... PostReport주 제: Lab#09 Application_Design_Ⅱ@ Text-LCD Control.지도교수 : 신 창 환 교수님실험조교 : 이 영 택실 험 일 ... : 2015년 11월 16일학 번 : 2012440이 름 :Ⅰ. 서론 (Introduction)1. 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중
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    | 리포트 | 23페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계실험2(전전설2)3주차결과
    를 FPGA를 이용하여 구현한다. 또한 gate primitive modeling 과 behavioral modeling의 차이를 이해하고 설계한다.2. 배경 지식 ... (Essential Backgrounds for this Lab)가. HDL(Hardware description language)말 그대로 하드웨어를 표현하는 언어라는 뜻으로 전기, 전자회로적인 ... 가 있다.나. Verilog HDLVerilog는 HDL 중 하나로 전자 회로 및 시스템에서 쓰이며 회로 설계 및 검증, 구현 등의 용도로 사용된다. Verilog 코딩 시 영어
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    | 리포트 | 19페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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    전자전기컴퓨터설계실험2(전전설2)5주차예비
    어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정에서 사용하는 클럭의 입력 ... (Results)1. 2비트 2:1 MUX를 설계하시오.코딩(text)// 2to1muxmodule two_one_mux(a,b,s,q);input [1:0] a,b;input s ... 하는 실험이었다. 또한 BCD 코드를 이해하고 이를 바탕으로 설계하는 실험이었다. 멀티플렉서의 경우 지정된 신호에 따라 결과값이 출력되기 때문에 이를 바탕으로 설계를 하는 실험이
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    | 리포트 | 13페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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2025년 11월 24일 월요일
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