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atmega128 led viterbi decoder 마프실 18세기영국문학 1x8 demux multiplier 7segment 74151 strobe
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"delayed decoding" 검색결과 21-40 / 104건

  • 자료 표지
    서강대학교 디지털논리회로실험 레포트 4주차
    )에 나타나 있다. 그림 3-(b)는 block diagram 표현이다. Enable신호를 갖는 binary decoder (예를 들어, 74x139)가 그림 4 ... \* . 이와 같은 기능을 수행하는 소자를 찾아보고 그 동작에 대해 알아보시오.이번 실험에 사용된 demux는 D2_4E로 decoder를 사용하였다. 이러한 demux는 앞쪽 ... 은 gate 수가 증가하면 delay가 발생할 수 있는데, 이러한 delay를 감소시켜주기 위해 그림 21과 같이(74x280) 병렬로 연결해 주는 방법이 있다. 그림 21을 보면 A
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    | 리포트 | 24페이지 | 1,000원 | 등록일 2020.08.12 | 수정일 2020.08.26
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  • 자료 표지
    전자전기컴퓨터설계실험2(전전설2) 계산기 프로젝트 팩토리얼 및 quiz mode 포함
    ] bin2;// BCD -> Binary///////////////////parameter DELAY=3'b000, FUNCTION_SET=3'b001, ENTRY_MODE=3'b ... 010, DISP_ONOFF=3'b011, LINE1=3'b100, LINE2=3'b101, Cursor=3'b110; //DELAY_T=3'b110, CLEAR_DISP=3'b ... 를 {4’b0011, ****}과 같은 방식을 이용해서 표현하였다. 즉 decoder를 사용해서 각 button을 누를 때마다 숫자가 입력되는 방식이 아닌 커서를 이용해서 up
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    | 리포트 | 35페이지 | 20,000원 | 등록일 2020.12.22
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  • 자료 표지
    텔레칩스 합격자소서
    multi cycle을 사용했습니다. cycle은 크게 Fetch, Decode, Execute, Memory, Write의 5단계로 나누어졌습니다. 어셈블리어를 공부하여 각 단계의 비트 ... 가지 이상의 접근을 해보았습니다. 첫째, PWM을 직접 측정하여 보고, 모터의 규격에 맞추어 구동을 시켰습니다. 둘째, Pulse Width, 전압원, delay 등을 조절해 보
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    | 자기소개서 | 4페이지 | 3,000원 | 등록일 2019.04.08
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  • 판매자 표지 자료 표지
    전자전기컴퓨터설계실험2(전전설2)8주차예비
    을 주었을 때 LED에 불이 들어오도록 하였다. Segment 모양에 따라서 각각의 decode 된 2진수들이 존재한다.나. Static/Dynamic 7-segment7-s ... bench를 구현한다.나. 시뮬레이션Functional simulation디바이스 고려 없이 설계한 Design File의 기능만으로 검증하는 시뮬레이션으로 결과 파형에 delay ... time의 요소가 없다.timing simulation하드웨어적인 요소가 반영된 시뮬레이션으로 target 디바이스와 핀 설정, 내부 Logic Cell 배치에 따라 delay
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    | 리포트 | 26페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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  • 자료 표지
    전기전자기초실험 Combination Logic Circuit Design 결과레포트 (영어)
    , eSelect input : b, cIt is 4 to 1 MUX.③ Find the maximum delay route of 7-segment decoder, then calculate ... /TThe maximum delay route of4 to 1 MUX is④ Think of the method of displaying hexadecimal number(i.e
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2017.12.01
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    Lab#05 Combinational Logic Design 2
    Post-Lab ReportLab#05 Combinational Logic Design 2@ Decoder, Encoder and Mux담당 교수강 상 혁담당 조교실 험 일실 험 ... & Methods5가. Materials5나. Methods5다. Precaution63. Supposed Data7가. Prelab1. 3:8 Decoder7나. Prelab2. 2:1 ... (Synthesis tool)나. Methods1) 3:8 Decoder Logic design가) 프로젝트를 생성한다.(Top level Source : HDL)나) Verilog
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    | 리포트 | 26페이지 | 1,500원 | 등록일 2016.09.11
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  • 자료 표지
    경북대학교 전자공학실험1 올A+ 결과보고서 7장
    - 7447 : 7-segment decoder0*************110100010101100111손으로그림10001001101010111100110111101111※분석1010 ... 가 여러개이고, DEMUX 가 출력해야 할 Data part 가 여러개라면, 한번에 하나씩만 연결하는 MUX, DEMUX 는 나머지 Data 의 delay를 초래하게 된다.이를 해결 ... 하기 위해 selecting 속도를 높이면, MUX 와 DEMUX 의 switching 속도가 빨라져서 Data delay time이 줄어들어, 동시에 여러 Data Source
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    | 리포트 | 6페이지 | 3,000원 | 등록일 2015.11.03 | 수정일 2022.03.28
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  • 자료 표지
    아주대 디지털통신시스템 SIMULINK 과제2[학점 A+]
    CalculationReceive delay가 없으므로 0, Output data는 Workspace로 variable name은 ErrorVec1으로 설정해주었다. [11,15] hamming c ... ](octal)을 사용한다. (디코딩은 Viterbi Decoder를 사용하여 hard decision 복호로 수행한다. generator function은 8진수 표현으로, 예를 들 ... ChannelViterbi DecoderEb/No[dB]는 명시된 값인 EbNo-10*log10(1*2)로 설정해주었다.Viterbi Decoder를 사용하여 디코더를 하는데, 여기서 경판정(hard
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    | 리포트 | 8페이지 | 2,000원 | 등록일 2015.12.30
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  • 자료 표지
    Combination Logic Circuit Design
    do with value of b,c,d,e1③Find the maximum delay route of 7-segment decoder, then calculate the ... decoder in experiment result segement. In real clock, the sum of the two delay is the real delay. So ... maximum operating frequency when this circuit is run by clock.-There is the delay matrix of 7-segment
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2012.11.27
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  • 자료 표지
    #6 디지털실험 결과
    (input- SW) + 1 (output- LEDR)▶ Timing분석tsu (Setup time) – 4.728nstco (Clock-to-output Delay) – 9 ... (Clock-to-output Delay) – 9.419nsth (Hold time) – -3.915 ns▶ 실험 동작D값이 변해도 출력은 나오지않고, Clk가 01로 변할 때 ... (input- SW) + 3 (output- ㅣHEX)▶ Timing분석tsu (Setup time) – 4.699nstco (Clock-to-output Delay) – 9
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2013.12.12 | 수정일 2014.04.22
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  • 자료 표지
    실험4 예비보고서
    (encoder)의 상대용어로, 흔히 디코더(decoder)라고 한다. 인코더는 우리말로 부호기(符號機)라고 한다. 컴퓨터의 디지털 데이터를 디코더를 사용하여 아날로그 데이터로 변환 ... 며, 부호기와 복호기를 함께 코덱(CODEC)이라고 한다. decoder는 이진 부호, BCD 부호, 기타 여러 가지 부호들을 부호가 없는 형태로 바꾸는 변환회로를 일컫는다.입력 ... )와 소자를 손상 시킬 수 있으므로 Tri-state 소자의 delay를 비대칭으로 만든다. 즉, Output-enable delay 가 Output-disable delay 보다 길
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    | 리포트 | 10페이지 | 1,000원 | 등록일 2013.01.01
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  • 판매자 표지 자료 표지
    전자전기컴퓨터설계실험2(전전설2)5주차예비
    PreliminaryReport주 제: Lab#05 Combinational_Logic_Design_Ⅱ@ Decoder, Encoder and Mux지도교수 : 신 창 환 교수님 ... 한 Design File의 기능만으로 검증하는 시뮬레이션으로 결과 파형에 delay time의 요소가 없다.timing simulation하드웨어적인 요소가 반영된 시뮬레이션으로 target ... 디바이스와 핀 설정, 내부 Logic Cell 배치에 따라 delay Time의 결과가 달라진다. 즉, 실제 하드웨어 동작 상황에 대한 시뮬이라 할 수 있다.Ⅲ. 실험결과
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    | 리포트 | 13페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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  • 자료 표지
    디지털 통신 프로젝트2
    를 선택해 decoding을 한다.a)와 b) 그래프를 보면 SNR에 따른 채널인코딩 없이 송신한 신호와 채널코딩을 하고 비터비 디코더로 디코딩한 신호의 BER차이를 볼 수 있다. 편의 ... . 흔히 대도시에서 송신신호가 건물들에 부딪히면서 세기 및 위상도 변하고 건물에 부딪혔느냐 바로 왔느냐에 따라 time delay도 발생하기도 한다. fading의 종류에는 크게 대규모 ... fading, 소규모 fading이 있으며 소규모 fading에는 multi path에 의한 time delay 확산 량에 따라 확산량이 크면 frequency selective
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    | 리포트 | 16페이지 | 4,000원 | 등록일 2014.12.28
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  • 판매자 표지 자료 표지
    전자전기컴퓨터설계실험2(전전설2)8주차결과
    LED에 불이 들어오도록 하였다. Segment 모양에 따라서 각각의 decode 된 2진수들이 존재한다.나. Static/Dynamic 7-segment7-segment 하나 ... File의 기능만으로 검증하는 시뮬레이션으로 결과 파형에 delay time의 요소가 없다.timing simulation하드웨어적인 요소가 반영된 시뮬레이션으로 target ... ;output c,b;output AS,BS,CS,DS,ES,FS,GS;reg[3:0] q;reg c,b;reg up_sync, dw_sync;reg[6:0] decode;wire
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    | 리포트 | 24페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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  • 자료 표지
    [Android/안드로이드] Simple Gallery. ( 겔러리 앱 )
    를 한 Activity 에서 다룹니다.따라서 전환에 delay 가 없이 매우 빠릅니다.이미지의 decode 부분이 핵심인데요.이미지의 decode 하는 도중에 UI 를 block 하지 ... 않기 위해서 ( 버벅댐을 방지하기 위해서 ) decode 를다른 thread 로 돌립니다.용량이 큰 이미지의 경우 OutOfMemory Error 가 발생하는데, 이를 방지 ... decoding 됩니다.이름이 Simple Gallery 인만큼, 사용성과 속도에 초점을 두었습니다.안드로이드 기본 갤러리보다 디코딩 속도가 더 빠릅니다.코드는 리펙토링 되어 있
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    | 리포트 | 7,000원 | 등록일 2012.04.09 | 수정일 2013.12.06
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  • 판매자 표지 자료 표지
    전자전기컴퓨터설계실험2(전전설2)5주차결과
    ‘PostReport주 제: Lab#05 Combinational_Logic_Design_Ⅱ@ Decoder, Encoder and Mux지도교수 : 신 창 환 교수님실험조교 ... 의 기능만으로 검증하는 시뮬레이션으로 결과 파형에 delay time의 요소가 없다.timing simulation하드웨어적인 요소가 반영된 시뮬레이션으로 target 디바이스 ... 와 핀 설정, 내부 Logic Cell 배치에 따라 delay Time의 결과가 달라진다. 즉, 실제 하드웨어 동작 상황에 대한 시뮬이라 할 수 있다.다. 기기연결1. 핀 번호 설정핀
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    | 리포트 | 20페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10
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  • 자료 표지
    실험6결과 Latch&FF
    [실험6] Encoder & Decoder1. 실험 결과1) R-S F/F가장 간단한 F/F인 R-S F/F을 구성하였다. R-S latch는 두 개의 입력 Set과 Reset ... 처럼 출력 데이터를 가지고 있음을 확인할 수 있다. 여기서 주의해야 할 점은 게이트지연시간(Delay)에 관한 것이다. 입력신호 Set 신호가 0으로 떨어지게 되면서 게이트지연시간 뒤 ... -S F/F는 delay를 가지는 latch 회로로 해석할 수 있다. Enable과 Clock 신호를 조종하는 CP입력의 상승 엣지에서 그 출력이 변화하게 된다. Latch 회로
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    | 리포트 | 7페이지 | 3,000원 | 등록일 2014.05.13
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    BCD 카운터 & up and down 카운터 결과보고서(ATmega128 부분)
    .121. 명 제⇒ 저번 설계에서 7447 BCD 디코더 & driver, 7-segment를 이용하여 BCD to 7-segment decoder를 설계하였다. 2진 입력을 BCD코드 ... 가 들어가0x00;PORTA=0x00;PORTD=0xFF;}void KDelay(unsigned int Delay){for(unsigned int i=0; i=9)knum=-1 ... ();void KDelay(unsigned int Delay);void DisplaySegment(unsigned char num);main소스에서 사용하게 되는 함수 이름들이
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    | 리포트 | 15페이지 | 3,500원 | 등록일 2013.05.05
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    전전컴설계실험2-4주차예비
    만으로 검증하는 시뮬레이션결과 파형에 delay time의 요소가 없다.) 과 Timing Simulation (위의 Behavioral Simulation의 결과에 하드웨어적인 ... 요소가 반영된 시뮬레이션 Target 디바이스와 핀 설정, 내부 Logic Cell 배치에 따라 delay Time의 결과가 달라진다.) 을 이용하여 미리 Input과 Output ... 와 프로그래밍가능 내부선이 포함된 반도체 소자이다. 프로그래머블 논리 요소는 AND, OR, XOR, NOT, 더 복잡한 Decoder나 계산기능의 조합 기능 같은 기본적인 논리 Gate
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    | 리포트 | 10페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
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  • 자료 표지
    combinational logic circuit design(결과)
    multiplexer that the output is.③ Find the maximum delay route of 7-segment decoder, then calculate the ... - Time Delay13.9ns13.9ns13.4ns13.4ns12.9ns / 13.4ns11.4ns② Demultiplexer(1-to-4 Demux) ... change of select signal.- Time Delay10.2ns10.2ns10.2ns11.1ns10.7ns10.7ns10.7ns11.6ns10.7ns10.7ns10
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2011.07.09
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2026년 04월 20일 월요일
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