"디지털 실험 보고서"의 검색결과 입니다.

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"디지털 실험 보고서" 검색결과 181-200 / 5,239건

디지털 실험 8장(디코더를 이용한 조합논리) 결과 보고서

실험 8장 디코더를 이용한 조합논리1. 실험목적-디코더를 이용한 다중 출력 조합 논리 회로를 구현한다.2. 실험순서1) 그림 8-6은 부분적으로 완성된 회로이다. 74LS139A ... ) 회로를 설계하고 진리표의 모든 조합들을 시험한다. 진리표 8-1에서 열거된 수서대로 스위치를 열고 닫는다면, 정확한 신호등 순서를 관찰할 수 있다.State CodeState ... OutputsLight OutputsS1S*************011011101011101101011110111110011101000110113. 결과 분석실험의 쓰인 상태 코드

리포트 | 9페이지 | 3,000원 | 등록일 2019.12.17

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디지털 실험 9장(멀티플렉서를 이용한 조합논리) 결과 보고서

할 수 있다. 또 다른 방법은 이론 요약 부분에서 제시된 MUX를 이용하는 것이다. 그 비교기를 부분적으로 완성한 진리표가 보고서의 표 9-1로 주어져 있다. 비교되어질 두 수 ... 하는 실행이다. 그러므로 데이터는 첫 번째 라인에 주어진 대로, 에 연결되어야 한다. 나머지 칸을 0, 1, 또는 으로 채워 넣어서 표 9-1을 완성한다.표 9-1을 이용하여 보고서 ... 실험 9장 멀티플렉서를 이용한 조합논리1. 실험목적-멀티플렉서를 이용하여 비교기와 패리티 발생기를 설계하고 그 회로를 시험한다.-2*N 입력의 진리표를 수행하기 위해 N입력

리포트 | 12페이지 | 3,000원 | 등록일 2019.12.17

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디지털 실험 9장(멀티플렉서를 이용한 조합논리) 예비보고서

실험 예비 보고서(9장 멀티플렉서를이용한 조합논리)실험 목적-멀티플렉서를 이용하여 비교기와 패리티 발생기를 설계하고 그 회로를 시험한다.-2XN 입력의 진리표를 수행하기 위해 N ... 은 이론 요약 부분에서 제시된 MUX를 이용하는 것이다. 그 비교기를 부분적으로 완성한 진리표가 보고서의 표 9-1로 주어져 있다. 비교되어질 두 수를 나타내는 입력은 이다. 와 비트 ... 는 첫 번째 라인에 주어진 대로, 에 연결되어야 한다. 나머지 칸을 0, 1, 또는 으로 채워 넣어서 표 9-1을 완성한다.표 9-1을 이용하여 보고서 그림 9-4에 제시된 회로도

리포트 | 14페이지 | 3,000원 | 등록일 2019.12.17

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홍익대,2-1,디지털공학실험,보고서들

이번 실험을 통해 클럭 펄스가 들어올 때마다 저장 데이터가 좌우의 플립플롭으로 이동하는 것을 눈으로 확인할 수 있었다. CLK 4 이후부터는 데이터가 (0,0,0,0)으로 유지 ... 시키는 과정이 없기 때문에 발생하는 것으로 보인다. 또한 실험 중 ‘NOT게이트가 왜 있어야 하는가?’에 대한 의구심이 들었는데, 조교님을 말을 통해 회로 작동 중 오류 시 ‘초기화’하는 행위를 ‘1’로 두기 때문에 NOT게이트를 사용하는 것을 알 수 있었다.

리포트 | 3페이지 | 1,000원 | 등록일 2019.01.23 | 수정일 2019.01.25

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연속파 디지털 변조 및 복조 실험 결과 보고서(7)

실험 결과 보고서정보통신공학과(3조)● 실험 목적- 3개의 IC와 몇 개의 소자를 이용하여 간단한 FSK 변조/복조기를 구성하고, 회로 동작원리를 이해한다.- FSK 송신기(변조 ... 를 측정하고 출력단의 주파수를 계산하여 실험 결과 보고서의 [표 10-2]에 기록한다.6. 주파수 편이를 계산하여 실험 결과 보고서 [표 10-2]에 기록한다.7. [그림 10 ... XR2206디지털 멀티미터저항오실로스코프사용 저항 값(150Ω, 560Ω, 4.7kΩ, 10kΩ, 30kΩ, 39kΩ, 47kΩ 등)● 실험 방법1. [그림 10-14]의 FSK

리포트 | 4페이지 | 1,000원 | 등록일 2019.07.29 | 수정일 2023.06.22

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서강대학교 디지털논리회로실험 - 실험 8. Multiplier Design 결과 보고서

디지털논리회로실험(EEE2052-01)서강대학교 전자공학과2017년 2학기 결과레포트실험8. Multiplier Design1. 실험개요1) 4비트 곱셈기의 구조와 원리를 이해 ... 한다.2) 팀 단위로 디지털 회로 설계하는 방법을 이해 한다2. 퀴즈 답안지 및 정답-퀴즈 없음3. 실험노트-실험 노트 없음4. 실험 결과 및 분석1) 각자가 설계한 Block ... 을 Xilinx ISE로 합성하고, FPGA에 다운로드 한 후 동작을 검증한다. Full adderc1 -> carry input, c -> output에서의 carry실험 시 full

리포트 | 4페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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디지털실험 - 설계 1 결과 보고서

*결과보고서*실험주제설계 1 결과 보고서조13조1. 실험 결과회로도 구성입력출력표시A3A2A1A0abcdefg0000○○○○○○×00001×○○××××10010 ... 설계는 SN7447 소자를 이용하지 않고 NOT, AND, OR게이트만을 이용하여 회로를 구성하여 7-Segment LED 장치에 숫자를 출력하는 실험이었다. NAND 게이트 ... 를 사용했으면 조금 더 게이트 구성이 쉬웠겠지만, 조금 욕심을 부려 가장 단순한 3가지 게이트만을 이용해 설계 실험을 해보고 싶어서 저렇게 훨씬 더 복잡한 회로가 나왔다. 이렇게 회로

리포트 | 2페이지 | 1,500원 | 등록일 2017.04.02

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디지털실험 - 설계 2 결과 보고서

*결과보고서*8주차설계 2 결과 보고서조13조1. 설계 결과회로도 구성1011+ 00011100 (가산)설계 예비보고서에 첨부했던 시뮬레이션 회로도와 같은 모양으로 구성 ... 를 구성하는 과정에서 오차가 발생하여 정확한 값이 나오지 않았다. 그래서 이번 설계에서는 예비보고서를 작성할 때부터 회로를 최소화시키고자 노력하였다. 소자 숫자를 최소화시키기 위한 ... 면 (-)로 부호를 결정하도록 회로를 구성하였다.2. 설계 결과 분석 및 고찰이번 설계는 기본 소자들을 이용하여 전감가산기를 구성하는 실험이었다. 설계과정은 먼저 4비트 전가산기

리포트 | 2페이지 | 1,500원 | 등록일 2017.04.02

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디지털실험 - 설계 1 예비 보고서

*예비보고서*실험주제설계 1 예비 보고서조13조1. 목적1) 디코더에 대해 알아보자.2) 논리회로소자에 대해 알아보자.3) 7-Segment를 디코더를 이용해서 사용해보자.2 ... . 실험 원리1) 디코더신호를 디지털 부호로 코드화해서 기억하거나 전송할 때 코드화된 신호를 원래 형태로 되돌리는 회로·유니트. 디지털 신호를 아날로그 신호로 되돌리는 경우에 D/A ... 에 다소 많은 수의 게이트가 사용되고 회로가 복잡해질 수 있지만 가장 기본적인 회로이므로 오차는 나타나지 않았다. 실험하는 과정에서도 굉장히 복잡한 회로가 구성되겠지만 실험 전에 미리 필요한 IC회로의 개수와 구성을 생각해두어 실험하는데 어려움을 줄일 것이다.

리포트 | 7페이지 | 1,500원 | 등록일 2017.04.02

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디지털 실험 4장(논리대수와 드모르간 정리, 간소화) 결과 보고서

을 가져오게 된 것이다. 1학기때 배웠던 디지털공학을 복습할 수 있는 계기가 되었고, 수학적으로 등가인지를 증명하기 위해 드모르간의 정리를 이용해보고 이해하게 되는 계기가 되었으며, 실험도구를 이용해보는 좋은 계기가 된 것 같다, ... 실험 4장 논리대수와 드모르간 정리, 간소화1. 실험목적-실험적으로 Boolean 대수의 여러 법칙을 증명한다.-규칙 10과 11을 증명할 회로를 구성한다.-실험적으로 4입력 ... 변수를 갖는 회로의 진리표를 결정하고, 수학적으로 등가인지를 증명하기 위해 드모르간 정리를 이용한다.2. 실험순서1) 그림 4-1에 제시된 회로를 구성한다. 전원은 5.0V로 고정

리포트 | 4페이지 | 3,000원 | 등록일 2019.12.17

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디지털실험 - 설계 3 결과 보고서

Flip-Flop를 구성하는 실험임에는 다른 점이 없기 때문에 기존에 작성했던 예비보고서를 참고하면, 이번에 설계한 회로가 D플립플롭으로 구성되어있는데 D플립플롭의 D가 Delay ... *결과보고서*10주차설계 3 결과 보고서조13조1. 설계 결과 및 분석회로도 구성CLK 입력D 입력PRESET = 0 , CLEAR = 0PRESET = 0 , CLEAR = 1 ... ?0100?1111↑0111↑10110NO Change2. 고찰- 처음 설계를 준비할 때 작성한 예비보고서에서 사용했던 회로는 아래의 회로이다.하지만 처음 설계를 구성하였을 때

리포트 | 4페이지 | 1,500원 | 등록일 2017.04.02

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서강대학교 디지털논리회로실험 - 실험 7. Finite State Machines 결과 보고서

디지털논리회로실험결과 보고서[8주차]실험 7. Finite State Machines1. 실험 개요1) Finite state machine (FSM) 회로를 설계하고 분석할 수 ... 있는 능력을 갖춘다.2) Mealy와 Moore state machine을 구분하고 각각의 특성을 이해한다.3) 비동기 counter의 동작을 분석한다.2. 실험 결과 및 분석1 ... ) 중간고사 1-(a)번의 회로를 schematic으로 구현하여 시뮬레이션이번 실험에서는 schematic으로 그린 회로를 키트에 FPGA로 구현하지 않고, 시뮬레이션으로 그 동작

리포트 | 10페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 고급전자회로실험 - 실험 8. Digital filter design 결과 보고서

고급전자회로 실험 결과 보고서실험 8. Digital filter design분반학번이름조학번이름시작종료실험시작/종료시간 기재(통계 목적임)1. Matlab function 조사 ... 이고 그 결과는 w이다.(2) freqz()freqz 함수는 디지털 필터의 주파수 응답을 알아볼 수 있는 함수이다.사용하는 방법으로 [h, w]=freqz(b, a, n) 이면 b ... 는 필터식의 분자, a는 분모를 입력 하는 것이고 n개의 포인트를 가진 주파수 응답 벡터 h, 각주파수 벡터 w를 반환한다.(3) filter()1차원 디지털 필터로서, 실수와 복

리포트 | 12페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 7. Finite State Machines 예비 보고서

디지털논리회로실험예비 보고서[8주차]실험 7. Finite State Machines1. 실험 목적1) Finite state machine (FSM) 회로를 설계하고 분석할 수 ... 고 Clear=0인 경우 J, K 값에 관계없이 Q=0이 된다. 실험에서는 Preset과 Clear에 모두 HIGH 신호를 인가하고 실험을 진 행한다. 핀 배열은 [그림 6]과 같 ... : 2-Input OR gate4. 실험 과정 및 예상 결과1) 중간고사 1-(a)번의 회로를 TTL과 FPGA(schematic)로 구현하여 동작 확인최소화된 상태표 및 카르노맵

리포트 | 12페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 3. Decoders and Encoders 결과 보고서

디지털논리회로실험결과 보고서[3주차]실험 3. Decoders and Encoders1. 실험 목적1) 일반적인 binary decoder의 동작 원리를 이해한다.2) 7-s ... egment의 동작 원리를 이해한다.3) Priority encoder의 동작 원리를 이해한다.4) FPGA와 VHDL을 이용한 회로의 구현 방식을 이해한다.2. 실험 결과 및 분석1 ... ] ~ LED[0]을 통해 확인하였다. EI는 PSW[0]을 통해 조정하였다. [표 4]에 실험을 통해 완성한 priority encoder의 진리표를 나타내었다.[표 4]B. DIP

리포트 | 10페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 3. Decoders and Encoders 예비 보고서

디지털논리회로실험예비 보고서[3주차]실험 3. Decoders and Encoders1. 실험 목적1) 일반적인 binary decoder의 동작 원리를 이해한다.2) 7-s ... 수 있다.[그림 15][그림 16]4. 실험 과정 및 예상 결과1) 과정 1 : Binary decoder의 구현INPUTOUTPUTI1I0A(Y3)B(Y2)C(Y1)D(Y0)0 ... VHDL 코드는 다음과 같다.[그림 23]VHDL Test bench에 대한 코드 작성법 미흡으로 인해 Timing diagram 시뮬레이션 결 과는 확인하지 못했다. 실험에서 [그림 15]의 진리표와 같은 결과가 나올 것으로 예상 된다.

리포트 | 11페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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디지털실험 및 설계 부호기 예비보고서

디지털공학실험예비보고서 : 부호기(1) 복호기는 일반적으로 n-bit의 코드 입력과 2n의 코드 출력을 가지는 소자로서 하나의 코드 입력과 하나의 코드 출력을 1대 1로 대응 ... 을 받아 부호화시켜 출력으로 내보낸다. 간단한 예로 4-to-2 line 부호기를 살펴보면 이것은 2-to-4 line 복호기의 반대기능을 가진 것이다. 일반적으로 보통의 디지털

리포트 | 9페이지 | 1,000원 | 등록일 2017.04.30

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전자회로실험) 결과보고서12. Digital Logic

결과보고서실험12. Digital Logic1.결과값V1(V)Vo(V)04.9650.02V1(V)V2(V)Vo(V)005.13050.01344500.01344550.01344[표 ... _{2}는 Saturation 된다. Vo=V _{CE}=0.01344V가 된다.2. 고찰이번 실험은 트랜지스터를 이용하여 디지털 로직인 인버터와 NOR gate를 구현하는 것이 ... 1][표2]=> 이번실험에서는 Inverter 와 NOR gate을 만드는 실험을 하였다.표1[Inverter] 같이 실험 결과값을 참고하면 입력 전압 V1=0V를 인가 하였을 때

리포트 | 2페이지 | 1,000원 | 등록일 2017.05.01

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서강대학교 디지털논리회로실험 - 실험 9. Memory Elements : ROM/RAM 예비 보고서

디지털논리회로실험예비 보고서[11주차]실험 9. Memory Elements : ROM/RAM1. 실험 목적1) 메모리 소자들의 동작 원리와 활용 방법을 이해한다.2 ... 기억 장치이다. 데이터 유지 방식 및 구조에 따라 SRAM과 DRAM으로 분류할 수 있다. 이번 실험에서는 동작의 이해와 사용이 쉬운 SRAM을 이용한 다. 전원이 제거되면 저장

리포트 | 7페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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서강대학교 디지털논리회로실험 - 실험 9. Memory Elements : ROM/RAM 결과 보고서

디지털논리회로실험결과 보고서[11주차]실험 9. Memory Elements : ROM/RAM1. 실험 개요1) 메모리 소자들의 동작 원리와 활용 방법을 이해한다.2 ... 지 및 정답 : 별첨 #13. 실험 노트 : 별첨 #24. 실험 결과 및 분석1) 과정 1~4실험 키트의 ROM에 저장된 데이터를 확인하였다. 회로는 [그림 1], [그림 2 ... ]와 같다. ROM의 주 소 값은 DIP 스위치로 입력하였고 저장된 데이터는 LED를 통해 확인하였다. 이때, OE와 CE의 값은 0이 되도록 한다. 실험 결과는 [표 1]에 정리

리포트 | 6페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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