[전자회로실험]실험7예비 Output Stage

최초 등록일
2010.05.05
최종 저작일
2010.04
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[전자회로실험]실험7예비 Output Stage입니다.

피스파이스 결과 및 비교 해석,
모두 포함되어있습니다.

목차

▣ 실험 목적
▣ 실험 기기
▣ 시뮬레이션을 통한 실험 예비 보고서

본문내용

▣ 실험 목적
◉ Class-A output stage를 설계하고 SPICE 시뮬레이션 하시오.
◉ Class-B output stage를 설계하고 SPICE 시뮬레이션 하시오.
◉ Class-AB output stage를 설계하고 SPICE 시뮬레이션 하시오.

▣ 실험 기기
1) 직류 전원 장치(±15V)
2) 오실로스코프
3) NPN BJT : 2N2222 or 2N3904
4) PNP BJT : 2N2907 or 2N3906
5) 저항 : 100Ω(4개), 10kΩ(2개), 1kΩ(1개)
6) Discrete Diode

▣ 시뮬레이션을 통한 실험 예비 보고서
✪ Class-A Output Stage 검증
- Setup & Measurement
DC Bias :
1) 입력노드 S 를 Ground로 연결하고, 노드 B에 부하저항을 연결하지 않는다.
2) A∼F 노드의 전압을 측정하고 Q1의 전류와 b를 구한다.
※ 각 노드의 측정 전압

A노드 : -28.32[mV]
B노드 : -649[mV]
C노드 : 4.960[V]
D노드 : -4.959[V]
E노드 : -4.338[V]
F노드 : -4.907[V]
S노드 : 0[V]

Signal Operation :
1) R2=10kΩ, load RL=10kΩ으로 구성하고, 입력 노드 S에 0.1VPP, 1kHz 삼각파형을 인가해 준다.

2) Oscilloscope를 이용하여 노드 S, A, B의 전압을 측정한다. S to B 전압 이득과 A to B 전압이득을 구하시오.

※ S, A, B 노드의 전압

S노드 : 50[mV]
A노드 : 25.35[mV]
B노드 : -591.707[mV]

- S to B 전압이득(A) =
- A to B 전압이득(A) =

참고 자료

없음

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