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matlab을 이용한 aloha 무선통신네트워크

-개요 (일부분) 알로하 네트워크와 이더넷 네트워크의 공통점은 다수가 네트워크에 접근할 수 있는 네트워크, 즉 다중 접근 네트워크인데, 만약 동시에 복수의 사용자 노드가 네트워크에 접근을 시작하면 일정한 지연(사실은 난수를 토대로 한 지연) 후에 다시 접근을 시도한다. 모든 노드들은 네트워크 상에서 다른 사용자의 접근을 감지한다. 이것을 네트워크 용어로 청취(Listen)라고 하는데 모든 노드는 곧 리스너(Listener)인 셈이 다. 이 리스너는 최근까지도 이더넷을 근간으로 하는 여러 네트워크에서 사용하는 개념이다. - matlab 코딩(일부분) function [next_time] = paloha(now_time) global STANDBY TRANSMIT COLLISION % definition of the global variable global Srate Plen global Mnum Mplen Mstate global Tint Rint global Spnum Splen Tplen Wtime persistent mgtime mtime % definition of the static variable if now_time < 0 % initialize access terminals rand('state',sum(100*clock)); % resetting of the random table mgtime = -Tint * log(1-rand(1,Mnum)); % packet generation time mtime = mgtime; % packet transmitting time Mstate = zeros(1,Mnum); Mplen(1:Mnum) = Plen; % packet length next_time = min(mtime); return end idx = find(mtime==now_time & Mstate==TRANSMIT);

공학/기술| 2007.06.16| 7페이지| 1,500원| 조회(1,148)

네트워크, MatLab, 무선, aloha, 통신네트워크

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[공학]matlab을 이용한 무선통신 ALOHA와 ISMA 비교

중앙 집중적인 무선 네트워크에선 ALOHA, PRMA(Packet Reservation Multiple Access),ISMA(Idle Signal Multiple Access) 등으로 만들어진 경쟁 기반 채널 액세스 프로토콜들로 평가된다. ISMA 액세스 프로토콜은 중앙 집중식 WCAN에서 부분적으로 적용된 방법 중의 하나이며 공유 채널에 전송하려면 중앙 노드와 단말기에 트래픽이 발생할 수 있다. <코딩 도입 부분>function [next_time] = ISMA(now_time) global STANDBY TRANSMIT COLLISION global Srate Plen global Mnum Mplen Mstate global Tint Rint global Spnum Splen Tplen Wtime bt_time bt persistent mgtime mtime if now_time < 0 % initialize access terminals rand(`state`,sum(100*clock)); % resetting of the random table mgtime = -Tint * log(1-rand(1,Mnum)); % packet generation time mtime = mgtime; % packet transmitting time Mstate = zeros(1,Mnum); Mplen(1:Mnum) = Plen; % packet length next_time = min(mtime); bt_time = next_time; % bt_time은 패킷하나 전송시 걸리는 시간 return end

공학/기술| 2007.06.23| 14페이지| 1,500원| 조회(640)

MatLab, aloha, isma

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1:3 출력비 Ring Hybrid Coupler

Ring Hybrid Coupler목 차1. Coupler Ring Hybrid2. ADS 회로 구성3. 결과물4. 실제 파형5. 고찰1. Coupler란?1. 하나의 신호전력을 두 개 이상의 특정 신호전력으로 배분하는 것 (divider 역할) 2. 특정 신호 전력원의 일부 전력만 추출하는 것 (sampler 역할)Ring Hybrid CouplerRing hybrid coupler는 4개의 포트로 구성되어 있고 2개의 출력단으로 3dB 의 전력분배가 일어남.1input port를 입력단으로 사용하면 output 1, 2에서 동일한 위상의 3dB 전력분배가 일어남. isolated port가 입력단으로 사용되면 위상이 180°차이가 있는 3dB 전력분배가 일어남1. Ring Hybrid Coupler21:3출력 Ring Hybrid Coupler1. Ring Hybrid Coupler1. Ring Hybrid Coupler1. 기판정보2. ADS 회로구성2. ADS 결과파형2. ADS 결과파형 (1:3 출력비)33. 결과물실제 제작한 Ring Hybrid Coupler4. 실제 파형4. 실제 파형 (isolate)4. 실제 파형4. 실제 파형 [1:3 출력비]5. 고찰설계했던 3:1 출력비가 약간의 오차를 갖긴 했지만 실제 제작에서도 보여졌다. 실제 제작에선 중심주파수가 약간 낮아진 것을 볼 수 있었다. (2.45GHz - 2.400GHz){nameOfApplication=Show}

공학/기술| 2007.06.17| 16페이지| 1,000원| 조회(1,498)

rat race, 커플러, 링하이브리드, coupler, ring hybrid

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VHDL을 이용한 교통신호기 평가A좋아요

#교통신호기의 동작➀ 신호등의 표시 전환- 주어진 신호 및 보행자 신호를 표시하되 남➙서➙동➙북 순으로 전환.➁ 주행 신호- 주어진 시간에서 2초를 뺀 만큼 녹색 주행신호가 표시되며, 나머지 2초는 황색 대기신호 표시➂ 보행 신호 - 3초 동안 녹색 보행신호를 표시. - 주어진 시간에서 2초를 뺀 시간까지 1초간 녹색 보행 신호가 점멸. - 나머지 2초는 적색의 보행금지 신호 표시 ➃ 점멸 신호- 점멸 버튼능 누를 경우 모든 황색 신호가 1초의 주기로 점멸.- 녹색 보행신호도 1초의 주기로 점멸 표시#traffic.vhd 코딩library ieee;use ieee.std_logic_1164.all;entity traffic isport( clk : in std_logic; sw_flick : in std_logic; -- switch input red : out std_logic_vector(3 downto 0); -- red light yellow : out std_logic_vector(3 downto 0); -- yellow light green : buffer std_logic_vector(3 downto 0); -- green light left : out std_logic_vector(3 downto 0); -- left light walk_r : out std_logic_vector(3 downto 0); -- walker`s red light walk_g : out std_logic_vector(3 downto 0)); -- walker`s green lightend traffic;architecture arc of traffic isconstant time_rotate : integer:= 30; signal scnt : integer range 31 downto 0; signal direct : integer range 3 downto 0; signal rotate : std_logic; signal flicker : std_logic;begin

공학/기술| 2006.11.10| 8페이지| 1,500원| 조회(1,713)

VHDL, MAX, 컴퓨터구조, 교통신호기

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[컴퓨터 구조]VHDL을 이용한 alu 32bit 설계 평가C아쉬워요

32bit alu로서 각각 a,b에 32비트의 입력 포트가 있고, 원하는 명령을 하기 위해 inst 4bit로 설계하였고, 출력포트에는 y와 carry로 설계하였다.*코딩library ieee; --필요 라이브러리 참조use ieee.std_logic_1164.all;use ieee.std_logic_unsigned.all;use ieee.std_logic_arith.all;-- entityentity ALU isport( a, b: in std_logic_vector(31 downto 0); -- 입력포트 a,b 선언(32 bit) inst : in std_logic_vector(3 downto 0); -- 입력포트 inst선언(4 bit) y: out std_logic_vector(31 downto 0); -- 출력포트 y 선언(32 bit) carry: out std_logic); -- 출력포트 carry 선언end ALU;--modeling

공학/기술| 2006.06.21| 7페이지| 1,500원| 조회(1,785)

VHDL, ALU, 32bit, alu 32bit

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