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2020 사물인터넷 이해 2학기 중간고사 족보

1. 다음 표준화 단체 중 사물인터넷 아키텍처 레퍼런스 모델 표준화와 가장 거리가 먼 것은?답: W3C2. 기술적 측면의 사물인터넷 활성화 요인으로 거리가 먼 것은?답: 디바이스의 고전력화3. 사물인터넷과 WSN(w..

시험자료| 2020.10.26| 3페이지| 3,000원| 조회(2,355)

사물인터넷, 사물인터넷 이해, 사물인터넷이해 족보, 사물인터넷이해 중간고사 족보

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중첩의 원리와 테브난/노턴 정리 예비보고서 평가A+최고예요

회로실험 예비보고서중첩의 원리와 테브난/노턴 정리실험 목적중첩의 원리를 이해한다.테브난 정리 및 노턴 정리를 이해한다.테브난 및 노턴 등가 회로의 상호 변환을 이해한다.직류 전압원과 전류원의 특성을 이해한다.실험 이론(원리)중첩의 원리중첩의 원리란 다중 전원이 있는 선형 회로 소자만으로 구성된 선형 회로망에서 모든 전원이 동시에 인가 될 경우 회로망에서의 전류 및 전압의 반응은 각 전원이 개별적으로 작용할 경우의 반응의 합과 같다는 것이다.오른쪽 그림은 두 개의 전압원을 가진 회로에서 중첩의 원리를 적용한 예이다. 다중 전원을 가진 선형 회로에서 중첩의 원리를 사용하면 쉽게 전압 및 전류를 구할 수 있다.를 단락시켜 의 전압원에 의한 에 흐르는 전류 을 구한다. 에 흐르는 전류 을 구하고 전류 분배 법칙을 사용하여 을 구한다.다음 그림과 같이 을 단락 시켜 전압원에 의한 에 흐르는 전류를 구한다.에 흐르는 전류 을 구하고, 다시 전류 분배 법칙을 사용하여 을 구한다.마지막으로 과 의 두 전압원에 의한 에 흐르는 전류 은 앞에서 구한 과 의 합으로 구할 수 있다.중첩의 원리는 전압원 뿐 아니라 전류원도 사용할 수 있으며, 다중 전원들 중 선택되지 않은 전원이 전압원인 경우 단락을 시키고 전류원인 경우 개방을 시킨 후 만들어진 선형 회로를 선택된 전원만 인가한 경우의 회로망의 반응을 구한다. 각각의 전원에 대한 회로망의 반응의 합은 모든 전원을 동시에 인가했을 경우의 반응과 같게 된다.테브난(Thevenin) 등가 회로전원을 포함한 선형 회로를 하나의 비종속 전압 전원 와 이와 직렬로 연결된 하나의 저항 로 구성된 회로로 표현한 회로이다. 즉 두 개의 단자 A와 B를 갖는 복잡한 회로를 단순화 시켜 회로 해석을 쉽게 할 수 있도록 해주는 등가 회로이다. 테브난 등가 회로로 표현되기 위해서는 내부에 비종속 전원이 있어야 하며, 내부의 모든 회로는 선형 회로로 구성 되어 있어야 한다.두 단자 A와 B을 개방하였을 때 A와 B의 사이의 전압을 회로 상에서 단락하였을 때, 두 단자 A와 B에서 바라본 저항임의의 전원을 포함한 선형 회로의 내부 회로를 모르는 경우 다음과 같은 측정을 통하여 테브난 등가 회로를 찾을 수 있다. 다음 그림과 같이 테브난 등가 회로를 위한 을 측정할 수 있다. 두 단자 A와B을 개방하고 A와 B 사이의 전압을 전압계로 측정하면 을 측정할 수 있다.테브난 등가 회로를 위한 을 측정할 수 있는데, 두 단자 A와 B을 단락하고 A와 B 사이의 전류를 전류계로 측정하면 단락 회로 전류 을 측정할 수 있다.노턴(Norton) 등가 회로전원을 포함한 선형 회로를 하나의 비종속 전류 전원 이와 병렬로 연결된 하나의 저항 로 구성된 회로로 표현한 회로이다. 두 개의 단자 A와 B을 갖는 복잡한 회로를 단순화 시켜 회로 해석을 쉽게 할 수 있도록 해주는 등가 회로이며, 노턴 등가 회로로 표현되기 위해서는 내부에 비종속 전원이 있어야 하며, 내부의 모든 회로는 선형 회로로 구성 되어 있어야 한다.임의의 전원을 포함한 선형 회로를 노턴 등가 회로로 표현하기 위해서는 INT와 을 구해야 한다.: 두 단자 A와 B을 단락하였을 때 A와B사이에 흐르는 전류: 을 회로 상에서 개방하였을 때, 두 단자 A와 B에서 바라본 저항임의의 전원을 포함한 선형 회로의 내부 회로를 모르는 경우 다음과 같은 측정을 통하여 노턴 등가 회로를 찾을 수 있다. 다음 그림과 같이 노턴 등가 회로를 위한 을 측정할 수 있다. 두 단자 A와 B 사이의 전류계를 연결하여 A와 B가 단락되었을 때, 전류계로 흐르는 전류량을 측정하면 을 측정할 수 있다.노턴 등가 회로를 위한 을 측정할 수 있다. 두 단자 A와 B을 개방하고 A와 B 사이의 전압을 전압계로 측정하면 개방 회로 전압 을 측정할 수 있다.테브난 및 노턴 등가 회로의 상호 변환테브난 등가 회로는 노턴 등가 회로로 또는 노턴 등가 회로는 테브난 등가 회로로 쉽게 변환할 수 있고 이들의 관계는 다음과 같다.직류 전압원과 전류원이상적인 전원은 부하 저항의 크기에 관계 없이 항상 일정한 전압 또는 전류를 공급해 주는 장치를 일컫는다. 오른쪽 그림은 이상적인 전압원과 전류원의 회로 기호를 보여준다.다음 그림은 이상적인 전압원과 전류원의 특성을 나타내는데, 이상적인 전압원은 부하저항이 감소하여 부하에 흐르는 전류가 증가하여도 항상 일정한 전압 을 공급해준다. 마찬가지로 이상적인 전류원은 부하 전압에 관계없이 일정한 전류 을 부하에 공급해준다.실제적인 전압원과 전류원의 등가회로를 각각 나타내면 다음과 같다.(a)의 실제적인 전압원의 등가회로는 전압 와 내부 등가저항 가 직렬로 연결된 테브난 등가회로로 나타낼 수 있다. 부하 에 공급되는 전압 은 다음과 같다.

공학/기술| 2024.04.16| 7페이지| 1,000원| 조회(209)

회로실험, 중첩의 원리, 충북대, 충북대학교, 테브난/노턴, 중첩의 원리와 테브난..

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반가산기와 전가산기 결과

실험 제목반가산기와 전가산기실험 과정실험준비물전원공급기오실로스코프브레드보드SN7400SN7404SN7408SN7432SN7486실험1)전원 공급기에 input을 해제하고 브레드보드에 전압을 인가해준다.게이트에 Vcc와 그라운드를 연결해준다.이 때 빨간색 선은 (-)에 꽂는다.입력 부분과 나머지 회로들을 연결해준다.반가산기 회로를 구성하고 5V의 전압을 가하며, 진리표 순서대로 S값과 C값을 측정한다.ABSC00011011실험2)전가산기 회로를 구성하고 진리표 순서대로 S, C 값을 측정한다.ABCSC0*************0101110111실험3)반감산기 회로를 구성하고 진리표 순서대로 B, D값을 측정한다.XYBD00011011실험4)전감산기 회로를 구성하고 진리표 순서대로 Bn, D값을 측정한다.빨간색 선=D값, 하얀색 선=B값XYBn-1BnD0*************0101110111실험 결과실험1)ABSC000.005[V]99.916[mV]015.485[V]98.413[mV]105.492[V]98.968[mV]112.077[mV]4.882[V]ABSC*************101실험2)ABCS [V]C [V]00000.140015.490.140105.490.1401104.901005.490.1410104.9111004.901115,494.91ABCS [V]C [V]0**************************1011100111111실험3)XYB [V]D [V]0000.10015.464.86105.460.101100.10XYB [V]D [V]*************100실험4)XYBn-1BnD0000.1400014.675.330104.635.210114.7301000.145.271010.1401100.1401114.775.37XYBn-1BnD0**************************1001100011111고찰7주차 실험은 반가산기와 전가산기의 원리를 이해하고 가산기를 이용한 논리회로의 구성능력을 키우는 실험이다.실험1)은 반가산기 회로를 구성하고 출력값을 측정하는 실험이다.S = A · B’ + A’ · B = A eq oac(○,+)B [행올림 없는 합계, 합(Sum)]C = AB [행올림 단계, 올림 비트(Carry Bit)]반가산기 논리식과 일치하는 출력값을 얻었다.실험2)은 실험1)의 반가산기를 회로를 확장하여 구성하고 출력값을 측정하는 실험이다. 이 때의 확장된 회로는 전가산기의 회로와 같다. 즉 1개의 자리올림수도 동시에 가산을 할 수 있는 회로로, 두 개의 반가산기와 1개의 OR게이트로 구성된다.실험3)은 반감산기 회로를 구성하고 출력값을 측정하는 실험이다. 실험1)에서 사용한 회로와 비교해보면 AND 게이트와 XOR 게이트의 위치를 바꾸고, AND에 NOT 게이트를 추가한 형태이다.실험4)은 전감산기 회로를 구성하고 출력값을 측정하는 실험이다.왼쪽에 보이는 그림은 전가산기 회로인데, 이 그림에서 알 수 있듯이 전감산기 회로는 전가산기 회로 입력 부분에 NOT게이트를 출력한 것과 같다.

공학/기술| 2022.06.12| 5페이지| 1,000원| 조회(233)

회로실험, 충북대, 충북대학교, 반가산기와 전가산기, 반가산기와 전가산기 예비

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인코더와 디코더 회로 예비

실험 제목인코더와 디코더 회로실험 목적Encoder와 Decoder의 기능을 익힌다.부호변환 회로의 설계방법을 익힌다.Seven-segment(숫자표시기)의 사용방법을 익힌다.실험 이론(원리)상태 혹은 명령들을 그에 대응하는 2진 정보로 변환하는 회로를 encoder(부호기)라고 하며, 반대로 주어진 2진 정보가 어떠한 상태 또는 명령으로 나타내는 회로를 decoder(복호기)라고 한다.디코더(Decoder)디코더는 코드화된 입력을 출력으로 변환하는 다중-입력, 다중-출력 논리회로이다. 입력코드 수는 일반적으로 출력코드보다 적은 수를 가진다 디코더는 조합회로로서 n개의 binary 입력신호로부터 최대 2n개의 출력신호를 만들 수 있다. 그림의 2선-4선 decoder회로와 같이 2진수 입력 BA의 4가지 조합의 부호들을 받아 서로 유일하게 구분되는 4개의 출력으로 바꿔주는 회로를 말한다. 회로의 인에이블(enable) 입력이 존재한다면 반드시 정상적인 논리출력을 얻기 위해서는 인에이블 신호가 회로에 인가되어야 한다. 그렇지 않으면 모든 입력 데이터의 디코더 맵은 disabled되어 단일상태의 출력이 얻어진다.인코더(Encoder)인코더는 입력으로 10진식이나 8진식의 정보를 받아들여 2진식이나 BCD와 같은 코드로 변환시키는 조합회로이다. 최대 2n개의 입력항에서 최대 n개의 출력항을 만든다. 이것은 또한 여러 가지 기호나 알파벳 문자를 코드화하기도 하고 기호나 숫자를 코드화 하는 것을 인코딩이라 한다. Encoder은 그림을 보면 알 수 있듯이 decoder 회로의 반대 기능을 지닌 회로로서 2n개 또는 이보다 적은 개수의 입력신호로부터 n개의 출력신호를 만든다.7-세그먼트 표시기(Seven Segment Indicator)디지털 회로는 LED(Light Emitting Diode) 또는 LCD(Liquid Crystal Display)와 같은 디스플레이 장치를 사용하는 출력을 나타내게 되는데, 시계나 전자 계산기 등이 좋은 예이다. 7-세그먼트는 디지털 신호에 의해 발광하는 LED가 7개의 세그먼트(선분)에 사용되는 디스플레이로 숫자를 표시 할 수 있다. BCD-7 세그먼트 디코더는 BCD에서 십진 숫자를 받아들이고 십진 숫자를 나타내는 선분을 선택하는 출력을 생성하는 조합회로이다.또한 BCD-7 세그먼트 디코더는 BCD 숫자에 대해 4개의 입력과 선분을 선택하는데 사용되는 7개의 출력을 가지고 있으며, 디코더의 7개 출력(a, b, c, d, e, f, g)은 다음 표와 같고 이는 7-세그먼트의 입력이 된다. 7개의 출력에 대한 논리함수를 구해보면 다음과 같은 부울함수로 표시된다.BCD-7 세그먼트 디코더는 2진수를 10진수로 변환해 주기 때문에 회로를 설계하는 입장에서는 디코더라 칭할 수가 있지만, 실제로는 4비트 십진수를 7비트 코드로 변환하는 코드 변환기이다.예비과제BCD to 7-Segment 디코더에 대해 설명하라BCD to-7 segment 디코더는 BCD에서 십진 숫자를 받아들이고 십진 숫자를 나타내는 세그먼트를 선택 후 출력을 생성하는 조합회로이다. BCD 숫자에 대해 4개의 입력과 세그먼트를 선택하는데 사용되는 7개의 출력을 가지고 있으며, 디코더의 7개 출력(a, b, c, d, e, f, g)은 오른쪽의 표와 같고 이는 7-세그먼트의 입력이 된다.또한 2진수를 10진수로 변환해주기 때문에 회로르 설계하는 입장에서는 디코더라 칭할 수가 있지만, 실제로는 4비트 십진수를 7비트 코드로 변환하는 코드 변환기이다.멀티플렉서와 디멀티플렉서를 이용하여 1개의 선로를 통한 4대의 전화를 연결하는 개략도를 작성하라. PAGE PAGE PAGE - 1 -

공학/기술| 2022.04.21| 3페이지| 1,000원| 조회(257)

회로실험, 충북대, 충북대학교, 인코더와 디코더 회로, 인코더와 디코더 회로 예..

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alexander의 회로이론 6장 실전문제

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학교| 2021.06.06| 7페이지| 2,000원| 조회(3,975)

회로이론, 회로이론 6장, 회로이론 실전문제, alexander의 회로이론

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논리 게이트 및 부울 함수의 구현 결과

회로실험 결과보고서논리 게이트 및 부울 함수의 구현실험 제목논리 게이트 및 부울 함수의 구현실험 과정기구디지털 멀티미터전원공급기오실로스코프브레드보드과정실험1)SN 7408 회로를 결선하고(VCC 전원과 GND 접지는 각각 14번, 7번 핀에 연결) 표와 같이 값을 입력한 후 결과를 확인한다.AB과정 사진00011011실험3)SN7432 2입력 OR 회로를 결선하고 표와 같이 값을 입력한 후 결과를 확인한다.AB과정 사진0010실험4)SN7404 회로를 구성하고 A에 1을 입력을 한 후 결과 값은 W, X, Y에서 모두 측정한다.A과정 사진1실험5)SN7402로 다음과 같이 회로를 구성하고 표와 같이 값을 입력한 후 결과를 확인한다.AB과정 사진00011011실험6)SN7486 로 다음과 같이 회로를 구성하고 표와 같이 값을 입력한 후 결과를 확인한다.AB과정 사진01실험 결과실험1)SN 7408 회로를 결선하고, 1) B=0, 2) B=1, B=open 상태에 대하여 진리표를 작성ABY결과000010100111실험3)SN7432로 2입력 OR 회로 진리표 작성ABY결과000101실험4)SN7404 회로를 구성하고 각 단자의 진리표 작성AWXY결과1010실험5)SN7402로 회로를 구성하고 B 단가의 3가지 입력에 대하여 진리표 구성ABY결과001010100110실험6)SN7486을 이용하여 회로 구성 및 진리표 작성ABY결과011고찰5주차 실험은 논리함수 개념과 Gate의 구조 및 기능을 습득하고 부울 대수를 사용한 논리회로 표현 방식 및 등가 회로를 익히는 실험이었다.실험1)에서 사용한SN7408 회로는 4쌍의 논리 곱을 구현하는 논리게이트인 AND Gate로 구성되어 있다. 입력 A, B 모두 1일 때만 4.878[V]의 결과 값이 나왔다. 이 값은 입력 전원(5V)의 측정치이다. 즉, 입력이 모두 1일 때만 출력Y의 값이 1이고, 이외에는 0(0.13756[V])의 결과가 나온다.실험3)에서 사용한 SN7432 회로는 4쌍의 OR게이트로 구성되어 있다. A, B의 입력이 (0,0) 과 (1,0)인 경우를 실험을 했는데, 결과값은 각각 0, 1이 나왔다. 두 입력 모두 0인 경우에만 출력이 0이 나오는 OR게이트임을 고려했을 때 실험 영상에 나와 있지 않은 A B 입력 값이 (0,1), (1,1)인 경우에는 1의 결과가 나올 것이다.실험4)에서 사용한 SN7404는 입력과 반대로 출력되는 NOT 게이트로 구성되어 있다. 실험에서는 A=1 입력을 하고 W, X, Y 값을 측정했다.A와 인접한 W에서는 0.13756[V], 즉 0의 출력이고 X에서는 0과 반대인 1의 출력인 4.878[V]의 측정치를 확인했다. 또한 Y 에서는 0의 결과 값을 확인했다. 실험 영상에 입력 A=0은 나오지 않았지만 NOT 게이트이므로, 입력 A=1인 경우와 정 반대인 W=1(4.878[V]) X=0(0.13756[V]) Y=1이 측정될 것이다.실험5)에서 사용한 SN7402은 4쌍의 2입력 NOR 게이트로 구성된다. NOR게이트는 OR의 반전이다. 실험3)을 참고하면 OR게이트는 입력이 모두 0인 경우에만 출력이 0이 나오는데 이를 반전하면, 두 입력이 모두 0인 경우에만 1이 나온다. 실험5)의 결과도 두 입력이 0일 때만 4.878[V]의 결과가 나온 것을 확인할 수 있다.실험6)에서 사용한 SN7486은 4개의 XOR 게이트를 내장하고 있다. XOR게이트는 두 입력 값이 같으면 0을 출력하고, 입력 값이 다르면 1을 출력하는 게이트이다. 실험영상에는 (0,1)인 경우를 실험했는데, 입력 값이 다르므로 4.878[V], 즉 1이 출력됨을 확인했다. PAGE PAGE PAGE - 1 -

공학/기술| 2021.04.20| 6페이지| 1,000원| 조회(227)

회로실험, 충북대, 충북대학교, 논리 게이트 및 부울 함수의 구현

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