"Verilog 시뮬레이션"의 검색결과 입니다.

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"Verilog 시뮬레이션" 검색결과 1-20 / 416건

공통 시뮬레이션 스냅샷 복원을 위한 Tcl 기반 검증 코드를 이용하여 Verilog 시뮬레이션 시간 단축 (Fast Verilog Simulation using Tcl-based verification code generation for Dynamically Reloading from Pre-Simulation Snapshot)

한국정보통신학회 이용훈, 박대진

논문 | 7페이지 | 무료 | 등록일 2025.05.22 | 수정일 2025.05.26

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빠른 회로 시뮬레이션을 위한 멤리스터의 전류-전압 및과도 동작 콤팩트 Verilog-A 모델 (Compact Verilog-A Model of Current-Voltage and Transient Behaviors of Memristors for Fast Circuit Simulation)

한국전기전자학회 조승명, 오석진, 윤리나, 민경식

논문 | 7페이지 | 무료 | 등록일 2025.04.29 | 수정일 2025.05.15

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SiC 다이오드 전류 전압 모델 (Verilog A 시뮬레이션) 제안

한다. 제안된 모델은 전온도 범위(17°C–600°C)에서 5% 이하의 상대 오차를 달성하며 Verilog-A 시뮬레이션에 통합이 용이하다.SiC Diode I–V Modeling ... 을 위한 예시 값입니다.6. Verilog-A 적용 모델 표현식SiC 다이오드 모델을 회로 시뮬레이션(예: Spectre, HSPICE, ADS 등)에서 적용하기 위한 Verilog ... Temperature-Dependent Two-Region Polynomial Modeling of SiC Diodes for Verilog-A Circuit

리포트 | 20페이지 | 2,500원 | 등록일 2025.10.05

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[Flowrian] Bingo Game 회로의 Verilog 설계 및 시뮬레이션 검증

1. Bingo Game 회로의 사양 설계 사양 - Bingo Game 회로는 숫자 맞추기 게임을 수행하는 회로로서 사용자가 0~254 사이의 정수값을 입력하면 회로는 추측값을 제시하면서 사용자가 입력한 목표값과 비교하여 크거나 작음을 판단 하면서 다음 추측값을 제시하..

리포트 | 22페이지 | 2,500원 | 등록일 2017.07.06

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각종 Verilog Design 소스코드와 시뮬레이션 결과 및 합성결과와 코멘트

1. 8비트 디지털 값이 같은 경우 same핀 1 출력 < Behavioral coding, Structural coding >1) Behavioral coding`timescale 1ns / 1psmodule behavioral(a,b,same);input[7:0] ..

리포트 | 9페이지 | 1,000원 | 등록일 2014.11.23 | 수정일 2019.11.22

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[Flowrian] 4 Bit Shift Register (TTL 7495)의 Verilog 설계 및 시뮬레이션 검증

- TTL 7495 회로는 4 비트의 데이터를 입력받아 한쪽 방향으로 시프트 시키는 레지스터 이다.- TTL 7495 회로는 아래 기능표와 같이 동작한다.* 입력 S='1' 이면 클럭 CP2의 하강에지에 동기되어 외부에서 제공되는 4비트 데이터를 입력 받아 레지스터에 ..

리포트 | 7페이지 | 1,000원 | 등록일 2014.05.28

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[Flowrian] Tone Generator 회로의 Verilog 설계 및 시뮬레이션 검증

는 레벨~15 사이의이진수를 카운팅 하게 되므로 출력되는 Terminal Count 의 주기도 변화하게 된다.4. Tone Generator 회로의 Verilog 설계 및 검증

리포트 | 16페이지 | 1,500원 | 등록일 2012.08.30 | 수정일 2014.08.19

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[Flowrian] Register File의 Verilog 설계 및 시뮬레이션 검증

언어로 모델링 되었으며 시뮬레이션에 의해서 검증된 파형을 제공하고 있다.디지털 논리회로를 배우거나 Verilog 설계를 배우려는 분에게 도움이 되는 문서이다. ... 을 레지스터르 선택하는 멀티플렉서 구문으로 이루어진다.쓰기 동작은 클럭의 상승에지에 동기되어 실행되지만 읽기 동작은 주소가 주어지는 즉시 출력되게 된다.모든 모듈들은 Verilog

리포트 | 13페이지 | 1,500원 | 등록일 2011.09.06

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[Flowrian] Dual 4 Bit Decade Counter (TTL 7469)의 Verilog 설계 및 시뮬레이션 검증

- TTL 7469 회로는 독립적으로 동작할 수 있는 16진 카운터가 2개 구현되어 있다. 하나의 16진 카운터는 2진 카운터와 8진 카운터로 나누어져 있어 따로 동작시킬 수 있다.- TTL 7469 회로에는 2진 카운터, 8진 카운터, 그리고 16진 카운터로 구성된다..

리포트 | 16페이지 | 1,000원 | 등록일 2014.05.06

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[Flowrian] 60 to 1 Frequency Divider (TTL 7457)의 Verilog 설계 및 시뮬레이션 검증

있다. 미국과 한국에서 표준으로 사용되는 60Hz 파형에서 1초를 추출하는데 사용될 수 있다.3. 5진 카운터의 Verilog 설계 및 시뮬레이션 검증 - 동작 사양5진

리포트 | 16페이지 | 1,000원 | 등록일 2014.04.26 | 수정일 2014.05.16

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[Flowrian] 6진 카운터 회로의 Verilog 설계 및 시뮬레이션 검증

동작 사양- 6진 카운터 회로는 0~5 범위를 카운팅 하는 카운터를 의미한다.- 6진 카운터는 0~&를 셀 수 있는 3 비트 이진 카운터를 변형하여 0~5범위만 카운팅 하도록 설계한다. 리셋 단자를 이용하여 설계하는 경우가 있지만 리셋은 논리구현에 사용하지 않아야 하기..

리포트 | 10페이지 | 1,000원 | 등록일 2012.06.02

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[Flowrian] Quadrature Counter 회로의 Verilog 설계 및 시뮬레이션 검증

의 Verilog 설계 및 검증3. JK 플립플롭의 Verilog 설계 및 검증4. Digital Filter 회로의 Verilog 설계 및 검증5. Quadrature Decode 회로 ... 의 Verilog 설계 및 검증6. 16 비트 Up/Down 카운터의 Verilog 설계 및 검증7. Quadrature Counter 회로의 Verilog 설계 및 검증

리포트 | 30페이지 | 2,000원 | 등록일 2011.12.08

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[Flowrian] 자동 속도 제어 회로의 Verilog 설계 및 시뮬레이션 검증

본 문서에서 설계하는 자동 속도 제어 회로는 선박의 운항 속도를 수동 혹은 자동으로 제어하는 회호호서 두 가지 모드로 작동된다. 수동 모드는 항해사가 직접 수동으로 선박 속도를 제어하는 모드이고, 자동 모드는 세팅된 속도로 선박의 속도를 자동으로 제어하는 모드이다.자동..

리포트 | 22페이지 | 2,500원 | 등록일 2012.08.25

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[Flowrian] Generic FIFO 회로의 Verilog 설계 및 시뮬레이션 검증

본 문서에서는 아래의 모듈들은 Verilog 언어로 설계하여 시뮬레이션 검증을 하였다.- GenericFIFO : 비트폭과 깊이를 가변시킬 수 있는 FIFOVerilog 언어를 이용하여 디지털 논리회로의 구조 설계를 배우려는 분에게 도움이 된다.

리포트 | 11페이지 | 1,500원 | 등록일 2011.10.24

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[Flowrian] 디지털 시계 회로의 Verilog 설계 및 시뮬레이션 검증

디지털 시계를 구성하는 모듈들을 Verilog 언어로 설계하고 시뮬레이션으로 검증한다.- mux4b : 4 비트 3 입력 멀티플렉서 - comparetime : 현재 시간과 알람 ... 관련 동작을 구현하는 모듈- stopwatch : 스톱워치 관련 동작을 구현하는 모듈- digiwatch : 디지털 시계의 최상위 모듈Verilog 언어를 이용하여 디지털 응용 회로의 고급 설계를 배우려는 분에게 도움이 된다.

리포트 | 74페이지 | 4,000원 | 등록일 2011.09.17

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[Flowrian] 데이터 정렬 회로의 Verilog 설계 및 시뮬레이션 검증

4개의 8비트 정수를 정렬하는 본 문서의 회로는 5개의 모듈로 구성된다.- 8 비트 멀티플렉서 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 1 비트 비교기 ... 시뮬레이션 검증- 데이터 정렬 회로 : 구조수준 설계 및 시뮬레이션 검증Verilog 언어를 이용하여 디지털 논리회로의 구조 설계를 배우려는 분에게 도움이 된다. ... : Primitive Logic Gate로 구조수준 설계 및 시뮬레이션 검증- 8 비트 비교기 : 구조수준 설계 및 시뮬레이션 검증- 최소/최대값 탐지 회로 : 구조수준 설계 및

리포트 | 23페이지 | 2,000원 | 등록일 2011.09.12

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[Flowrian] Dual 4 Bit Decade Counter (TTL 7468)의 Verilog 설계 및 시뮬레이션 검증

- TTL 7468 회로는 독립적으로 동작할 수 있는 10진 카운터가 2개 구현되어 있다. 하나의 10진 카운터는 2진 카운터와 5진 카운터로 나누어져 있어 따로 동작시킬 수 있다. - TTL 7468 회로에는 아래 그림과 같이 2진 카운터, 5진 카운터, 그리고 10..

리포트 | 16페이지 | 1,000원 | 등록일 2014.04.30

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[Flowrian] 래치와 플립플롭들의 Verilog 설계 및 시뮬레이션 검증

에서 래치와 플립플롭을 Verilog 언어로 모델링된 코드도 제공되고 있다.모든 모듈들은 Verilog 언어로 모델링 되었으며 시뮬레이션에 의해서 검증된 파형을 제공하고 있다.디지털 논리회로를 배우거나 Verilog 설계를 배우려는 분에게 도움이 되는 문서이다.

리포트 | 37페이지 | 2,500원 | 등록일 2011.09.02

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[Flowrian] 50 to 1 Frequency Divider (TTL 7456)의 Verilog 설계 및 시뮬레이션 검증

- TTL 7456 회로는 입력된 클럭을 대 로 분주하는 주파수 분주기 회로로서 내부에 구현된 3개 카운터의 연결을 조합하면 여러 가지 비율의 주파수 분주를 구현할 수 있다. - TTL 7456 회로에는 아래 그림과 같이 두 개의 5진 카운터와 하나의 2진 카운터가 포..

리포트 | 13페이지 | 1,000원 | 등록일 2014.04.24

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[Flowrian] Linear Feedback Shift Register의 Verilog 설계 및 시뮬레이션 검증

D 플립플롭을 직렬로 연결하는데 쉬프트 레지스터에서 tap 의 위치에 해당되는 비트들 중간에 XOR 게이트를 통하여 연산되는 방식의 구조를 갖는다.Verilog 언어를 이용 ... 하여 디지털 논리회로의 구조 설계를 배우려는 분에게 도움이 된다.1. Linear Feedback Shift Register의 사양2. D 플립플롭의 Verilog 설계 및 검증3 ... . Fibonacci LFSR 회로의 Verilog 설계 및 검증4. Galois LFSR 회로의 Verilog 설계 및 검증

리포트 | 19페이지 | 2,000원 | 등록일 2011.12.20

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