"Clock synchronization"의 검색결과 입니다.

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bi-phase mark coding 컴퓨터구조및설계 위상제어루프 생체시계 uwb master slave 기디실

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"Clock synchronization" 검색결과 1-20 / 23건

무선 네트워크 제어 시스템을 위한 클럭 동기화 메커니즘 (A Mechanism of Clock Synchronization for Wireless Networked Control System)

한국통신학회 트렁홉도, 전문길, 유명식

논문 | 8페이지 | 무료 | 등록일 2025.02.10 | 수정일 2025.02.15

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실내 망 동기화를 위한 NTP와 Master/Slave 방식의 비교 (Comparison of NTP and Master/Slave Network Synchronization Methods in in-door Environment)

대한전자공학회 이효정, 권영미

논문 | 6페이지 | 무료 | 등록일 2025.04.28 | 수정일 2025.05.15

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펨토셀 주파수 신호 생성을 위한 IEEE 1588 기반 클록 동기화 시스템의 설계 (Design of a IEEE 1588 Based Clock Synchronization System for Femtocell Frequency Signal Generation)

한국산학기술학회 한지호, 박용재

논문 | 7페이지 | 무료 | 등록일 2025.05.25 | 수정일 2025.05.27

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CAN 시간동기를 이용한 복수 전동기 동기제어 (Synchronization Control of Multiple Motors using CAN Clock Synchronization)

제어·로봇·시스템학회 Le Minh Khoa Do, 서영수

논문 | 5페이지 | 무료 | 등록일 2025.04.13 | 수정일 2025.05.09

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네트워크 기반 임베디드 시스템을 위한 IEEE1588 시간동기 구현 (Implementing IEEE1588 based Clock Synchronization for Networked Embedded System)

대한임베디드공학회 전종목, 김동길, 김은로, 이동익

논문 | 9페이지 | 무료 | 등록일 2025.05.10 | 수정일 2025.05.18

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연세대학교 기초디지털실험 4주차 예비레포트 (sequential logic)

circuit, because digital circuit usually use the clock signal for synchronization.They can be active s ... 1. Clock signalClock signal is a signal oscillating between 1, high and 0, low like pic 1. It is ... made by clock generator and can be represented as the square wave. It is quite important for logic

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| 리포트 | 6페이지 | 2,500원 | 등록일 2021.08.31 | 수정일 2022.12.15

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동위상 클럭라인을 이용한 멀티칩 시스템 클럭 신호 분배 및 동기화 기법 (Multi-Chip System Clock Signal Distribution Synchronization Technology with In-Phase Clock Lines)

사단법인 인문사회과학기술융합학회 허강인, 김성진, 김현수, 문규

논문 | 8페이지 | 무료 | 등록일 2025.07.12 | 수정일 2025.07.19

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단방향 지연 변이와 일주 지연을 이용한 양단간의 단방향 지연 추정 (One-Way Delay Estimation Using One-Way Delay Variation and Round-Trip Time)

한국컴퓨터정보학회 김동근, 이재용

논문 | 10페이지 | 무료 | 등록일 2025.04.09 | 수정일 2025.05.08

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TDOA 기반의 실시간 위치 측정 시스템을 위한 정밀 무선 시각 동기 시스템 (Precision Time Synchronization System over Wireless Networks for TDOA-based Real Time Locating Systems)

한국통신학회 조현태, 정연수, 백윤주, 장현성, 박인구

논문 | 11페이지 | 무료 | 등록일 2025.03.02 | 수정일 2025.03.06

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무선 센서 네트워크에서 비잔틴 오류를 허용하는 클럭 동기화 기법 (A Byzantine Fault-tolerant Clock Synchronization Scheme in Wireless Sensor Networks)

한국정보과학회 임형근, 남영진, 백장운, 고석영, 서대화

논문 | 5페이지 | 무료 | 등록일 2025.03.01 | 수정일 2025.03.06

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CDR을 사용한 FPGA 기반 분산 임베디드 시스템의 클록 동기화 구현 (An Implementation of Clock Synchronization in FPGA Based Distributed Embedded Systems Using CDR)

대한임베디드공학회 송재민, 정용배, 박영석

논문 | 8페이지 | 무료 | 등록일 2025.05.10 | 수정일 2025.05.18

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서강대학교 마이크로프로세서 9주차 실험

선택 및 구성한다.- Internal trigger inputs(ITRx): 이는 타이머 동기화(timer synchronization)의 특별한 경우로 생각할 수 있다. 한 개 ... 이 이루어지고 각 경우마다 UEV가 발생함을 알 수 있다.● Timers and external trigger synchronization외부 신호가 trigger 되어서 어떤 동작을 수행 ... 할 수도 있다. 즉 어떠한 모드에서는 타이머가 external trigger와 synchronization 될 수 있다.(a) Reset mode그림 (a)와 같은 reset

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| 리포트 | 27페이지 | 3,000원 | 등록일 2021.06.30 | 수정일 2022.04.14

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동기망과 전송망에서의 동기클럭 성능 분석을 위한 시뮬레이터 개발 (Development of Simulater for Performance Analysis of Synchronization Clock in the Synchronization Network and Transmission Network)

한국정보처리학회 이창기

논문 | 12페이지 | 무료 | 등록일 2025.04.28 | 수정일 2025.05.15

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무선 임베디드 환경에서의 시간 동기화 (Clock Synchronization in Wireless Embedded Applications)

한국정보과학회 노진홍, 홍영식

논문 | 8페이지 | 무료 | 등록일 2025.02.28 | 수정일 2025.03.06

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무선 시간 민감성 네트워킹을 위한 클록 동기화 기술과 프로토콜 (Clock Synchronization Technologies and Protocols for Wireless Time-Sensitive Networking)

국제차세대융합기술학회 한지호, 신창용

논문 | 10페이지 | 무료 | 등록일 2025.07.12 | 수정일 2025.07.20

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[A+] 중앙대 아날로그 및 디지털 회로설계실습 위상제어루프(PLL) 예비보고서

는 Signal Receiver 측에서 시작과 끝점을 판단하지 못하고 Error가 발생하는 원인을 제공한다. 이와 같은 현상을 막기 위해 Clock의 시작과 끝을 맞추어주는 동기화(s ... 사용 장비오실로스코프 (Oscilloscope)1대브레드보드 (Bread board)1개파워서플라이 (Power supply)1대함수발생기 (Function generator)1대 ... ynchronization)가 필요하다. 바로 이렇게 주기적 신호의 위상을 원하는 대로, 고정시켜주기 위해 만들어진 회로가 과 같은 위상 제어 루프 (Phase Locked Loop

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| 리포트 | 17페이지 | 1,500원 | 등록일 2021.09.01

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<컴퓨터 구조 및 설계>1장 컴퓨터 추상화 및 관련 기술 요약정리

Computer ArchitectureLayers of Representation/InterpretationMoore’s LawPrinciple of Locality/Memory ... 하기까지의 총 소유시간L=람다 W => average interarrival rate (l) x average service time (W)Bandwidth(throughput ... 는지와 관련된 성능척도 필요거의 모든 컴퓨터는 하드웨어 이벤트가 발생하는 시점을 결정하는 클락을 이용하여 만들어진다.Clock cycle-> 클럭의 시간 간격, Clock period

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| 리포트 | 8페이지 | 1,000원 | 등록일 2019.07.29

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1. 백홀기술

/MSAll-IP 기반의 RAN 백홀망을 지원하기 위해서 다음과 같은 요구사항들이 고려되고 있다.가. 네트워크 동기(Clock synchronization)일반적으로 무선기술 ... -VID) 및 서비스 ID(I-SID)가 포함되어 있다. 백본망 MAC 헤더를 통하여 Un tagged, C-Tagged, S-Tagged 서비스 인터페이스를 포함하는 고객망 ... 과 서비스 제공자 백본망을 분리하는 것이다. 따라서, PBBN에서브리지되는 서비스는 S-ID(224개) 및 3-Tuple(BDA, B-SA, B-VID)을 통해 정의되며, TE 단방향

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| 리포트 | 13페이지 | 2,000원 | 등록일 2019.08.13

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Pseudo-Random Binary Sequences

Figure 1-7.② On the Pseudo-Random Binary Sequence Generator, set the INTEGRAL CLOCK PERIODS dispy to ... hown in Figure 1-8(b). However, there is always one synchronization pulse per sequence.③ When setting ... Unit 11 _ Exercise 1Pseudo-Random Binary Sequences1. 실험 목적pseudo-random binary sequences의 주파수와 시간

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| 리포트 | 7페이지 | 2,000원 | 등록일 2012.12.23 | 수정일 2014.01.01

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BI-PHASE CODE

? 제목실험12 Clock 신호의 재생 #2 (BI-PHASE CODE)? 목적양 위상(Bi-phase) Code의 형태를 관찰하고 이 Code가 갖는 특성에 대하여 공부하기 ... 는다.? 동기화: 각 비트시간 간격 동안의 전압전이를 예측할 수 있으므로, 수신측은 그 전이에 대해 동기화(synchronization)를 할 수 있다. 이러한 이유에서 2단계 코드 ... 하여 Bit Clock Information을 자주 수신측으로 보내어 줄 수 있는 기능에 대하여 공부하기로 한다. Bi-phase Code 이외에도 Clock과 Data의 재생에 관련

Non-Ai HUMAN
| 리포트 | 3페이지 | 1,000원 | 등록일 2008.03.09

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