"논리회로실험"의 검색결과 입니다.

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verilog 전전설2 논리회로 텀프로젝트 실험12 멀티플렉서 vhdl 디지털회로실험 라인트레이서

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"논리회로실험" 검색결과 1,941-1,960 / 4,685건

멀티플렉서와 디멀티플렉서

는 조합 논리 회로인데 2개의 입력밖에 받을 수 없으므로 전 단계의 Carry는 더해 줄 수 없다. 두 번째 실험에서는 이러한 단점을 보완한 전가산기를 설계하였다. NOT게이트 ... 셈기에 대해 알아본다.2. 기초이론멀티플렉서(MUX: Multiplexer)는 여러 개의 입력 데이터 중에서 하나를 선택하여 출력으로 내보내는 논리회로이며 데이터 선택기라고도 한다 ... 회로는 실험과정 5.3에서 재사용하므로 해체하지 않는다.)5.2 실험 예비 보고를 바탕으로 하나의 74153칩을 사용하여 전가산기를 구성하고, 실험과정 5.1을 반복하여 실험

리포트 | 8페이지 | 1,000원 | 등록일 2019.06.27 | 수정일 2020.05.01

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쌍안정 회로와 RS래치 결과보고서 A+

Experiment-Report(11장 쌍안정 회로와 RS래치)1. 실험목적쌍안정 회로의 동작을 이해하고, 메모리 기본 소자의 개념을 파악한다.2개의 NOR 게이트 또는 2개 ... 실험은 RS래치와 D래치를 이해하고 회로로 구현하는 것이다. RS래치는 디지털 실험 책과는 달리 NOR게이트로 구성을 했다. RS래치는 R에 1이 인가되고 S에 0이 인가될때 ... 을 다시한번 상기하게 되는 시간이었다. 그리고 디지털공학과 논리회로설계 시간에 학습한 내용들을 실습으로 접목을 시킨 점에서 의미가 깊다고 생각한다.

리포트 | 5페이지 | 1,000원 | 등록일 2020.03.05 | 수정일 2020.03.11

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[예비레포트] M2 아날로그 및 디지털 기초 회로 응용

1. 실험명M2 아날로그 및 디지털 기초 회로 응용2. 개요기존에 수행했던 아날로그 및 디지털 기초 회로의 동작을 아두이노를 이용해 되풀이해보고, 패키지 소자들을 이용해 하드웨어 ... 수작업으로 구현했던 과거 회로와 비교하여 어떤 부분이 어떻게 프로그램으로 대체가 가능한지 학습한다.3. 실험이론키르히호프의 전압법칙 및 전류법칙키르히호프의 전류법칙은 회로상의 한 ... 다.가산기가산기의 논리회로는 위와 같다. 가산기의 종류에는 반가산기와 전가산기가 있는데, 전가산기는 반가산기를 조합한 형식이다. 반가산기는 2개의 입력과 2개의 출력이 있

리포트 | 2페이지 | 1,000원 | 등록일 2019.09.23

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2장 . 디지털 논리회로 개론 . 결과보고서

2장 . 디지털 논리회로 개론1. 실험 목적▶ 각종 기본 논리게이트의 특성 이해2. 관련 이론● AND gate- 표현방법 : dot product (.) 혹은 아무런 표시 없이 ... ? 회로구성도회로 종류회로 사진AND gateOR gateNOT gateNAND gateNOR gate? 실험결과- AND gateinput오실로스코프디지털 멀티미터ABLowLow ... 되어 컬렉터와 이미터사이에 전류가 흐르지 않게 된다. 결과를 보면 이론데로 나왔음을 알 수 있다.4) 네 번째 NAND gate 실험 회로를 살펴보면 0,0 일 때 트렌지스터가 동작하지않

리포트 | 11페이지 | 1,500원 | 등록일 2013.10.16 | 수정일 2013.10.19

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전자전기컴퓨터설계실험2(전전설2) (3) Logic Design using Verilog HDL

HDLpost-lab reportⅠ. 서론1. 실험 목적본 실험에서는 Verilog HDL의 사용법을 익히고 이를 사용하여 디지털 논리회로를 설계하는 여러 가지 방법을 다룬다 ... . 실험 이론2.1. HDL전자공학에서 하드웨어 기술 언어(Hardware Description Language)는 전자회로를 정밀하게 기술하는 데 사용하는 컴퓨터 언어이다. 흔히 ... 프리미티브를 이용한 모델링, 반가산기 회로)[사진 4] 베릴로그 HDL 모델링의 예시(행위수준 모델링(조합논리회로), 2-to-1 MUX)[사진 5] 베릴로그 HDL 모델링의 예시

리포트 | 84페이지 | 2,000원 | 등록일 2019.10.11 | 수정일 2021.04.29

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논리게이트 및 부울함수의 구현

? 실험 4. 논리게이트 및 부울함수의 구현1. 실험 목적1) AND, OR, NOT, NAND, NOR, XOR, XNOR의 논리함수 개념과게이트의 구조 및 기능을 습득한다.2 ... ) 부울 대수를 사용한 논리회로의 표현방식 및 등가회로를 익힌다.2. 이론1) NOT 게이트(INVERTER)하나의 입력과 출력을 가지며 논리적 부정 연산을 행하는 역할을 한다 ... 이 되는 논리회로를 말한다.부울 식은Y=A+B로 나타낼 수 있다.3) AND 게이트입력이 모두 1일 때만 출력이 1이 되는 논리게이트이다.부울식은Y=A CDOT B로 나타낸다.4

리포트 | 5페이지 | 1,000원 | 등록일 2019.05.20

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7th monostable , not gate

1. 실험 목적555 timer를 이해하고, monostable, not gate 회로를 제작하고 알아본다.2. 실험 이론555 timer555 timer는 IC로 예부터 많이 ... 은 논리 값이 불확실한 구간이므로 이 범위의 전압을 디지털 회로에서 사용하면 그 결과를 예측할 수 없다. 그러므로 매우 느리게 변하는 신호나 잡음에 의해서 전압이 불안정한 신호 ... 논리을 히스테리시스(Hysteresis)라고 한다.3. 실험 기구 및 재료555 timer, oscilloscope, power supply, 가변저항, 콘덴서 , 발광다이오드4

리포트 | 10페이지 | 1,000원 | 등록일 2019.06.10

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7-세그먼트 표시기와 디코더 결과보고서A+

를 설계한다.2. 자료 및 관찰TL = 0일 때 7세그먼트에 불이 들어오는 모습이다. 위 사진을 봤을 때 회로와 7-세그먼트는 정상 작동함을 알 수 있다. 이후 0~9까지 실험할 때 ... 는 BCD-to-7 세그먼트 디코더에서 입력에 대한 출력값을 나타낸 것이다.3. 결과 분석이번 실험은 7-세그먼트 디코더를 이해하여서 이를 회로로 구현하는 것이다. 이를 알기 위 ... 논리회로설계에서 학습한 내용들(디코더, BCD, 플립플롭 등)을 상기하는 시간을 가졌고 이론과 실습을 접목시킨 점에서 의미가 깊다.고찰문제아래의 [그림 10 – 1]74138

리포트 | 9페이지 | 1,000원 | 등록일 2020.03.05 | 수정일 2020.03.12

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시프트 레지스터와 시프트 카운타

하는 회로이다.3. 실험[기초실험-1] D 플립플롭(7474)을 이용하여 5비트 시프트 레지스터를 설계하고 실험을 통하여 그 결과를 확인하시오.타이밍도계수표입력출력CLKABCDE0상승 ... 100002하강010003하강001004하강000105하강00001회로 구성도실제 회로도 구성[기초실험-2]4.실험사진[기초실험-1][응용실험-1][응용실험-2]5.고찰[기초실험-1과 응용 ... 시프트 레지스터와 시프트 카운터1. 실험목적① 시프트 레지스터의 동작 이해② 시프트 레지스터의 특성을 이용한 카운터 이해③ 존슨 카운터 동작 이해④ 링 카운터 동작 이해2. 배경

리포트 | 5페이지 | 1,000원 | 등록일 2019.06.21

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[결과레포트] Chapter 5. 논리 게이트-2

의 경험을 토대로 실험을 진행하였다.지금까지의 논리 게이트 실험과는 다르게 이번에는 LED를 제어할 수 있는 회로를 만들어 LED의 상태를 결과값으로 측정하는 실험을 진행 ... Chapter 5. 논리 게이트-2결과레포트1. 실험제목 : Chapter 5. 논리 게이트-22. 실험결과OR 게이트입력출력출력 전압 측정치ABX0000.02mV0114 ... 2-입력 OR 게이트만을 활용하였지만 4-입력 OR과 같은 기능을 할 수 있다.3. 고찰이번 실험은 논리 게이트에 대해 알아보았다. 실험에 들어가기에 앞서 논리 게이트에 대해

리포트 | 2페이지 | 1,000원 | 등록일 2019.04.09

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판매자 표지

[전기실험]디지털 공학 실험 레포트 1장(문제풀이)

2가 개방되어 있으면 LIGHT는 OFF이다.L=SW1+SW2+SW1+SW1·SW216. 모든 입력이 HIGH일 때만 출력이 HIGH가 되는 논리회로가 있다. 이것은 어떤 논리회로 ... 인가?AND 게이트17. 한 개의 입력이 HIGH이고, 다른 하나의 입력이 LOW일 때, 출력이 LOW인 2-입력 논리회로가 있다. 어떤 논리회로인가?AND 게이트18. 한 개 ... 의 입력이 HIGH이고, 다른 하나의 입력이 LOW일 때, 출력이 HIGH인 2-입력 논리회로가 있 다. 어떤 논리회로인가?OR 게이트1-4절 시스템 개념19. 그림 1-63의 입

리포트 | 5페이지 | 1,500원 | 등록일 2020.04.20

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플립플롭 예비

는 참이 된다. 입력값이 서로 다르면 1을 출력하고, 같으면 0을 출력한다.2) 7400 quad NAND 게이트:모든 입력이 참일 때에만 거짓인 출력을 내보내는 논리 회로이다.3 ... ) 7404 hex 인버터:인버터 회로는 그 반대 논리 레벨을 나타내는 전압을 그 입력에 출력한다. 주요 기능은 적용된 입력 신호를 반전시키는 것입니다.4) 7474 dual D플립 ... 있다.< JK 플립플롭>5. 실험 방법1) D 플립플롭(1) 실험회로를 구성한다.(2) CLK에 주파수 = 1Hz, 5Vpp, offset = 0V 인가한다..(3) Vdc = 5

리포트 | 8페이지 | 1,000원 | 등록일 2019.03.26

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flip flop 레포트

실험-#1실험순서1.브레드보드에 논리게이트를 이용하여 아래의 회로를 구성하시오.14번핀:+5V7번핀:GND2. E,J,K의 상태를 다음의 표와 같이 변화시키며, 출력 상태를 기록 ... ↓1111↓1110↓1111flip flop-#2실험순서1.브레드보드에 논리게이트를 이용하여 아래의 회로를 구성하시오.4번핀:+5V11번핀:GND2. CP 상태를 다음과 같이 설정 ... 과 같이 설정하여 입력시키며 출력 상태를 기록하시오.pspice 값5.실험 결과에 대한 고찰이번 실험을 통해 순차논리회로 S-R flip flop, D flip flop, J-K

리포트 | 7페이지 | 1,000원 | 등록일 2018.11.02 | 수정일 2020.01.22

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플립플롭 실험보고서

한 순차회로로서 그림과 표를 통해 S-R래치를 나타내었다. 여기서 S(set)는 출력 1을, R(reset)은 출력 0으로 되도록 한다는 의미이다. NOR 논리 게이트를 교차 되먹임 ... 의 경우에도 JK플립플롭에서 J와K가 합쳐진 형태와 같다. 의 특성식을 가지며, T 플립플롭은 카운터 및 주파수 분주회로 등의 스테이트 머신 설계에 유용하게 사용된다.3. 실험 ... - NAND 게이트- AND 게이트- 인버터5. 실험방법 및 순서5.1 [그림 7-1]의 R-S 플립플롭 회로를 결선하고 [표 7-1], [표 7-2]와 같이 동작하는지 확인하고 그

리포트 | 12페이지 | 1,000원 | 등록일 2020.04.26

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논리결과-1-Basic Gates

에 입력시켜 주어야 하고 VCC는 5V의 입력을 14번 핀에 입력시켜 주어야 한다는 것을 알게 되었다. 이런 기본적인 논리회로실험 소자들에 대한 이해를 마친 후에야 제대로 실험을 진행할 ... 들로 구성된 logic 회로에서의 Boolean equation과 De Morgan의 법칙에 대하여 알아본다.2. 실험결과실험방법1) 위 회로를 구성하고, 출력 결과를 토대로 Truth ... HLHLL505어어HHLHL550밝어HHHHH555밝밝실험 1-1에서는 AND gate(74HC08)를 이용하여 회로를 구성한 후에 진리표와 실험의 결과 값이 일치하는지를 확인해 보

리포트 | 7페이지 | 1,000원 | 등록일 2012.12.23

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논리예비2 CMOS 회로의 전기적 특성

실험2. CMOS 회로의 전기적 특성1. 실험목적- COMS 회로의 전기적 특성을 이해한다.- 74HC시리즈를 실험을 통해 동작을 확인하기2. 실험이론- Logic levels ... (Transistion time) - 논리회로의 출력이 한 상태에서 다른상태로 변화할 때 걸리는 시간, 출력 값이 변화하는 시간 : VCC 10%, 90%- Resistive Load ... 하지 않는 입력핀의입력 값은 VCC또는 GND에 연결한다.(Pull down, Pull up)실험 1) Inverter의 입출력 특성 확인- 위 회로를 구성한다.- VCC = 4

리포트 | 4페이지 | 1,000원 | 등록일 2012.12.23 | 수정일 2013.11.07

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회로실험I 예비보고서 - Multiplexer 가산-감산

회로실험I 9주차 예비보고서실험 9. Multiplexer 가산-감산목적? 전가산기 구성을 위해 2개의 4입력 Multiplexer 사용을 익힌다.? 2개의 4-입력 ... (Read Only Memory)으로 논리회로 합성 가능멀티플렉서를 이용한 논리회로- Y = A?B = A’B+AB’의 논리식을 의 멀티플렉서로 구성하는 경우S=0, D0=0, D1 ... =1, D2=1, D3=0로 하면 Y=1(0*A’B’ + 1*A’B + 1*AB’ + 0*AB) = A’B+AB’함수 발생(Function generation)- 논리회로에서는 A

리포트 | 3페이지 | 1,500원 | 등록일 2019.05.13 | 수정일 2020.05.06

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비동기 및 동기 입력을 포함한 J-K 플립플롭의 여러 구성에 대한 레포트

0 0래치0 101 011 1토글실험 순서J-K 에지-트리거 플립플롭1. 그림 16-2(a)의 회로를 구성하여라. LED는 결과 논리를 보기 위한 것이며 출력이 LOW일 때 ON ... 사이클 펄스를 얻는 좋은 방법이 된다. 실험 보고서에 관찰 내용을 요약 정리하여라. J-K 플립플롭의 진리표에 대한 토의 내용도 포함시켜라.3. 그림 16-3의 회로를 살펴보아라 ... 의 플립플롭을 사용한 리플 카운터를 보여주고 있다. 회로를 구성하고 실험 보고서의 도표 1에 QA 와 QB 출력을 그려라.LED가 ON이 될 떄 출력 Q는 HIGH인 것에 주의

리포트 | 10페이지 | 3,000원 | 등록일 2015.06.03

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디지털공학실험 (래치회로 및 SR, D플립플롭)

결과 레포트디지털공학실험( 래치회로 및 SR, D플립플롭 실험 )과 목 명디지털공학실험이 름담당 교수실험 일자제출 일자결과 보고서1. 실험 목표- 기억소자로서 래치의 기본 개념 ... 을 이해하고 SR래치 및 SR, D플립플롭의 원리 및 동작 특성을 이해하는데 목적을 둔다.- 기본논리게이트를 응용하여 래치와 플립플롭 회로를 Breadboard에 구성한다.2. 관련 ... 이론(1) 클록이란?- 논리회로를 사용한 연산을 시간적으로 양자화하기 위한 신호이다. 논리소자의 동작속도는 무한대가 아니라 그들을 조합한 논리회로에서는 입력이 주어지고 있

리포트 | 9페이지 | 1,000원 | 등록일 2019.01.23

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9. PLC 및 모터제어 실험

를 분류하는 실험을 PLC 로직 프로그램인 래더 로직 다이어그램을 작성하여 수행한다.3. 이론적 배경(1) 불대수(Boolean algebra)불대수란 2진 변수와 논리동작을 기술 ... 하는 대수를 말한다. 논리회로의 형태와 같은 구조를 기술하는데 필요한 수학적 이론으로 변수들의 입출력 관계를 대수적으로 쉽게 표현할 수 있다. 2진 변수란 참(T,ON)과 거짓(F ... +A = 1(보수법칙)X?1 = X(특성화 정리)(2)래더 로직 다이어그램래더 다이어그램은 프로그램 가능 제어기의 언어이다. 래더 다이어그램은 논리 AND연산자의 직렬회로나 논리

리포트 | 13페이지 | 1,000원 | 등록일 2019.09.15

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