"vector coding"의 검색결과 입니다.

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"vector coding" 검색결과 161-180 / 777건

디지털시스템설계 hw5

한 방식으로 s1과 s0을 input vector로 이용해 해당 입력에 따라 정해진 output을 출력하는 방식이다. 위 코드를 시뮬레이션 진행하는 과정에서 계속 error가 나 ... HW#5문제 3-1번- 코드입력포트 : x, y, c_in출력포트 : sum, c_out- 시뮬레이션 결과 비교순서대로 실행했을 때 파형코드 순서를 바꿔서 실행했을 때 파형코드 ... 째 문장에서 t가 선언된 이후에는 값이 정상적으로 출력된다.문제 3-2번- 코드출력포트 : x_b, y_b, z_b : blocking문 사용할 변수x_nb, y_nb, z_nb

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| 리포트 | 18페이지 | 1,000원 | 등록일 2021.01.07

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아주대학교 기구설계 [A+ / 통합 1등 / C언어] 중간프로젝트 문제5번

`,`mm/s )2) MATLAB 그래프 ( 단위 :DEG `,```mm`,`mm/s )이론적 배경 - Project 5[Vector Loop Equation을 이용한 풀이]여기 ... 에서는 Vector Loop Equation을 이용하여 점 P의 위치를 구하였다.설계변수는 a , b , c , Bx , By , Cx , Cy 이고, 미지수는 x1 , x2 , pi1 ... , pi2 이다.이 미지수들은 theta1의 변화에 따라 값이 달라진다. theta2는 theta1*2-45 의 값을 가진다.먼저 점 F의 좌표를 Vector Loop Equation

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| 리포트 | 19페이지 | 3,000원 | 등록일 2019.10.12 | 수정일 2019.10.14

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논리회로설계실습-비교기-MUX-ALU-결과보고서

여 use work.Pac_A6_JSW_CHS.all 코드로 패키지를 호출하여 위에서 작성한 패키지를 사용할 수 있도록 한다. 이후 입력 A, B를 std_logic_vector (3 ... downto 0)로 4비트 입력을 가지도록 하였으며 기능선택 비트 S를 std_logic_vector (1 downto 0)으로 하여 2비트 입력을 가지도록 코드를 구성하였다. 그 ... 비트 이진수 Y를 출력하는 산술논리연산장치(ALU)의 동작을 이해하고 설계한다. 소스 코드 작성 시, 함수와 프로시저를 포함한 패키지를 사용하여 작성한다. 테스트 벤치 작성을 통해

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| 리포트 | 8페이지 | 1,500원 | 등록일 2018.01.10

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논리회로실험 프로젝트 도어락

. 다이어그램5 소스 코드library ieee;use ieee.std_logic_1164.all;use ieee.std_logic_arith.all;use ieee.std ... : in std_logic_vector (3 downto 0);alarm : out std_logic :='0';door_open : out std_logic );end door ... tate, mod_state);signal state :states;signal password : std_logic_vector(3 downto 0):="1101";signal ps

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| 리포트 | 14페이지 | 1,000원 | 등록일 2018.11.18

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VHDL 설계 실습 보고서 (전감산기 설계)

를 설계하여 시뮬레이션한 결과는 위 진리표에서의 값과 같게 나오는 것을 확인 할 수 있었다.전감산기의VHDL 설계1. 전감산기를 VHDL로 설계하고 아래에 VHDL 코드를 작성하시오 ... 200911758 issignal sum: std_logic_vector(1 downto 0);beginprocess(x, y, bi)beginsum

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| 리포트 | 3페이지 | 1,000원 | 등록일 2020.05.29

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아주대 임베디드 시스템 실험3-예비

는 과정이 실행되고 2가지 방식이 있다. ① 정해진 주소값으로 무조건 Jump. 단, 정해진 주소에 ISR코드가 존재해야 한다. ② Interrupt vector table에서 주소값 ... 하며 예외처리 방식에 의해 처리된다. microprocessor는 interrupt를 감지하면 실행중인 코드를 중단하고 해당 interrupt를 처리하기 위해 프로그램으로 점프

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| 리포트 | 6페이지 | 2,000원 | 등록일 2019.01.28

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경희대학교 DSP 실험

a) ... ig); % length of signal vector sigfor x=1:lg[Index(x) pq] = biquant(bits, -5,5, sig(x)); % Output the quantized indexend% transmitted% receivedfor x=1:lg

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| 리포트 | 6페이지 | 5,000원 | 등록일 2016.10.24

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경희대 새로운생명체 인공지능 기말고사 정리, 기출문제

새로운 생명체: 인공지능 기말고사 정리Ⅰ. 기계학습 소개 및 처리과정1. 기계학습(Machine Learning)이란?가. 문제를 해결하기 위한 맞춤코드(Custom code ... Vector Machine: SVM)가. 주로 분류에 사용되는 지도 학습 모델1) 주어진 데이터 점들이 두 개의 클래스 안에 각각 속해 있다고 가정했을 때2) 새로운 데이터 점

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| 시험자료 | 24페이지 | 8,500원 | 등록일 2020.12.16

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디지털통신2-Convlutional Coding

가 생성되었다.2. Encode the message vector using the best convolutional code of constraint length K=7 and ... code rate 1/2. Here, `best' means the code with the maximum free distance. ... message vector of length 16. (packetLen=16)random 함수를 이용해 길이가 16인 메시지 벡터를 생성하였다.그 결과 다음과 같은 길이 16인 메시지 벡터

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| 리포트 | 6페이지 | 1,000원 | 등록일 2015.06.17

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조선대학교 운영체제 기말 정리본(2019, 개인정리, 최종 A학점)

의 모든 스레드는 아래 자원들을 공유▷ 스레드의 개수와 상관없이 실행 코드 공유 → 각 스레드는 process 내의 어떠한 함수도 호출하여 실행 가능▷ 전역변수, 힙 등의 자원 ... 그al Section or Critical Region(임계영역)○공유자원 또는 공유데이터를 access(읽거나 쓰는) 코드 영역○분리될 수 없는 하나의 기계어 명령어같이 취급 ... 되어야 하는 여러 개의 명령어 문장들을 말함(프로그램상의 연속된 코드들의 일정 영역)○Critical Section을 보호하기 위해선 상호 배제를 통해 한 스레드만 임계영역에 진입

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| 시험자료 | 10페이지 | 3,000원 | 등록일 2019.12.23 | 수정일 2024.01.09

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디지털공학실험 08. 신호등 결과

< Traffic Light 결과보고서>VHDL 코드[VHDL Module Code]library IEEE;use IEEE.STD_LOGIC_1164.ALL;use IEEE ... _LOGIC_VECTOR (5 downto 0));end traffic;architecture traffic of traffic istype state_type is (s0, s1 ... , s2, s3, s4, s5);signal state: state_type:=s0;signal count: STD_LOGIC_VECTOR(3 downto 0):="0000";c

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| 리포트 | 6페이지 | 1,000원 | 등록일 2017.06.29

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조류독감에 대해 발표한 피피티 자료입니다.

- Involved in the synthesis of capsid and virus M2 - Ion channel protein coding NS - non-structural ... protein coding 02 Avian influenza virus of structureNew type the flu virus Avian influenza virus H ... protential variation of antigen during incubation Virus-like particles Recombinant viral vectors that

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| 리포트 | 13페이지 | 5,000원 | 등록일 2017.07.10

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[생명공학실험]Cell Transformation

vector의 형질전환이나 M13 phage vector DNA의 형질도입 등을 실시하는 경우, Vector DNA로부터 발현하는 lacZα peptide와 JM109 F‘가 코드 ... 의 제작이나 subcloning 이외에 M13 vector DNA의 숙주로써 ssDNA의 제조에도 사용할 수 있다.3) E.coli DH5αpUC계 plasmid를 사용하여 유전자 ... 여 벼이를 도입하고자 하는 유전자를 pUC 118/119, M13 PHAGE등의 한가닥 DNA을 조제할 수 있는 vector에 cloning하여 ssDNA를 조제하므로써 Kunkel법

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| 리포트 | 4페이지 | 1,500원 | 등록일 2018.11.04 | 수정일 2020.08.05

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C와 MATLAB을 사용한 B-mode 영상_13

된다.B. 코드 (Code)과제의 각 세부 목표를 위해 작성한 코드를 주석과 함께 정리하여 기록한다.?Cmain#include#include#include#include ... #define N_SAMPLES 3154#define N_VECTORS 192#define N_DATA N_SAMPLES*N_VECTORS#define PI 3.1415926535s ... hort main(void){int iVector;int iSample;int temp_a[N_VECTORS] = {0,};int max = 0;int i;// allocate

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| 리포트 | 13페이지 | 3,000원 | 등록일 2017.05.30

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컴퓨터 보안(Computer Security) 전용희 저 3장 요약, 3장 연습문제

방식(대칭 키 암호 분류):스트림 암호-일회성 암호 형태, 블록 암호-코드북 개념 형태스트림 암호-일회성 암호: 키가 상대적으로 짧다, 키가 긴 스트림으로 늘려진다.키스트림은 일회 ... 성 암호 키 같이 사용된다.블록 암호-코드북 개념:블록암호 키가 한 권의 코드북을 결정한다.각 키가 다른 코드북을 결정한다. 혼돈과 학산 모두가 적용된다.블록 암호의 암호화와 복호 ... 뿐만 아니라 그 이전의 평문 블록들의 영향도 받게 된다.CBC 모드의 초기화 벡터(initialization vector)최초의 평문 블록을 암호화할 때는 1단계 앞의 암호문

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| 리포트 | 12페이지 | 1,000원 | 등록일 2021.04.08

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2020년 웹 개발자로 구직하며 면접에서 받았던 실제 질문 모범 답변 및 면접을 준비하며 서칭하여 찾은 실제 질문 및 답변을 정리

의 역할을 수행하는 메소드와 변수(데이터)의 묶음이다.절차적 프로그래밍의 단점이 될 수 있는 코드의 중복과 스파게티 코드가 되는 일을 방지역할 분담이 쉽고, 유지 보수하기 좋 ... +은 java.util.concurrent API, scanner class콜렉션 종류 3가지1) List(순서O, 중복 허용)- ArrayList- Vector ... 를 기반으로, 어플리케이션을 제작할 때 효율적으로 빠르게 개발할 수 있도록 하는 어플리케이션 프레임워크- 코드의 경량화 그리고 개발 중에 테스트가 쉽다- DI(Dependency

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| 자기소개서 | 11페이지 | 3,000원 | 등록일 2020.12.29 | 수정일 2021.01.04

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[분자생물학실험]E.coli 에서의 GFP발현 유도

imbalance가 생겨 DNA가 세포 안으로 빨려 들어가게 된다. Host cell로 들어간 DNA는 ampicillin 내성 유전자 (beta lactamase를 coding ... huttle vector)에 의한 유전자의 회수, 특정한 유전자를 상동교차를 통하여 특수하게 만들어진 회수벡터(retrieval vector)에 삽입시킴으로써 정상 염색체 위치

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| 리포트 | 15페이지 | 4,600원 | 등록일 2019.01.01 | 수정일 2020.08.05

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VHDL실습 메모리(ROM,RAM)설계

.서론(1) signal vs variable? signal : ① 할당은 ‘ 코드전체에서 사용가능하다.④ 순차코드 내부에서 사용될 때는 값의 갱신이 즉각적으로 이루어지지 않 ... , procedure 내부에서만 사용가능하다.④ 값의 갱신이 바로바로 이루어진다.⑤ 순차코드 내부에서만 사용가능하다.(2) ROM vs RAMBus = 8bit? ROM 설계Address = 2 ... 하는 vector를 integer로 변환해주는 function이다.enable이 1이면 값이 유효하지 않도록 data포트에 0을 출력한다. clk가 rising edge면 data에 mem

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| 리포트 | 10페이지 | 2,000원 | 등록일 2019.04.20

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논리회로실험 - 제 9장 KIT의 출력방식 중 하나인 LCD display 결과보고서

library declaration if instantiating---- any Xilinx primitives in this code.--library UNISIM;--use ... 코드의 디스플레이 데이터를 가지고 있음. D.D.RAM 내에 글자표시에 사용되지 않는 메모리 영역은 일반적인 데이터 RAM으로 사용될 수 있음.-D.D.RAM의 주소를 16진수 ... 할 것인가1) VHDL 코드를 구성하는 기본 설정(1)설계 사항-LCD 모듈을 이용하여 학번, 이름을 다음과 같이 출력한다(313881)(313305)LCK!LTI?-조원의 학번

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| 리포트 | 22페이지 | 1,000원 | 등록일 2014.08.15

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[디지털논리회로] 프로젝트 - 고속 동작 덧셈기 설계

test vector를 포함하는 test bench code를 작성한다.- Test bench code를 Quartus 또는 Modelsim 등의 시뮬레이터를 사용해 시뮬레이션을 수행 ... 에 대한 test vector를 만든다. 이때 overflow에 대한 고려가 있어야 하며 입력, 출력 공히 2‘s complement number 를 사용한다.- 전 단계에서 만든 ... 에서는 VHDL 코드 상의 지연시간이 아닌 target FPGA의 지연시간으로 시뮬레이션되므로 두 덧셈기에 대해서 같은 시뮬레이터를 사용한다.)4. 설계 과정덧셈기를 구현하기 위한 수학적 이론

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| 리포트 | 19페이지 | 1,000원 | 등록일 2014.05.06

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