"디지털논리회로실험"의 검색결과 입니다.

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논리회로 verilog HDL 실험12 멀티플렉서 논리회로 FPGA 텀프로젝트 회로 7400 전전설 fpga 시계 디코더 인코더 7 세그먼트

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"디지털논리회로실험" 검색결과 1,321-1,340 / 2,439건

최종 실험42 AND OR 결과레포트

전자회로설계 및 실험[ 실험 42. 디지털 집적회로: AND, OR 게이트결과 레포트 ]디지털 집적회로 보고서 작성 방법AND게이트, OR게이트, 혼합 AND-OR게이트의 이론 ... 적인 특징을 이해한 후 실험을 통한 출력 값에 따라 보고서를 작성하고, 실험에서 느낀 점을 부가적으로 서술할 것이다.AND게이트0 또는 1로 표현되는 논리회로에서 곱으로 표현 ... 가 1( HIGH )이 출력되는 것을 확인하는 실험이었다.OR게이트0 또는 1로 표현되는 논리회로에서 합으로 표현 가능한 OR게이트의 연산을 수행하고 이에 대한 특성 등을 실험

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| 리포트 | 6페이지 | 3,000원 | 등록일 2013.12.23

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AND,OR,NOT(결과)

.305554.28- NOT 게이트 실험입 력(V)출 력(V)54.9708(mV)3. 고찰이번 실험은 AND, OR, NOT 게이트의 작동을 실험적으로 확인해보는 시간이었다. 논리회로 ... 실험결과보고서 – AND·OR·NOT 게이트 실험`1. 목적1) 논리 게이트인 AND, OR, NOT 게이트의 동작특성을 이해한다.2) AND, OR, NOT 게이트의 진리표 ... 을 디지털 멀티미터를 이용해서 5V로 맞춘 뒤 실험을 진행하였다. 파워 서플라이에서 5V로 나타났지만 좀 더 정밀한 측정을 해보니 5V에 근사한 값으로 조금은 부족한 값이 나오고 있

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| 리포트 | 5페이지 | 2,000원 | 등록일 2013.11.18

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[텀프로젝트] 디지털소자를 이용한 시간설정 기능이 있는 `다운카운터`

99분 다운 카운터Term Project 결과 보고서목차1. 실험 제목2. 실험 목적3. 실험 이론 및 회로 동작 설명4. 실험 사용 소자5. 실험 진행 과정6. 제작 후기 및 ... 하는 숫자를 설정하여 그 시간부터 거꾸로 다운카운트 하는 다운카운터를 제작해 보자.3. 실험 이론 및 회로 동작 설명(1) 디코더 IC를 이용한 7-SEGMENT 구동 이론 7 ... 카운터 입력 단자이다. 이 실험은 다운카운트 하는 회로이므로 4번 핀을 사용하였다.? 2,3,6,7번 핀은 BCD 코드를 출력하는 단자이고, 15,1,10,9번 핀은 SW2 (DIP

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| 리포트 | 12페이지 | 1,500원 | 등록일 2011.11.20

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전자전기컴퓨터설계실험2(전전설2)4주차예비

-ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습을 위한 장치로 회로에서 많이 사용되는 Switch, LED와 같은 주변 장치를 위주로 구성 ... 하여 장비의 크기를 간단하게 만든 모델이다. 가장 큰 특징으로는 Breadboard를 가지고 있어 다양한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx ... 창 환 교수님실험조교 : 이 영 택실 험 일 : 2015년 10월 12일학 번 : 2012440이 름 :Ⅰ. 서론 (Introduction)1. 실험의 목적(Purpose of

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| 리포트 | 16페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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기본논리게이트 예비보고서

2주차 기본논리게이트 예비보고서일시 : 2013. 3. 13(수)장소 : P2041. 실험제목□ 기본논리게이트2. 실험목적□ 우리 주변의 대부분의 전자기기들은 디지털 시스템 ... 으로 이루어져 있다. “0”과“1”로 이루어져있는 디지털 시스템을 실질적으로 연산하는 과정에는 가장 기본적인 논리게이트를 바탕으로 연산이이루어진다.이번 실험에서는 기본 논리게이트인 ... High 또는 LOW이면 출력은 High가 된다.2주차 4. 실험순서□ 실험회로도4. 실험순서(계속)(1) 디지2주차 털 실험기판 위에 7408 AND 게이트를 이용하여 논리

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| 리포트 | 7페이지 | 1,000원 | 등록일 2013.11.19

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실험9결과 DAC&ADC

부터 9까지의 10진 숫자를 Clock signal에 맞추어 2진법으로 바꾼 후 이를 전압 차이로 바꿔주는 Digital to Analog 회로를 구성하였다.실험 2) ADC실험 1 ... 실험) ADCLadder type의 ADC회로이다. 입력단자 시작부와 마지막 저항을 R/2를 연결하고, 각 R 단계마다 OP amp를 연결하여 Digital 신호를 분류해낸다 ... or 접속이라고 한다. 단 하나의 풀업저항만 있어도 상관 없으며, 이는 실험 노트에 제시된 회로에서 확인할 수 있다.두 IC의 이러한 장/단점을 잘 살리기 위해 7404는 논리 회로

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| 리포트 | 6페이지 | 3,000원 | 등록일 2014.05.13

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[아주대]논리회로실험 1장[Basic gates] 예비 A+

wikipedia교재 : 디지털논리회로[이론,실습,시뮬레이션]/한빛미디어/임석구,홍경호 저Bread Board 가상 결선도실험 1실험 2실험 2 회로에서 강의노트에 논리 기호로는 AND ... 게이트는 입력단자 한 개 이상과 출력단자하나로 구성되는 전자회로이다.논리레벨영역논리0논리1TTL0V~0.8V2.5V~5VCMOS0V~1.5V3.5V~5V디지털시스템에 흐르는 전압 ... 이나 전류와 같은 전기적인 신호는 두 가지 구분된 값으로(0과 1) 인식된다. 보통은 전압으로 나타내며, 디지털 회로는 논리 1과 논리 0을 구분하기 위해 두 전압 영역에서 동작

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| 리포트 | 10페이지 | 2,000원 | 등록일 2013.09.13 | 수정일 2013.09.15

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[컴퓨터공학기초설계및실험1 예비레포트] RS 및 D 래치(Latch) / JK,T 및 D 플립플롭(Filp Flop)

는다는 것은 데이터를 저장하는 의미가 있다.참고문헌이재수/공학도를 위한 알기쉬운 디지털공학/한올출판사/2001.02.25이원석,정길수/논리회로실험/생능출판사/2010.03.05예비 ... tate) 중 어느 쪽이든지 한쪽을 보존한다. 이것을 논리 회로로 사용할 경우에는 이 두 개의 상태를 0과 1에 대응시킨다. 즉, 최초의 상태가 1이라 하면, 반대 상태의 입력이 없 ... 컴퓨터 공학 기초 설계 및 실험1예비보고서실험제목:RS 및 D 래치(Latch) (예비)JK, T 및 D 플립플롭(Filp Flop) (예비)예비보고서제목 및 목적제목RS 및 D

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| 리포트 | 7페이지 | 1,500원 | 등록일 2015.04.12

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논리결과-5-Decoder & Encoder

+500011040000+500111500000+51000실험 3에서는 십진수의 수 0~5를 excess-3 코드로 바꾸는 실험이다. 위와 같이 회로를 구성한 다음 다이오드에 불이 들어오는 것을 통해 ... 실험 5. Decoder & Encoder1. 목적- 디코딩(decoding)과 인코딩(encoding)의 코드 변환 동작에 관해 실험하고 그 동작원리를 이해한다.2. 실험 결과 ... 실험 1)? 실험 결과표InputOutputABD0D1D2D*************100100111000는 2개의 입력을 통해서 총 4개의 서로 다른 출력은 나타내는 조합회로이

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| 리포트 | 3페이지 | 1,000원 | 등록일 2012.12.23

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논리결과-7-Shift Register

결과실험 1. 6bit Shift Right Register(1) 아래와 같이 회로를 구성하라. 그리고 PR1,2 : 1, Serial Data : 0가 되도록 세팅한다.(2 ... 도 6개가 필요하다. 그림과 같이 회로를 구성한 후에 실험을 진행하였다. CLR은 모든 상태를 초기화 시키는 역할을 한다. 우선 CLR을 0에서 1로 이동시킨 후 PR1과 2를 0 ... shift Register(1) 위의 실험 2 회로에서 SER과 QE 연결하고 다시 2번 실험처럼 하여 그 결과를 관찰Shift PulseL0L1L2L3L40HHLLL1LHHLL

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| 리포트 | 3페이지 | 1,000원 | 등록일 2012.12.23 | 수정일 2013.11.07

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논리결과-10-D/A & A/D counter (DAC & ADC)

실험 10. D/A & A/D counter (DAC & ADC)1. 실험목적- D/A와 A/D 변환기(converters) 회로의 구성과 동작 원리에 대해 이해한다.- DAC ... : digital 신호를 analog 신호로 변환- ADC : analog 신호를 digital 신호로 변환2. 실험결과실험 1. DAC1) 주파수 발생기를 이용하여 계단 파형(1 ... 가 거의 유사한 것을 알 수 있다.3. 고찰이번 실험의 목적은 D/A와 A/D 변환기(converter) 회로의 구성과 동작 원리에 대해 이해한다. 이번 실험은 첫 번째 실험만 진행

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| 리포트 | 6페이지 | 1,000원 | 등록일 2012.12.23

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예비 Basic Gates

gate(논리 게이트)란? >: 디지털 회로를 만드는 데 가장 기본적인 요소로서 대부분은 두 개의 입력과 한 개의 출력을 가진다. 특정 순간에 모든 단자는 두 개의 조건 중 하나 ... - 이들 변수 간의 상관관계를 논리곱(AND), 논리합(OR), 부정(NOT) 등의 연산자로 논리적으로 나타낼 수 있다불 대수의 이 2가지 측면은 디지털 계산에 사용되는 전자 회로 ... 1. 실험목적- Logic gates의 이해- Logic 회로 구성 법칙의 이해 : Boolean equation의 이해, De Morgan의 법칙 이해2. 실험이론< Logic

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| 리포트 | 5페이지 | 1,500원 | 등록일 2013.12.26

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HBE-ComboⅡ-SE 보드, Xilinx 스파르탄3 FPGA 칩, ISE 디지털 디자인 툴

error)Inlab 1. And gate 프로그래밍 : 이 실험에서는 먼저 참고 강의자료를 보면서 Prelab을 통해서 미리 설계해 본 논리회로를 가져와서 장비에 연결 후 작동 ... Post-Lab Report- Title: Lab#02_HBE-ComboⅡ-SE 보드, Xilinx 스파르탄3 FPGA 칩, ISE 디지털 디자인 툴 -담당 교수담당 조교실 험 ... 일학 번이 름목 차< 초록 (Abstract) >1. Introduction (실험에 대한 소개)가. Purpose of this Lab나. Essential Backgrounds

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| 리포트 | 23페이지 | 3,000원 | 등록일 2016.04.06 | 수정일 2017.03.08

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Decoder, encoder와 multuplexer, demultiplexer 결과 report

Decoder, encoder와 multuplexer, demultiplexer2. 결과 분석1. 다음 그림 11.1의 회로를 구성하고 표 11.1의 진리표를 실험에 의해 완성하라. 입력 ... 즉 E1가 High일 때 모든 출력이 High가 되었다3. 다음 그림 11.3의 회로를 구성하고 표 11.3의 진리표를 실험에 의해 완성하라.- 실험 시 BreadBoard 위 ... 11.5의 회로를 구성하고 표 11.5의 진리표를 실험에 의해 완성하라.- 실험 시 BreadBoard 위에 11.5의 회로 74151를 구성하였다. 입력단자 D0, D3, D4

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| 리포트 | 9페이지 | 2,000원 | 등록일 2015.11.01

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논리결과-8-Counter

으로 들어가기 때문에 비동기식 Counter라고 할 수 있다. 실험 1 회로의 원리는 J와 K에 모두 H가 걸려있기 때문에 출력 값은 이전 값의 보수가 되어야 한다. 따라서 ... 하게 Clock 펄스가 들어가기 때문에 동기식 Counter라는 것을 알 수 있다. 실험 2의 회로에서 주목할 점은의 출력이 J의 입력으로 들어간다는 점이다. 따라서 회로의 최초 ... 에는 A와 B모두 처음 상태인 Low를 출력하게 된다. 이렇게 되면 총 3가지의 2진의 수가 나오게 되는데 00(BA), 01(BA), 10(BA)이 3가지의 수이다.실험 3은 회로

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| 리포트 | 4페이지 | 1,000원 | 등록일 2012.12.23

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아주대학교 논리회로실험 실험6 예비보고서

할 수 있는 회로이며 순차 회로의 기본요소이다. 조합논리회로에 비해 플립플롭은 이전상태를 계속 유지하여 저장한다. 디지털 공학에서 입력을 출력에 반영하는 시점을 클럭 신호의 순간 ... 1. 실험목적여러 종류의 filp-flop을 구성하고 그 동작 특성을 알아본다.2. 실험이론래치와 플립플롭은 대부분의 순차 회로를 구성하는 기본적인 블록이다. 래치와 플립플롭 ... 을 사용하는 전형적인 디지털 시스템은 미리 구성 되어 있으며, 표준 직접 회로를 기능적으로 규정한 소자이다. ASIC 설계 환경에서는 래치와 플립플롭은 전형적으로 ASIC 제작회사

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| 리포트 | 13페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02

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[A+ 예비보고서] 아주대 논리회로실험 실험3 '가산기& 감산기'

에 더함으로써 구할 수 있다. 이 방법에 의하면 뺄셈은 전가산기를 사용하는 덧셈이 된다. 그러나, 뺄셈을 직접 수행하는 논리 회로를 구성하여 뺄셈을 할 수도 있다. 이번 실험에서는 전 ... 실험 3 예비보고서1. 실험목적-Logic gates를 이용하여 가산기(adder)와 감산기(subtractor)를 구성하여 동작을 확인해본다.-디지털 시스템의 기본 요소인 가산 ... 과 차이점을 이해한다.2. 실험이론●가산기(adder)-이번에 실험할 가산기에는 전가산기(full adder: FA)와 반가산기(half adder: HA)가 있는데, 간단

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| 리포트 | 5페이지 | 1,000원 | 등록일 2015.03.27

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실험3예비 Adder&Subtracter

되는 논리 회로의 하나. 반 덧셈기라고도 한다. 반가산기는 2개의 디지털 입력(비트)을 받고, 2개의 디지털 출력(비트)을 생성한다. 덧셈해야 할 2개의 비트를 받아서 2개의 출력 ... [실험3] Adder & Subtracter1. 목적- Logic gate를 이용해서 가산기(adder)와 감산기(subtracter)를 구성한다.- 디지털 시스템의 기본 요소인 ... 에는 LED를 연결해서 HIGH/LOW를 판별하는데, 반드시 저항을 직렬로 연결해서 LED에 과도전류가 흐르지 않도록 한다. 컴퓨터 내에서 2진 숫자(비트)를 덧셈하기 위한 논리 회로

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| 리포트 | 4페이지 | 2,000원 | 등록일 2014.05.13

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2016년 하반기 S-OIL 합격 자기소개서(전기전자)

시장의 1위로 만들겠습니다.첫째, 사소한 것을 놓치지 않는 세심한 사람입니다. 공정은 작은 오차가 존재하면 엄청난 손해를 미치는 과정으로 꼼꼼함이 동반 되어야합니다. 디지털 논리 ... 중, 전자회로 과목을 통해 Pspice를 통한 기초 회로 설계의 기반을 다졌고 네트워크 실험을 통해 회로 설계에 필요한 각 프로그램(JAVA, 리눅스)을 배우며, 좀 더 나은 공정 ... 코드 책을 공부하고 수차례 시뮬레이션 한 결과, 어려운 프로젝트를 완벽하게 구현했습니다.둘째, 기술직 업무로서 기기 설비에 필요한 회로 설계의 지식을 탄탄히 다졌습니다. 학부 과정

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| 자기소개서 | 2페이지 | 3,000원 | 등록일 2016.12.06

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디지털회로응용설계(자동차 과속 경보장치 설계)

2. 본 론 자동차 과속 경보장치 전체 블럭도실험1자동차 입력신호의 디지털 정형화 회로? 연산 증폭기인 LM311과 슈미트 트리거 74LS14로 구성? 자동차에서 발생하는 정현파 ... 와 직접 연결할 수 있는 디지털 신호이다.● CH 1 : 입력신호● CH 2 : COMP신호 - TP1● CH 1 : 입력신호● CH 2 : Sout신호실험 2 주파수 증배회로? 주파수 ... 보 고 서(디지털 회로 응용설계 최종보고서)`교과목 명디지털회로응용설계설계자성 명소 속학 번학 년연 락 처과제 명자동차 과속 경보장치 설계개발기간2013년 월 일 ～ 2011년

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| 리포트 | 22페이지 | 3,800원 | 등록일 2014.01.03 | 수정일 2014.11.05

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