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논리회로 verilog HDL 실험12 멀티플렉서 논리회로 FPGA 텀프로젝트 회로 7400 전전설 fpga 시계 디코더 인코더 7 세그먼트

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방송통신대 - 2025 방송통신대 리포트 및 과제물 업데이트, 중간고사/기말고사자료
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"디지털논리회로실험" 검색결과 1,401-1,420 / 2,439건

  • 자료 표지
    디지털공학실험 결과보고서
    2주. 플립플롭 [결과 보고서]* 실험결과 보고 사항(1) 표 1을 예비보고사항 (2)와 비교하고, 이로부터 레이스 조건을 설명하여라.-> 레이스 조건은 두 가지 입력이 정확 ... 이 같은 시점에 들어와야 실행이 되는 것을 의미한다.즉 둘 다 1 이 들어와도 약간의 시간적 오차가 있으면 회로에선 잠시 동안 1, 0 이 입력되는 것으로 인식하게 된다. 실재 ... 회로에서는 이것을 맞혀주기 위해서 not 회로를 이용하거나 다른 장치들을 이용하여 동시에 입력이 들어 올수 있도록 한다. 레이스 조건이 잘 맞아야 회로에 잡음이 없이 정확한 값이 들
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 1,000원 | 등록일 2012.12.18
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  • 자료 표지
    부울대수의정리
    실험예비보고서 – 부울대수의 정리1. 실험 목적1) 부울대수(Boolen algebra)의 기본적인 공리와 정리를 이해하고 증명한다.2) 부울대수식을 이용한 논리회로의 간략화 및 ... 의 타이밍도에 기록한다.(1) 논리회로 실험장치 또는 전원공급기의 공급전압을 DC +5[V]로 설정하고, 오실로스코프 또는 멀티미터(검은색 선은 접지의 접속, 붉은색 선은 전원 또는 신호 ... 출력단에 접속)를 사용하여 전압을 확인한다. 전원을 OFF하고 다음 순서대로 실험을 진행한다.(2) 논리회로 실험장치 또는 브레드보드에 IC를 부착하고 (그림 1-1과 그림 1
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 2,000원 | 등록일 2013.11.18
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    실험10 신호발생기와 오실로스코프 사용법 예비레포트
    :analog-to-digital converter)가 사용된다. 아날로그와 디지털 장비에 있어 외관의 차이는 거의 없지만 디지털 오실로스코프는 아날로그 오실로스코프에 비해 신뢰 ... 부분이 대칭성을 갖는 구형, 정현, 삼각파에 있어 그 두 부분이 차지하는 비율을 조절하는 것을 뜻한다. TTL(PUSH)/CMOS(PULL) : TTL/CMOS 논리회로의 입력파형 ... 예비 보고서제출일 : 2014년 5월 14일실험 제목신호발생기와 오실로스코프 사용법실험 목적이 장에서는 신호발생기와 오실로스코프의 기본적인 사용법을 익히는 실험을 한다.실험 이론
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 1,000원 | 등록일 2014.08.30
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    아주대 논리회로실험 프로젝트 FPGA로 Stop Watch 만들기
    와 K가 모두 1인 때를 제외하고는R-S F/F의 동작과 똑같다.3) 래치 (D Latch): 디지털 논리회로에 있어서 Latch는 하나 이상의 비트를 저장하기 위한 디지털 논리회로 ... 1. 설계 목적- FPGA를 이용하여 Stop Watch를 구현해보는 것이다. Quartus2 프로그램을 이용하여 Stop Watch가 작동할 수 있는 회로를 구성한 뒤 ... )를 이용하여 확장보드로써 브레드보드에 연결하여 실험을 진행한다.3) JP2 핀의 구성4) 플랫케이블에서 양쪽띠 핀 중 1번 핀을 찾는 방법: 케이블 끝 쪽에 삼각형 표시가 있
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    | 리포트 | 15페이지 | 5,000원 | 등록일 2015.03.12
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    아주대 논리회로실험 실험결과3 가산기와 감산기(Adder & Subtractor)
    실험으로 위의 진리표에서 알 수 있듯이 실험에서 구성한 회로 가 이론상의 반가산기의 결과와 정확히 일치했다. 결과를 보면 1+1을 했을 때 C(carry)는 1의 출력 을 S(s ... .9mV05.7mV11114.22V14.82VSimulationComent : 이번 실험은 전감산기를 구성해 동작을 확인해 보는 실험이었다. 회로를 분석해보면 최초 X와 Y를 비교 ... ubtractor)를 구성하여 동작을 확인해 보고 이를 바탕으로 디지털 시스템의 기본 요소인 가산기와 감산기의 기본 구조 및 동작 원리를 이해하는 실험이었다. 평소에 가산기와 감산기라는 용어
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    | 리포트 | 7페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03
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    디지털실험 11 예비 멀티 바이브레이터
    디지털 실험 예비보고서실험 11. 멀티 바이브레이터실험 목적1. 비안정 멀티 바이브레이터의 동작을 이해한다.2. 비안정 모드에서 사용된 555 타이머의 동작특성을 실험적으로 입증 ... , 51, 2kΩ캐패시터 0.01, 0.1, 1uF전원공급기, 오실로스코프, 함수발생기실험방법1.처럼 회로를 연결하고 RA=1[㏀], RB=4.7[㏀], C=0.1[㎌]을 사용하여라. 3번 핀의 출력파형을 관측하여 파형을 자세히 그려라. ... 로 나타난다.문턱 및 출력 전압2. 비안정 멀티 바이브레이터비안정 멀티 바이브레이터는 안정되지 않는 두 개의 다른 상태를 갖는 스위칭 회로이다. 즉 이 회로는 두 개의 안정되지 않는 상태
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2014.09.30
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    Term Project (7세그먼트 실험) 보고서
    Term Project- 7세그먼트 실험 -과 목: 디지털회로실험 및 설계교수명:학 과:조번호:학 번:이 름:1. 실험목표7세그먼트(FND)에 대해 알아보고 7세그먼트 디코더 ... 로 작동하는 논리회로를 구성하여 동작을 실험하고 결과를 관찰한다.2. 실험이론1) 7세그먼트(FND)7세그먼트는 LED 8개가 내장되어 있는 소자로, 7개의 LED를 조합하여 숫자 ... 때 불이 들어오는 것은 공통 GND를 이용하는 Common Cathode 방식이다. 자세한 내부 구조는 그림 (b)와 같다.2) 디코더디코더(Decoder)는 디지털 조합 논리회로
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    | 리포트 | 13페이지 | 2,000원 | 등록일 2013.05.07
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  • 자료 표지
    전전컴설계실험2-8주차결과
    번 실험은 순차 논리 회로에 대해 기본 개념을 이해하고 Flip-Flop과 4-bit Shift Register의 순차 논리 회로를 직접 설계하는 과정을 통해 이론적인 내용과 실제 ... Simulation과 하드웨어 장비동작으로 검증해본다.(2)Essential Backgrounds for this Lab-순차 논리 회로입력의 조합만으로는 출력이 정해지지 않 ... 는 논리 회로로, 현재의 내부 상태와 입력에 의해 출력의 상태가 정해지는 것. 즉, 기억 작용이 있는 논리 회로이다. 예를 들면, Hyperlink "http://terms.naver
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    | 리포트 | 16페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
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    디지털실험 8 예비 실험 8. CMOS – TTL interface
    디지털 실험 예비보고서실험 8. CMOS TTL interface실험 목적1.COMS의 동작을 이해한다.2.COMS와 TTL interface방법에 대하여 이해한다.이론 ... 한 구동을 위해서 어떻게 해야 할지를 기술하라4001로 구성한 회로이다. 이론적인 low의 최대값 1.666과 high의 최소값 3.3334를 줘서 0을 기대하고 실험했는데 2 ... _{NH}=1.38V이다.실험 준비물SN7406SN7401SN7411SN7450저항 (470, 1K, 4.7K, 10K, 15K, 47K)Ω전원공급기, 오실로스코프, 함수발생기의 회로
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    | 리포트 | 13페이지 | 1,000원 | 등록일 2014.09.30
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    디지털 공학 및 실습 예비레포트(6주차)
    디지털 공학 및 실습 예비레포트(6주차)1. 실험 제목 : 드모르간의 정리2. 실험 목표 : 회로를 구성하여 논리식을 구하고 드모르간의 법칙을 적용하여 이해도를 높인다.3. 사용 ... 7404(Hex Inverter)- IC 7408(Quad 2-input AND)- IC 7432(Quad 2-input OR)4. 실험순서1) (a)와 (b)의 회로에서 출력 X ... 값은 다음과 같다.2) (a)와 (b)의 회로에서 출력 X, Y의 이론 값과 논리식을 구하여 기록하고, 실험을통하여 출력 X와 Y를 측정하여 표에 기록하여라.*예상결과첫 번
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2013.06.09
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  • 자료 표지
    전전컴설계실험2-Final Report
    FSM이란 '제한된 상태들의 변화를 순차적으로 나타내는 장치'라고 또다시 표현할 수 있다. FSM는 디지털 논리에서 회로를 꾸미고자 할 때 중요하게 사용되는 방법중의 하나입니다 ... 을 구현 하는 것이 목표이다. 이제까지 실험하였던 TEXT LCD 실험을 바탕으로 Digital Clock이 가지는 기능을 잘 이해하고, 명령어와 data입력을 확장시켜 시계를 구현 ... Backgrounds for this Lab-FINITE STATE MACHINEFSM은 일반적으로 디지털회로를 꾸밀 때 사용하는 중요한 기법중의 하나이다. 순차적인 디지털 회로
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    | 리포트 | 24페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
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    전전컴실험Ⅱ 06반 제09주 Lab#07 [FSM, Counter] 결과보고서
    다. FSM는 디지털 논리에서 회로를 꾸미고자 할 때 중요하게 사용되는 방법중의 하나입니다. 주로 마이크로 프로세서 뿐만 아니라 디지털로 꾸밀수 있는 모든 회로들의 주요 콘트롤러 ... ://term반적으로 디지털회로를 꾸밀 때 사용하는 중요한 기법중의 하나이다. 순차적인 디지털 회로의 상태 변화를 나타내는 방법이로, FSM에서 앞 글자 finite는 아시겠지만 '제한적인 ... (1) 장비들은 주의해서 사용하도록 한다.(2) 예측 가능한 오류들은 최대한 피한다.(3)실험 회로를 꾸밀 때에는 장비의 전원을 OFF한다.(4)회로를 완성하고 전원을 키기 전
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    | 리포트 | 12페이지 | 1,500원 | 등록일 2013.09.09 | 수정일 2013.09.15
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  • 자료 표지
    엔코더와 디코더 회로 결과보고서
    ,D2,D3)A=0 B=0입력시A=1 B=0입력시결과 해석실험1번의 경우 디코더 회로의 설계를 나타낸 것으로 다중-입력, 다중-출력의 논리회로이다. 그리고디코더의 경우 조합회 ... 4장 결과보고서 2009069160 김기훈실험 (1)다음 그림의 회로를 구성하고, 진리표를 구하여 표로부터 D0-D3의 논리식을 AB로 나타내어라.입력값실험결과 사진(D0,D1 ... .02V5.04V실험 (2)다음은 7-segment의 진리치표이다. 회로를 구성하여 7-segment LED를 구동 확인하고 0-9숫자의 논리식을 표시하라.입력값실험결과 사진(S,C
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2014.06.03
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  • 자료 표지
    서울시립대학교-전자전기컴퓨터설계실험2-제07주-Lab06-Post
    -Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소. ... Post-lab Report전자전기컴퓨터설계실험Ⅱ7주차. Sequential Logic Design, Flip-Flop, Register and SIPO실험 날짜2016. 10
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2017.09.04
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    전전컴실험Ⅱ 06반 제15주 Project [최종보고서] 전자시계, digital watch
    만큼 있다는 것을 뜻한다. 따라서 FSM이란 '제한된 상태들의 변화를 순차적으로 나타내는 장치'라고 또다시 표현할 수 있다. FSM는 디지털 논리에서 회로를 꾸미고자 할 때 중요 ... /down동작을 button을 통해 구현한다.2. 기본 이론(1) FINITE STATE MACHINE(가) FSM은 일반적으로 디지털회로를 꾸밀 때 사용하는 중요한 기법중의 하나이 ... 다. 순차적인 디지털 회로의 상태 변화를 나타내는 방법이로, FSM에서 앞 글자 finite는 아시겠지만 '제한적인'이란 뜻이 있듯이 이러한 상태(state)들이 제한된 숫자
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2013.09.09
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    전전컴실험Ⅱ 06반 제15주 Project [최종보고서] 전자시계, digital watch
    다는 것을 뜻한다. 따라서 FSM이란 '제한된 상태들의 변화를 순차적으로 나타내는 장치'라고 또다시 표현할 수 있다. FSM는 디지털 논리에서 회로를 꾸미고자 할 때 중요하게 사용 ... /down동작을 button을 통해 구현한다.2. 기본 이론(1) FINITE STATE MACHINE(가) FSM은 일반적으로 디지털회로를 꾸밀 때 사용하는 중요한 기법중의 하나이 ... 다. 순차적인 디지털 회로의 상태 변화를 나타내는 방법이로, FSM에서 앞 글자 finite는 아시겠지만 '제한적인'이란 뜻이 있듯이 이러한 상태(state)들이 제한된 숫자만큼 있
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2013.09.09 | 수정일 2013.09.15
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    실험2 제07주 Lab05 Post Mux & DMux & BCD
    Circuit의 동작원리와 설계 방법을 익히는 심화된 실험이었다. 조합 논리 회로는 Output이 Input에 의해 변하는 회로이다. Lab 1, 2, 3의 경우를 살펴볼 때, Output ... . Reference1. Introduction1) Purpose of this Lab출력이 오로지 입력에 의해 영향을 받는 조합 논리 회로(Combinational Circuit ... ) 중 Multiplexer와 Decoder, 그리고 BCD to Excess-3 Code Converter를 설계, 제작함으로써 조합 논리 회로의 성질을 이해할 수 있다.2
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    | 리포트 | 11페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17
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    논리회로실험. 실험10. D/A & A/D converter(DAC & ADC)
    한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2015.11.27과목명: 논리회로실험(결과보고서)교수명: 최연익 교수님 ... 을 위해 다음의 회로를 구성해야 한다.우선적으로 이번 실험에서 계단 파형을 만들어내는 BCD 카운터 74HC90에 대해 살펴보자. 다음은 74HC90의 블록도이다.- BCD 코드 ... 엣지에서 0001씩 증가하다가 1001에서 다시 0000으로 돌아가 순환하는 즉, BCD코드가 반복되는 순환회로를 구성하게 된다.- 실험 시작전 항상 카운터를 초기상태로 0000
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    | 리포트 | 13페이지 | 2,000원 | 등록일 2015.12.21 | 수정일 2016.06.02
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    디지털로직실험/최신 디지털 공학 실험 14 D래치와 D플립플롭
    NAND 게이트7404 6조 인버터7474 2조 D 플립플롭저항 : 330Ω 2개, 1.0kΩ 2개이론 요약지금까지 본 것처럼 조합논리(combinational logic) 회로 ... 는 출력이 완전히 입력에 의해서만 결정되는 회로이다. 순차 논리(sequential logic) 회로는 이전 상태에 관한 정보를 포함하고 있다. 차이점은 순차 회로만이 메모리 ... 다.8. 이제 클럭 지연 회로를 제거하여 펄스 발생기와 클럭 입력을 직접 연결하여라. 불충분한 셋업 시간으로 인해 출력 DC 레벨이 변경되었을 것이다. 실험 보고서에 관찰 내용
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    | 리포트 | 18페이지 | 1,000원 | 등록일 2014.06.29
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    [실험 예비 보고서] 디지털 I/O 기초 실험
    디지털 I/O1. 실험 목적디지털 전자기기는 현대 컴퓨터를 구성함에 있어 가장 핵심이 되는 부분입니다. 디지털 라인을 설정하고 측정하는 일을 수행하는 능력은 디지털회로 파악에 있 ... 어 필수적인 것입니다. 이에 NI ELVIS를 활용하여 디지털 클록, 디지털 카운트, 그리고 논리적 상태를 실험을 통해서 이해하는 것이 실험의 주목적입니다.2. 실험 장비 및 부품 ... 여 디지털 회로에서 흔히 사용되는 카운터를 구현할 수 있다.4. 실험 내용1) 디지털 바이트 패턴 표현하기NI ELVIS protoboard(NI ELVIS 장치 위에 장착된 브레드 보드
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2012.11.06 | 수정일 2014.01.12
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