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"아날로그 및 디지털 회로 설계실습" 검색결과 101-120 / 735건

  • [A+]아날로그및디지털회로설계실습 2장 결과보고서
    SMPS는 일정한 직류 출력 전압을 부하에 공급해주는 직류 안정화 전원으로, PWM 제어회로를 이용한다. PWM 제어회로는 출력 전압과 기준 전압을 비교하여 생긴 오차를 오차 ... onverter, Boost converter을 구성하고 SMPS의 동작 원리에맞게 출력되는지 확인해보도록 한다.2. 실험 결과2-4-1 PWM 제어회로예비보고서에 작성한 것과 같이 위 설계도 ... 와 같이 회로도를 구성하였다. 각주에 표시된 것과 같이 회로도의 1번 저항은 5.08kΩ, 2번은 9.94Ω, 3번은 1.28kΩ 값의 저항으로 실험을 진행하였다. 실험은 출력전압이 0~10V로 12.5kHz로 스위칭하는 동작을 목표로 하였다.
    리포트 | 11페이지 | 1,000원 | 등록일 2024.02.18
  • [A+]아날로그및디지털회로설계실습 5장 결과보고서
    amplifier) 를 이용한 적분기 구조의 Relaxation 타입 전압제어 발진기를 실습한다. 이 발진기는 적분회로에 인가 되 는 입력 전압의 크기에 따라서 출력전압이 일정한 값 ... 에 도달하는 시간이 변하는 것을 이용하여 출력 주파수를 제어하는 구조이다. 회로는 OP amp를 이용한 적분기와 스위치 역할을 하는 BJT 그리고 비교기 로 사용될 슈미트회로 ... 로 구성된다. 본 실험에서 그림 3의 적분회로를 응용한 전압제어 발진기 회로를 구성하여 제어 전압 Vc를 0.5V단위로 하여 0.5V부터 4.5V까지 변화시키며 Oscilloscope
    리포트 | 7페이지 | 1,000원 | 등록일 2024.02.18
  • [A+]아날로그및디지털회로설계실습 8장 결과보고서
    (A) RS 래치 그림 11-1은 교차교합(Cross-coupled)된 두 NOR 게이트로 만들어진 순차식 회로로, RS 래치라고 불리는 기본 기억소자장치이다.입력 R이 1일 때 ... 경우에는 현재 상태의 Q와 ~Q값을 그대로 유지하 게 된다. 위와 같이 두 개의 NOR 게이트로 이루어진 회로를 RS 래치라 부른다.(B) RS 래치의 타이밍 특성 출력 Q는 동시 ... 이 edgetriggered 플립플롭이다. Edge-triggered 플립플롭들은 게이트 상호 간의 작은 시간딜레이(delay) 차이를 이용하거나 다소 복잡한 회로를 구성하여 클록 신호가 바뀌는 동안
    리포트 | 8페이지 | 1,000원 | 등록일 2024.02.18
  • 판매자 표지 자료 표지
    아날로그 디지털회로 설계 실습 실습5_전압제어 발진기_예비보고서
    설계 실습5. 전압 제어 발진기5-1. 목적전압제어 발진기(VCO: Voltage Controlled Oscillator)를 설계하고 전압을 이용한 발진 주파수의 제어를 실험 ... 으로 확인한다.5-2. 준비물 유의사항부품저항 100Ω, 1/2W, 5% : 3개저항 5.1kΩ, 1/2W, 5% : 1개저항 10kΩ, 1/2W, 5% : 1개저항 20kΩ, 1
    리포트 | 6페이지 | 1,000원 | 등록일 2024.08.27
  • 판매자 표지 자료 표지
    아날로그 디지털 회로 설계 실습 결과보고서7 논리함수와 게이트
    아날로그 디지털 회로 설계 실습-실습 7 논리함수와 게이트-설계실습 내용 분석설계한 논리게이트 구현 동작Low(0) 값, High(1) 값, Vcc를 각각 0V, 5V ... 었다. 특히 이번 실습은 현재 배우고 있는 ASIC 설계 과정과 맞물려 그간의 Digital 회로의 가장 기본적인 게이트의 특성을 이해하는 데 많은 도움을 주었다. 또한, 이번 ... 을 하였으며 그 결과는 어떤가? 수치를 포함하여 요약한다. 설계실습계획에서 설계회로와 실제 구현한 회로의 차이점을 비교하고 이에 대한 이유를 서술한다. 설계실습이 잘되었다고 생각
    리포트 | 24페이지 | 2,000원 | 등록일 2023.09.05 | 수정일 2023.10.24
  • 판매자 표지 자료 표지
    아날로그 디지털 회로 설계 실습 결과보고서8 래치와 플립플롭
    아날로그 디지털 회로 설계 실습-실습 8 래치와 플립플롭-8-4 설계실습 내용 분석PSPICE를 활용한 RS래치 구현 동작PSPICE를 사용하여 그림 9-1의 회로 ... )의 형식으로 작성하되, 다음 사항을 검토하여 작성하라.-본 설계실습에서 무엇을 하였으며 그 결과는 어떤가? 수치를 포함하여 요약한다. --설계실습계획에서 설계회로와 실제 구현 ... 한 회로의 차이점을 비교하고 이에 대한 이유를 서술한다.-설계실습이 잘되었다고 생각하는가? 실습이 잘되었거나 못 되었으면 그 이유를 생각하여 서술한다.이번 설계실습에서는 clk값
    리포트 | 11페이지 | 2,000원 | 등록일 2023.09.05 | 수정일 2023.10.24
  • 실습6.위상제어루프PLL 예비보고서 중앙대 아날로그 디지털 회로 설계 실습
    디지털 회로아날로그 회로 둘 다에서 사용되는데 디지털 시스템에서는 위상을 맞추어주는 클럭에 이용, 통신에서 PLL 은 원하는 주파수를 수신, 송신할 수 있게 만들어준다 ... 와 feedback 회로로 들어온 신호의 주파수를 비교하여 그 위상 차이를 검출해낸다.실험에서는 XOR gate 를 이용하였다.2. 루프필터 Loop filterXOR gate ... 에서 검출해낸 위상을 전압의 크기로 VCO 를 제어하는 dc 전압으로 바꿔주는 역할을 한다. (적분기) 이때 전압의 크기는 위상 차이의 평균 전압이다. RC 회로로 구성된 LPF 를 사용
    리포트 | 14페이지 | 1,000원 | 등록일 2021.07.17
  • 판매자 표지 자료 표지
    A+ 아날로그디지털회로설계 실습 예보_신호 발생기
    리포트 | 6페이지 | 1,000원 | 등록일 2022.03.27
  • A+ 중앙대 아날로그및디지털회로설계실습(예비)11. 카운터 설계
    리포트 | 3페이지 | 1,500원 | 등록일 2022.09.10
  • [A+]아날로그및디지털회로설계실습 6장 결과보고서
    전자회로 설계실습설계실습 6. 위상 제어 루프(PLL)4조 결과보고서요약: 위상 제어 루프를 설계하고 출력신호가 입력신호와 같아지는지 특성을 확인하였다. function ... 그림 \* ARABIC 5 Pspice로 설계회로서론의 [그림 1]과 같이 위상검출기 – RC 루프필터 – Vco로 피드백 회로설계하였다.출력파형은 5.361Vpp, 1 ... 출력 위상의 차이 로 주파수의 차이는 이 되므로 위상 고정이 되었다는 것은 입력과 출력 주파수가 같아진다는 것을 말한다.(B) PLL 회로위상제어루프 회로는 1. 위상 검출기, 2
    리포트 | 19페이지 | 1,000원 | 등록일 2024.02.18
  • [A+]아날로그및디지털회로설계실습 11장 결과보고서
    요약: dual JK Flip Flop을 사용하여 비동기식 카운터 동기식 카운터를 만들고 그 원리를 이해한다.1. 서론Dual JK Flip Flop 소자인 74HC73 ... 며 이것을 ‘분주회로’의 특성으로 볼 수 있다. 때문에 각 stage의 결과값을 이진법기준으로 한자리씩 할당하였을 때, 그 결과값은 clk가 한 주기 지날때마다 1(2)씩 증가 ... 하는 결과를 출력할 수 있다. 즉, 카운터를 설계할 수 있다.반면 동기 카운터는, 모든 FF가 동일한 clk 신호를 공유한다. 하나의 clk signal을 공유하기 때 문에 앞선 비동기
    리포트 | 10페이지 | 1,000원 | 등록일 2024.02.18
  • 아날로그 디지털회로설계실습 9 부울대수 조합논리회로 예비 리포트
    설계실습 9. 부울대수 조합논리회로요약: 이번 보고서를 통해 부울대수 조합논리회로를 학습했다. 전가산기의 진리표를 작성하고 Karmaugh 맵을 통해 불리언식을 알아보 ... 은 n개의 1비트 가산기를 서로 연결해주는 것이다.위의 회로들을 이용하여 2Bit 가산기 회로설계하면결론: 이번 보고서를 통해 부울대수 조합논리회로를 학습했다. 전가산기 ... 았다. 이를 ORcad를 통해 2-level회로설계했으며 그 후에 XOR gate를 간단화 한 회로설계했다. 2Bit 가산기 회로설계했다.서론: 전가산기는 3개의 이진수
    리포트 | 4페이지 | 1,000원 | 등록일 2021.09.02
  • 판매자 표지 자료 표지
    A+ 아날로그디지털회로설계 실습 예보_stopwatch tjfrP
    리포트 | 2페이지 | 1,000원 | 등록일 2022.03.27
  • A+ 중앙대 아날로그및디지털회로설계실습(결과)11. 카운터 설계
    을 진행해주신 조교님께 감사의 인사를 드린다.4. 참고문헌(보고서 작성에 참고한 문헌을 번호로 나열하며 본문에서 인용된 부분에 이 번호를붙인다.)1. 중앙대학교 전자전기공학부, “아날로그 디지털 회로 설계 실습”, pp 87-91 ... . 설계실습 방법11-4-1 비동기 8진 카운터 설계(A) 그림 11-1과 같이 회로를 결선한다.(B) 출력 Q1, Q2, Q3에 LED를 연결한다. (330Ω저항과 LED를 직렬 ... -2 비동기 동기 16진 카운터 설계(A) 설계실습 계획서를 참고하여 16진 비동기 카운터를 결선한다.led는 위에서부터 순서대로 Q1, Q2, Q3, Q4이다.(B) 설계실습
    리포트 | 5페이지 | 1,000원 | 등록일 2022.09.10
  • 판매자 표지 자료 표지
    아날로그및디지털회로설계실습 (예비)설계실습 2. Switching Mode Power Supply (SMPS) A+
    2-3-1 PWM칩(UC3845)을 이용하여 아래 성능의 PWM 제어 회로설계하시오. - 출력전압 : 0 V ~ 10 V (peak to peak) - 스위칭 주파수 f
    리포트 | 3페이지 | 1,000원 | 등록일 2024.12.23
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  • [A+]아날로그및디지털회로설계실습 7장 결과보고서
    에서 디지털 신호 HIGH는 5V로, LOW는 0V로 설정하여 구분하였다. 동시에 각 게이트에 넣는 전원전압도 5V로 공통되었는데 각 논리 소자는 정격 동작 전압이 5V이기 때문에 입력
    리포트 | 11페이지 | 1,000원 | 등록일 2024.02.18
  • [A+]아날로그및디지털회로설계실습 10장 결과보고서
    전자회로 설계실습설계실습 10. 7-segment / Decoder 회로 설계4조 결과보고서1. 서론7segment LED는 숫자를 표시하는 7개의 LED와 소수점을 나타내는 1 ... 있어 7-segamet의 type이 anode common type임을 확인하였다.2) 7-Segment 구동 회로 설계설계 실습 계획서 10-3-3에서 그린 7-Segment ... 을 확인하였다. [실험 2.2] 확인한 결과와, 서론에서 언급한 진리표, boolean 식을 활용하여 회로설계하였다.2진수의 디지털 신호를 통해서 7-segment LED에 10
    리포트 | 8페이지 | 1,000원 | 등록일 2024.02.18
  • 아날로그 디지털 회로설계실습 2주차 초전형 적외선센서
    아날로그 디지털회로 설계실습예비 REPORT1. 초전형(Pyroelectric) 적외선 센서분 반교 수 명실험 날짜2020. 09. 08제출 날짜2020. 09. 08조학 번 ... 이 름요약 : 센서가 인체의 움직임을 감지하였을 때 발생하는 전압의 변화를 검출할 수 있는 초전형 센서 회로설계하였습니다. 이를 통해 초전형 적외선 센서, LED, Op-Amp ... 의 원리를 이해할 수 있었습니다.1. 서론센서가 인체의 움직임을 감지하였을 때 발생하는 전압의 변화를 검출할 수 있는 초전형 센서 회로설계함으로 초전형 적외선 센서, LED
    리포트 | 3페이지 | 1,000원 | 등록일 2021.12.14
  • [A+]중앙대학교 아날로그및디지털회로설계실습 Stopwatch 설계 과제
    위 표를 보면, 16분주 회로가 16진수의 수를 어떻게 만들어 내는지, 이를 10진수의 카운터로 바꿀 수 있는 방법을 소개하고 있다. 자세히 보면, 10진수가 되려면 10이 되
    리포트 | 2페이지 | 1,000원 | 등록일 2021.09.02
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2025년 10월 10일 금요일
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