"레지스터 설계"의 검색결과 입니다.

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atmega128 전자계산기 구조 verilog ssafy 스텝 모터 구동기 디지털시스템실험 중앙대 마이크로 쉬프트 레지스터 atmega128 프로젝트

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"레지스터 설계" 검색결과 881-900 / 2,202건

논리회로실험 - 제 9장 KIT의 출력방식 중 하나인 LCD display 결과보고서

과 목 : 논리회로설계과 제 명 : 결과보고서 9담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 6 / 31 ... . IntroductionVHDL의 순차 논리 회로 설계에서 KIT의 출력방식 중 하나인 LCD display에 대해서 이론적으로 공부해보고 이를 KIT에 올려서 실습해보는 실험이다. LCD는 5*8 ... 의 점으로 구성되어 있고 이 점들을 모아서 글자의 형태로 되어진 설계가 이미 되어있다. 우리는 이번 실험에서 이미 만들어진 글자의 형태를 가지고 학번과 이니셜을 출력해보는 설계

리포트 | 22페이지 | 1,000원 | 등록일 2014.08.15

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레지스터 실험(예비)

? 실험 제목 : 레지스터 실험? 실험 일자 : 2011년 11월 15일 화요일? 실험 목적- 레지스터의 기본 원리를 이해한다.- 시프트 레지스터(Shift register ... )를 이용한 카운터의 동작을 이해한다.? 실험관련 이론- 레지스터 : 플립플롭은 2진 정보를 저장하기 위하여 사용되고 있으나, 일반적인 디지털 데이터는 1비트 이상의 비트열로 구성 ... 내용물을 이용할 수 있도록 되어있다. CPU내부에는 여러 개의 레지스터가 있으며 각종 명령을 실행할 때의 명령의내용 또는 자료를 일시적으로 유지하거나 사는데 사용된다.- 시프트

리포트 | 6페이지 | 2,000원 | 등록일 2012.10.11

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동기식 16비트 Gray Counter 로직 설계 소스 코드

연속 카운터 값사이에 1비트의 값만 변화(토글)시키면서 상태값을 증가(감소)시키는 Gray 계수기를 System Verilog를 이용하여 설계파일을 구현한다.설계파일의 기능외 ... 에도 테스트 벤치 파일 기능을 수행할 수 있도록 초기화 블록을 포함시키고이의 기능을 동작할 수 있도록 시스템 베릴로그의 데이터 자료형 중 네트형 변수와 레지스터형 변수의 기능을 함께

리포트 | 3,000원 | 등록일 2013.02.17

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실험6 결과보고서

실험 6. Shift Register & Counter(결과보고서)*이번 실험은 앞 반에서 결과 값이 나오지 않는다고 하여 시뮬레이션으로 대체하였다.*실험 1. 시프트 레지스터A ... 여 7496은 시프트레지스터로 작동한다는 것을 유추 할수 있다. 이 실험은 실험 1의 A와 같은 결과를 보이는데 실험 1의 A의 경우 J-K플리플롭을 사용하여 시프트레지스터를 설계 ... )이 되게 한다.(2) 시프트 레지스터의 Q 단자의 전압을 측정하여 표의 값들과 비교하라.-아래의 사진을 통해 확인IC1IC2IC3Pin 15Pin 11Pin 15Pin 11Pin 15

리포트 | 9페이지 | 1,000원 | 등록일 2013.01.01

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디지털실험 설계3 예비 positive edge triggered master-slave D flip flip의 설계

디지털 실험 예비보고서설계3. positive edge triggered master-slave D flip flip의 설계실험 목적1. D flip flip의 동작을 이해 ... 하고 기본 소자를 이용하여 clock input, reset, clear 기능을 가진 positive edge triggered master-slave D flip flip를 설계이론 ... 을 latch라 하고, pulse transition에서 작동하는 flip flop을 register라 한다.이번 실험에서는 기본소자로 만든 SR latch를 이용해서 소장의 동작

리포트 | 4페이지 | 1,000원 | 등록일 2014.09.30

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통신실험 예비 11

은 선형 피드백이 있는 시프트 레지스터(Linear Feedback Shift Register, LFSR)를 사용하는 방법이 있으며 통계적 균형성은 한 주기에 `0` 과 `1`이 ... Sequence (29 - 1), 2047 Pseudo-Random Sequence (211 - 1), PN Code 등이 있다. PRBS는 디지털 시스템 설계 등 매우 다양한 분야에 사용 ... 작위로 나타나는 shift register들의 수를 이용한 periodic sequences은 쉽게 생성이 가능하다. 왜냐하면 이러한 sequence들은 오직 무작위로 나타나기 때문

리포트 | 4페이지 | 1,000원 | 등록일 2014.12.05 | 수정일 2014.12.19

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[Flowrian] BCD to 7-Segment Decoder (TTL 7448)의 Verilog 설계 및 시뮬레이션 검증

들로 구성된 조합논리회로도가 제공되지만 본 문서에서는 레지스터 전송 수준 (RTL, Register Transfer Level)에서 동일한 논리를 구현하도록 설계한다. 논리회로 ... 는 RTL 수준의 코드에서 자동으로 생성될 수 있고, Verilog 언어로 설계를 배우는 독자에게는 RTL 수준의 코드가 보다 교육적이기 때문이다.TTL 7447 회로와 논리적 동작 ... 은 동일하나 7 세그멘트를 Active High 로 구동시킨다는 점이 다르다.즉, 논리값 `1` 에서 세그멘트 LED 가 켜진다는 의미이다. 설계는 Verilog 언어를 이용

리포트 | 10페이지 | 1,000원 | 등록일 2012.05.07

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[선박의 이해] 선박의 주요 치수 - 선박의 개요, 선박의 길이와 나비 및 깊이와 흘수

선박의 주요 치수목차1. 개요2. 길이3. 나비4. 깊이 및 흘수1. 개요선박을 잘 설계하기 위해서는 여러 가지의 상충되는 설계조건들을 성공적으로 융합시켜야만 한다. 예를 들 ... 하게 든다.이와 같이 서로 상충되는 설계조건들을 적절하게 조정하는 것은 설계자의 주관에 따르게 되므로, 같은 설계조건 하에서도 2명의 설계자가 동일한 선형을 갖는 선체를 설계할 수는 없 ... Perpendiculars)- 선수 수선에서 선미 수선 사이의 수평거리- 선박설계에서 일반적으로 사용되는 길이㉮ 선수 수선(Fore Perpendiculars : F.P.)- 만재 흘수선과 선수재의 전면

리포트 | 5페이지 | 1,000원 | 등록일 2014.04.17

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8bit Gray Counter

연속 카운터 값사이에 1비트의 값만 변화(토글)시키면서 상태값을 증가(감소)시키는 Gray 계수기를 System Verilog를 이용하여 설계파일을 구현한다.설계파일의 기능외 ... 에도 테스트 벤치 파일 기능을 수행할 수 있도록 초기화 블록도 포함시키고이의 기능을 동작할 수 있도록 시스템 베릴로그의 데이터 자료형 중 네트형 변수와 레지스터형 변수의 기능을 함께

리포트 | 2,500원 | 등록일 2013.02.04

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실험2 제10주 Lab08 Post Counter & 7Segment & Piezo

/Counter의 CTC Mode를 사용하여 기준 Clock을 분주하면 되는데 CTC Mode 중 ICR(Input Capture Register)3 레지스터가 TOP으로 정확히 50 ... 전자전기컴퓨터설계실험Ⅱ분반 : 문용삼 교수님주차 : 10주차과목 : 전자전기컴퓨터설계실험Ⅱ학과 : 전자전기컴퓨터공학부학번 : 2009440132이름 : 전상기-목차-1 ... 있다. 그리고 7 Segment와 Piezo의 조합회로를 설계, 제작할 수 있다.2) Essential background for this Lab⦁ 7 Segment⦁ Piezo

리포트 | 12페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17

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국민대학교 자동차공학실험 - 3차원 역공학

등을 이용하여 생명주기 초기 단계의 생성물에 해당하는 정보나 문서들을 만들어 내는 일로서, 설계부터 순차적으로 이루어지는 순공학에 상대되는 개념으로 역공학이라 한다. 간단하게 기존 ... 의 시스템으로부터 각종 문서 또는 설계 기법의 데이트를 역으로 얻어내는 것이다.2. 실험목적RealScan USB 300의 자동차 모형 스캔을 직접 보고, RapidForm ... 2004를 이용하여 예제를 통해 실습을 해본다.3. 실험의 이론적 배경 및 원리처음에는 하드웨어 분야에서 완제품으로부터 제품의 설계사양을 추출하려는 목적에서 출발했으며, 리코프(M.G

리포트 | 8페이지 | 2,000원 | 등록일 2014.03.09

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호텔용어정리

-손님의 체크 아웃(Check Out), 즉 출숙 후에 늦게 프론트 회계에 돌아오는 전표에 의한 지연계정을 말한다.레지스터 리딩 리포트 (Register Reading Report) ... -식당회계 시스템에서 전날까지의 판매고와 당일까지의 판매 합계를 기록한 회계보고서이다.레지스터 시트 (Register Sheet) -회계처리에 대한 감사를 하기에 편리하도록 한 장 ... -소규모 모임이나 또는 취침도 할 수 있도록 설계된 다목적 호텍 객실을 말한다.이인점유 객실료 (Double Occupancy Rate)-한 객실을 두 사람이 사용할 때의 객실료.익

리포트 | 28페이지 | 2,000원 | 등록일 2014.06.10 | 수정일 2015.05.20

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디지털 회로 설계 프로젝트 vending machine (자판기)

, adder, register, d flip-flop, logic gates 등의 기능을 이용해 음료수 자판기의 동작을 combinational circuit으로 설계, 구현 ... elect하여 4 bit adder로 더한 값을, register의 load 기능을 이용해 output을 낼 수 있도록 설계했다. 여기서 output은 잔돈의 액수이다.e. 회로먼저 ... VENDING MACHINEtable of contentsa. 설계 목표b. state diagramc. transition table & transition equationsd

리포트 | 7페이지 | 2,000원 | 등록일 2013.01.02 | 수정일 2021.01.31

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디지털실험 예비 #3

(예비)Lab 3. 카운터와 시프트 레지스터디지털 실험이명진 교수님금(09:00 ~ 13:00)2007122043 김병주Due date - 2012.03.23. (금)1 ... 를 찾아서 작동 방법을 설명하시오.74164는 8-bit shift register이다. 이름 그대로 8bit의 숫자를 저장하는데 clock이 뛸 때마다 한 bit씩 정의된 방향 ... hift register이다. 74164와는 다른 점은 저장 가능한 bit 개수도 있지만, 74194는 shift방향을 결정할 수 있다.(왼쪽 or 오른쪽)작동방법* MR

리포트 | 4페이지 | 1,000원 | 등록일 2013.12.12 | 수정일 2014.04.22

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[직렬][직렬연결]직렬(직렬연결)과 상호변환, 직렬(직렬연결)과 RL직렬회로, 직렬(직렬연결)과 RLC직렬회로, 직렬(직렬연결)과 RC직렬회로, 직렬(직렬연결)과 직류고전압 분석

는 것은 그래서 자기장안에 놓여져 있다. 진짜 직류 발전기는 영구 자석보다 더 강한 자기장을 얻기 위해 전자석을 사용했다는 것을 주목하시오. 이런 설계의 특징은 두 가지 이로운 점 ... 은 시트(판))으로 되어 있다.Ⅱ. 직렬(직렬연결)과 상호변환정보가 한 번에 한 비트씩 전송되고 조작될 때 디지털 시스템이 직렬모드로 작동한다고 한다. 정보는 한 레지스터에서 다른 ... 레지스터로 한 번에 한 비트씩 이동시킴으로써 전송할 수 있다. 이것은 레지스터의 모든 비트를 한꺼번에 전송하는 병렬 전송과는 대조적이다.레지스터 A에서 B로의 정보의 직렬전송은 쉬프트

리포트 | 11페이지 | 5,000원 | 등록일 2013.03.25

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텀프로젝트2

에 부합하는 프로그램 완성2. 실험 관련 이론.-실험에 사용된 관련 레지스터.-1) 외부 인터럽트.1. 상태레지스터(SREG:Status REGister)AVR상태 레지스터. 여기 ... Rate Register)USART의 송수신 속도를 설정한다. (설정시 UBRRn 레지스터를 먼저 설정 해야 한다.)ATmega128에는 입력 클럭에 따라 설정되는 값을 미리 계산 ... 1. 설계과제의 목표 및 제한 조건.1) 실험목표 - 다중 입력식 전자 계산기를 만들어라!2) 실험 제한 조건.① 계산기 설계 조건◎ 사칙연산 ( +, -, *, / ) 가능

리포트 | 16페이지 | 2,000원 | 등록일 2012.04.01

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디지털실험 15예비 up/down counter

에서 제품이 생산되어 랜덤하게 출하검사가된다. 이때 제품의 생산개수를 카운터 하고 검사시 불합격점인 경우 생산개수가 감소한다. 실험가능한 회로를 구성하라.문제 1번을 위해 설계한 회로이 ... 다. 왼쪽의 시프트 레지스터를 제품이 생산되는 컨베이어 벨트로 생각한다. 제품인지 아닌지는 입력 in에서 1이면 상품 0이면 불량품으로 생각했다. 랜덤하게 골라서 검사를 할 네 번 ... .시뮬레이션 결과이다. 초기 레지스터의 결과는 0으로 되어있지만 ran값이 1이라서 업 카운터로 동작하고 있다. 마지막 5번째 클락에서 ran값을 0으로 바꿔서 제품을 검사하고 불량

리포트 | 8페이지 | 1,000원 | 등록일 2014.09.30

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마이크로프로세서 응용 및 실험 [LED 및 7-segment 점등]

( Interrupt ) 관련 레지스터▷ The AVR Status Register – SREG ( 상대 레지스터 )비트7의 1 “ Global Interrupt Enable “ 은 전체 ... 1. 설계과제의 목표 및 제한조건1.1 설계과제의 목표◆ LED 점등▷ 1번 스위치 입력(Rising Edge)이 1번 있을 때 점등된 2개의 LED가 중앙에서 바깥쪽으로 (바깥 ... 마다 한칸씩 이동 )- 7-segment 출력이면 표시 숫자 증가1.2 설계과제의 제한조건▷ 모든 스위치 입력처리는 인터럽트만 사용▷ 입력 : push switch – 2개▷ 출력

리포트 | 16페이지 | 10,000원 | 등록일 2012.03.31 | 수정일 2013.12.17

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컴퓨터구조 설계 프로젝트 DashWatch

컴퓨터구조 설계 프로젝트제목 : Design of DashWatch or Handheld PIG Game설계 이론 : DashWatch1. write a detailed ... time) to be stored in a register- the front of stopwatch : Fig.7-23(a)INPUT- START button : causes ... dash value to be displayed- RESET button : initializes the storage register to 10011001.10011001,max

리포트 | 16페이지 | 1,000원 | 등록일 2014.07.09

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Verilog 4bit ALU Design (4비트 ALU설계)

Register를 사용한다.- opcode(6)=opcode(7)='1' : 레지스터로 동작이 Enable- Clock(클럭) : 상승에지에 동기- Reset(리셋 ... ◆ ALU 회로의 설계 및 검증SelectOperationFunctionS3 S2 S1 S0 Cin0 0 0 0 0F = A + BAdd0 0 0 0 1F = A + B + 1 ... right A into F1 1 X X XF = shr AShift left A into F표 . ALU의 동작 상태표● 사양◇ ALU 연산을 수행하는 회로로서 Register

리포트 | 6페이지 | 3,500원 | 등록일 2009.11.26 | 수정일 2020.09.10

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