"디지탈실험"의 검색결과 입니다.

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"디지탈실험" 검색결과 621-640 / 21,545건

디지털실험 3예비 2비트 전가산기

디지털 실험 예비보고서실험 3. 2비트 전가산기실험 목적1. 반가산기와 전가산기의 원리를 이해한다.2. 가산기를 이용한 논리회로의 구성능력을 키운다.이론2진 연산(Binary ... Arithmetic)2진수 체계는 모든 디지털 시스템의 기초이다. 그러므로 디지털 회로에서는 모든 연산동작이 2진수를 이용하도록 구성되어 있다.두 개의 2진 2진수의 덧셈에는 4가지 ... 의 2진 digit가산은 합 digit와 자리올림 digit의 2개의 digit로 결과가 얻어진다.반가산기(Half Adder)2진 덧셈을 살펴보면 2-입력(A,B)의 논리회로

리포트 | 7페이지 | 1,000원 | 등록일 2014.09.30

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디지털실험 10 예비 4-Phase clock

디지털 실험 예비보고서실험 10. 4-Phase clock실험 목적1. 비중첩 클럭펄스를 발생시키기 위해 ‘139의 사용법을 익힌다.2. ‘139를 사용하여 발생된 클럭파형 ... 하기가 용이한 점에서 디지털 시스템에서 많이 사용된다. 예를 들면 마이크로프로세서는 보통 Φ1, Φ2로 불리는 비중첩의 2상 클럭을 필요로 한다. 그러나 동시에 두 개의 파형이 양 ... 의 레벨로 되는 것을 피해야 하는 주의가 필요하다. 따라서 양의 펄스는 비중첩된다고 말한다.4상 클럭(4-phase clock)이 실험에서 4상 클럭은 3종류의 IC를 연결하여 구성

리포트 | 4페이지 | 1,000원 | 등록일 2014.09.30

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디지털실험 설계2 결과 4비트 가(감)산기

디지털 실험 결과보고서설계 2. 4비트 가(감)산기다음의 회로도대로 회로를 결선하고 e입력에 따라 가산 감산이 되는지 실험한다.위 4비트 회로의 한 부분이다. 1비트 연산을 하 ... 다른 입력일 때도 e값에 따라 출력이 제대로 나오는 것을 확인했다. 이번 실험에서 입력 z는 필요 없고 가장 낮은 비트(4비트 회로에서 제일 오른쪽 부분)부분은 반가산기로 설계 ... 해도 되지만 같은 소자를 이어 붙이는 식으로 설계하는 것으로 연산을 할 수 있다는 것을 보여주기 위해서 이렇게 설계했다.설계는 실패했다.고찰실험 3을 기억해 보자. 우리는 전감산기

리포트 | 3페이지 | 1,000원 | 등록일 2014.09.30

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디지털 시스템 실험 Latch & Flip-Flop 결과보고서

디지털 시스템 설계 및 실험 결과 보고서작성자:학번:실험조:실험일:실험제목Latch & Flip-Flop실험목표1. SR Latch를 설계한다.2. SR Latch를 이용하여 D ... -Flop을 설계한다.4. Negative-Edge-Triggered JK Flip-Flop을 이용하여 BCD Ripple Counter를 설계한다.실험결과nand 게이트를 이용

리포트 | 4페이지 | 1,000원 | 등록일 2016.04.08

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디지털 시스템 실험 Add, Subtractor, Multiplier, Divider 설계 결과보고서

디지털 시스템 설계 및 실험 결과 보고서작성자:학번:실험조:실험일:실험제목Add/Subtractor/Multiplier/Divider 설계실험목표4bit Add ... 만 캐리가 1임을 알 수 있으며, 입력 값 중 하나만이 1일 때 합 값이 1을 나타냄을 알 수 있다.ABCinSCout0*************00110110010101011100111111위 진리표의 값을 그대로 표현하고 있음을 알 수 있다.디지털 시스템 설계 및 실험 ... /Subtractor를 설계하고, Multiplier / Divier를 설계한다.실험결과7 (0111)(2)과 5 (0101)(2)의 연산 결과가 35 (00100011)(2)가 나옴을 알 수 있

리포트 | 9페이지 | 1,000원 | 등록일 2016.04.08

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디지털 시스템 실험 Add, Subtractor, Multiplier, Divider 설계 예비보고서

디지털 시스템 설계 및 실험 예비 보고서작성자:학번:실험조:실험일:실험제목Add/Subtractor/Multiplier/Divider 설계실험목표4bit Add ... ])|(p[2]&p[1]&p[0]&c_in);assign c[3]= g[3]|(p[3]&g[2])|(p[3]&p[2]&g[1])|(p[3]&p[2]&p[1]&g[0])|(p[3]&p실험

리포트 | 12페이지 | 1,000원 | 등록일 2016.04.08

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디지털 시스템 실험 Sequential Circuit 설계 및 구현 예비보고서

디지털 시스템 설계 및 실험 예비 보고서작성자:학번:실험조:실험일:실험제목Sequential Circuit 설계 및 구현실험목표1. 동기식 UP/DOWN 카운터를 설계 ... 을 바로 Full Color LED 의 RGB 라인에 연결하여 회로를 동작시켜 볼 수 있다. 장비에는 Full color LED 가 4 개가 있기 때문에 모두 같은 값이 출력되도록 4 bit로 구성한다.디지털 시스템 설계 및 실험 ... )를 사용해서 해결 할 수 있다.실험방법1. 동기식 UP/DOWN 카운터를 설계한다.1. RESETN의 값을 받아 0으로 초기화하고, CLK의 Rising Edge(CLK이 0

리포트 | 5페이지 | 1,000원 | 등록일 2016.04.08

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[디지털실험][설계과목]디지털 시계 만들기

1. 설계목적/ 18(1) 그 동안 학습했던 내용을 토대로 디지털 시계를 설계(2) 디지털 응용회로 설계에 대한 개념 정립 및 설계 절차 학습.2. 이 론주변에서 흔히 볼 수 있 ... 는 디지털 시계는 카운터를 이용해 설계할 수 있는 대표적인 순차회로의 하나이다. 이와 같은 디지털 시계를 설계하기 위해서 기본적으로 필요한 것이 무엇인지 살펴보자. 에 나타낸 ... 디지털 시계의 전체 블록도를 보면 시간 표시를 위한 7세그먼트 표시기를 비롯하여 BCD-to-7세그먼트 디코더(TTL 7447), 12시간 표시기 디코더, modulo-N 카운터 등

리포트 | 18페이지 | 1,000원 | 등록일 2010.03.25 | 수정일 2014.11.18

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디지털실험 3결과 2비트 전가산기

디지털실험 결과보고서실험 3. 2비트 전가산기실험 결과1.다음 회로를 구성하고 진리표를 작성하라실험 1의 반가산기를 구성한 회로이다. 입력 A, B를 XOR한 것이 출력 S ... 으로 보이는데, 디지털 공학 시간에 배웠듯 전가산기를 연속적으로 늘어놔도 2비트 이상의 가산기가 만들어진다.고찰실험 1,2,3,4의 결과를 이용하여 가산기 및 감산기의 출력을 부울대두 ... 상황이 만들어 지게 된다.실험 2. 전가산기 회로를 구성하고 진리표를 작성하라3.반감산기 회로를 구성하고 진리표를 작성하라.실험 3번의 회로를 구성한 사진이다. NOT 게이트 하나

리포트 | 8페이지 | 1,000원 | 등록일 2014.09.30

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[디지털실험]디지털실험

실험12. 쉬프트 레지스터( 예비 보고서 )■ 목 적1. 쉬프트레지스터의 구조와 동작원리를 이해한다.2. 쉬프트레지스터를 이용한 커운터의 동작을 이해한다.■ 원 리플립플롭 ... 로도 사용할 수 있다.레지스터는 디지털 시스템에서 매우 중요한 논리 블럭이다. 쉬프트 레지스터는 플립플롭을 직렬로 접속하여 만들 수 있고 각 플립플롭의 출력은 다음 단 플립플롭에 접속 ... 도 있다. 따라서, 이러한 쉬프트 레지스터는 직렬입력을 직렬 또는 병렬출력으로 병렬입력을 직렬 또는 병렬출력으로 내보낼 수 있게 된다. 병렬입출력형 쉬프트 레지스터■ 실험 준비물SN

리포트 | 7페이지 | 1,000원 | 등록일 2006.01.08

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[디지털 실험]디지털 실험

실험10.4-Phase clock 발생기(예비 보고서)■ 목 적1. 비중첩 클럭펄스를 발생시키기 위해 74139의 사용방법을 익힌다.2. 74139를 사용하여 발생된 클럭파형 ... 지만 회로를 제어하기가 용이한 점에서 디지털 시스템에서 많이 사용된다. 예를 들면 마이크로 프로세서는 보통 ?1, ?2로 불리는 비중첩의 2상 클럭을 필요로 한다. 그러나 동시에 두 개 ... 의 파형이 양의 레벨로 되는 것을 피해야 하는 주의가 필요하다. 따라서 양의 펼스는 비중첩 된다고 말한다.4상 클럭(4-phase clock)이 실험에서 4상 클럭은 3종류의 IC

리포트 | 5페이지 | 1,000원 | 등록일 2006.01.08

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텀프로젝트 / 디지털회로 및 실험 /각종 게이트를 활용한 LED 잠금장치

디지털 회로 실험 및 설계Term Project Report- D Filp-Flop을 활용한 LED 패턴잠금장치 -1. 작품 개요스마트폰의 패턴 잠금 장치를 광센서, D Flip

리포트 | 9페이지 | 3,000원 | 등록일 2016.12.21

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최신 디지털회로실험 실험5 추가논리게이트

실험5. 추가 논리 게이트실험목표 :□ 실험을 통하여 OR와 XOR의 진리표 결정.□ 펄스 파형을 이용하여 OR와 XOR 논리게이트 테스트.□ OR와 XOR 게이트를 사용하여 4 ... 비트 2진수의 1의 보수 또는 2의 보수를 실행하는 회로 구성.□ 모의 실험용 결함에 대한 보수(complement) 회로의 고장 진단.데이터 및 관찰내용 :표5-2 표 5-3OR ... 하여 1의 보수와 2의 보수의 결과를 볼수 있었으나 , 회로를 구성하는데 있어서 복잡한 배선의 문제 때문에 결과값을 구하는데 어려움이 있었다.실험을 통하여 1의보수와 2의보수를 직접 눈

리포트 | 3페이지 | 1,000원 | 등록일 2012.12.02

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디지털 시스템 실험 Sequential Circuit 설계 및 구현 결과보고서

디지털 시스템 설계 및 실험 결과 보고서작성자:학번:실험조:실험일:실험제목Sequential Circuit 설계 및 구현실험목표1. 동기식 UP/DOWN 카운터를 설계 ... 을 눌러 1이 되게 하면 Q의 값이 0000이 되는 것도 확인하였으나 촬영하진 못했다.디지털 시스템 설계 및 실험 ... 한다. (기본)2. 카운터를 이용한 Sequential Circuit을 설계한다. (선택)실험결과토의Line 1: 변수 RESETN, CLK, DNUP, Q를 갖는 모듈 LAB01_7을 선언

리포트 | 3페이지 | 1,000원 | 등록일 2016.04.08

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디지털 시스템 실험 Latch & Flip-Flop 예비보고서

디지털 시스템 설계 및 실험 예비 보고서작성자:학번:실험조:실험일:실험제목Latch & Flip-Flop실험목표1. SR Latch를 설계한다.2. SR Latch를 이용하여 D ... );endmodule_______________________________________________디지털 시스템 설계 및 실험 ... 아질수록 clock delay가 커지기 때문에 bit 수가 적은 것에만 사용해야 한다는 것이다.3.2 4bit BCD Ripple Up Counter실험방법1. SR Latch

리포트 | 6페이지 | 1,000원 | 등록일 2016.04.08

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[디지털실험]디지털실험

실험15. Up/Down 카운터 예비 보고서■ 목 적증계수, 감계수 및 증/감계수의 논리를 이해한다.■ 이 론증가 2진 카운터 sequence에서는 내부의 상태를 변화하는 과정 ... 하여 세는 데 사용될 수 있는 카운터는 Up/Down counter라 한다. 또한 Up/Down counter는 A/D(Analog-to-digital conversion)에 많이 ... ■ 실험 준비물SN7400, SN7404, SN7472, SN7476, SN74169Power supply, Osilloscope, Function Generator■ 실험 방법1

리포트 | 6페이지 | 1,000원 | 등록일 2006.01.08

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[디지털실험]디지털 실험

식 리플 캐리 계수기4비트 Johnson 계수기실험 준비물SN7408SN7411SN7421SN7476SN7472Power supply, Osilloscope, Function ... Generator실험 방법1.SN7476과 7478을 이용하여 다음의 리플캐리 방식의 4단 병력 계수회로를 구성하라. 먼저 CLEAR를 시킨 후 push ON/ release OFF

리포트 | 5페이지 | 1,000원 | 등록일 2006.01.08

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[실험 예비 보고서] 디지털 I/O 기초 실험

디지털 I/O1. 실험 목적디지털 전자기기는 현대 컴퓨터를 구성함에 있어 가장 핵심이 되는 부분입니다. 디지털 라인을 설정하고 측정하는 일을 수행하는 능력은 디지털회로 파악에 있 ... 어 필수적인 것입니다. 이에 NI ELVIS를 활용하여 디지털 클록, 디지털 카운트, 그리고 논리적 상태를 실험을 통해서 이해하는 것이 실험의 주목적입니다.2. 실험 장비 및 부품 ... -실험장비: NI ELVIS (Digital Write, Digital Read, FGEN, DMM, OSC,)-실험부품: 555 타이머 칩, 저항(10kΩ, 100kΩ), F

리포트 | 7페이지 | 1,000원 | 등록일 2012.11.06 | 수정일 2014.01.12

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[디지털실험]디지털 실험

11.멀티 바이브레이터(예비 보고서)목 적1. 비안정 멀티 바이브레이터의 동작을 이해한다.2. 비안정 모드에서 사용된 555 타이머의 동작 특성을 실험적으로 입증한다.3. 단안정 ... cycle은 95%를 갖는다.실험 준비물555 Timer, LM55554/74121Resistor : 1kΩ, 4.7kΩ, 22kΩ, 33kΩ, 51kΩ, 2kΩCapacitor: 0 ... .01㎌, 0.1㎌, 1㎌Power supply, Oscilloscope, Function Generator실험 방법1. 처럼 회로를 연결하고 RA=1kΩ, RB=4.7kΩ, C=0.1㎌을 사용하여라. 3번핀의 출력파형을 관측하여 파형을 자세히 그려라.

리포트 | 4페이지 | 1,000원 | 등록일 2006.01.08

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브레드보드 디지털논리회로 실험

디지털논리회로 실험(브레드 보드)정보통신공학과1. 서론디지털 논리회로를 구현하여 실험하기 위해서는 디지털 논리 게이트를 회로로 구현할 수 있는 기판이 필요하다. 일반적으로 대부분 ... 의 간단한 디지털 논리 게이트는 반도체 칩(chip)으로 구현이 되어 있는데, 이러한 디지털 논리 게이트만으로는 원하는 기능을 구현하는데 한계가 있다. 따라서 칩으로 만들어진 다양 ... 한 디지털 논리 게이트들을 연결하여 원하는 기능을 수행할 수 있도록 회로를 구현하는데 필요한 부가적인 장치가 필요하다. 브레드보드(breadboard)는 이러한 요구사항을 만족

리포트 | 2페이지 | 1,000원 | 등록일 2010.11.03

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