"logic circuit"의 검색결과 입니다.

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"logic circuit" 검색결과 381-400 / 637건

[컴퓨터공학기초설계및실험2 보고서] Ripple-Carry Adder (RCA) design

circuit)로 연산하는 것으로 기억 능력을 갖지 않는다. 말 그대로 2진수의 덧셈을 하는 논리 회로이며, 종류로는 반가산기와 전가산기가 있다.* 반가산기반가산기란 1비트의 2개 ... NAND gate와 2-input XOR gate인 logic gates으로 구성돼있음을 세부적으로 볼 수 있다.Flow Summary* print RCA result to 7s

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| 리포트 | 20페이지 | 2,000원 | 등록일 2015.04.12 | 수정일 2015.04.24

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쌍안정 회로와 RS 래치

(asynchronous sequential logic circuit)라 하고, 클럭에 의해 동작되는 상태 메모리를 거쳐 궤환될 경우 동기순서논리회로(synchronous sequential ... circuit)라 한다.일반적으로 기억소자의 기본인 1비트 메모리 소자로서 플립플롭이 있고, 플립플롭을 구성하기 위한 기본소자로서 쌍안정 래치가 있다. 또한 이 래치는 비동기

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| 리포트 | 4페이지 | 1,000원 | 등록일 2012.11.20

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디지털논리회로 FSM 설계 유료 빨래방 구동회로

DIGITAL LOGIC CIRCUIT _ 디지털논리회로디지털논리회로유료 빨래방 세탁기구동회로 FSM 설계디지털논리회로(#1,Project1)제출날짜담당교수강성호 교수님조원1 ... 지 않도록 하였고(청색), 1500원인 상태에서는 Reset이 되어 다시 0원인 상태로 돌아가도록 설정(녹색)하였다.6.Circuit Schematic회로 Schematic1첫 시도

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| 리포트 | 13페이지 | 3,000원 | 등록일 2013.10.28

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연세대 전기전자 기초실험 09년도 A+ 레포트 예비 12

& Common-Anode type(right)The internal circuitry and logic gates for the display is shown below ... .INTERNAL CIRCUITRY AND LOGIC GATES FOR 7 SEG DISPLAY- Components of combinational and sequential circuits ... Electric Circuit Experiment Pre-ReportChapter 12" Digital clock design "DepartmentYearStudnt

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| 리포트 | 7페이지 | 1,000원 | 등록일 2009.12.17

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플립플롭 실험 예비보고서

플립플롭관련이론1. 순차논리회로 (Sequential Logical Circuit)입력의 조합만으로는 출력이 정해지지 않는 논리 회로로, 현재의 내부 상태와 입력에의해 출력

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| 리포트 | 6페이지 | 1,000원 | 등록일 2014.10.15

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[Digital Logic Design Project] Full adder

000111100001010111Cout = ab + bc + ac작성한 표를 이용하여 logic circuit를 설계한다.VHDL을 이용하여 full adder을 설계한다.ENTITY adder ... Digital Logic Design Project #2Full adderProject #1 Gray Code Converter개요3개의 입력과 2개의 출력을 가지는 full

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| 리포트 | 5페이지 | 1,000원 | 등록일 2010.01.20

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예비4

with parallel input. If you don't know what this means, well its simply a circuit that will take as ... them double the other (example 10K and 20K), in on of my circuits I used 1M ohm and 470K ohm resistors ... buffer circuit, which will be explained in the next section.③ The applied circuitAll the components

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| 리포트 | 6페이지 | 1,500원 | 등록일 2011.06.01

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flip-flop and counter design(예비)

and the next value is decided by each logic circuit. In experiment, synchronous method is used ... , 1 and 0, for the output. In a TTL circuit, 1 represents +5V, while 0 is assigned to 0V. Latch ... table circuit. Latch is the most commonly utilized circuit in many digital circuit processes, which

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| 리포트 | 16페이지 | 1,000원 | 등록일 2011.07.09

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결과보고서-Exp 1. Combinational Logic Design,Flip-Flop, and Counter.hwp

combinational logic circuits- Understand how to simplify the Boolean function using Karnaugh map ... - Understand the operation of flip-flop.- Implement simple digital logic circuits.2. Problem Statement1 ... Exp 1. Combinational Logic Design, Flip-Flop, and Counter1. Objectives- Understand the operation of

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| 리포트 | 11페이지 | 2,000원 | 등록일 2010.10.11

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[토끼] BCD to EX-3 code converter (sequential circuit)

1.TitleBCD to EX-3 code converter (sequential circuit)2.Name3.AbstractBCD-EX3 Final Term Project본 ... . VHDLLIBRARY IEEE,ARITHMETIC;USE IEEE.STD_LOGIC_1164.ALL;USE ARITHMETIC.STD_LOGIC_ARITH.ALL; -- 라이브러리 설정 및

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| 리포트 | 7페이지 | 5,000원 | 등록일 2011.04.10 | 수정일 2020.07.10

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16Bit CLA layout 설계

Propagation function,,- Carry function2) Logic circuitAND, OR로 구성된 논리도를 transistor 개수의 간소화를 위해서 NAND ... 000000011011011000011011111mAND, OR로 구성된 논리도를 transistor 개수의 간소화를 위해서 NAND, NOT으로 회로 구성을 변경했다. 마찬가지로 LVS 오류를 방지하기 위해서 Logic ... 단의 gate 수가 많기 때문에 그 delay가 크게 나오게 되었다.4. propagation unit1) functionGeneration :Propagation :2) logic

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| 리포트 | 18페이지 | 2,000원 | 등록일 2011.06.17

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pspice로 opamp, rlc를 이용한 필터설계

에서 사용하고 동조하기 쉽다. n차수 n=C의 수(1) 능동/수동의 차이기본적으로 FET/BJT/Diode 류의 비선형소자를 포함한 회로를 능동회로(Active circuit)이 ... 라 부르고, 그렇지 않은 회로를 수동회로(Passive circuit)이라고 부른다. 이 분류법은 일반 전자회로와 완전히 동일하다.비선형소자가 포함된 경우에는 제3의 사용자 입력설정 ... 한 소자라고 생각하면 됩니다. TR, FET, OPAMP, LOGIC...따라서 R,L,C로만 구성된 필터라면 수동필터라고 할수 있고, 여기에 OPAMP나 TR들을 사용했다면 능동필터

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| 리포트 | 6페이지 | 3,000원 | 등록일 2012.01.26

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제휴를 통한 사업확장- Mips 사례

et computing(CISC: 복합병렬시스템)에 비해 회로(circuitry)가 덜 들어가기 때문에 설계와 최초 시험단계가 단축되고 제조비용도 절감되는 장점을 지녔다. 당시 ... 하였다. 1987년에 세개의 작은 기업(LSI logic, IDT, Performance Semiconductor)과의 라이센싱 체결에 성공하였다. 일본 Kubota 사와는 지분참여 대가 ... 는 반도체 제조업체들에게 자신의 기술에 대한 라이센싱을 적극 시도하였다. 1987년 세 개의 작은 기업, 즉 LSI logic, IDT, Performance

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| 리포트 | 9페이지 | 2,000원 | 등록일 2012.10.14

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lab10-final MOSFET Parameter 추출과증폭기 및 스위치 회로

(V가장 크고 그다음 회로 4.1, 회로 4.3 순이다.그림 Circuit for 4.4, 4,5그림 Circuit for 4.6⑥ Logic thresholdandof CMOS ... 의 Transfer curve를 통해 voltage gain을, CMOS inverter의 transfer curve를 통해 Logic Threshold voltage를, MOS ... Extracting그림 Lissajous Pattern그림 MOSFET circuitVBS(V)0-0.5-1-2-3-5-7-10시뮬레이션값1.712.182.573.23.734.615.356.3이론

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| 리포트 | 13페이지 | 1,000원 | 등록일 2010.08.29

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예비3

circuit, which converts continuous signals to discrete digital numbers. The reverse operation is ... circuit typically consists of four chief subcircuits:A sample and hold circuit to acquire the input ... which then supplies the analog equivalent of this digital code (Vref/2) into the comparator circuit

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| 리포트 | 5페이지 | 1,500원 | 등록일 2011.06.01

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디지털 회로설계 3차 설계과제1-to-8 Multiplexe, 8-to-1 De-Multiplexer

*************10111010001101111101111112) Logic Circuit of 8-to-1 MultiplexerB. VHDL Code of 8-to-1 MultiplexerC ... . 1) Simulation of Logic Circuit of 8-to-1 Multiplexer2) Simulation of VHDL Code of 8-to-1 ... Multiplexer- Logic Circuit과 동일한 동작을 수행하는지 살피기 위해 w0~w7을 동일한 값으로 사용했다.2. 1-to-8 De-MultiplexerA. Select Input s

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| 리포트 | 5페이지 | 1,000원 | 등록일 2008.05.04 | 수정일 2019.04.11

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다이오드를 이용한 반파정류 실험

(Diode Logic Gate) 다이오드를 이용한 OR게이트다이오드와 저항을 이용하여 디지탈 논리 함수를 구현할 수 있다. 그림 13-1(a)는 OR 게이트를 나타낸다. "0"은 0V ... 가 된다.(b)이번의 회로는 다이오드의 방향이 역방향이므로 오픈 서킷이 된다. 그러므로 이론치는 5V로 예상된다. 측정치는 약 4.94V이었다. 약간의 오차가 발생했지만 파워 ... 서플라이와 DVM과의 연결에 따른 오차라고 생각했다. 그리고 오픈 서킷 이므로 전류는 0A이 된다.(c)이 회로는 그라운드가 0이고 전압원이 -5V이므로 그라운드 쪽이 전압이 높

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| 리포트 | 7페이지 | 1,000원 | 등록일 2012.06.10

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실험1결과.Basic.Gates 최종

table을 작성하라.회로 SEQ 회로 \* ARABIC 1. 3-input AND gate의 logic diagram그림 SEQ 그림 \* ARABIC 1. 3-input AND ... \* ARABIC 2. 3-input OR gate의 logic diagram그림 1- SEQ 그림 \* ARABIC 2. 3-input OR gate 출력 파형ABCL1L ... \* ARABIC 3. 3-input NAND gate의 logic diagram그림 1- SEQ 그림 \* ARABIC 3. 3-input NAND gate 출력 파형ABCL1L

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| 리포트 | 9페이지 | 1,000원 | 등록일 2011.06.27

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Term Project Report Traffic Light Controller

. ▶ VHDL and COMBO it leads and it studies in about digital logical operation circuit plan.1.2

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| 리포트 | 16페이지 | 5,000원 | 등록일 2011.06.09

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아주대논리회로실험 9장 예비보고서(기본구성+빵판+예상결과)

입력을 사용함으로써 외부의 제어 상태에 따라 정보를 random하게 memory에 기록하거나 읽어낼 수 있다. 이 실험에서 사용하는 memory들은 positive logic일 때 ... 는 데이터가 memory에 기록되고(writing) negative logic일 때는 밖으로 읽혀진다(reading). 이와 같은 양립성은 shift register에 데이터가 병렬 ... - IC 메모리(integrated circuit memory)각 워어드가 n비트로 되어 있는 m개의 워어드로 구성된 RAM의 내부 구조는 m×n 개의 2진 저장 소자와 각 단어

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| 리포트 | 7페이지 | 1,500원 | 등록일 2011.12.21

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