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전전설1 서울시립대 편입 전전설3 d플립플롭cadenc 시립대 전자전기공학부
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"서울시립대전자전기컴퓨터공학부" 검색결과 21-40 / 115건

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    서울시립대 편입학 전자전기 컴퓨터공학부 학업계획서
    작동시켜보고, 신호등이나 속도 표지판 등을 인식해 스스로 자율주행 할 수 있도록 만들어보았습니다. 이러한 전적대학에서의 경험들을 토대로 서울시립대학교 전자전기컴퓨터공학부에서 공부 ... 하면서 직접적인 시도를 해볼 수 있는 기회가 많지 않았습니다. 하지만 전자전기컴퓨터공학부에서는 C 프로그래밍이나 디지털 논리설계, 자료구조, 소프트웨어 시스템 실습 등과 같은 프로그램 ... 함을 알고 있습니다. 따라서 목표를 높게 설정한 만큼 이론 중심 수업과 실무 중심 수업을 병행하며 전자전기컴퓨터공학부에서 그에 맞는 역량들을 지속적으로 성장시킬 것입니다. 다만
    Non-Ai HUMAN
    | 자기소개서 | 2페이지 | 3,000원 | 등록일 2019.01.18
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    서울시립대 편입학 전자전기컴퓨터공학부 학업계획서, 면접자료 할인자료
    에 대해서 관심 가지고 열심히 공부하고 싶습니다.3. 전적대학교에서 수학한 분야와 지원학부·과 분야의 연계성 및 발전 방안전자전기컴퓨터공학 중 전적대에서 컴퓨터공학을 전공했기 때문 ... 같아 편입에 도전하게 되었습니다. 전적대에서 컴퓨터공학을 전공하였기 때문에 지원하는 학과에서 배우는 일부 내용에 대해서는 편입 후 어려움 없이 수학할 수 있을 것이라 생각 ... 합니다 .하지만 전기전자 부분에 대해서는 전공기초부터 필수까지 커리큘럼을 통해 열심히 공부할 것입니다. 또한 본 전공의 오랜 전통을 자랑하는 본교에 지원하게 되어 무척 기쁘게 생각합니다.2
    Non-Ai HUMAN
    | 자기소개서 | 3페이지 | 15,000원 (50%↓) 7500원 | 등록일 2016.03.05 | 수정일 2017.03.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab03(예비) / 2021년도(대면) / A+
    pecified by the following Verilog description4. 참고문헌1) 서울시립대학교 전자전기컴퓨터설계실험2 실험 교안2) M. Morris Mano, Michael. ... - ASIC 개발에 있어서 라이브러리가 충실하다.- 전세계 기업체의 70% 이상이 사용하는 실질적인 업계 표준이다.b. VHDL: 미 전기학회(IEEE) 표준 HDL, 엄격한 문법 ... ) Veri순하기 때문에 시뮬레이터가 고속이다.⑤ 검증 정확도가 높으며(설계 도중에 검증이 가능하며 입력신호의 부가, 출력의 관측과 비교가 쉽다. 또한 System Level의 검증이 가능
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab07(예비) / 2021년도(대면) / A+
    diagramSource codeTestbench testbench 시뮬레이션 결과4. 참고문헌1) 서울시립대학교 전자전기컴퓨터설계실험2 실험 교안2) 차재복(2019). 정보통신 ... an Introduction to the Verilog HDL.5) 한빛미디어. IT CookBook, 디지털 논리회로. 조합논리회로.6) ㈜한백전자. HBE-COMBO II – SE Verilog HDL 실습 Verilog HDL 문법
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab05(예비) / 2021년도(대면) / A+
    multiplexer(MUX)의 형태이다.4. 참고문헌1) 서울시립대학교 전자전기컴퓨터설계실험2 실험 교안2) M. Morris Mano, Michael D. Ciletti(2016
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab04(결과) / 2021년도(대면) / A+
    Post-reportCombinational Logic 1실험날짜 :학번 :이름 :1. Introduction가. 실험의 목적Verilog HDL 언어를 사용하여 Combinational Logic을 설계 및 실험하고, 설계한 로직을 시뮬레이션하기 위한 벤치를 작성하고..
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 2,000원 | 등록일 2022.07.16
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    전전설3 MOSFET 실험 2 Biasing and Common-Source Amplifier
    A. 실험 목적MOSFET을 이용한 증폭기의 biasing 방법, 소신호 모델, 그리고 이를 이용한 증폭기인 Common-Source 증폭기에 대해 학습한다.B. 실험 이론 및 과정 개략 설명MOSFET을 증폭기로 동작시키기 위해서는 적절한 DC 바이어스가 인가..
    리포트 | 4페이지 | 2,000원 | 등록일 2023.11.25
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab04(예비) / 2021년도(대면) / A+
    Pre-reportCombinational Logic 1날짜 :학번 :이름 :1. Introduction가. 실험의 목적Verilog HDL 언어를 사용하여 Combinational Logic을 설계 및 실험하고, 설계한 로직을 시뮬레이션하기 위한 벤치를 작성하고 장비..
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    | 리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab01(예비) / 2021년도(대면) / A+
    /D)와 DAC(Digital-to-Analog Converter, D/A)이다.- 범용 디지털 컴퓨터가 디지털 시스템에서 가장 잘 알려진 예라 할 수 있으며, 또한 현재 대부분 ... 의 전자기기의 시스템은 디지털 시스템을 사용하고 있다.(3) Why do we use (and study) digital systems?a. Advantage- 회로의 전압 ... 의 신호를 부호화 된 신호로 변환하여 컴퓨터 내부로 들여보내는 조합 논리회로로, 2^n개의 입력신호로부터 n개의 출력신호를 만든다. 오직 한 비트만이 1, 나머지비트는 0이 되는 입력
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    | 리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab06(결과) / 2021년도(대면) / A+
    Post-reportSequential Logic 1실험날짜 :학번 :이름 :1. Introduction가. 실험의 목적Verilog HDL 언어를 사용하여 Sequential Logic을 설계 및 실험(Flip-Flop, Register, SIPO 등)하고, 설계한 ..
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    | 리포트 | 18페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab05(결과) / 2021년도(대면) / A+
    Configuration까지 수행해서 동작을 확인하였을 때의 결과는 역시나 이론적 진리표의 값과 동일했다.6. Reference1) 서울시립대학교 전자전기컴퓨터설계실험2 실험 교안2) M
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    | 리포트 | 19페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab03(결과) / 2021년도(대면) / A+
    하였을 때 역시 결과는 이론적 진리표의 값과 동일했다.6. Reference1) 서울시립대학교 전자전기컴퓨터설계실험2 실험 교안2) M. Morris Mano, Michael D ... 하다.- ASIC 개발에 있어서 라이브러리가 충실하다.- 전세계 기업체의 70% 이상이 사용하는 실질적인 업계 표준이다.b. VHDL: 미 전기학회(IEEE) 표준 HDL, 엄격
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    | 리포트 | 19페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab02(결과) / 2021년도(대면) / A+
    적인 진리표의 값과 일치하는 것을 확인할 수 있다.6. Reference1) 서울시립대학교 전자전기컴퓨터설계실험2 실험 교안2) M. Morris Mano, Michael D ... 한다.나. 실험 이론(1) ASICa. ASIC의 이해- 특정한 전자/정보통신 제품에 사용할 목적으로 설계된 비메모리 반도체 칩으로, 복잡한 큰 디지털 시스템은 앞서 소개한 TTL ... 화된 full custom ASIC이 칩의 면적이 작다. 핸드폰처럼 작은 사이즈가 필요한 제품은 사이즈나 발열, 전력소모 등으로 FPGA로 설계하기 부적합하다.2. Materials and
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    | 리포트 | 9페이지 | 2,000원 | 등록일 2022.07.15
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab08(예비) / 2021년도(대면) / A+
    -bit up-down counter의 출력 값을 FND Array에 표시하시오.Source codeTestbenchPin testbench 시뮬레이션 결과4. 참고문헌1) 서울시립대학교 전자 ... 전기컴퓨터설계실험2 실험 교안2) M.Morris Mano, Michael D. Ciletti. Digital Design with an Introduction to ... 을 요하는 전자회로와 마이크로프로세서에서 많이 사용되는데, 이는 순수 이진법으로 표현된 숫자를 십진법으로 출력하기 위해서는 복잡한 나눗셈 회로가 필요하기 때문이다. 이진화 십진법
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    | 리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab06(예비) / 2021년도(대면) / A+
    Pre-reportSequential Logic 1날짜 :학번 :이름 :1. Introduction가. 실험의 목적Verilog HDL 언어를 사용하여 Sequential Logic을 설계 및 실험(Flip-Flop, Register, SIPO 등)하고, 설계한 로직을..
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    | 리포트 | 16페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab02(예비) / 2021년도(대면) / A+
    . 실험 이론(1) ASICa. ASIC의 이해- 특정한 전자/정보통신 제품에 사용할 목적으로 설계된 비메모리 반도체 칩으로, 복잡한 큰 디지털 시스템은 앞서 소개한 TTL 등 ... 들도 설계하기 부적합하다.2. Materials and Methods가. 실험 장비HBE Combo-II SE3. Prelab(1) PROM, PAL, CPLD, FPGA에 대하 ... - 모델 온보드 (공중) 디지털 컴퓨터. 또한 일회성 프로그램 가능 비 휘발성 메모리 ( OTP NVM ) 및 현장 프로그램 가능 읽기 전용 메모리 ( FPROM )로 알려져 있
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    | 리포트 | 9페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab08(결과) / 2021년도(대면) / A+
    Post-reportPeripherals실험날짜 :학번 :이름 :1. Introduction가. 실험의 목적Verilog HDL 언어를 사용하여 7-segment, Piezo 등 주변 디지털 장치 제어를 실험하며 그의 controller를 설계한다. 또한 Behavio..
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    | 리포트 | 17페이지 | 2,000원 | 등록일 2022.07.16
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    [서울시립대] 전자전기컴퓨터설계실험2 / Lab07(결과) / 2021년도(대면) / A+
    Post-reportSequential Logic 2실험날짜 :학번 :이름 :1. Introduction가. 실험의 목적Verilog HDL 언어를 사용하여 Sequential Logic을 설계 및 실험하고, Finite State Machine 등을 설계 실습한 뒤,..
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    | 리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16
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    서울시립대 ㄱㅇㄱ 이동통신 기출 및 답지
    2015년 부터 2020년까지 이동통신 기출문제지 밎 답지입니다.중간중간 안 푼 문제들이 있습니다. -> 최근 시험에서는 안나오는 유형 같습니다.2021년 기출문제와 2022년 기출문제는 이 파일에는 올리지 않았지만 교수님께서 올려주실 것으로 예상됩니다. 또한 해당 기..
    시험자료 | 19페이지 | 12,000원 | 등록일 2025.02.10
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    전전설3 Op-Amp 실험 2 Non-idealities of the Op-Amp
    1. Introduction Ÿ A. 실험 목적이 실험에서는 OP-AMP의 실제 동작 특성에 대해 알아본다.Ÿ B. 실험 이론 및 과정 개략 설명실제 OP-AMP는 이상적인 동작 특성과 달리 유한한 open-loop gain과 bandwidth, slew-rate ..
    리포트 | 8페이지 | 2,000원 | 등록일 2023.11.25
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2025년 12월 24일 수요일
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