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8진 psk M EMI/EMC HTL TTL 차이 lock in amp 아두이노 레이더
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"Digital Phase Shifter" 검색결과 1-13 / 13건

  • 자료 표지
    2-6 GHz 디지털 위상변위기 모듈 (2-6 GHz Digital Phase Shifter Module)
    대한전자공학회 鄭明得, 박동철, 蘇俊鎬, 禹丙日, 林重洙, 李相沅
    논문 | 7페이지 | 무료 | 등록일 2025.06.17 | 수정일 2025.06.26
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  • 자료 표지
    CMOS 공정 기반의 X-대역 위상 배열 시스템용 다기능 집적 회로 설계 (Design of CMOS Multifunction ICs for X-band Phased Array Systems)
    대한전자공학회 구본현, 홍성철
    논문 | 8페이지 | 무료 | 등록일 2025.07.05 | 수정일 2025.07.10
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  • 자료 표지
    위상천이기 분해능에 따른 위상 배열 안테나의 최대 빔 조향 오차에 관한 연구 (A Study on Maximum Beam Pointing Error according to Resolution of Phase Shifter for Phased Array Antenna)
    대한전자공학회 정진우, 김영담, 서종우
    논문 | 8페이지 | 무료 | 등록일 2025.04.07 | 수정일 2025.05.08
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  • 판매자 표지 자료 표지
    [서울대학교 대학원] 2025년 1학기 전자전기공학과 합격 자기소개서
    의 송수신모듈 개발 경험으로 인해, 부배열 구조와 Digital Phased Array 구조 등의 동작 원리 및 기본 구조 이해 및 경험 ⑨지원동기 및 장래계획 [안테나 분야 ... Mu다. 통신이나 레이다 시스템 등 다양한 전파 Application에서 빔포밍 기술은 이미 핵심 기술로 자리 잡고 있습니다. 이에 따라, Phase Shifter의 고성능이 요구 ... 으로 인해, 부배열 구조와 Digital Phased Array 구조 등의 동작 원리 및 기본 구조 이해 및 경험 하지만 통신 시스템에 대한 경험이 부족한 점, 공정 및 회로 설계 등
    자기소개서 | 5페이지 | 6,000원 | 등록일 2025.02.23 | 수정일 2026.01.10
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  • 자료 표지
    삼성전자DS 회로설계 면접
    Effect) 및 회로 해석 모델02. 디지털/아날로그 설계: Setup/Hold Time 마진 확보 및 High-Speed I/O 설계 전략03. PPA 최적화 전략: 저전력(Power ... (Elmore Delay) 모델 등을 활용해 타이밍 크리티컬 패스를 정밀하게 분석하고 최적화하겠습니다.09. PLL(Phase Locked Loop)의 기본 구조와 동작 원리를 설명 ... 전압을 형성하고, 이를 통해 출력 주파수를 고정(Lock)합니다. 주로 시스템의 메인 클록 생성, 데이터 통신의 주파수 합성, 클록 동기화 등에 사용되는 핵심 아날로그-디지털 혼
    자기소개서 | 22페이지 | 5,000원 | 등록일 2026.04.15
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  • 자료 표지
    EMI EMS EMC
    )은 안테나에서 방사된 에너지가 공간에서 특정한 방향을 따라 집중 되는 것임? Digital Beamforming은 배열 안테나로부터 디지털 신호를 받아들이고 그 신호에 대해 공간적인 ... 처리를 행하는 것임2. 구성도위상 배열 안테나와 DMF 안테나의 구성도* PS : Phase Shifter, DC : Down Converter3. 특징? 위상배열 안테나는 각 소자 ... 점수EMI/EMS/EMCS파라미터Digital BeamformingPAPR / OVSF / USIMEMI/EMS/EMC1. 개요? 전자파 방해 규정에는 능동장해규제(EMI
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 2,000원 | 등록일 2011.10.05
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  • 자료 표지
    와전류 탐상 시스템-Lock in Amp
    Sensitive Detector)6제3장 Lock In Amp의 제작83.1 Phase Shifter83.2 PSD (Phase Sensitive Detector)113.3 LCD ... -2] 위상차에 따른 참조신호와 측정신호10[그림 3-3] Phase Shifter 회로도10[그림 3-4] R8가변저항 0일 경우 출력 파형11[그림 3-5] LCD 구동 회로 ... 이 된다. LIA의 출력은 참조신호와 측정신호간 위상차가 90° 차이 질 경우에도 크기가 출력되어야 하므로 위상 조정이 필요하고 이를 위해서 Phase Shifter가 필요하다. 참
    Non-Ai HUMAN
    | 리포트 | 20페이지 | 2,500원 | 등록일 2008.12.12
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  • 자료 표지
    labvolt(랩볼트)를 이용한 PSK 변조, 복조 실험
    의 반송파와 위상을 맞추어 주면 된다.채널 2를 Phase Shifter 회로블럭의 90도 단자에 연결한 모습이다. 원래의 반송파와 위상이 같음을 알 수 있다. 이는 반송파신호 ... 가 PSK신호로부터 복구가 되었음을 보여준다.Phase Shifter 회로블럭에서. 주파수가 줄여진 VCD출력과, PLL출력인 VCO출력이 XOR게이트로 입력되어 90도 위상이 바뀐 ... 신호가 출력된 것이다.이제 감쇄된 Phase Shifter의 출력과 PSK신호는 믹서에 입력되어 두 신호의 곱을 출력할 것이다. 두 신호의 극성이 같으면 +로 출력이 되고 극성이 다르면 -가 출력이 될 것이다.
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 1,000원 | 등록일 2007.11.08
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  • 자료 표지
    BJT IC의 특성설명과 서로의 장단점 비교
    가의 위에 있어 붙여진 이름이다.는 위상 반전기(Phase Shifter)이며증가시는 증가하나는 감소한다.는가 포화시가 동시에 turn-on되는 것을 방지한다.부분을 능동 풀업 ... BJT IC의 특성설명과 서로의 장단점 비교BJT의 기본적으로는 전류를 증폭할 수 있는 부품이다. 아날로그 회로에서는매우많은 종류의 트랜지스터가 사용되지만 디지털회로에서는 그다지 ... 많은 종류는사용하지 않는다.디지털 회로에서는 ON 아니면 OFF의 2치 신호를 취급하기 때문에트랜지스터의 증폭 특성에 대한 차이는 별로 문제가 되지 않는다.디지털 회로
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 2,000원 | 등록일 2009.04.08 | 수정일 2014.04.15
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  • 자료 표지
    [공학]통신실험 PSK 변복조 실험 보고서, LABVOLT
    신호들이 적절한 위상 이동을 갖는다. 즉 MPSK의 복조는 기저백터의 곱으로 나타낼수 있다.-실험 이론PSK(phase shift keying)는 각 디지털 신호마다 반송파 신호 ... 실험제목 : PSK 신호의 변조 및 복조통신실험전파통신공학1. 이론위상 편이 방식 (Phase Shift KEYing : PSK )은 딥스페이스 (deep-space) 프로그램 ... 다.이 그림은 회로보드에서, 의미를 지닌 신호가 PSK변조되는 과정을 나타낸 것이다.디지털 입력 신호는 0V와 +5V의 신호레벨을 가진다. 레벨 변환기는 논리레벨을 -5V와 +5V
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 1,500원 | 등록일 2007.06.20
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  • 자료 표지
    [공학기술]PSK 실험 결과 레포트 <그림 첨부>
    에 연결채널 2를 PHASE SHIFTER 회로블럭의 90° 단자에 연결해서 파형을 관찰하면 재생된 신호는 반송파 신호와 주파수와 위상이 같고, 따라서 수신기의 마지막 신호와 보내진 ... 이 바뀌어도 반송파의 위상변화는 여전히 각 디지털 신호의 변화 시점에 일어난다는 것을 알 수 있다. 맨체스터 방식에 연결된 신호는 에 나타나 있다. RZ방식에 연결된 신호 맨체스터 ... 방식에 연결된 신호시간축을 50㎲/DIV로 바꾸고, 스코프의 파형이 그림과 같이 나타나도록 바꿔준신호는 에 나타나 있다. 이로써 디지털 신호가 low로 바뀔 때 PSK신호의 위상
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,500원 | 등록일 2007.06.20
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  • 자료 표지
    [디지탈공공학]BJT Technologies
    _2는 위상 반전기(Phase Shifter)이며 {I_R2증가시{V_E2는 증가하나 {V_C2는 감소한다.{D_0는 {Q_4가 포화시 {Q_3가 동시에 turn-on되는 것을 방지 ... Injection Logic)1. 서론가장 보편적인 디지털 직접회로 논리군의 내부 회로를 설명하고 그 동작 및 특성을 분석정리 해 본다. 각 논리군에서의 공통게이트의 전자회로는 전자회로의 이론 ... 시키기 위하여 삽입된 phase splitter이다. 두 신호를 비교하는 일종의 비교기이다.이 회로에는 이외에도 입구단자에 보호용 다이오드가 연결되어 있다. 신호의 변화가 급격한 회로
    Non-Ai HUMAN
    | 리포트 | 10페이지 | 1,000원 | 등록일 2006.04.14
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  • 자료 표지
    [전자회로실험] 기본 논리 함수 및 gate와 가산기
    기 쉽다.출력형태에 따른 분류① totem-pole OutputTotem-Pole이란Q_3가Q_4의 위에 있어 붙여진 이름이다.Q_2는 위상 반전기(Phase Shifter)이며I_R ... . 디지털 논리회로의 기본 특성을 안다.9. AND OR NOT NAND NOR GATE의 실습회로를 구성하고 진리표를 만들 수 있다.10. 조합회로 및 순서회로의 동작원리를 이해 ... 회ter를 사용하는 DTL과 같으나, phase splitter 및 totem-pole 구조를 사용하여 부하용량의 방전뿐만 아니라 충전까지도 능동소자인 트랜지스터를 사용
    Non-Ai HUMAN
    | 리포트 | 37페이지 | 1,000원 | 등록일 2003.10.25
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2026년 04월 18일 토요일
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