"신호파형"의 검색결과 입니다.

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주기신호 측정 전자회로실험 클램퍼 회로 이학전자실험 전자회로설계실습 정류회로 mosfet다단 증폭기 신호발생기

"신호파형" 검색결과 981-1,000 / 10,219건

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아날로그 및 디지털 회로 설계 실습 결과보고서4 신호발생기

아날로그 및 디지털 회로 설계 실습-실습 4 결과보고서-신호발생기학 과 :담당 교수님 :제출일 :조 :학번 / 이름 :. 설계실습 내용 및 분석설계한 Wien bridge ... 에서 저항값을 변화시키며 측정할 것이기에 저항을 계획에서보다 더 많이 부착시켜 진행하였다.설계한 Wien bridge oscillator 측정출력파형과 출력주파수값 ... 이 Oscilloscope screen에 보이도록 조정한 화면을 시뮬레이션 결과와 함께 제출하시오. (Oscilloscope의 파형 저장 기능을 사용) 출력파형이 왜곡되는지 확인하시오. 발진 조건인 R2

리포트 | 10페이지 | 2,000원 | 등록일 2023.09.05 | 수정일 2023.10.24

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A+ 정보통신실험 6주차 예비보고서 - RC 정현파 발진 회로

과 방전을 위한 소자※슈미트 트리거 회로 = 파형 정형 회로- 디지털 회로에서 “1”(HIGH)와 “0”(LOW)신호가 잡음이 섞여서 신호가 전달될 때 정확한 신호가 가기 위한 회로이 ... 예비보고서실험 6. RC 정현파 발진 회로과목학과교수조학번성명제출일1. 실험 이론? 발진기= 전원이 인가된 상태에서 외부의 입력신호 없이 회로 자체의 동작에 의해 특정 주파수 ... 의 신호(정현파, 구형파, 삼각파, 톱니파)를 생성하는 회로? 종류= 귀환 발진기 (Feedback oscillator), 이완 발진기(Relaxation oscillator)1

리포트 | 12페이지 | 1,500원 | 등록일 2024.02.05

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27장 30장 차동 증폭기 회로, 능동 필터 회로 결과보고서

는 두 BJT의 Base 입력 전압차를 이용하여 출력신호를 증폭시키고 전압이득은 이미터 저항의 영향을 받는다.차동증폭기 회로는 기존회로와 전류원을 추가하여 저항을 올린 회로의 차동모드 ... 피크값은 측정할 수 있었지만 파형을 측정하지 못했다. 그래도 기존회로보다 더 높은 CMMR =105dB를 가졌음을확인했다.능동필터회로는 차단 주파수 공식을 이용하여 차단 주파수 ... 한 주파수에서 최대값의 RMS 값을 가지는 것을 확인할 수 있다.실험결과27장 차동 증폭기회로차동모드 전압이득 기본회로 측정결과↓입력파형(45mVp-p) ↓출력파형(3.42mVp-p

리포트 | 13페이지 | 1,500원 | 등록일 2022.05.01 | 수정일 2022.10.27

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A+받은 카운터(계수기,COUNTER) 회로 결과보고서 PSPICE

1. 실험 장비① 신호(함수) 발생기② 직류 전원 장치③ 오실로스코프④ 프로브⑤ 브레드 보드⑥ 연결도선⑦ BNC 코넥터-악어클립 케이블⑧ JK flip-flop (HD74LS76 ... 에는  또는  이라는 입력이 있어서 JK flip-flop은 이  입력에 동기되어 동작한다.    입력이 둘 다 1이고,  단자에 신호가 입력될 때 출력  의 상태 ... 가 이전의 값과 반대로 바뀌게 되는 데 이를 토글 동작이라고 한다. 계수기는 flip-flop의 토글 동작을 이용하는 회로이다. 그림 1은  입력을 갖는 JK flip-flop의 기호와 이 flip-flop의 토글 동작을 나타내는 파형을 도시한다.

리포트 | 5페이지 | 1,000원 | 등록일 2022.12.28

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A+, 100점) 22학년도 일반물리학실험1 <줄의 정상파> 실험 리포트

1. 실험 제목 줄의 정상파2. 실험 목적1) 진동수를 조절하여 진동수에 따른 파형을 관찰하고, 파동의 속도를 비교해본다.2) 선밀도를 이용하여 줄의 장력에 따른 파동의 속도 ... 레이터(신호 생성기), 진동 제네레이터, 버니어 도르래, 고급 실험용 자, 스탠드 세트, 슬롯추 세트, 역학실험용 줄5. 실험 방법1) [Part 1] 정상파 패턴 관찰(1) 진동 ... 단자에 연결선을 연결하고 시그널 제네레이터의 반대쪽 선을 연결한다.(4) 시그널 제네레이터의 파형을 Sine으로 선택하고 초기진동수를 약 5Hz로 설정한다. (5) 줄이 기본진동

리포트 | 11페이지 | 2,500원 | 등록일 2022.06.29

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인하대 VLSI 설계 6주차 Flip-Flop

로 구성되며 CLK 입력에 반응해서 출력의 상태를 변경하는 기억 소자이다. Master Latch와 Slave Latch로 불리는 2중 Latch를 통해 입력 신호 D를 출력 신호 Q ... Negative Latch는 CLK 신호를 PMOS 쪽에, Positive Latch는 clk신호를 NMOS 쪽에 인가한다. eq \o\ac(○,1) CLK = 0: Negative ... 를 추출한 Post-sim의 경우가 직접 netlist를 작성한 경우보다 출력 Q의 값이 튀는 부분이 적고 깔끔한 파형이 나왔는데 그 이유는 Post-sim의 경우 netlist

리포트 | 8페이지 | 2,000원 | 등록일 2023.03.15 | 수정일 2023.03.22

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전자회로실험및설계 4주차예비

를 형성할때는 커패시터의 리액턴스가 전원 주파수에 대해 충분히 작다고 생각하고 단락시켜 해석하면 된다시뮬레이션 결과시뮬레이션 회로시뮬레이션 결과파형입력과 출력 분리한 결과파형소신호 ... 파라미터값Pnp형 공통이미터 증폭기시뮬레이션 결과소신호 파라미터값3, 고찰이번 시뮬레이션에서는 공통이미터 증폭기에 대해서 다루어보았습니다증폭기이기에 입력신호에 비해 출력신호가 증폭 ... 었고위 그림처럼 입력전압과 출력전압이 위상이 반대로 나타나는 것 또한 확인 할 수 있었습니다 위 그림을 소신호 등가 모델로 표현하면이렇게 표현할 수 있는데 가장 중요한 전압이득은이런

리포트 | 11페이지 | 2,500원 | 등록일 2023.10.09

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[2024/A+]서울시립대_전전설3_실험6_결과

Exponential 함수가 됨을 확인V – I GraphV – log(I) Graph실험2다음과 같은 Diode 회로에 대하여 입력으로 -10 ~ +10V의 펄스 파형을 인가하고 출력 파형을 측정 ... 하시오. 결과 파형을 사전보고서의 결과와 비교하시오.실험 2-1실험 교안의 회로를 설계함수발생기로 펄스 파형을 인가Oscilloscope로 출력 파형을 측정실험 2-2실험 교안 ... 의 회로를 설계함수발생기로 펄스 파형을 인가Oscilloscope로 출력 파형을 측정토론 (Discussion)데이터 분석실험1실험 1-1Ideal Diode Model:Ideal

리포트 | 26페이지 | 2,000원 | 등록일 2025.03.10

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줄의 진동 예비실험보고서

줄의 진동 예비보고서실험 제목: 줄의 파형 발생 실험실험 목적: 도르래와 질량 추를 이용하여 줄에 장력을 만들어 주고 모터의 전압을 조절하여 진동수를 변화시켜 주며 정상파를 관찰 ... 한다.③ 함수발생기의 출력 파형은 사인 파형으로 설정하고 전원을 킨다.④ 질량 100g을 매달고 줄자로 줄의 길이(L)를 측정하고 기록한다.⑤ 주파수에 대한 줄의 진동양상을 관찰 ... g으로 바꾸고 위의 과정을 반복하여 실험해 보고 데이터를 기록한다.2) 길이변화(주파수와 장력 고정)에 따른 줄의 진동① 신호발생기에서 주파수를 로 질량은 100g으로 고정

리포트 | 4페이지 | 2,000원 | 등록일 2023.07.28

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[전자공학기초실험] 신호발생기의 동작원리

제목신호발생기의 동작원리날씨온도습도담당교수님학부학년학번조성명□ -> 가로 100us, 세로 1V표 22-2 함수발생기의 특성dc Offset+,V-,5V2.5V-2.5V가. 고찰 ... 사항1) 신호발생기의 Sine Wave 동작 실험 결과를 보면 1000Hz일 때의 주기는 약 1000us이고 2000Hz일 때는 약 500us주기를 갖는 것을 알 수 있다. 이 ... 에 생성된다. 다른 파형을 검출하려 해도 직류성분만 남게 된다. Offset을 ?2V로 바꿔도 ?2V값만 검출된다.

리포트 | 2페이지 | 1,000원 | 등록일 2022.09.25

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전자회로2 보고서 - 2. CE Emitter amplifier without bypass

저항옴101001k10k100k이미터 바이패스 커패시터가 이득에 미치는 영향CE가 제거되있는 경우에는 RE에 의해 교류 및 직류 신호 감소가 발생한다. 그리고 RE를 단락 ... = 2.38re = 26mV/IE = 26mV/2.46mA = 10.57옴증폭이 1을 넘었다. 즉 신호가 입력보다 커졌다.부하저항 100k옴회로입력부하저항 100k옴출력결과&이론값실험 ... kHz보다더 증폭도가 줄었다. 하지만 매우 소폭이다.R1 100옴회로입력R1 100옴출력결과증폭도가 조금 줄었을뿐 파형의 왜곡은 관찰되지 않았다.R2 100옴회로입력R2 100옴출력

리포트 | 60페이지 | 2,500원 | 등록일 2021.09.23

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전자전기컴퓨터설계실험3 - 결과레포트 - 실험08_-Diode Circuit (Rectifier Circuit Design) (A+)

신호의 진폭보다 커야 한다.(3) Half Wave Rectifier – With Capacitor(1)에서 실험한 회로에 Capacitor를 연결해 같은 입력 파형에 대해 출력 ... ) 주어진 회로와 구하고자 하는 데이터Half-wave Rectifier에서 C가 없을 때 입력 정현파와 출력 파형을 측정하여 비교하고, Peak Inverse Voltage를 측정 ... CircuitDiode와 Resistor로 Rectifier 회로를 구현하였다. Capacitor가 없을 때 사인파를 입력하고 Oscilloscope를 통해 출력 파형을 측정한다.그림

리포트 | 15페이지 | 2,000원 | 등록일 2020.11.26 | 수정일 2020.11.29

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연세대학교 일반대학원 전기전자공학부 학업계획서

오디오 신호 표현을 위한 파형 인코딩 연구, 레이저 조사를 통해 캡슐화된 MoTe2 1T' 에지 접점의 전기적 특성 개선 연구, 전기 전도성 나노복합 재료의 데이터 중심 설계 ... 흐름 필드 연구, 양자 인터넷에서 통합 에지 학습을 위한 개인 정보 보호 지능형 리소스 할당 연구, 전광학 초음파 트랜스듀서와 적응형 신호 처리 알고리즘을 이용한 초기 혈전 형성 및 전혈 응고의 미세 초음파 평가 연구 등을 하고 싶습니다.

자기소개서 | 2페이지 | 3,800원 | 등록일 2023.04.25

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[전기회로설계실습] 설계실습 8 계획서

이 좋은지를 결정하고 이 결과를 이용하여 저항전압(=전류X저항), 인덕터전압의 예상 파형을 그래프로 그려서 제출하라.RL 회로에서 시정수 τ 는 이고 시정수가 10 ㎲ 이므로 이 ... 할 수 있도록 회로와 오실로스코프의 연결 상태를 그려서 제출하라.3.2의 회로도와 같이 설계하고 CH2를 Invert 한 다음 ADD단자를 눌러 CH1의 신호를 더한다. 이 때 나오 ... 게 되는 파형이 저항전압의 파형이다3.4 3.3의 상태에서 Function generator의 출력을 low = -0.5 V, high = +0.5 V, 즉. DC offset

리포트 | 4페이지 | 1,000원 | 등록일 2022.09.14

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실험14_전자회로실험_예비보고서_캐스코드 증폭기

곡선을 그리시오.포화 영역에서 회로가 동작하는 경우 , ,의 트랜스 컨덕턴스 값, 출력 저항 를 구하여 표에 기록하시오. 이를 이용하여 소신호 등가회로를 그리고, 실험회로 1 ... 의 입력 - 출력 전압의 크기를 표에 기록하여 전압 이득을 구하고, 크기와 위상을 고려하여 입력전압, 출력 전압 파형을 캡처하여 기록하라.실험회로 1의 입력 저항과 출력 저항을 직접 ... 의 크기를 표에 기록하여 전압 이득을 구하고, 크기와 위상을 고려하여 , 입력 전압(의 게이트 전압), 출력 전압(의 드레인 전압)의 파형을 캡처하여 그림과 같은 형태로 결과 보고서

리포트 | 5페이지 | 2,500원 | 등록일 2024.01.09

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실험 15_다단 증폭기 예비 보고서

_{v2},R _{i}{} _{n2},R _{out2}로 정의하였다.[그림 15-2] 다단 증폭기의 등가회로신호원v _{sig}부터 추력v _{o}까지의 전압 이득을 식 (15.1 ... )과 같이 계산할 수 있다.식 (15.1)로부터, 신호원v _{sig}가 증폭기 1의 입력v _{i1}에 인가될 때는R _{sig}와R _{i}{} _{n1}에 의해서 전압분배 ... 됨을 알 수 있다. 따라서 전압 이득이 증가되기 위해서는R _{i}{} _{n1}이R _{sig}에 비해 그 값이 커야 한다.식 (15.2)로부터, 증폭기 1에서 증폭된 신호A _{v

리포트 | 28페이지 | 2,000원 | 등록일 2023.01.25

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6주차-실험16 결과 - RLC회로의 과도응답

주파수가 5 [kHz]인 구형파 신호v _{g} (t)를 회로에 인가한다.v _{g} (t)와 커패시터 양단에 걸리는 전압v _{g} (t)파형을 오실로스코프로 측정하고 그 파형 ... . 07실험제목 : RLC회로의 과도응답실험(1) 의 회로 (R=1 [kOMEGA ], C=0.01 [uF], L=10 [mH])를 구성하고 신호발생기로부터 발생된 진폭이 5 [V]이고

리포트 | 3페이지 | 1,500원 | 등록일 2020.10.02

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(A+/이론/예상결과/고찰) 아주대 통신실험 결과보고서1

는 0.04ms/div가 된다. 실제 주기는 최소 사이클과 최대 사이클 모두 5칸으로 이루어져 있어 1ms라고 할 수 있다. 그리고 pulse duration은 신호가 들어와 높이 솟 ... 음을 알 수 있다.5. FREQUENCY MODULATION 부분은 발생기 B와 같이 외부의 신호를 사용해서 발생기 A의 신호를 변조하는데 사용된다. 실험 3번 과정의 경우와 같 ... Generator의 조정을 아래와 같이 한다. 어떤 방법으로 채널 A의 신호를 다양하게 할 수 있는가?A: sine wave, B: square waveA: square wave, B: sine

리포트 | 13페이지 | 1,500원 | 등록일 2021.10.24

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[A+예비보고서] 설계실습 2. Op Amp의 특성측정 방법 및 Integrator 설계

하고 PSPICE를 이용하여 회로, 입력전압과 출력전압의 파형을 제출한다.그림3. 의 삼각파를 출력하는 적분기그림4. 위 회로의 출력파형(B) Offset voltage가 있을 때 ... , (A)번에서 설계한 적분기의 출력파형이 어떻게 될 것인지 예측, 기술한다.Offset voltage가 있다면 출력파형은 그림4. 와 같이 shift된 형태로 나오게 된다. 그 ... 에 의해 DC gain은 무한대가 되고 출력파형은 그림4. 와 같이 최대 출력 전압인 -15V 근방에서 나타나게 된다. 이는 회로설계에 사용한 LM741 모델 내부에 offset

리포트 | 10페이지 | 1,000원 | 등록일 2025.01.31

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[분반 1등], [A+], 중앙대학교 전기회로설계실습 12. 수동소자의 고주파특성측정방법의 설계 예비보고서

은 Function generator의 전압 파형으로 하고, 저항(R4)에 걸리는 전압 파형을 측정하면 고주파특성을 알 수 있을 것이다.2.1 R = 10 ㏀, C = 0.1 ㎌가 직렬 ... 로 연결된 회로에 교류 신호가 입력될 때 입력전압에대한 저항에 걸리는 전압의 크기의 비(amplitude of transfer function)를 R, C만 고려하여 주파수의 함수 ... 도 감소함수가 되지 않음을 식과 그래프에서 모두 확인할 수 있다.2.2 R = 10 ㏀, L = 10 mH가 직렬로 연결된 회로에 교류신호가 입력될 때 입력전압에대한 저항에 걸리

리포트 | 6페이지 | 1,000원 | 등록일 2022.09.25

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