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전자회로실험 전자회로설계실습 다단 증폭기 과제 고급전자회로실험 oscillator 설계 능동 2차 Lpf 결과 클리퍼 클램퍼 공통이미터
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"시뮬레이션파형" 검색결과 901-920 / 3,209건

  • 자료 표지
    서울시립대학교 통신공학실습 5주차 예비레포트
    에서 시뮬레이션을 하면 어떻게 파형이 관측이 되는지 까지 확인을 하였다. 이제 이것을 실제 소자와 함수발생기들을 가지고 실험을 할 예정이다. RLC 소자들의 Q특성으로 BPF의 특성 ... 를 고려를 해보았다. Q의 값이 너무 커져버리니 파형의 진폭이 확 줄어드는 것을 확인이 가능했다. 위의 세가지의 파라미터를 PSPICE의 시뮬레이션을 통해 그래프로 출력을 했 ... 통신공학실습Preliminary Report5주차 : 믹서 회로 설계 및 제작Ⅰ1. Introduction (실험에 대한 소개)가. Purpose of this Lab시뮬레이션
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10
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  • 자료 표지
    Multi-stage Amplifiers 13주차 예비보고서
    ommon-source amplifier1) 위의 회로를 구성하고 Vdd=0V로 한다.2) Vsig=1Vp-p인 5kHz, sine 파형의 신호를 인가한다.3) Vin과Vout의 파형 ... ource + source follower (CS-SF amplifier)1) 위의 회로를 구성한다.2) Vsig=1Vp-p인 5kHz, sine 파형의 신호를 인가한다.3 ... ) Vin과Vout의 파형을 측정한다..4) Voltage gain을 측정한다.5)Rsig에 흐르는 전류를 측정하고 이를 통해 Rin을 측정한다.6) Vout의 peak값을 기록한다.7
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,000원 | 등록일 2020.04.04
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  • 자료 표지
    [제어공학실험] PD(비례미분) 제어기
    spice 시뮬레이션0.01μF0.022μF0.047μF0.1μF[5.5] 5.3과 5.4항에서 얻어진 파형으로부터 제어기의 비례이득과 미분시간을 측정하시오. Pspice ... }를 제거한 경우의 파형을 관찰하고 그 영향에 대하여 검토하시오.α=1α=0.8α=0.6오실로스코프Pspice 시뮬레이션α=0.4α=0.2α=0오실로스코프Pspice 시뮬레이션오실로스코프 ... Pspice 시뮬레이션0.01μFα를 감소 시켰을 경우, 출력파형의 비례이득이 증가하여 출력 값의 크기가 커지는 것을 알 수 있다. 출력이 계속 증가하다가 전원 Vcc,Vee
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    | 리포트 | 10페이지 | 1,500원 | 등록일 2020.04.07
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  • 자료 표지
    전회실험6 예보
    동일한 동작을 반복한 과정을 나타낸 것이 그림1의V_0 ,V _{0}'및V_R1의 각 파형이다. 이 회로의 발진주파수f_0는f_{0}= { 1} over { 4RC}times ... }로스코프에 나타난 각각의 파형을 그림에 각각 나타내고V _{S} 와V _{T},V _{T} 의`````f _{0}을 측정한다.(4) 출력파형의 최대전압 사이의(V _{T ... })_{P-P}=V _{S}times (R1/R2)의 식을 확인한다.(5) 전원을 끄고R_1을4.7K OHM과15K ohm으로 하고 표에 기입한다.R_1}(K` ohm)시뮬레이션시뮬레이션
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    | 리포트 | 6페이지 | 2,000원 | 등록일 2020.09.26
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  • 자료 표지
    전자회로설계실습_실습10(Oscillator 설계)_예비보고서
    -} 의 파형을 제출하라. 또한,T _{1},T _{2},V _{TH},V _{TL} 의 값을 제출하라.전과는 다르게 시간이 오래 걸리는 것을 확인하여 40ms 로 시뮬레이션 했다.각각 ... 하고, 피드백 회로의 parameter 변화에 따른 신호 파형에 대해 학습한다.2. 준비물장비명개수Oscilloscope (2channel)1대DC Power Supply (2c ... 에서 PSPICE를 이용하여 위에서 설계한 oscillator의 파형을 제출하라. 또한,T _{1},T _{2},V _{TH},V _{TL} 의 값을 제출하라.각각 초록색이v _{o
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,000원 | 등록일 2020.09.07 | 수정일 2020.09.15
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  • 자료 표지
    [전자전기컴퓨터설계실험1] [전전설1] PSpice를 이용한 전기회로의 시뮬레이션 결과레포트
    , 함수발생기의 오차 등 여러가지 변수들로 인하여 오차가 생길 수 있다.2번 실험의 경우, RC회로를 구현하여 PSPICE로 시뮬레이션한 결과와 파형을 비교해 보는 실험이다. 구형파 ... 로 시뮬레이션 한 이론값과 실제 결과값이 약 1% 정도의 오차율을 보였고 2번 실험의 경우 입력파형과 출력파형의 모양이 모두 일치했다. 3번 실험은 직접 빵판에 회로를 구현해보지는 않 ... PSpice를 이용한 전기회로의 시뮬레이션과 목 명전자전기컴퓨터설계실험 I학 과전자전기컴퓨터공학부학 번이 름실 험 일2016.3.31담 당 교 수담 당 조 교목차 TOC \o
    Non-Ai HUMAN
    | 리포트 | 11페이지 | 1,500원 | 등록일 2019.11.16
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  • 자료 표지
    1.Inductor를 이용한 RL회로 Pspice 결과
    12020' IT시스템설계1. 과제 내용수업 중 inductor 를 사용할때 결과 제출하세요. (classnet 으로 제출)2. 시뮬레이션 결과Pspice프로그램을 이용하여 다음 ... 과 같은 회로를 그린다. 측정 이전에 Sin파 입력 전압원의 주파수를 60Hz로 바꾸고 Inductor의 용량을 1uH로 변화시켰다.주기 : 0.0167(s)파형의 최고점의 위상
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    | 리포트 | 1페이지 | 3,000원 | 등록일 2020.09.22
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  • 자료 표지
    미분기 적분기 결과보고서
    시뮬레이션][1[khz] 구형파] [1[khz] 사인파][1[khz] 삼각파]삼각파는 시뮬레이션과 비슷하게 나왔고 구형파 입력파형을 줬을 때 출력파형이 y축으로 무한대로 증가하는 파형이 나왔고 사인파를 줬을 때 그대로 사인파가 나왔다. ... 적으로 수행하는 회로- 입력 신호 파형의 시간 변화율에 비례하여 출력을 발생한다.2.2 적분기신호에 대한 적분 연산을 전기 회로적으로 수행하는 회로- 입력 신호 파형의 시간 변화
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2019.09.30
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  • 자료 표지
    충북대학교 전자공학부 전자회로실험II 결과보고서 함수 발생기
    경우VR _{1}의 저항 값 구하기.발진주파수C _{1} ,`C _{2} ,`C _{3}10nF1kHz4.4k OMEGA시뮬레이션 결과 - 정현파제작 결과 - 정현파시뮬레이션 결과 ... - 구형파제작 결과 - 구형파시뮬레이션 결과 - 삼각파제작 결과 - 삼각파2. 차이점이론적으로 발진 주파수가 1kHz가 나오게 하는 저항값을 계산하면f _{o} =1kHz= {1 ... 가 났는데 그 이유는 op-amp 소자가 타서였는데, op-amp 소자를 바꾸고 다시 실험하였을 때 정현파, 구형파, 삼각파 파형을 얻을 수 있었다.전원 공급기의 전압을 줄 때에 주의
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    | 리포트 | 2페이지 | 2,000원 | 등록일 2020.09.30
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  • 자료 표지
    quartus 를 사용하여 and-or gate와 NAND gate 구현
    해 회로로 나타낸 후 , 두 경우에서의 output wave 가 어떠한 지 비교하는 것이다 . 동일한 함수를 다르게 표현하여 시뮬레이션을 돌리는 것일 뿐이기에 최종 파형은 같을 것
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    | 리포트 | 15페이지 | 2,000원 | 등록일 2020.10.08
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  • 자료 표지
    MOSFET 전달특성곡선 예비보고서
    실험회로를 구성한다.[실험 회로](2) V1를 0[V]부터 3[V]까지 0.2[V]씩 올리면서 시뮬레이션 파형을 관측한다.(3) 똑같이 V2를 0[V]부터 3[V]까지 0.2[V ... ]씩 올리면서 시뮬레이션 파형을 관측한다.5. 예상실험 결과시뮬레이션 그래프2N7000은 증가형 MOSFET이기 때문에 전달특성곡선이 다음과 같이 관찰된다.
    Non-Ai HUMAN
    | 리포트 | 2페이지 | 1,000원 | 등록일 2019.09.30
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  • 자료 표지
    2019학년도 3학년 1학기 중앙대 전자회로설계실습 1. OP Amp를 이용한 다양한 Amplifier 설계 예비
    Pspice▶Marker▶Advanced▶dB Magnitude of Voltage)를 연결한 후 시뮬레이션을 행하고 결과파형을 출력하시오.(D) 출력전압이 Inverting ... -Inverting Amp의 PSPICE 출력파형을 제출한다.(B) 2 KHz에서 목표 출력전압과 시뮬레이션 출력전압이 다르면 그 이유를 기술한다.- 목표 출력전압과 시뮬레이션 출력전압이 같 ... 한 Amplifier 설계3.2.1 Inverting Amplifier 설계와 시뮬레이션(A) 주파수가 2 kHz인 위의 센서와 출력을 증폭하여 그 출력이 1 Vpp인
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,000원 | 등록일 2019.09.21
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  • 자료 표지
    실험레포트 - (결과) LC회로의 리액턴스 측정 및 RLC 직,병렬 회로의 임피던스 측정
    시뮬레이션 해봤지만 동영상에서는 RC직렬회로와 RLC병렬회로에 대해서만 실험하였다.RC 직렬회로를 구성하고 입력파형과 출력파형을 비교했을 때 ?6.09정도의 위상차가 발생 ... 하였다.나머지 값들은 동영상에 나오지 않아서 알 수 없었다. 다음 실험인 RLC병렬회로에서도 입력과 출력파형 사이에서의 위상차이가 33.65~35 정도라는 것을 알 수 있었고, 병렬
    Non-Ai HUMAN
    | 리포트 | 3페이지 | 1,500원 | 등록일 2020.10.28
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  • 자료 표지
    UA741 amp SPICE 및 해석
    전자회로실험1ContentsⅠ. UA741 Data Sheet 분석Ⅱ. PSPICE 시뮬레이션Ⅲ. 참고 문헌Ⅰ. UA741 Data Sheet 분석전압 이득공통모드 입력전압 범위 ... 입력 전압 스윙 레벨출력 전압 스윙 레벨공통 모드 제거비입력 임피던스출력 임피던스오프셋 전압슬루율 대역폭10. 전체Ⅱ. PSPICE 시뮬레이션(1)(2)Vin(AMPL) = 1 ... ) = 1V, Vout(AMPL) = 5.9812V(8) Vin과 Vout의 전압 파형으로부터 이 증폭기의 전압 이득을 계산하라.Av = Vo/Vi = 5.9812V / 1V = 5
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2020.11.03
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  • 자료 표지
    전회실험3 결보
    . 실험결과1) 미분기(1) 아래 회로를 구성한다. 입력 삼각파의 전압을 1V, 주파수를 400Hz로 고정하고 출력을 측정하여 그 파형을 그린다.(2) 출력 파형의±V _{p-p ... }과 출력 파형의 전압이 ?인 주기와 +인 주기를 측정하여 기록한다.V _{O,`max}[mV]V _{O,`min}[mV]±V _{p-p}[mV]전압이 -인 주기 [ms]전압이 +인 ... 었다. 전압이 ?인 주기와 전압이 +인 주기는 녹색선의 주파수 역수로 이론값과 같은 100μs의 값을 얻을 수 있었다.3. 실험 결과와 시뮬레이션에 대한 비교 및 오차율 계산1) 미
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    | 리포트 | 6페이지 | 2,000원 | 등록일 2020.09.26
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  • 자료 표지
    중앙대학교 실험 예비 보고서(RCL회로의 과도응답 및 정상상태응답)
    = 50%)인 경우 입력을 기준으로 R,L,C에 걸리는 전압파형을 시뮬레이션 하여 제출하라.(0 < ωo,< a이기 때문에 과감쇠 응답)3.3 위의 회로에서 R=4kΩ이며 입력이 사 ... 각파(0 to 1 V, 1kHz, duty cycle = 50%)인 경우 입력을 기준으로 R,L,C에 걸리는 전압파형을 시뮬레이션 하여 제출하라.(0 < a < ωo 이기 때문 ... o가 되면 임계상황이 된다. 앞의 회로에 R을 가변저항으로 하여 가변저항을 바꿔주면서 오실로스코프로 파형이 임계감쇠응답이 나타날 때 가변저항 값을 측정하면 될 것이다.3.6 RLC
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2020.01.13
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  • 자료 표지
    [전기회로설계실습-설계실습 10 RLC 회로의 과도응답 및 정상상태 응답] 중앙대학교 전자전기공학부 2-2 A+ 예비보고서
    3.3 위의 회로에서 R=4kΩ이며 입력이 사각파(0 to 1V, 1kHz, duty cycle=50%)인 경우 입력을 기준으로 R, L, C에 걸리는 전압파형을 시뮬레이션 하 ... 여 제출하라.감쇠상수는 R/2L=200000이므로 0
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2020.07.12
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  • 자료 표지
    Common-Gate & Common-Drain Amplifiers 12주차 예비보고서
    , sine 파형의 신호를 인가한다.3) Vin과Vout의 파형을 측정한다..4) Voltage gain을 측정한다.5)Rsig에 흐르는 전류를 측정하고 이를 통해 Rin을 측정 ... ) Bandwidth frequency를 찾는다.3.3.2 Source-follower1) 위의 회로를 구성한다.2) Vsig=1Vp-p인 5kHz, sine 파형의 신호를 인가한다.3 ... ) Vin과Vout의 파형을 측정한다..4) Voltage gain을 측정한다.5)Rsig에 흐르는 전류를 측정하고 이를 통해 Rin을 측정한다.6) Vout의 peak값을 기록한다.7
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2020.04.04
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  • 자료 표지
    기본선형증폭기
    의 정현파가 되도록 하라. Time Domain Analysis를 수행하라. 시뮬레이션 결과로부터 입력전압 V1 과 741 의 출력전압을 도시하라. 전압이득을 구하고, 두 파형 ... 실험 #3-1 결과보고서기본 선형 증폭기2. 시뮬레이션(1) CAD 프로그램을 이용하여 다음의 회로를 입력하라. V1 은 VSIN 으로 하라.(2) V1 은 5 Vp-p, 400 ... Hz 의 정현파가 되도록 하라. Time Domain Analysis 를 수행하라. 시뮬레이션 결과로부터 입력전압 V1 과 741 의 출력전압을 도시하라. 전압이득을 구하고, 두
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2019.07.19
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  • 자료 표지
    전기전자실험2 - 공통 에미터 트랜지스터 증폭기 예비
    된다. 그러나 고주파 특성은 밀러 효과로 인해 양호하지 않다. 다음 공통 이미터 증폭기에 대해 부하 저항의 변화에 대한 증폭도 변화와 바이어스 변화에 대한 출력 파형의 변화를 해석 애플릿 ... 을 통해 관측할 수 있다. 부하 저항이 증가하면 증폭도가 증가하여 출력 파형의 진폭도 증가한다. 바이어스 저항 R2가 증가하면 트랜지스터의 동작점은 포화 영역쪽으로 이동하고 감소 ... 하면 차단 영역쪽으로 이동한다. 이러한 동작점의 변화로 증폭도의 증감과 출력 파형에 왜곡이 수반된다.(1) 교류 전압 이득공통 에미터 증폭기는 에미터가 접지와 연결되어 있기 때문
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    | 리포트 | 2페이지 | 1,000원 | 등록일 2020.10.17
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2025년 11월 22일 토요일
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